KR960019683A - 반도체 장치 - Google Patents

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KR960019683A
KR960019683A KR1019950043333A KR19950043333A KR960019683A KR 960019683 A KR960019683 A KR 960019683A KR 1019950043333 A KR1019950043333 A KR 1019950043333A KR 19950043333 A KR19950043333 A KR 19950043333A KR 960019683 A KR960019683 A KR 960019683A
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KR
South Korea
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substrate
main surface
integrated circuit
circuit device
insulating tape
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Application number
KR1019950043333A
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English (en)
Inventor
마사히코 니시우마
오사무 호리우치
마코토 오마타
Original Assignee
가나이 쓰토무
가부시키가이샤 히타치세이사쿠쇼
스즈키 진이치로
히타치 쬬오 엘. 에스. 아이. 엔지니아링 가부시키가이샤
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Publication date
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    • H01L2924/1615Shape
    • H01L2924/16152Cap comprising a cavity for hosting the device, e.g. U-shaped cap

Abstract

LSI의 다핀화에 대응 가능하며, 또한 저열저항의 면(面) 실장형 패키지가 개시된다. 구체적으로는, 본 발명의 면 실장형 패키지는, 금속판으로 이루어지는 기판과, 상기 기판상에 탑재된 반도체 칩과, 상기 기판의 이면에 배치된 TAB 테이프와, 상기 기판의 이면에 배치된 TAB 테이프의 표면에 형성되고 동시에 TAB 테이프 안의 배선층에 접속된 복수의 범프전극을 가진다. 상기 TAB 테이프는, 상기 기판의 이면부터 측면을 경유하고, 상기 반도체 칩이 탑재된 상면까지 연장되어, 상기 기판의 상면으로 연장하는 TAB 테이프 안의 배선층과 상기 반도체 칩이 입출력패드가 와이어에 의해 접속된다. 상기 면 실장형 패키지는 상기 범프 전극을 통하여 프린트 배선기판에 실장된다.

Description

반도체 장치
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명의 일실시예인 LSI 패키지(package)의 평면도.
제2도는 제1도에 나타내는 LSI 패키지의 캡(cap)을 제거한 상태를 나타내는 평면도.
제3도는 제1도에 나타내는 III-III선에 따른 LSI패키지의 단면도.
제4도는 제1도에 나타내는 LSI 패키지의 조립에 사용하는 TAB 테이프의 평면도.
제5도는 제1도에 나타내는 LSI 패키지의 조립에 사용하는 TAB 테이프의 평면도.
제6도는 제1도에 나타내는 LSI 패키지의 조립방법을 설명하는 사시도.
제7도는 제1도에 나타내는 LSI 패키지의 조립방법을 설명하는 단면도.
제8도는 제1도에 나타내는 LSI 패키지의 조림방법을 설명하는 단면도.
제9도는 본 발명의 일실시예인 BGA 구조의 LSI 패키지의 단면도.

Claims (10)

  1. 반도체 칩을 탑재하는 기판과, 배선패턴 및 상기 배선패턴의 일부를 구성하는 외부전극 패드를 형성한 절연테이프를 구비하고, 상기 절연테이프는 상기 외부전극패드가 상기 기판의 이면측에 위치하도록 배치됨과 동시에, 상기 절연테이프의 주변부는 상기 기판의 주면측으로 구부러지고, 상기 기판의 주면에 탑재된 상기 반도체칩은 상기 기판의 주면측에 위치하는 상기 배선패턴의 일단에 전기적으로 접속된 것을 특징으로 하는 반도체 집적회로장치.
  2. 제1항에 있어서, 상기 범프전극은 상기 외부전극 패드에 접속되고, 상기 범프전극을 통하여 상기 기판을 프린트 배선기판에 실장 가능하게 구성된 것을 특징으로 하는 반도체 집적회로장치.
  3. 제2항에 있어서, 상기 범프전극은 상기 외부전극 패드에 다단식 접속된 것을 특징으로 하는 반도체 집적회로장치.
  4. 제1항에 있어서, 상기 기판은 금속으로 구성된 것을 특징으로 하는 반도체 집적회로장치.
  5. 제1항에 있어서, 상기 반도체 칩은 몰드수지 또는 수지제의 캡으로 통지된 것을 특징으로 하는 반도체 집적회로장치.
  6. 제1항에 있어서, 상기 반도체 칩과 상기 배선패턴의 일단은 와이어 또는 TAB 리드로 전기적으로 접속된 것을 특징으로 하는 반도체 집적회로장치.
  7. 제1항에 있어서, 상기 기판은 도전성 재료로 구성되고, 상기 반도체침의 정전위 패드 및 상기 절연테이프의 정전위 외부전극패드에 전기적으로 접속되는 것에 의해, 상기 기판이 정전위화된 것을 특징으로 하는 반도체 집적회로장치.
  8. 제1항에 있어서, 상기 기판에는 그 주면에서 이면에 도달하는 관통구멍이 설치되고, 상기 관통구멍 저부의 상기 외부전극패드는 상기 반도체 칩과 와이어로 전기적으로 접속된 것을 특징으로 하는 반도체 집적회로장치.
  9. 제1항에 있어서, 상기 가이드 구멍은 상기 절연테이프의 4귀퉁이에 설치된 것을 특징으로 하는 반도체 집적회로장치.
  10. 제1주면과, 상기 제1주면에 대향하는 제2주면 및 상기 제1 및 제2주면간의 측면을 가지는 판상의 금속재료로 이루어지는 기판과, 주면에 형성된 복수의 반도체 소자와 복수의 입출력패드를 가지고, 상기 기판의 제1주면상에 탑재된 반도체 칩과, 상기 기판의 제2주면상으로 연장되는 제1부분과, 상기 기판의 측면을 따라 연장되는 제2부분 및 상기 기판의 제1주면상으로 연장되는 제3부분을 가지고, 복수의 배선층이 형성된 절연테이프와, 상기 반도체층의 입출력패드와 상기 절연테이프의 제3부분의 배선층을 전기적으로 접속하는 수단 및, 상기 절연테이프의 제1부분상에 형성되고, 상기 제1부분의 배선층에 접속된 복수의 범프전극을 포함하는 것을 특징으로 하는 반도체 장치.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019950043333A 1994-11-30 1995-11-23 반도체 장치 KR960019683A (ko)

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KR100237329B1 (ko) * 1997-02-17 2000-01-15 김규현 칩 스케일 반도체 패키지의 구조 및 제조 방법
JP3482850B2 (ja) 1997-12-08 2004-01-06 セイコーエプソン株式会社 半導体装置及びその製造方法、回路基板並びに電子機器
US7705445B2 (en) * 2005-02-11 2010-04-27 Rambus Inc. Semiconductor package with low and high-speed signal paths
CN100583433C (zh) * 2007-07-26 2010-01-20 江苏宏微科技有限公司 非绝缘双塔型二极管模块
JP5498604B1 (ja) * 2013-04-17 2014-05-21 エムテックスマツムラ株式会社 固体撮像素子用中空パッケージ

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