JPH02214187A - プリント配線板 - Google Patents
プリント配線板Info
- Publication number
- JPH02214187A JPH02214187A JP3525289A JP3525289A JPH02214187A JP H02214187 A JPH02214187 A JP H02214187A JP 3525289 A JP3525289 A JP 3525289A JP 3525289 A JP3525289 A JP 3525289A JP H02214187 A JPH02214187 A JP H02214187A
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- JP
- Japan
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- circuits
- substrate
- circuit
- wiring board
- board
- Prior art date
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- Granted
Links
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- 229920005989 resin Polymers 0.000 claims description 3
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Classifications
-
- H—ELECTRICITY
- H05—ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
- H05K—PRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
- H05K1/00—Printed circuits
-
- H—ELECTRICITY
- H05—ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
- H05K—PRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
- H05K1/00—Printed circuits
- H05K1/02—Details
Landscapes
- Structure Of Printed Boards (AREA)
- Wire Bonding (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
本発明は、電子素子を実装するパフケークとして用いら
れるプリント配線板に関するものである7
れるプリント配線板に関するものである7
PGA、PLDCClPLCCなどとして用いられる電
子素子実装用のパフケークにおいては、プリント配線板
で形成するようにしたものが主流である。すなわち、銅
張り〃ラス基材エポキシat脂積層板など金属箔を基板
1である積層板に@屑した金属箔張り積層板を用い、金
I!4箔をエツチング処理等して回路として必要のない
部分を除去することによって、第3図に示すように基板
1の表面に多数本の回路2,2・・・を設けて形成され
るプリント配線板Aを電子素子を実装するためのパーケ
ークとして用いるのである。第3図において7はICな
どの電子素子を実装するためのキャビティ用パッド、8
はメツキリード用線であり、これC7は金属箔の一部を
残して形成してある。また第:2図においてイの符号で
示す線は、最終的に切り離すための線であり、線イの内
側が製品(パフケージ)となる。 そして上記のようなプリント配線板Aにあっで、基板1
に設けられる各回路2.2・・・は回路としての必要な
幅のみを有する細い線状に形成されており、金属箔をエ
ツチング除去した回路2,2・・・以外の部分が基板1
の表面において占める面積の側合が大きくなっている。
子素子実装用のパフケークにおいては、プリント配線板
で形成するようにしたものが主流である。すなわち、銅
張り〃ラス基材エポキシat脂積層板など金属箔を基板
1である積層板に@屑した金属箔張り積層板を用い、金
I!4箔をエツチング処理等して回路として必要のない
部分を除去することによって、第3図に示すように基板
1の表面に多数本の回路2,2・・・を設けて形成され
るプリント配線板Aを電子素子を実装するためのパーケ
ークとして用いるのである。第3図において7はICな
どの電子素子を実装するためのキャビティ用パッド、8
はメツキリード用線であり、これC7は金属箔の一部を
残して形成してある。また第:2図においてイの符号で
示す線は、最終的に切り離すための線であり、線イの内
側が製品(パフケージ)となる。 そして上記のようなプリント配線板Aにあっで、基板1
に設けられる各回路2.2・・・は回路としての必要な
幅のみを有する細い線状に形成されており、金属箔をエ
ツチング除去した回路2,2・・・以外の部分が基板1
の表面において占める面積の側合が大きくなっている。
しかしこのように回路2,2・・・以外の部分が基板1
の表面において占める面積の割合が大きくなるというこ
とは、基板1の表面のうち回路2,2・・・で覆われず
露出する部分の面積が大きくなるということである。従
って、金属箔を張った状態では金属箔で湿気を遮断でき
るために基板1には吸湿は殆ど発生しないが、このよう
に金属箔をエツチング処理して回路2.2・・・を形成
してプリント配線板Aに加工すると、回路2,2・・・
で覆われず露出する表面から基板1が吸湿し、基板1の
絶縁性能が劣化するという問題があった。 本発明は上記の点に鑑みて為されたものであり、基板の
吸湿を低減することがで外、基板の絶縁性能が劣化する
ようなおそれがないプリント配線板を提供することを目
的とするものである。
の表面において占める面積の割合が大きくなるというこ
とは、基板1の表面のうち回路2,2・・・で覆われず
露出する部分の面積が大きくなるということである。従
って、金属箔を張った状態では金属箔で湿気を遮断でき
るために基板1には吸湿は殆ど発生しないが、このよう
に金属箔をエツチング処理して回路2.2・・・を形成
してプリント配線板Aに加工すると、回路2,2・・・
で覆われず露出する表面から基板1が吸湿し、基板1の
絶縁性能が劣化するという問題があった。 本発明は上記の点に鑑みて為されたものであり、基板の
吸湿を低減することがで外、基板の絶縁性能が劣化する
ようなおそれがないプリント配線板を提供することを目
的とするものである。
本発明は、樹脂を主体とする基板1の表面に金属導体で
多数本の回路2.2・・・を設けて形成されるプリント
配線板において、隣合う回路2闇に回路を分離するのに
必要な間隙3のみを設けて、基板1の表面のほぼ全面に
回路2,2・・・を形成して成ることを特徴とするもの
である。
多数本の回路2.2・・・を設けて形成されるプリント
配線板において、隣合う回路2闇に回路を分離するのに
必要な間隙3のみを設けて、基板1の表面のほぼ全面に
回路2,2・・・を形成して成ることを特徴とするもの
である。
本発明にあっては、隣合う回路2間に回路を分離するの
に必要な間隙3のみを設けて、基板1の表面のほぼ全面
に回路2,2・・・を形成するようにしたために、基板
1の表面のうち回路2,2・・・で覆われず露出する部
分の面積を小さくすることができ、基板1が吸湿するこ
とを低減することができる。
に必要な間隙3のみを設けて、基板1の表面のほぼ全面
に回路2,2・・・を形成するようにしたために、基板
1の表面のうち回路2,2・・・で覆われず露出する部
分の面積を小さくすることができ、基板1が吸湿するこ
とを低減することができる。
以下本発明を実施例によって詳述する。
プリント配線板Aは樹脂を主体とする積層板などの基板
1の表面に金属箔を張ったものを加工して形成すること
ができる。例えば銅張り〃う六基材エポキシ樹脂積層板
など金属箔を基板1である積層板に積層した金属箔張り
積層板を用ν1、金属箔をエツチング処理等して回路2
,2・・・となる箇所を残して回路2として必要のない
部分を除去することによって、基板1に回路2.2・・
・を形成してプリント配線@Aを作成することができる
ものである。そして本発明にあっては、第1図(第1図
においては金属箔のうちエツチングしないで残す部分を
斜線で示す)に示すように隣合う回路2闇の闇PJII
3が回路2を絶縁分離するのに必要な狭い幅となるよう
にして形成するものである。すなわち、各回路2,2・
・・をできるだけ幅広く形成するようにして、金属箔を
エツチング除去することによって形成される各回路2間
の間隙3をできるだけ幅狭(するようにしたのである、
従って、第1図より明らかなように基板1の表面のうち
回路2.2・・・で覆われず露出する部分の面積が小さ
くなる。このように基板1の表面に多数本の回路2゜2
・・・を設けて形成されるプリント配線板Aを電子素子
を実装するためのパフケーノとして用いるのである。 第1図において7はICなどの電子素子を実装するため
のキャビティ用パッド、8はメツキリード用線−であっ
て、これらは金属箔の一部を残して形成してあり、基板
1に設ける回路2.2・・・は−端がキャビティ用パッ
ド7の近傍に位置すると共に他端がメツキリード用線8
に連続するように放射状に形成してある。また9は各回
路2に設けたランドであり、このランド9の部分にスル
ーホールを設けることによって接続用のピンを取り付け
ることができる。また第1図においてイの符号で示す線
は、最終的に切り離すための線であり、線イめ内側が東
品(パフケーノ)となる。尚、本発明は、両面プリント
配線板や多層プリント配線板など任意のものに適用する
ことができる。 上記のようにして形成されるプリント配線板Aにあって
は、基板1の表面のうち回路2,2・・・で覆われず露
出する部分、すなわち回路2間の間隙3の面積を小さく
することができるために、この露出する表面から基板1
が吸湿することを低減することができるものである。ち
なみに、第1図のもの(実施例)と第3図のもの(従来
例)について、121℃、2気圧の条件でプレッシャー
クツカーテストをおこない、その絶縁抵抗(層開厚み0
.4−輪としたときの層間抵抗と回路間0.2m鴫とじ
たときの内層回路量抵抗とからなる)とプレッシャーク
ツカー処理時間との関係を測定すると、第2図のグラフ
に示すような結果が得られる。第2図のグラフにみられ
るように、第1図の実施例のものは第3図の従来例のも
のに比べて絶縁性能の劣化が遅く、吸湿のスピードを遅
くすることができることが確認される。
1の表面に金属箔を張ったものを加工して形成すること
ができる。例えば銅張り〃う六基材エポキシ樹脂積層板
など金属箔を基板1である積層板に積層した金属箔張り
積層板を用ν1、金属箔をエツチング処理等して回路2
,2・・・となる箇所を残して回路2として必要のない
部分を除去することによって、基板1に回路2.2・・
・を形成してプリント配線@Aを作成することができる
ものである。そして本発明にあっては、第1図(第1図
においては金属箔のうちエツチングしないで残す部分を
斜線で示す)に示すように隣合う回路2闇の闇PJII
3が回路2を絶縁分離するのに必要な狭い幅となるよう
にして形成するものである。すなわち、各回路2,2・
・・をできるだけ幅広く形成するようにして、金属箔を
エツチング除去することによって形成される各回路2間
の間隙3をできるだけ幅狭(するようにしたのである、
従って、第1図より明らかなように基板1の表面のうち
回路2.2・・・で覆われず露出する部分の面積が小さ
くなる。このように基板1の表面に多数本の回路2゜2
・・・を設けて形成されるプリント配線板Aを電子素子
を実装するためのパフケーノとして用いるのである。 第1図において7はICなどの電子素子を実装するため
のキャビティ用パッド、8はメツキリード用線−であっ
て、これらは金属箔の一部を残して形成してあり、基板
1に設ける回路2.2・・・は−端がキャビティ用パッ
ド7の近傍に位置すると共に他端がメツキリード用線8
に連続するように放射状に形成してある。また9は各回
路2に設けたランドであり、このランド9の部分にスル
ーホールを設けることによって接続用のピンを取り付け
ることができる。また第1図においてイの符号で示す線
は、最終的に切り離すための線であり、線イめ内側が東
品(パフケーノ)となる。尚、本発明は、両面プリント
配線板や多層プリント配線板など任意のものに適用する
ことができる。 上記のようにして形成されるプリント配線板Aにあって
は、基板1の表面のうち回路2,2・・・で覆われず露
出する部分、すなわち回路2間の間隙3の面積を小さく
することができるために、この露出する表面から基板1
が吸湿することを低減することができるものである。ち
なみに、第1図のもの(実施例)と第3図のもの(従来
例)について、121℃、2気圧の条件でプレッシャー
クツカーテストをおこない、その絶縁抵抗(層開厚み0
.4−輪としたときの層間抵抗と回路間0.2m鴫とじ
たときの内層回路量抵抗とからなる)とプレッシャーク
ツカー処理時間との関係を測定すると、第2図のグラフ
に示すような結果が得られる。第2図のグラフにみられ
るように、第1図の実施例のものは第3図の従来例のも
のに比べて絶縁性能の劣化が遅く、吸湿のスピードを遅
くすることができることが確認される。
上述のように本発明にあっては、隣合う回路間に回路を
分離するのに必要な間隙のみを設けて、基板の表面のほ
ぼ全面に回路を形成するようにしたので、基板の表面の
うち回路で覆われず露出する部分の面積を小さくするこ
とができるものであり、基板の多くの面積を金属の回路
で遮蔽して基板が吸湿することを低減することができ、
基板に絶縁劣化が生じることを防ぐことができるもので
ある。
分離するのに必要な間隙のみを設けて、基板の表面のほ
ぼ全面に回路を形成するようにしたので、基板の表面の
うち回路で覆われず露出する部分の面積を小さくするこ
とができるものであり、基板の多くの面積を金属の回路
で遮蔽して基板が吸湿することを低減することができ、
基板に絶縁劣化が生じることを防ぐことができるもので
ある。
第1図は本発明の一実施例を示す平面図、第2図は絶縁
抵抗とプレッシャークツカー処理時間との関係を示すグ
ラフ、 第3図は従来例の平面図で ある。 1は基板、 2は回路、 3は回路間の間隙である
抵抗とプレッシャークツカー処理時間との関係を示すグ
ラフ、 第3図は従来例の平面図で ある。 1は基板、 2は回路、 3は回路間の間隙である
Claims (1)
- (1)樹脂を主体とする基板の表面に金属導体で多数本
の回路を設けて形成されるプリント配線板において、隣
合う回路間に回路を分離するのに必要な間隙のみを設け
て、基板の表面のほぼ全面に回路を形成して成ることを
特徴とするプリント配線板。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1035252A JPH0793477B2 (ja) | 1989-02-15 | 1989-02-15 | プリント配線板 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1035252A JPH0793477B2 (ja) | 1989-02-15 | 1989-02-15 | プリント配線板 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH02214187A true JPH02214187A (ja) | 1990-08-27 |
JPH0793477B2 JPH0793477B2 (ja) | 1995-10-09 |
Family
ID=12436634
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP1035252A Expired - Lifetime JPH0793477B2 (ja) | 1989-02-15 | 1989-02-15 | プリント配線板 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH0793477B2 (ja) |
Citations (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS63140627U (ja) * | 1987-03-07 | 1988-09-16 | ||
JPS6459985A (en) * | 1987-08-31 | 1989-03-07 | Ibiden Co Ltd | Printed wiring board for ic card |
JPH01129861U (ja) * | 1988-02-25 | 1989-09-04 |
-
1989
- 1989-02-15 JP JP1035252A patent/JPH0793477B2/ja not_active Expired - Lifetime
Patent Citations (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS63140627U (ja) * | 1987-03-07 | 1988-09-16 | ||
JPS6459985A (en) * | 1987-08-31 | 1989-03-07 | Ibiden Co Ltd | Printed wiring board for ic card |
JPH01129861U (ja) * | 1988-02-25 | 1989-09-04 |
Also Published As
Publication number | Publication date |
---|---|
JPH0793477B2 (ja) | 1995-10-09 |
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