JPH02146868A - 画像縮小回路 - Google Patents

画像縮小回路

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Publication number
JPH02146868A
JPH02146868A JP63301335A JP30133588A JPH02146868A JP H02146868 A JPH02146868 A JP H02146868A JP 63301335 A JP63301335 A JP 63301335A JP 30133588 A JP30133588 A JP 30133588A JP H02146868 A JPH02146868 A JP H02146868A
Authority
JP
Japan
Prior art keywords
picture
main scanning
input
reduction
reduction rate
Prior art date
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Pending
Application number
JP63301335A
Other languages
English (en)
Inventor
Hisao Fujimoto
藤本　久夫
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
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Filing date
Publication date
Application filed by NEC Corp filed Critical NEC Corp
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は画像縮小回路に関し、特にファクシミリ装置等
に使用する画像縮小回路に関する。
〔従来の技術〕
従来の画像縮小回路は、受信する画信号が記録装置の用
紙寸法やメモリ回路の記憶容量より大きい場合、予め操
作盤上のスイッチ等を操作することによって縮小率を設
定した後、画信号を受信する方法をとっていた。
〔発明が解決しようとする課題〕
上述した画像縮小回路は、受信する画像の大きさを、予
め確認し、操作盤上のスイッチ等を用いて縮小率を設定
する操作が必要であるとともに、誤操作により縮小率を
間違って設定する可能性があるという欠点があった。
〔課題を解決するための手段〕
本発明の画像縮小回路は、主走査イネーブル及び画信号
クロックを間引くことによって入力画像の縮小を行う画
像縮小回路において、入力の前記主走査イネーブルを計
数した副走査長によって縮小率を決定する手段と、画像
メモリに蓄積した前記入力画像を前記縮小率に従って読
み出し間引処理して出力する手段とを有している。
〔実施例〕
次に、本発明について図面を参照して説明する、第１図
は本発明の一実施例のブロック図、第２図は本実施例の
動作を説明するためのタイミング図である。第１図にお
いて、入力主走査イネーブル５が副走査長カウンタ１に
入力され、主走査イネーブル５のカウント結果８が縮小
率判定回路２に出力され、１ペ一ジ分の画像入力後に縮
小率指定９を縮小回路４に出力する。
入力画像６は、主走査イネーブル５及び画信号クロック
７と共に画像メモリ３に、１ペ一ジ分蓄積され、入力終
了後に画像メモリ３から主走査イネーブル出力１０と画
信号１１と画信号クロック１２を、縮小回路４へ読み出
される。
縮小回路４は、縮小率判定回路からの縮小率指定９に従
って画像メモリ３から読み出された画像を縮小し、縮小
後の主走査イネーブル１３と画信号４と画信号クロック
１５を出力する。
第２図では、入力画像を５０％縮小する場合の処理例を
示す０画信号１６は、主走査イネーブル１７及び画信号
クロック１８を伴って入力され、縮小率５０％の処理を
受けた後に主走査イネーブル１９及び画信号クロック２
０が出力されることになる。ここで主走査イネーブル１
７及び１９は、論理レベルＨが無効、Ｌが有効となって
いる。
〔発明の効果〕
以上説明したように本発明は、画信号の副走査長を検出
した値によって縮小率を自動的に設定ることかでき、外
部より予め縮小率を設定する必要なしに最適の縮小率で
出力できるという効果がある。
【図面の簡単な説明】
第１図は本発明の一実施例のブロック図、第２図は本実
施例の動作を説明するためのタイミング図である。 １・・・副走査長カウント、２・・・縮小率判定回路、
３・・・画像メモリ、４・・・縮小回路、５・・・入力
主走査イネーブル、６・・・入力画像、７・・・入力画
信号クロック、８・・・カウンタ出力、９・・・縮小率
指定、１０・・・画像メモリ主走査イネーブル出力、１
１・・・画像メモリ画信号出力、１２・・・画像メモリ
クロック出力、１３・・・縮小後の主走査イネーブル、
１４・・・縮小後面信号出力、１５・・・縮小後クロッ
ク出力、１６・・・画信号、１７・・・入力主走査イネ
ーブル、１８・・・入力画信号クロック、１９・・・縮
小後生走査イネーブル、２０・・・縮小後面信号クロッ
ク。

Claims (1)

    【特許請求の範囲】
  1. 主走査イネーブル及び画信号クロックを間引くことによ
    つて入力画像の縮小を行う画像縮小回路において、入力
    の前記主走査イネーブルを計数した副走査長によって縮
    小率を決定する手段と、画像メモリに蓄積した前記入力
    画像を前記縮小率に従って読み出し間引処理して出力す
    る手段とを有することを特徴とする画像縮小回路。
JP63301335A 1988-11-28 1988-11-28 画像縮小回路 Pending JPH02146868A (ja)

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JP63301335A JPH02146868A (ja) 1988-11-28 1988-11-28 画像縮小回路

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JPH02146868A true JPH02146868A (ja) 1990-06-06

Family

ID=17895622

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JP63301335A Pending JPH02146868A (ja) 1988-11-28 1988-11-28 画像縮小回路

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
EP0801359A1 (en) * 1996-04-12 1997-10-15 Nec Corporation Automatic picture size magnification/reduction circuit

Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS6253572A (ja) * 1985-09-03 1987-03-09 Nec Corp フアクシミリ装置

Patent Citations (1)

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