JPH02106974A - 高耐圧半導体装置 - Google Patents

高耐圧半導体装置

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JPH02106974A
JPH02106974A JP26180688A JP26180688A JPH02106974A JP H02106974 A JPH02106974 A JP H02106974A JP 26180688 A JP26180688 A JP 26180688A JP 26180688 A JP26180688 A JP 26180688A JP H02106974 A JPH02106974 A JP H02106974A
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JP
Japan
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type impurity
impurity
concentration
diffused
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Pending
Application number
JP26180688A
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English (en)
Inventor
Kunio Sasaki
佐々木 邦男
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NEC Corp
Original Assignee
NEC Corp
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Publication date
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    • H01L29/02Semiconductor bodies ; Multistep manufacturing processes therefor
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    • H01L29/1095Body region, i.e. base region, of DMOS transistors or IGBTs
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    • H01L29/68Types of semiconductor device ; Multistep manufacturing processes therefor controllable by only the electric current supplied, or only the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched
    • H01L29/70Bipolar devices
    • H01L29/72Transistor-type devices, i.e. able to continuously respond to applied control signals
    • H01L29/739Transistor-type devices, i.e. able to continuously respond to applied control signals controlled by field-effect, e.g. bipolar static induction transistors [BSIT]
    • H01L29/7393Insulated gate bipolar mode transistors, i.e. IGBT; IGT; COMFET
    • H01L29/7395Vertical transistors, e.g. vertical IGBT
    • H01L29/7398Vertical transistors, e.g. vertical IGBT with both emitter and collector contacts in the same substrate side

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  • General Physics & Mathematics (AREA)
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は高耐圧の2重拡散MOSトランジスタ(DMO
3)に関し、チャネル部に低濃度のN型不純物を補償拡
散し、高耐圧で閾値電圧vTを低くしたDMO8に関す
る。
〔従来の技術〕
従来、この種の縦型のN型DMO8を形成する場合、ゲ
ートポリシリコン形成後、P型不純物とN型不純物を二
重拡散することにより、チャネル部とソースを形成して
いた。そのときの不純物濃度分布は第3図のようになっ
ていた。
〔発明が解決しようとする課題〕
上述した従来の高耐圧縦型DMO3は、高耐圧を確保す
るために空乏層の曲率が小さくならないように、P型不
純物(Pベース)の濃度を高くして深く拡散されるよう
にしている。Pベースの濃度が高いためvTが高くなり
、高耐圧と同時に大電流を得ることは難しいという問題
がある。
〔課題を解決するための手段〕
本発明の縦型DMO8は、Pベースを形成するP型不純
物をイオン注入した後短時間の押込みを行い、その後低
濃度のN型不純物をイオン注入し、さらに押込みを行う
ことによりP型不純物の補償を行い表面濃度を下げる。
その後にソースとなる高濃度のN型不純物を拡散する。
本発明においてはPベースの濃度とN型不純物の濃度に
よりvTをコントロールする。
〔実施例〕
次に本発明について図面を参照して説明する。
第1図は本発明の一実施例の縦断面図である。
第1図に示すように、P型半導体基板lの表面からN型
不純物を拡散しドレインとなる埋込層2を形成する。そ
の後N−型エピタキシャル層4とドレインの取り出し拡
散層3を形成する。次にゲートポリシリコンロを形成し
た後、Pベース9となるP型不純物をイオン注入し短時
間の押込みを行なう。さらにV、を下げるための低濃度
N型不純物をイオン注入した後、さらに押込みを行い、
ソース7となるN型拡散層、バックゲートの電位を取る
P型拡散層8を形成する。このときの不純物濃度は第2
図のようになる。
また、他の実施例としてPベース層9の形成方法として
、まずP型不純物のイオン注入後法に低濃度のN型をイ
オン注入し、同時に押込みを行なった後ソース7を形成
することもできる。
〔発明の効果〕
以上説明したように本発明は、チャネル部に低濃度のN
型不純物が補償拡散されているため、Pベースとなる高
濃度のP型不純物を拡散しても、深く拡散されることに
より高耐圧を得ることが出来ると同時に、表面のP型濃
度が低くV?が低くなることにより電流特性も良くする
ことが出来る。
【図面の簡単な説明】
第1図は本発明の一実施例の縦断面図、第2図は本発明
の一実施例の不純物濃度と深さの関係を示す図、第3図
は従来の不純物濃度分布を示す図である。 1・・・・・・P型半導体基板、2・・・・・・N型埋
込層(DMO3のドレイン)、3・・・・・・N型拡散
層、4・・・・・・N−型エピタキシャル層、5・・・
・・・低濃度N型拡散層、6・・・・・・ゲートポリシ
リ、7・・・・・・DMO8用N1(ソース)、8・・
・・・・P型拡散層、9・・・・・・DMO8用Pベー
ス。 代理人 弁理士  内 原   音

Claims (1)

    【特許請求の範囲】
  1. 高耐圧の2重拡散MOSトランジスタにおいて、チャネ
    ル部に逆導電型の不純物を補償拡散したことを特徴とす
    る高耐圧半導体装置
JP26180688A 1988-10-17 1988-10-17 高耐圧半導体装置 Pending JPH02106974A (ja)

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JPH02106974A true JPH02106974A (ja) 1990-04-19

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ID=17366975

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JP26180688A Pending JPH02106974A (ja) 1988-10-17 1988-10-17 高耐圧半導体装置

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US7938414B2 (en) 2005-09-13 2011-05-10 Ksm Castings Gmbh Auxiliary frame, particularly for motor vehicles

Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US7938414B2 (en) 2005-09-13 2011-05-10 Ksm Castings Gmbh Auxiliary frame, particularly for motor vehicles
JP4856705B2 (ja) * 2005-09-13 2012-01-18 カーエスエム キャスティングス ゲーエムベーハー 補助フレーム、より好適には自動車に対する補助フレーム
US8393627B2 (en) 2005-09-13 2013-03-12 Ksm Castings Group Gmbh Longitudinal link for an auxiliary frame, particularly for motor vehicles

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