JPH0195556A - ヘテロ接合バイポーラトランジスタ - Google Patents
ヘテロ接合バイポーラトランジスタInfo
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- JPH0195556A JPH0195556A JP25446287A JP25446287A JPH0195556A JP H0195556 A JPH0195556 A JP H0195556A JP 25446287 A JP25446287 A JP 25446287A JP 25446287 A JP25446287 A JP 25446287A JP H0195556 A JPH0195556 A JP H0195556A
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- silicon
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Links
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- 229910052710 silicon Inorganic materials 0.000 abstract description 20
- 239000010703 silicon Substances 0.000 abstract description 20
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Landscapes
- Bipolar Transistors (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
(産業上の利用分野)
本発明は、シリコンへテロ接合バイポーラトランジスタ
において、電流利得が向上する構造に関するものである
。
において、電流利得が向上する構造に関するものである
。
(従来の技術)
シリコンバイポーラトランジスタの素子動作を高速化さ
せるために、ヘテロエミッタ構造をとることが提案され
ている。異種の半導体材料を接合させた、ヘテロ接合を
利用したヘテロ接合バイポーラトランジスタは、従来の
単一材料を用いて作られるホモ接合バイポーラトランジ
スタと比較して、多くの利点がある。
せるために、ヘテロエミッタ構造をとることが提案され
ている。異種の半導体材料を接合させた、ヘテロ接合を
利用したヘテロ接合バイポーラトランジスタは、従来の
単一材料を用いて作られるホモ接合バイポーラトランジ
スタと比較して、多くの利点がある。
例えば、エミッタ層を構成する半導体物質を、ベース層
を構成する半導体物質よりバンドギャップの広いものと
することにより、エミッタ注入効率を低下させることな
く、エミッタ領域の不純物濃度と、ベース領域の不純物
濃度を独立に設定することができる。
を構成する半導体物質よりバンドギャップの広いものと
することにより、エミッタ注入効率を低下させることな
く、エミッタ領域の不純物濃度と、ベース領域の不純物
濃度を独立に設定することができる。
従って、ベース層の不純物濃度を高くすることができる
ため、ベース低抗を低くすることができ、また薄いベー
ス層を形成することができる。
ため、ベース低抗を低くすることができ、また薄いベー
ス層を形成することができる。
同様に、エミッタ層の不純物濃度を低くすることができ
るため、エミッタ容量を低減することができる。
るため、エミッタ容量を低減することができる。
これらの利点により、ヘテロ接合バイポーラトランジス
タは、従来のホモ接合バイポーラトランジスタに比べて
、高周波特性、スイッチング特性の点で、非常に優れた
ものとなる可能性をもっている。
タは、従来のホモ接合バイポーラトランジスタに比べて
、高周波特性、スイッチング特性の点で、非常に優れた
ものとなる可能性をもっている。
このようなヘテロ接合バイポーラトランジスタを実際に
構成するのに当たり、構造としては、エミッタ層にアモ
ルファス炭化シリコン(以下a−5iC:H)を用いる
ことが提案されている。(昭和62年 春季応用物理学
会)第5図に、従来のへテロ接合バイポーラトランジス
タの断面図を示す。
構成するのに当たり、構造としては、エミッタ層にアモ
ルファス炭化シリコン(以下a−5iC:H)を用いる
ことが提案されている。(昭和62年 春季応用物理学
会)第5図に、従来のへテロ接合バイポーラトランジス
タの断面図を示す。
♂シリコンウェハlにn−シリコンエビ層2をエビ成長
させる。次に、S i O,膜4を形成し、1フオトリ
ソグラフイでパタニング後、イオン注入等によりホウ素
をドープし、P領域3を形成する。続いて、プラズマC
VD法により、n”a−5iC:H5’を積層する。そ
して最後に、S i O,膜4にフォトリソグラフィで
コンタクトホールを形成し、n+シリコンウェハlの裏
面及び、P領域4とn+a−SiC:H5’との上面に
、アルミニウム金属6を積層し、配線する。
させる。次に、S i O,膜4を形成し、1フオトリ
ソグラフイでパタニング後、イオン注入等によりホウ素
をドープし、P領域3を形成する。続いて、プラズマC
VD法により、n”a−5iC:H5’を積層する。そ
して最後に、S i O,膜4にフォトリソグラフィで
コンタクトホールを形成し、n+シリコンウェハlの裏
面及び、P領域4とn+a−SiC:H5’との上面に
、アルミニウム金属6を積層し、配線する。
このような構造では、nシリコンウェハ1がコレクタ、
P領域3がベース、n”a−SiC:Hがエミッタとな
り、バイポーラトランジスタを構成している。
P領域3がベース、n”a−SiC:Hがエミッタとな
り、バイポーラトランジスタを構成している。
(発明が解決しようとする問題点)
従来のへテロ接合バイポーラトランジスタのエミッタ層
に用いられているa−9iC:Hは、導電率が低く注入
効率がわるいので、電流利得がおちる。
に用いられているa−9iC:Hは、導電率が低く注入
効率がわるいので、電流利得がおちる。
また、高周波特性、スイッチング特性がある。
また、C組成比が増加した場合、局在準位密度の増大に
より、トランジスタの特性劣化、電流利得の低下を引き
起こす可能性がある。
より、トランジスタの特性劣化、電流利得の低下を引き
起こす可能性がある。
上記のような欠点があるため、a−5iC:Hをエミッ
タ層に用いたヘテロバイポーラトランジスタは、実用化
に至っていない。
タ層に用いたヘテロバイポーラトランジスタは、実用化
に至っていない。
本発明の目的は、上記問題点に鑑みなされたもので、電
流利得、高周波特性の高いヘテロ接合バイポーラトラン
ジスタを提供することにある。
流利得、高周波特性の高いヘテロ接合バイポーラトラン
ジスタを提供することにある。
(問題点を解決するための手段)
本発明は、シリコンへテロ接合バイポーラトランジスタ
において、エミッタ層を微結晶(マイクロクリスタル)
シリコン(以下μc−5i)を用いて上記問題点を解決
する。
において、エミッタ層を微結晶(マイクロクリスタル)
シリコン(以下μc−5i)を用いて上記問題点を解決
する。
(作用)
μc−Siの導電率は、非常に高いのでキャリアが高く
抵抗は低い。従って、キャリア密度が高いため、エミッ
タからベースへ注入される電子が多くなる。
抵抗は低い。従って、キャリア密度が高いため、エミッ
タからベースへ注入される電子が多くなる。
また、抵抗が低いため、電流利得が向上する。
さらに、pc−9iはa−5iC:Hの炭素(C)のよ
うな異種原子をふくまないので、格子歪による局在準位
密度の増加はないので、再結合電流による電流利得低下
をまねかない。
うな異種原子をふくまないので、格子歪による局在準位
密度の増加はないので、再結合電流による電流利得低下
をまねかない。
(実施例)
以下、図面に従って本発明のシリコンへテロ接合バイポ
ーラトランジスタの説明をする。
ーラトランジスタの説明をする。
第1図に、本発明のシリコンへテロ接合バイポーラトラ
ンジスタの断面図を示す。
ンジスタの断面図を示す。
始めに、0.02ΩΦQ以下のnシリコンウェハ1に、
0.5〜5Ωφ(至)のn−シリコンエビ層2を10μ
m程度エビ成長させる。
0.5〜5Ωφ(至)のn−シリコンエビ層2を10μ
m程度エビ成長させる。
次に、n−シリコンエビ層2上に、5000人程度のS
i O,膜4を形成し、フォトリソグラフィによりパ
タニングする。
i O,膜4を形成し、フォトリソグラフィによりパ
タニングする。
続いて、前記パタニング領域より表面濃度toll/c
IT13、深さ0.5μm程度のホウ素拡散を行い、P
領域3を形成する。
IT13、深さ0.5μm程度のホウ素拡散を行い、P
領域3を形成する。
さらに、フォトリソグラフィでS i O,膜4のパタ
ニングを行い、ベースとエミッタの接合面を形成し、そ
の領域に5Ω・印のμc−5i:Hを5ooo人、プラ
ズマCVD法で積層し、n“μc−Si5を形成する。
ニングを行い、ベースとエミッタの接合面を形成し、そ
の領域に5Ω・印のμc−5i:Hを5ooo人、プラ
ズマCVD法で積層し、n“μc−Si5を形成する。
最後に、フォトリソグラフィイでS i O,膜4をパ
タニングし、コンタクトホールを形成し、P領域3とn
Bc−9i:H5との上面と、nシリコンエビ層1の裏
面とにアルミニウム金属6を蒸着し、配線する。
タニングし、コンタクトホールを形成し、P領域3とn
Bc−9i:H5との上面と、nシリコンエビ層1の裏
面とにアルミニウム金属6を蒸着し、配線する。
以上で本発明のシリジンへテロ接合バイポーラトランジ
スタは完成する。
スタは完成する。
但し、ここでいうμc−5i:Hとは第2図に示すよう
に、アモルファスシリコンの中に微結晶相を含む構造で
ある。そしてその微結晶の周囲は、水素原子で終端され
ている。
に、アモルファスシリコンの中に微結晶相を含む構造で
ある。そしてその微結晶の周囲は、水素原子で終端され
ている。
第3図にμc−5i:Hのバンドギャップを示す。同図
より、μc−5iのバンドギャップは、1.95eVと
なりa−Si:l(と同様、広いバンドギャップである
。そのため、エミッタの注入効率を低下させることなく
、エミッタ領域の不純物濃度とベース領域の不純物濃度
を独立に設定することができる。従って、ベース層の不
純物濃度、を高くすることができるため、ベース抵抗を
低くすることができ、また、薄いベース層を形成するこ
とができる。同様に、エミッタ層の不純物濃度を低くす
ることができるため、エミッタ容量を低減することがで
きる。
より、μc−5iのバンドギャップは、1.95eVと
なりa−Si:l(と同様、広いバンドギャップである
。そのため、エミッタの注入効率を低下させることなく
、エミッタ領域の不純物濃度とベース領域の不純物濃度
を独立に設定することができる。従って、ベース層の不
純物濃度、を高くすることができるため、ベース抵抗を
低くすることができ、また、薄いベース層を形成するこ
とができる。同様に、エミッタ層の不純物濃度を低くす
ることができるため、エミッタ容量を低減することがで
きる。
第4図(a)にpc−Si:Hの導電率と、第4図(b
)にa−3iC:Hの導電率を示す。
)にa−3iC:Hの導電率を示す。
同図から明らかなように、a−SiC:Hの導電率が約
I X 10−’On−♂というのに比較して、μc−
5i:Hの導電率は、約5Ω4・♂であり、非常に高い
値である。従って、μc−3iHのエミッタ層は、バン
ドギャップが、a−Si:Hと同様の値を維持したまま
、キャリア密度が高く抵抗が低くなる。
I X 10−’On−♂というのに比較して、μc−
5i:Hの導電率は、約5Ω4・♂であり、非常に高い
値である。従って、μc−3iHのエミッタ層は、バン
ドギャップが、a−Si:Hと同様の値を維持したまま
、キャリア密度が高く抵抗が低くなる。
エミッタ層のキャリア密度が高いため、ベースとコレク
タとの間に、逆方向の電圧を印加しつつ、エミッタとベ
ースとの間に順方向の電圧印加した場合、電子はエミッ
タからベースへ注入されるが、この時の電子の注入がa
−5iC:Hをエミッタに用いた時に比べて大きくなる
。
タとの間に、逆方向の電圧を印加しつつ、エミッタとベ
ースとの間に順方向の電圧印加した場合、電子はエミッ
タからベースへ注入されるが、この時の電子の注入がa
−5iC:Hをエミッタに用いた時に比べて大きくなる
。
(注入効率が向上する)
そして、エミッタの抵抗が低いため、電流利得が向上す
る。
る。
さらに、μc−Si:Hは、炭素(C)のような異種原
子を含まないので、a−5iC:Hのように格子歪によ
る局在準位密度の増加はない。
子を含まないので、a−5iC:Hのように格子歪によ
る局在準位密度の増加はない。
本実施例においては、エミッタ層にμc−Si:Hを用
いたが、μc−5i:Fを用いても同様である。
いたが、μc−5i:Fを用いても同様である。
(発明の効果)
本発明によれば、エミッタ層にμc−Siを用いること
により、エミッタ層のキャリア密度は高く、抵抗は低く
なる。従って、注入効率、電流利得は向上し、素子の高
周波特性、スイッチング速度は向上するので、高速のス
イッチング素子が得られる。
により、エミッタ層のキャリア密度は高く、抵抗は低く
なる。従って、注入効率、電流利得は向上し、素子の高
周波特性、スイッチング速度は向上するので、高速のス
イッチング素子が得られる。
さらに、pc−Siの耐熱性は、a−SiC:Hよりも
50℃程度上がるので、アルミシンタリング等の後工程
での熱処理を高い温度で行うことができ、工程設計の自
由度があがり、高温でアルミシンタリングを行うことに
より、コンタクト抵抗を下げることが可能となる。
50℃程度上がるので、アルミシンタリング等の後工程
での熱処理を高い温度で行うことができ、工程設計の自
由度があがり、高温でアルミシンタリングを行うことに
より、コンタクト抵抗を下げることが可能となる。
第1図は、本発明のシリコンへテロ接合バイポーラトラ
ンジスタの断面図 第2図は、同エミッタ層に用いたμc−Si:Hの構造
を示す図 第3図は、μc−5i:Hのバンドギャップを示す図 第4図(a)は、pc−StのRF pow−erと
導電率の関係を示す図 第4図(b)は、a−SiC:HのCH4/(CH,+
S i H4)のガス比と導電率の関係を示す図 第5図は、従来のシリコンへテロ接合バイポーラトラン
ジスタの断面図である。 111・・φnシリコンウェハ 2・争争・n′″シリコンエビ層 3・・・・P領域 4・・・φS i Ot膜 ° 5・・Φ・がμc−Si:H 6会φ・φアルミニウム金属
ンジスタの断面図 第2図は、同エミッタ層に用いたμc−Si:Hの構造
を示す図 第3図は、μc−5i:Hのバンドギャップを示す図 第4図(a)は、pc−StのRF pow−erと
導電率の関係を示す図 第4図(b)は、a−SiC:HのCH4/(CH,+
S i H4)のガス比と導電率の関係を示す図 第5図は、従来のシリコンへテロ接合バイポーラトラン
ジスタの断面図である。 111・・φnシリコンウェハ 2・争争・n′″シリコンエビ層 3・・・・P領域 4・・・φS i Ot膜 ° 5・・Φ・がμc−Si:H 6会φ・φアルミニウム金属
Claims (1)
- エミッタ層に微結晶(マイクロクリスタル)シリコン
を用いたヘテロ接合バイポーラトランジスタ。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP25446287A JPH0195556A (ja) | 1987-10-07 | 1987-10-07 | ヘテロ接合バイポーラトランジスタ |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP25446287A JPH0195556A (ja) | 1987-10-07 | 1987-10-07 | ヘテロ接合バイポーラトランジスタ |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH0195556A true JPH0195556A (ja) | 1989-04-13 |
Family
ID=17265361
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP25446287A Pending JPH0195556A (ja) | 1987-10-07 | 1987-10-07 | ヘテロ接合バイポーラトランジスタ |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH0195556A (ja) |
-
1987
- 1987-10-07 JP JP25446287A patent/JPH0195556A/ja active Pending
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