JPH01286587A - テレビジョン画像処理装置 - Google Patents
テレビジョン画像処理装置Info
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- JPH01286587A JPH01286587A JP11667588A JP11667588A JPH01286587A JP H01286587 A JPH01286587 A JP H01286587A JP 11667588 A JP11667588 A JP 11667588A JP 11667588 A JP11667588 A JP 11667588A JP H01286587 A JPH01286587 A JP H01286587A
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- 230000006866 deterioration Effects 0.000 claims abstract description 43
- 238000001514 detection method Methods 0.000 claims abstract description 20
- 230000001052 transient effect Effects 0.000 abstract 1
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- 238000006243 chemical reaction Methods 0.000 description 2
- 230000005684 electric field Effects 0.000 description 2
- 230000004044 response Effects 0.000 description 2
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- 230000007704 transition Effects 0.000 description 1
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
[発明の目的]
(産業上の利用分野)
本発明は据置型や携帯型のテレビジョン受像機における
チャンネル切換え時の画像部れや、車載用テレビジョン
受像機における受信状B悪化時の画一劣化を解消し得る
ようにしたテレビジョン画像処理装置に関する。
チャンネル切換え時の画像部れや、車載用テレビジョン
受像機における受信状B悪化時の画一劣化を解消し得る
ようにしたテレビジョン画像処理装置に関する。
(従来の技術)
一般に、据置型や携帯型のテレビジョン受像機を一定箇
所に設置して固定受信する場合に、チャンネル切換操作
を行うと、その切換操作によってテレビジョン信号が途
切れる為、何んらかの画像部れを生じる。また、1ヂヤ
ンネル毎のアップダウン選局やオートサーチ選局により
無信号チャンネルや微弱電界チャンネルを通過する際は
、スノーノイズ両面や同期乱れを含む不安定な画面とな
る。
所に設置して固定受信する場合に、チャンネル切換操作
を行うと、その切換操作によってテレビジョン信号が途
切れる為、何んらかの画像部れを生じる。また、1ヂヤ
ンネル毎のアップダウン選局やオートサーチ選局により
無信号チャンネルや微弱電界チャンネルを通過する際は
、スノーノイズ両面や同期乱れを含む不安定な画面とな
る。
一方、車載用テレビジョン受像機のようにテレビジョン
電波を移動受信する場合は、電波到来方向にある障害物
、トンネル等の通過、及び反射波に伴うゴースト等によ
り、受像画面に一時的なS/N劣化(スノーノイズ)や
同期乱れを生じ、安定な画面が得られない状態が比較的
頻繁に発生しやすい。
電波を移動受信する場合は、電波到来方向にある障害物
、トンネル等の通過、及び反射波に伴うゴースト等によ
り、受像画面に一時的なS/N劣化(スノーノイズ)や
同期乱れを生じ、安定な画面が得られない状態が比較的
頻繁に発生しやすい。
しかしながら、上記の画像の乱れ及び劣化は、過渡的或
いは一時的に生ずるものであり、特にこれらを軽減する
よう対策が講じられていなかった。
いは一時的に生ずるものであり、特にこれらを軽減する
よう対策が講じられていなかった。
(発明が解決しようとする課題)
上述のように、従来は、チャンネル切換え時に画像性れ
を生じたり、車載用テレビジョン受像機において入力電
波状態の悪化に伴いS/N劣化や画像性れを生じても、
これを軽減する為の処置が行なわれていなかった。
を生じたり、車載用テレビジョン受像機において入力電
波状態の悪化に伴いS/N劣化や画像性れを生じても、
これを軽減する為の処置が行なわれていなかった。
そこで、本発明は上記の問題を解決づる為のもので、チ
ャンネル切換え時や受信条件悪化時に生じる画像劣化を
軽減することができるテレビジョン画像処理装置を提供
することを目的とするものである。
ャンネル切換え時や受信条件悪化時に生じる画像劣化を
軽減することができるテレビジョン画像処理装置を提供
することを目的とするものである。
[発明の構成]
(課題を解決するための手段) ′
本発明のテレビジョン画像処理装置は、入力として供給
されるビデオ信号をフィールド毎に交互に書込み、読出
しを行う2つのフィールドメモリで構成され、信号劣化
検出信号にて前記2つのフィールドメモリの交互の書込
み、読出しを停止し、信号劣化直前の1フィールド分を
読出す記憶手段と、 前記の入力されるビデオ信号が一方の入力端に供給され
、前記記憶手段から読出されるビデオ信号がもう一方の
入力端に供給され、これらの入力端を信号劣化検出信号
にて選択的に切換えて、出力端に信号劣化の無いビデオ
信号を得る切換手段と、 前記の入力されるビデオ信号が、チャンネル切換え時や
受信条件の悪化時に、チャンネル切換えに同II した
信号を得るか又は信号劣化を検出することにより信号劣
化検出信号を得、前記記憶手段及び前記切換手段に供給
する信号劣化検出手段と、を具備したことを特徴とする
ものである。
されるビデオ信号をフィールド毎に交互に書込み、読出
しを行う2つのフィールドメモリで構成され、信号劣化
検出信号にて前記2つのフィールドメモリの交互の書込
み、読出しを停止し、信号劣化直前の1フィールド分を
読出す記憶手段と、 前記の入力されるビデオ信号が一方の入力端に供給され
、前記記憶手段から読出されるビデオ信号がもう一方の
入力端に供給され、これらの入力端を信号劣化検出信号
にて選択的に切換えて、出力端に信号劣化の無いビデオ
信号を得る切換手段と、 前記の入力されるビデオ信号が、チャンネル切換え時や
受信条件の悪化時に、チャンネル切換えに同II した
信号を得るか又は信号劣化を検出することにより信号劣
化検出信号を得、前記記憶手段及び前記切換手段に供給
する信号劣化検出手段と、を具備したことを特徴とする
ものである。
(作用)
本発明においては、通常の良好な受信状態では入力され
るビデオ信号がそのまま切換手段を通して出力され、チ
ャンネル切換え時や受信状態の悪化時には信号劣化検出
手段からの検出信号にて記憶手段及び切換手段を制御し
、チャンネル切換え直前又は信号劣化直前の記憶内容を
記憶手段から読出し、−時的に静止画として出力するこ
とにより、信号劣化の無いテレビジョン画像が得られる
。
るビデオ信号がそのまま切換手段を通して出力され、チ
ャンネル切換え時や受信状態の悪化時には信号劣化検出
手段からの検出信号にて記憶手段及び切換手段を制御し
、チャンネル切換え直前又は信号劣化直前の記憶内容を
記憶手段から読出し、−時的に静止画として出力するこ
とにより、信号劣化の無いテレビジョン画像が得られる
。
(実施例)
以下、図面に示した実施例に基づいて本発明を説明する
。
。
@1図は本発明の一実施例のテレビジョン画像処理装置
を示すブロック図である。
を示すブロック図である。
この図において、入力端子1にはベースバンドのビデオ
信号(複合映像信号)が入力され、スイッチ回路2の一
方の端子aに供給されると共にメモリ回路3に供給され
る。メモリ回路3は1フイールド毎にビデオ信号の書込
み、読出しを交互に行う2つのフィールドメモリで構成
され、入力端子4に供給される制御信号によってその古
込み、読出しの動作がilJ IIIされる。メモリ回
路3がら読出されるビデオ信号はスイッチ回路2のもう
一方の端子すに供給されるようになっている。そして、
スイッチ回路2は上記入力端子4からの制御信号によっ
て選択的に切換えられて、その出力端Cに接続した出力
端子5から信号劣化の無いビデオ信号が出力されるよう
になっている。
信号(複合映像信号)が入力され、スイッチ回路2の一
方の端子aに供給されると共にメモリ回路3に供給され
る。メモリ回路3は1フイールド毎にビデオ信号の書込
み、読出しを交互に行う2つのフィールドメモリで構成
され、入力端子4に供給される制御信号によってその古
込み、読出しの動作がilJ IIIされる。メモリ回
路3がら読出されるビデオ信号はスイッチ回路2のもう
一方の端子すに供給されるようになっている。そして、
スイッチ回路2は上記入力端子4からの制御信号によっ
て選択的に切換えられて、その出力端Cに接続した出力
端子5から信号劣化の無いビデオ信号が出力されるよう
になっている。
上記の構成において、通常の受信状態即ちチャンネル切
換えや受信信号の劣化の無い時には、スイッチ回路2は
図示の状態となっており、入力端子1からのビデオ信号
はそのまま出力端子5に導かれると共にメモリ回路3に
も供給され、1フイールド毎に書込み、読出しが交互に
行なわれる。
換えや受信信号の劣化の無い時には、スイッチ回路2は
図示の状態となっており、入力端子1からのビデオ信号
はそのまま出力端子5に導かれると共にメモリ回路3に
も供給され、1フイールド毎に書込み、読出しが交互に
行なわれる。
そして、チャンネル切換えの過渡時や受信信号の劣化が
検出された場合は、これらの検出信号に基づくυItl
l信号によりメモリ回路3の書込み、読出しを停止させ
、チャンネル切換え操作直前或いは信号劣化の直前の安
定した良好なビデオ信号をメモリ回路3から1フィール
ド分読出し、スイッチ回路2を端子すに切換えて出力端
子5に導出する。
検出された場合は、これらの検出信号に基づくυItl
l信号によりメモリ回路3の書込み、読出しを停止させ
、チャンネル切換え操作直前或いは信号劣化の直前の安
定した良好なビデオ信号をメモリ回路3から1フィール
ド分読出し、スイッチ回路2を端子すに切換えて出力端
子5に導出する。
第2図は第1図の具体的な回路構成を示すブロック図で
ある。
ある。
この図おいて、入力端子11には映像検波後に得られる
ベースバンドのビデオ信号(a)が入力され、このビデ
オ信号(a)はアナログスイッチ12の一方の端子aに
供給されると共にバッファアンプ13を通して垂直同期
分離回路14、水平同期分離回路15、クロック発生器
16、フィールドメモリ回路18.19に供給される。
ベースバンドのビデオ信号(a)が入力され、このビデ
オ信号(a)はアナログスイッチ12の一方の端子aに
供給されると共にバッファアンプ13を通して垂直同期
分離回路14、水平同期分離回路15、クロック発生器
16、フィールドメモリ回路18.19に供給される。
クロック発生器16からのクロック及び垂直同期分離回
路14からの垂直同期パルス(b)はフィールドメモリ
回路18.19の駆動用信号として使われる。フィール
ドメモリ回路19では、入力される垂直同期パルス(0
)に同期した矩形波信号(f)を発生し、データラッチ
回路22にデータ入力として供給し、回路22はこれと
同相の書込み/読出し制御信号(す)及びこの信号を反
転した書込み/読出し制御信号(h)をそれぞれフィー
ルドメモリ回路18゜19に供給する。これによって、
1垂直周期(以下1Vと称す)毎に一方のメモリにビデ
オ信号を書込むと同時に他方のメモリから1v@にig
込まれたビデオ信号を読出ず操作を交互に行うようにし
ている。なお、フィールドメモリ回路18.19はビデ
オ信号を書込む時はA/D変換して行ない、読出し時は
D/A変換して出力する。上記データラッチ回路22は
そのCK端子にローレベルの信号が入力されると、入力
データ状態がラッチされるようになっている。一方、入
力端子20には、図示しない信号劣化検出回路から、チ
ャンネル切換えの過渡時や受信信号の劣化を検出した時
にその検出信号に基づいたハイレベルの制御信号が入力
され、インバータ21で反転して得たローレベルの信号
によって、スイッチ回路17をオフさせたり、データラ
ッチ回路22にラッチ動作させたり、アナログスイッチ
12を端子すに切換えたすする。フィールドメモリ回路
18.19から交互に読出される1■前のビデオ信号は
、各メモリの読出し期間に対応してアナログスイッチ2
3で端子a又はbに交互に切換えられ出力端Cより、ア
ナログスイッチ12の端子すに出力される。アナログス
イッチ12は前記インバータ21からの制御信号によっ
て制御され、通常の受信状態では端子aに、またチャン
ネル切換え時や信号劣化時は端子すに切換えられるよう
になっている。そして、アナログスイッチ12の出力端
Cからバッファアンプ24を経て出力端子25に信号劣
化の無いビデオ信号(1)として出力される。
路14からの垂直同期パルス(b)はフィールドメモリ
回路18.19の駆動用信号として使われる。フィール
ドメモリ回路19では、入力される垂直同期パルス(0
)に同期した矩形波信号(f)を発生し、データラッチ
回路22にデータ入力として供給し、回路22はこれと
同相の書込み/読出し制御信号(す)及びこの信号を反
転した書込み/読出し制御信号(h)をそれぞれフィー
ルドメモリ回路18゜19に供給する。これによって、
1垂直周期(以下1Vと称す)毎に一方のメモリにビデ
オ信号を書込むと同時に他方のメモリから1v@にig
込まれたビデオ信号を読出ず操作を交互に行うようにし
ている。なお、フィールドメモリ回路18.19はビデ
オ信号を書込む時はA/D変換して行ない、読出し時は
D/A変換して出力する。上記データラッチ回路22は
そのCK端子にローレベルの信号が入力されると、入力
データ状態がラッチされるようになっている。一方、入
力端子20には、図示しない信号劣化検出回路から、チ
ャンネル切換えの過渡時や受信信号の劣化を検出した時
にその検出信号に基づいたハイレベルの制御信号が入力
され、インバータ21で反転して得たローレベルの信号
によって、スイッチ回路17をオフさせたり、データラ
ッチ回路22にラッチ動作させたり、アナログスイッチ
12を端子すに切換えたすする。フィールドメモリ回路
18.19から交互に読出される1■前のビデオ信号は
、各メモリの読出し期間に対応してアナログスイッチ2
3で端子a又はbに交互に切換えられ出力端Cより、ア
ナログスイッチ12の端子すに出力される。アナログス
イッチ12は前記インバータ21からの制御信号によっ
て制御され、通常の受信状態では端子aに、またチャン
ネル切換え時や信号劣化時は端子すに切換えられるよう
になっている。そして、アナログスイッチ12の出力端
Cからバッファアンプ24を経て出力端子25に信号劣
化の無いビデオ信号(1)として出力される。
次に、第2図の回路動作を第3図のタイミングチャート
を参照しながら説明する。第3図において、(a)〜(
1)は第2図の回路各部の、信号(a)〜(1)に対応
している。
を参照しながら説明する。第3図において、(a)〜(
1)は第2図の回路各部の、信号(a)〜(1)に対応
している。
通常の良好な受信状態においては、入力端子20からの
制御信号(C)がローレベルであるとインバータ21の
出力(d)はハイレベルになっている・。
制御信号(C)がローレベルであるとインバータ21の
出力(d)はハイレベルになっている・。
この時、アナログスイッチ12は端子aに接続しており
、ビデオ信号(a)はバッファアンプ24を介してその
ままビデオ出力(1)として出力される。
、ビデオ信号(a)はバッファアンプ24を介してその
ままビデオ出力(1)として出力される。
また、入力されるビデオ信号はバッファアンプ13を介
してフィールドメモリ回路18.19に供給される。そ
して、インバータ21の出力(d)がハイレベルである
為にスイッチ回路17はオンしており、垂直同期分離回
路14の出力(b)はそのままフィールドメモリ回路1
8.19の垂直同期(V)パルス入力端子に供給される
。■パルスの入力によりフィールドメモリ回路19はA
D/CL R端子より■パルスに同期した30H7でデ
ユーティが1:1の矩形波信号(アドレスクリア信Q)
(f)を出力する。データラッチ回路22は、アドレス
クリア信号(f)をデータ入力としてデータ入力と同相
の信号(0)をQ端子に、反転出力(h)を互端子に出
力する。ラッチ出力(a)及び(h)はそれぞれフィー
ルドメモリ回路18.19のm込み/読出し制御入力端
子R/Wに加えられる。その結果、フィールドメモリ回
路18.19はv周期でS込み<W)及び読出しくR)
が交互に行なわれ、且つ一方のメモリ回路が書込み状態
の時他方のメモリ回路が読出す動作を行う。このように
2つのフィールドメモリ回路18.19を交互に動作さ
せることにより、信号(f)のT1のタイミングではメ
モリ回路18は書込みモード、メモリ回路19は読出し
モードとなる為、メモリ回路18の出力にはmのように
ビデオ入力(a)のイに対応した信号がそのまま出力さ
れ、メモリ回路19の出力(j)には1■前に書込まれ
たビデオ信号(斜線部にて示す)が読出される。そして
、次ぎのT2のタイミングでは、メモリ回路18.19
の書込み/読出しが反転する為、メモリ回路18の出力
(i)にはタイミングT1で書込まれたビデオ信号イが
イ′として読出される一方、メモリ回路19の出力(j
)にはビデオ入力(a)の口がそのまま出力される。そ
して、メモリ回路18.19のビデオ出力(i) 、(
j)はアナログスイッチ23を介して常に1■遅れのメ
モリ出力(イ′1ロ′等の斜線部)のみが選択されビデ
オ出力ih)として出力される。
してフィールドメモリ回路18.19に供給される。そ
して、インバータ21の出力(d)がハイレベルである
為にスイッチ回路17はオンしており、垂直同期分離回
路14の出力(b)はそのままフィールドメモリ回路1
8.19の垂直同期(V)パルス入力端子に供給される
。■パルスの入力によりフィールドメモリ回路19はA
D/CL R端子より■パルスに同期した30H7でデ
ユーティが1:1の矩形波信号(アドレスクリア信Q)
(f)を出力する。データラッチ回路22は、アドレス
クリア信号(f)をデータ入力としてデータ入力と同相
の信号(0)をQ端子に、反転出力(h)を互端子に出
力する。ラッチ出力(a)及び(h)はそれぞれフィー
ルドメモリ回路18.19のm込み/読出し制御入力端
子R/Wに加えられる。その結果、フィールドメモリ回
路18.19はv周期でS込み<W)及び読出しくR)
が交互に行なわれ、且つ一方のメモリ回路が書込み状態
の時他方のメモリ回路が読出す動作を行う。このように
2つのフィールドメモリ回路18.19を交互に動作さ
せることにより、信号(f)のT1のタイミングではメ
モリ回路18は書込みモード、メモリ回路19は読出し
モードとなる為、メモリ回路18の出力にはmのように
ビデオ入力(a)のイに対応した信号がそのまま出力さ
れ、メモリ回路19の出力(j)には1■前に書込まれ
たビデオ信号(斜線部にて示す)が読出される。そして
、次ぎのT2のタイミングでは、メモリ回路18.19
の書込み/読出しが反転する為、メモリ回路18の出力
(i)にはタイミングT1で書込まれたビデオ信号イが
イ′として読出される一方、メモリ回路19の出力(j
)にはビデオ入力(a)の口がそのまま出力される。そ
して、メモリ回路18.19のビデオ出力(i) 、(
j)はアナログスイッチ23を介して常に1■遅れのメ
モリ出力(イ′1ロ′等の斜線部)のみが選択されビデ
オ出力ih)として出力される。
次に、タイミングT3の途中でビデオ信号(a)が八か
ら二のように劣化した場合、信号劣化検出回路の出力即
ち制御入力(C)はローレベルからハイレベルに変化す
る為、インバータ21の出力(d)はハイレベルからロ
ーレベルへ変化づる。これを受けて、データラッチ回路
22はQ、?l)出力状態をラッチし、データ入力(f
>に無関係となる。この為、ビデオ入力(a)が劣化し
始めたタイミングT3からその劣化状態が回復するタイ
ミングT5までメモリ回路18は内込みモードとなり、
劣化したビデオ信号をそのまま出力Jる一方、メモリ回
路19は読出しモードに固定される為、入力信号劣化の
1v前に書込んだビデオ信号口をメモリ19から読出し
ol(斜線部)の形で出力し続ける。
ら二のように劣化した場合、信号劣化検出回路の出力即
ち制御入力(C)はローレベルからハイレベルに変化す
る為、インバータ21の出力(d)はハイレベルからロ
ーレベルへ変化づる。これを受けて、データラッチ回路
22はQ、?l)出力状態をラッチし、データ入力(f
>に無関係となる。この為、ビデオ入力(a)が劣化し
始めたタイミングT3からその劣化状態が回復するタイ
ミングT5までメモリ回路18は内込みモードとなり、
劣化したビデオ信号をそのまま出力Jる一方、メモリ回
路19は読出しモードに固定される為、入力信号劣化の
1v前に書込んだビデオ信号口をメモリ19から読出し
ol(斜線部)の形で出力し続ける。
そして、タイミングT5内でビデオ入力の劣化がなくな
ると信号劣化検出回路からの出力によるti11tlI
l入力は通常モードのローレベルに戻る為、データラッ
チ回路22も動き出しデータ入力(f)に従った01口
出力をし、メモリ回路18.19も門込み/読出しを1
■毎に繰返す動作に戻り、タイミングT6においてメモ
リ回路18はタイミングT5で書込まれたビデオ入力へ
及びトを読出しへ′及びト′として出力するとともにメ
モリ回路19は店込みモードの為入力信号(a)をその
まま通した信号チを出力する。
ると信号劣化検出回路からの出力によるti11tlI
l入力は通常モードのローレベルに戻る為、データラッ
チ回路22も動き出しデータ入力(f)に従った01口
出力をし、メモリ回路18.19も門込み/読出しを1
■毎に繰返す動作に戻り、タイミングT6においてメモ
リ回路18はタイミングT5で書込まれたビデオ入力へ
及びトを読出しへ′及びト′として出力するとともにメ
モリ回路19は店込みモードの為入力信号(a)をその
まま通した信号チを出力する。
以上のようにしてアナログスイッチ23のメモリ出力と
してのビデオ信号は419079口′。
してのビデオ信号は419079口′。
口′、へ′、ト′ のように全て1フイールド前に書込
まれたビデオ信号を読出したものを基本とし、制御入力
(C)がハイレベルになっている期間は読出された信号
内容が同一なものとなる。
まれたビデオ信号を読出したものを基本とし、制御入力
(C)がハイレベルになっている期間は読出された信号
内容が同一なものとなる。
そこで、アナログスイッチ12にてビデオ信号(a)と
メモリ出力のビデオ信号(k)を制御入力(C)に基づ
くインバータ出力(d)により切換え選択することによ
り、最終的なバッファ24のビデオ出力(1)はビデオ
入力(a)にお番プる信号劣化期間Td (制御信号
(C)において示す)のみ、劣化直前のタイミングT2
で書込まれた良好なビデオ信号を読出したちのO′で補
間されたものとなる。
メモリ出力のビデオ信号(k)を制御入力(C)に基づ
くインバータ出力(d)により切換え選択することによ
り、最終的なバッファ24のビデオ出力(1)はビデオ
入力(a)にお番プる信号劣化期間Td (制御信号
(C)において示す)のみ、劣化直前のタイミングT2
で書込まれた良好なビデオ信号を読出したちのO′で補
間されたものとなる。
ここで、ビデオ出力の時間的配列はイ11ロ、ハロ′1
ロ′0ロ′、ト、チ、・・・となるが、大部分のビデオ
信号においては前後のフィールドの絵柄と相関がある為
、八から口′へと逆戻りした場合はもちろんのこと、ロ
′1ロ′111011ロ′、トに不連続部が生じること
になるが、信号劣化期間Tdが短ければ不自然さは少な
い。
ロ′0ロ′、ト、チ、・・・となるが、大部分のビデオ
信号においては前後のフィールドの絵柄と相関がある為
、八から口′へと逆戻りした場合はもちろんのこと、ロ
′1ロ′111011ロ′、トに不連続部が生じること
になるが、信号劣化期間Tdが短ければ不自然さは少な
い。
なお、ビデオ入力が劣化した時、■分離出力(b)には
本来の■同期信号以外にもノイズやゴーストによりパル
スが出力される為、そのままメモリ回路18.19の■
パルス入力とすると書込み/読出しの切換え動作のタイ
ミングが乱され、メモリ出力のV周期が1v毎に変動し
画面上では同期のがたつき現象となって現れる。そこで
、本発明では、■分離出力とメモリ回路の間にスイッチ
回路17を設け、ビデオ信号(a)の劣化に伴い制御入
力(C)がハイレベルになった時はスイッチ回路17を
オフとし、ノイズを含む■パルスがメモリ回路に入力さ
れないようにしている。■パルスが入力されない場合は
メモリ回路内の疑似カウン夕にてアドレスクリア出力m
が出力される為動作上支障は無い。
本来の■同期信号以外にもノイズやゴーストによりパル
スが出力される為、そのままメモリ回路18.19の■
パルス入力とすると書込み/読出しの切換え動作のタイ
ミングが乱され、メモリ出力のV周期が1v毎に変動し
画面上では同期のがたつき現象となって現れる。そこで
、本発明では、■分離出力とメモリ回路の間にスイッチ
回路17を設け、ビデオ信号(a)の劣化に伴い制御入
力(C)がハイレベルになった時はスイッチ回路17を
オフとし、ノイズを含む■パルスがメモリ回路に入力さ
れないようにしている。■パルスが入力されない場合は
メモリ回路内の疑似カウン夕にてアドレスクリア出力m
が出力される為動作上支障は無い。
また、チャンネル切換え時については、マイコンを用い
た選局システムであれば、予めミュートを掛けた後にチ
ャンネル切換えを行い、切換え動作終了復にミュート解
除することが一般的である為、このミュート信号を前記
メモリ回路の制御入力(C)と1にとにより第3図(C
)におけるTdはチャンネル切換えに伴う信号の乱れる
期間より幅広くなる為に、信号劣化検出の為の時間遅れ
の問題も全く無関係となり非常に安定した画像が得られ
る。更に、オートサーチ選局時は、ミュートを掛けてか
ら実際のチャンネルアップダウン動作に移り、無信号チ
11ンネルの掃引中はミュートが掛かり続け、有信号チ
ャンネルを選局し掃引停止後にミュート解除になる為、
掃引中はオートサーブ開始直前の画面が静止画として安
定に得られ、スノーノイズ画面や微弱電界チャンネル通
過時の同期乱れ等の不快な画面を一掃することができる
。
た選局システムであれば、予めミュートを掛けた後にチ
ャンネル切換えを行い、切換え動作終了復にミュート解
除することが一般的である為、このミュート信号を前記
メモリ回路の制御入力(C)と1にとにより第3図(C
)におけるTdはチャンネル切換えに伴う信号の乱れる
期間より幅広くなる為に、信号劣化検出の為の時間遅れ
の問題も全く無関係となり非常に安定した画像が得られ
る。更に、オートサーチ選局時は、ミュートを掛けてか
ら実際のチャンネルアップダウン動作に移り、無信号チ
11ンネルの掃引中はミュートが掛かり続け、有信号チ
ャンネルを選局し掃引停止後にミュート解除になる為、
掃引中はオートサーブ開始直前の画面が静止画として安
定に得られ、スノーノイズ画面や微弱電界チャンネル通
過時の同期乱れ等の不快な画面を一掃することができる
。
[発明の効果]
以上述べたように本発明によれば、チャンネル切換え時
の画像乱れやスノーノイズ状態を解消することができる
上、車載用テレビジョン受像機のように移動受信による
障害物やトンネル通過時などに生じるスノーノイズや同
期乱れを無くし、常に安定なテレビジョン画像を得るこ
とができる。
の画像乱れやスノーノイズ状態を解消することができる
上、車載用テレビジョン受像機のように移動受信による
障害物やトンネル通過時などに生じるスノーノイズや同
期乱れを無くし、常に安定なテレビジョン画像を得るこ
とができる。
第1図は本発明の一実施例のテレビジョン画像処理装置
を示づブロック図、第2図は第1図の具体的な回路構成
を示すブロック図、第3図は第2図の回路動作を説明す
るタイミングブーヤードである。 1・・・ビデオ信号入力端子、2・・・スイッチ回路、
3・・・メモリ回路、4・・・制御信号入力端子、5・
・・ビデオ信号出力端子。 卸IKu入か 第20 第3図
を示づブロック図、第2図は第1図の具体的な回路構成
を示すブロック図、第3図は第2図の回路動作を説明す
るタイミングブーヤードである。 1・・・ビデオ信号入力端子、2・・・スイッチ回路、
3・・・メモリ回路、4・・・制御信号入力端子、5・
・・ビデオ信号出力端子。 卸IKu入か 第20 第3図
Claims (1)
- 【特許請求の範囲】 入力として供給されるビデオ信号をフィールド毎に交互
に書込み、読出しを行う2つのフィールドメモリで構成
され、信号劣化検出信号にて前記2つのフィールドメモ
リの交互の書込み、読出しを停止し、信号劣化直前の1
フィールド分を読出す記憶手段と、 前記の入力されるビデオ信号が一方の入力端に供給され
、前記記憶手段から読出されるビデオ信号がもう一方の
入力端に供給され、これらの入力端を信号劣化検出信号
にて選択的に切換えて、出力端に信号劣化の無いビデオ
信号を得る切換手段と、 前記の入力されるビデオ信号が、チャンネル切換え時や
受信条件の悪化時に、チャンネル切換えに同期した信号
を得るか又は信号劣化を検出することにより信号劣化検
出信号を得、前記記憶手段及び前記切換手段に供給する
信号劣化検出手段と、を具備したことを特徴とするテレ
ビジョン画像処理回路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP63116675A JP2618976B2 (ja) | 1988-05-12 | 1988-05-12 | テレビジョン画像処理装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP63116675A JP2618976B2 (ja) | 1988-05-12 | 1988-05-12 | テレビジョン画像処理装置 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH01286587A true JPH01286587A (ja) | 1989-11-17 |
JP2618976B2 JP2618976B2 (ja) | 1997-06-11 |
Family
ID=14693100
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP63116675A Expired - Fee Related JP2618976B2 (ja) | 1988-05-12 | 1988-05-12 | テレビジョン画像処理装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP2618976B2 (ja) |
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0271685A (ja) * | 1988-09-07 | 1990-03-12 | Hitachi Ltd | 映像機器 |
US5311317A (en) * | 1991-04-19 | 1994-05-10 | Sony Corporation | Video signal processing apparatus for displaying stored video signal during channel selection |
WO2018207477A1 (ja) * | 2017-05-09 | 2018-11-15 | 株式会社ソシオネクスト | 中継装置 |
Citations (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS53126212A (en) * | 1977-04-11 | 1978-11-04 | Hitachi Ltd | Channel selector |
JPS62145972A (ja) * | 1985-12-19 | 1987-06-30 | Mitsubishi Electric Corp | テレビジヨン受像機 |
JPS62160883A (ja) * | 1986-01-09 | 1987-07-16 | Mitsubishi Electric Corp | テレビ受信機 |
-
1988
- 1988-05-12 JP JP63116675A patent/JP2618976B2/ja not_active Expired - Fee Related
Patent Citations (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS53126212A (en) * | 1977-04-11 | 1978-11-04 | Hitachi Ltd | Channel selector |
JPS62145972A (ja) * | 1985-12-19 | 1987-06-30 | Mitsubishi Electric Corp | テレビジヨン受像機 |
JPS62160883A (ja) * | 1986-01-09 | 1987-07-16 | Mitsubishi Electric Corp | テレビ受信機 |
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0271685A (ja) * | 1988-09-07 | 1990-03-12 | Hitachi Ltd | 映像機器 |
US5311317A (en) * | 1991-04-19 | 1994-05-10 | Sony Corporation | Video signal processing apparatus for displaying stored video signal during channel selection |
WO2018207477A1 (ja) * | 2017-05-09 | 2018-11-15 | 株式会社ソシオネクスト | 中継装置 |
Also Published As
Publication number | Publication date |
---|---|
JP2618976B2 (ja) | 1997-06-11 |
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Legal Events
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LAPS | Cancellation because of no payment of annual fees |