JPH01235643A - カラーハードコピーのビデオインターフェイス回路 - Google Patents
カラーハードコピーのビデオインターフェイス回路Info
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- JPH01235643A JPH01235643A JP63064380A JP6438088A JPH01235643A JP H01235643 A JPH01235643 A JP H01235643A JP 63064380 A JP63064380 A JP 63064380A JP 6438088 A JP6438088 A JP 6438088A JP H01235643 A JPH01235643 A JP H01235643A
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- Japan
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- memory device
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- Pending
Links
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- 238000010586 diagram Methods 0.000 description 11
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- PEDCQBHIVMGVHV-UHFFFAOYSA-N Glycerine Chemical compound OCC(O)CO PEDCQBHIVMGVHV-UHFFFAOYSA-N 0.000 description 1
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Landscapes
- Dot-Matrix Printers And Others (AREA)
- Color, Gradation (AREA)
- Digital Computer Display Output (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
この発明は、カラーの映像信号から、カラーのプリント
を得るカラーハードコピー装置に関する。
を得るカラーハードコピー装置に関する。
映像信号からカラーハードコピーを得るビデオインター
フェイス回路において、画像記憶装置の構造を、階調方
向に深みをもたせた構造にし、階調データとして記憶で
きるようにし、画像記憶装置から読み出した階調データ
を面積階調のパターンに展開できる手段をもたせること
により、多階調のデータ処理であっても、画像記憶装置
の大きさを必要最小限に抑えるものである。
フェイス回路において、画像記憶装置の構造を、階調方
向に深みをもたせた構造にし、階調データとして記憶で
きるようにし、画像記憶装置から読み出した階調データ
を面積階調のパターンに展開できる手段をもたせること
により、多階調のデータ処理であっても、画像記憶装置
の大きさを必要最小限に抑えるものである。
多階調をもった映像信号から、カラーハードコピーを得
る場合、熱転写方式のカラープリンタでは、1ドツトの
濃淡表現が困難なため、面積階調法を用いてカラー表現
を行うのが普通である。従来、映像信号の記憶手段には
、面積階調にあらかじめ展開した記憶装置をもたせ、印
字データと記憶装置のデータが1対1に対応していた。
る場合、熱転写方式のカラープリンタでは、1ドツトの
濃淡表現が困難なため、面積階調法を用いてカラー表現
を行うのが普通である。従来、映像信号の記憶手段には
、面積階調にあらかじめ展開した記憶装置をもたせ、印
字データと記憶装置のデータが1対1に対応していた。
近年、カラーハードコピー装置の解像度が上昇し、4X
4.6X6といったマトリクスの面積階調法によるカラ
ー表現が可能になってきた0例えば、6×6のマトリク
スの面積階調を行うには、36階調のデータとして扱う
必要がある。そして従来の方式では、1画素を表現する
のに、36個の記憶素子が必要になる。多階調データを
扱うと、記憶装置が膨大になる。
4.6X6といったマトリクスの面積階調法によるカラ
ー表現が可能になってきた0例えば、6×6のマトリク
スの面積階調を行うには、36階調のデータとして扱う
必要がある。そして従来の方式では、1画素を表現する
のに、36個の記憶素子が必要になる。多階調データを
扱うと、記憶装置が膨大になる。
そこでこの発明の目的は、従来のこのような欠点を解決
するため、多階調データであっても、記憶装置を太き(
することなく、また、少ない階調データでも、同様にし
て扱えるビデオインターフェイスを得ることにある。
するため、多階調データであっても、記憶装置を太き(
することなく、また、少ない階調データでも、同様にし
て扱えるビデオインターフェイスを得ることにある。
上記課題を解決するために、この発明は記憶装置の構造
を階調方向に深みをもたせた構造にし、階調データとし
て記憶できるようにしたものである。そして、前記記憶
装置から読み出した階調データを面積階調のパターンと
比較し、印字データに展開できる手段をもたせたもので
ある。
を階調方向に深みをもたせた構造にし、階調データとし
て記憶できるようにしたものである。そして、前記記憶
装置から読み出した階調データを面積階調のパターンと
比較し、印字データに展開できる手段をもたせたもので
ある。
上記の記憶装置では、多階調データは、2進数データと
なるため、例えば、上記36階調でも6ビソトで扱え、
このため記憶装置は従来方式に比べて、176の大きさ
で処理することができる。
なるため、例えば、上記36階調でも6ビソトで扱え、
このため記憶装置は従来方式に比べて、176の大きさ
で処理することができる。
以下にこの発明の詳細な説明する。
第1図において、R,G、 B映像信号は、セレクタ
lによりR,G、Bのいずれかの信号が選択され、コン
パレータ3の子端子に人力される。コンパレータ3の一
端子には、D/Aコンバータ2により、しきい値電圧が
印加される。画像記憶装置5にはコンパレータ3からの
出力信号と、CPU4から階調データが与えられる。R
OM 8は、面積階調パターンを格納している。印字時
には、画像記憶装置5から読み出した値を減算回路6に
より減算処理を施し、ROM8の値と比較する比較回路
7を介して、サーマルヘッド9に信号を供給する。
lによりR,G、Bのいずれかの信号が選択され、コン
パレータ3の子端子に人力される。コンパレータ3の一
端子には、D/Aコンバータ2により、しきい値電圧が
印加される。画像記憶装置5にはコンパレータ3からの
出力信号と、CPU4から階調データが与えられる。R
OM 8は、面積階調パターンを格納している。印字時
には、画像記憶装置5から読み出した値を減算回路6に
より減算処理を施し、ROM8の値と比較する比較回路
7を介して、サーマルヘッド9に信号を供給する。
第2図は16階調の処理に対応して4ビツトの階調ビッ
トを備えた画像記憶装置の構造説明図である。aで示し
た部分は、階調ビット1のメモリブレーンでブレーンの
中はR,G、 Bに区分されている。ここではaのメ
モリプレーンが4枚積み重なっている。CPU4からの
階調データは画像記憶装置5の階調ビット1〜4に接続
される。コンパレータ3の出力が 「高」信号の場合に
階調データの書き込みを行う。
トを備えた画像記憶装置の構造説明図である。aで示し
た部分は、階調ビット1のメモリブレーンでブレーンの
中はR,G、 Bに区分されている。ここではaのメ
モリプレーンが4枚積み重なっている。CPU4からの
階調データは画像記憶装置5の階調ビット1〜4に接続
される。コンパレータ3の出力が 「高」信号の場合に
階調データの書き込みを行う。
第3図はコンパレータ3の子端子に印加されるs、t、
u、vというレベルをもった映像信号の例を示す説明図
である。縦軸は、映像信号の振幅を示す。各レベルの振
幅値は、s=0+ t=4.5u=13.5 v=
7.sとする。Wはコンパレータ3の一端子に印加され
るしきい(l!雷電圧示し、振幅値lを示している。
u、vというレベルをもった映像信号の例を示す説明図
である。縦軸は、映像信号の振幅を示す。各レベルの振
幅値は、s=0+ t=4.5u=13.5 v=
7.sとする。Wはコンパレータ3の一端子に印加され
るしきい(l!雷電圧示し、振幅値lを示している。
第4図は、16階調による映像信号の画像記憶装置への
書き込みにおいて、映像信号のs、t、u。
書き込みにおいて、映像信号のs、t、u。
■に対応した記憶素子の内容が、しきい値電圧が順次上
昇させていく手順による書き込みにより、遷移していく
様子を示した説明図である。
昇させていく手順による書き込みにより、遷移していく
様子を示した説明図である。
まず、階調データを0にし、全ての記憶素子に書き込む
、これは、記憶装置のイニシャライズに相当する。(K
部参照) 次に、階調データを「1」にして書き込む。しきい値電
圧は、第3図のWに相当する。
、これは、記憶装置のイニシャライズに相当する。(K
部参照) 次に、階調データを「1」にして書き込む。しきい値電
圧は、第3図のWに相当する。
映像信号の8部は、しきい値電圧より低いため8部記憶
素子の内容はOのまま変わらない。t。
素子の内容はOのまま変わらない。t。
u、v部は、「高」のためt、u、v記憶素子の内容は
「1」に書き変わる。(1部参照)このように階調デー
タと、それに対応したしきい値電圧を順次上昇させ、そ
の都度「高」の部分の記憶素子の内容を階調データの値
に書き変えていく。最大値の階調データ16まで手順を
実行するとmの内容となる。この手順によって映像信号
の振幅に対応した階調データが画像記憶装置5に記憶さ
れる。
「1」に書き変わる。(1部参照)このように階調デー
タと、それに対応したしきい値電圧を順次上昇させ、そ
の都度「高」の部分の記憶素子の内容を階調データの値
に書き変えていく。最大値の階調データ16まで手順を
実行するとmの内容となる。この手順によって映像信号
の振幅に対応した階調データが画像記憶装置5に記憶さ
れる。
印字時には、mの値を減算回路6によってしきい値の最
大値(この場合は16)から減算する。
大値(この場合は16)から減算する。
s、t、u、vの値は5=16 t=12 u=3
v=9に変換される。この変換は減色混合のRlG、
B信号と、加色混合のYMCが補色の関係にあるから
である。
v=9に変換される。この変換は減色混合のRlG、
B信号と、加色混合のYMCが補色の関係にあるから
である。
第5図は、4×4面積階調パターン説明図である。数字
はしきい値を示している。上記s、t。
はしきい値を示している。上記s、t。
u、vの値は、本パターンのしきい値と順次比較される
。例えば、t=12の場合、本パターン上で12以下の
しきい値の部分において、サーマルヘッド7に電流を流
す。
。例えば、t=12の場合、本パターン上で12以下の
しきい値の部分において、サーマルヘッド7に電流を流
す。
第6図は、s、t、u、v部が4×4面積階調として印
字された例を示す説明図である。図面中で黒く塗り潰し
た所に、インクが塗布される。
字された例を示す説明図である。図面中で黒く塗り潰し
た所に、インクが塗布される。
本実施例では画像記憶装置の構造を、RGBにし読み出
しでYMCに変換したのが、画像記憶装置をYMCにし
ても、同様の方式により実現できる。また階調ビット数
を6にすれば64階調の処理まで行える。
しでYMCに変換したのが、画像記憶装置をYMCにし
ても、同様の方式により実現できる。また階調ビット数
を6にすれば64階調の処理まで行える。
この発明は以上説明したように、画像記憶装置を階調ビ
ット構造にすることにより、多階調データでも、記憶装
置の大きさが極端に大きくならない。また、階調ビット
の選択は、記憶装置の大小だけの差となり、周辺回路を
共通にできる。このため、単色から多色の表現を同一の
回路構成により安価に供給できるという効果がある。
ット構造にすることにより、多階調データでも、記憶装
置の大きさが極端に大きくならない。また、階調ビット
の選択は、記憶装置の大小だけの差となり、周辺回路を
共通にできる。このため、単色から多色の表現を同一の
回路構成により安価に供給できるという効果がある。
第1図はこの発明にかかるビデオインターフェイスのブ
ロック図、第2図は画像記憶装置の構造説明図、第3図
は映像信号説明図、第4図は記憶素子の内容の遷移説明
図、第5図は4×4面積階調パターン説明図、第6図は
印字例を示す説明図である。 2・・・D/Aコンバータ 3・・・コンパレータ 5・・・画像記憶装置 6・・・減算回路 7・・・比較回路 8・・・面積階調パターン格納したR OM以上 出願人 セイコー電子工業株式会社 ビテオイノ7−フエfスのフ゛0.77図第1 図 ’stag己億)1且p)も1.造訟5月〔コ
9り己1交1占号シ呂宅日月[]
332図 第3図 アトレス 1 ロΣ:ロ=口]コー−−−−Q 6 匡コニ[I 第5図 13 ロ]ゴmコ 印3図例の言え一図
14 [Em工■■コ 第6図言己
J?禾ゴ 〆]円谷の遷才多只えB月図第4図
ロック図、第2図は画像記憶装置の構造説明図、第3図
は映像信号説明図、第4図は記憶素子の内容の遷移説明
図、第5図は4×4面積階調パターン説明図、第6図は
印字例を示す説明図である。 2・・・D/Aコンバータ 3・・・コンパレータ 5・・・画像記憶装置 6・・・減算回路 7・・・比較回路 8・・・面積階調パターン格納したR OM以上 出願人 セイコー電子工業株式会社 ビテオイノ7−フエfスのフ゛0.77図第1 図 ’stag己億)1且p)も1.造訟5月〔コ
9り己1交1占号シ呂宅日月[]
332図 第3図 アトレス 1 ロΣ:ロ=口]コー−−−−Q 6 匡コニ[I 第5図 13 ロ]ゴmコ 印3図例の言え一図
14 [Em工■■コ 第6図言己
J?禾ゴ 〆]円谷の遷才多只えB月図第4図
Claims (1)
- 映像信号を複数のしきい値により2値に変換する手段と
、2値に変換された信号を、映像信号の階調データとし
て記憶する記憶装置と、上記記憶装置から階調データを
読み出し、面積階調の印字データに展開する手段と、映
像信号を階調データとして記憶し、印字時に印字データ
に展開することを特徴とするカラーハードコピー装置の
ビデオインターフェイス回路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP63064380A JPH01235643A (ja) | 1988-03-17 | 1988-03-17 | カラーハードコピーのビデオインターフェイス回路 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP63064380A JPH01235643A (ja) | 1988-03-17 | 1988-03-17 | カラーハードコピーのビデオインターフェイス回路 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH01235643A true JPH01235643A (ja) | 1989-09-20 |
Family
ID=13256644
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP63064380A Pending JPH01235643A (ja) | 1988-03-17 | 1988-03-17 | カラーハードコピーのビデオインターフェイス回路 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH01235643A (ja) |
-
1988
- 1988-03-17 JP JP63064380A patent/JPH01235643A/ja active Pending
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