JPH01205527A - 投影露光方法 - Google Patents

投影露光方法

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Publication number
JPH01205527A
JPH01205527A JP63030313A JP3031388A JPH01205527A JP H01205527 A JPH01205527 A JP H01205527A JP 63030313 A JP63030313 A JP 63030313A JP 3031388 A JP3031388 A JP 3031388A JP H01205527 A JPH01205527 A JP H01205527A
Authority
JP
Japan
Prior art keywords
photomask
alignment
mark
semiconductor substrate
marks
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP63030313A
Other languages
English (en)
Inventor
Tomonori Sawano
沢野 知紀
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
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Filing date
Publication date
Application filed by NEC Corp filed Critical NEC Corp
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Publication of JPH01205527A publication Critical patent/JPH01205527A/ja
Pending legal-status Critical Current

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Landscapes

  • Manufacture Or Reproduction Of Printing Formes (AREA)
  • Exposure And Positioning Against Photoresist Photosensitive Materials (AREA)
  • Container, Conveyance, Adherence, Positioning, Of Wafer (AREA)
  • Exposure Of Semiconductors, Excluding Electron Or Ion Beam Exposure (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は半導体装置の製造方法に関し、特に投影露光装
置によるホ1へマスクの合せ方法に関する。
〔従来の技術〕
従来、この種の投影露光装置によるホトマスクの合せは
先行する工程で半導体基板上に形成された単一のフライ
メン1−マークを検出し、該アライメントマークに対し
て誤差がOになるようにホトマスクの合せを行っていた
。第2図でこの説明を行う。
半導体基板1上に第1のホl−マスクによって作られる
第」−のプライメン1〜マーク2と第1のプライメン1
〜マーク2を利用して合せを行う第2のホトマスクによ
って作られる第2のアライメントマーク3がある。第3
のホトマスクを第2のホl−マスクに対して合せる際に
、第2のアライメントマーク3の座標を検出し、それに
対して誤差Oとなるような第3のホトマスクの合せを行
う位置4を求めることが必要であるか、この位置は第j
のホ1へマスクによるアライメントマーク2に対して第
1及び第2のアライメントマーク1と2の誤差を含んで
いる。
〔発明か解決しようとする課題〕
上述した従来のホトマスク合せ方法では、合せ毎に生し
る幾つかの誤差を補正する方法がないので、誤差は単純
に累積していくという欠点がある。
本発明の目的は前記課題を解決した投影露光方法を提供
することにある。
〔発明の従来技術に対する相違点〕
」二連した従来の合せ方法に列し、本発明は先行する複
数の工程で半導体基板上に形成された複数のプライメン
1〜マークを同時に検出してホ1−マクスの合せを行う
という相違点を有する。
〔課題螢解決するための手段〕
上記1」的を達成するため、本発明は投影露光方法にお
いては、半導体基板」−に形成された第1のホI−マス
クによる第1のアライメントマークと第2のホI−マス
クによる第2のアライメントマークの座標を同時に検出
し、その検出した座標から第3のホトマスクを合せる最
適座標を計算し、ホトマスクの合せを行うものである。
〔実施例〕
次に、本発明について図面を参照して説明する。
第1図は本発明の一実施例を説明する図である。
半導体基板]−Hに第1のホトマスクによって作られる
第1のフライメン1ヘマーク2と、第コ−のアライメン
1へマークを利用して合せを行う第2のホl−マスクに
よって作られる第2のプライメン1〜マーク3がある。
本発明は第1−のプライメン1〜マーク2及び第2のフ
ライメン1ヘマーク3を同時に検出することにより第1
のホ1−マスクに列する第2のホ1−マスクの基板上で
の合せ誤差を求め、第1のホl−マスク及び第2のホト
マスクに対する誤差を最小にするような第3のポ1ヘマ
スクの合せを行う位置4を求めるものである。
本発明によれは、ホトマスクの合せは先行する工程での
複数のアライメン)へマークを利用するため、先行する
工程における合せ誤差を最小限に抑えることが可能とな
る。
〔発明の効果J 以上説明したように本発明は、ホl−マスクの合せを行
う際に検出するパターンとして先行する工程で半導体基
板上に作られた複数のプライメン1〜マークを利用する
ことにより、先行する工程に対する合せ誤差位少なくす
ることができるという効果かある。
【図面の簡単な説明】
第1 I’、/Iは本発明の一実施例を説明する平面図
、第2図は従来例を説明する平面図である。 1 ・半導体基板

Claims (1)

    【特許請求の範囲】
  1. 1、半導体基板上に形成された第1のホトマスクによる
    第1のアライメントマークと第2のホトマスクによる第
    2のアライメントマークの座標を同時に検出し、その検
    出した座標から第3のホトマスクを合せる最適座標を計
    算し、ホトマスクの合せを行うことを特徴とする投影露
    光方法。
JP63030313A 1988-02-12 1988-02-12 投影露光方法 Pending JPH01205527A (ja)

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