JPH01176146A - 有効領域判定信号発生回路 - Google Patents
有効領域判定信号発生回路Info
- Publication number
- JPH01176146A JPH01176146A JP62336101A JP33610187A JPH01176146A JP H01176146 A JPH01176146 A JP H01176146A JP 62336101 A JP62336101 A JP 62336101A JP 33610187 A JP33610187 A JP 33610187A JP H01176146 A JPH01176146 A JP H01176146A
- Authority
- JP
- Japan
- Prior art keywords
- signal
- point position
- area determination
- signal point
- effective area
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
Links
- 230000007274 generation of a signal involved in cell-cell signaling Effects 0.000 claims description 18
- 238000000034 method Methods 0.000 claims description 17
- 238000004891 communication Methods 0.000 claims description 4
- 238000005070 sampling Methods 0.000 abstract description 3
- 238000010586 diagram Methods 0.000 description 11
- 238000005562 fading Methods 0.000 description 3
- 238000011084 recovery Methods 0.000 description 1
Landscapes
- Digital Transmission Methods That Use Modulated Carrier Waves (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
（産業上の利用分野）
本発明は有効領域判定信号発生回路に係り、特に、位相
平面上の信号点配置が階段状となるようにする高多値直
交振幅変調方式を採用するディジタル無線通信システム
における復調装置において用いられる有効領域判定信号
発生回路に関する。
平面上の信号点配置が階段状となるようにする高多値直
交振幅変調方式を採用するディジタル無線通信システム
における復調装置において用いられる有効領域判定信号
発生回路に関する。
（従来の技術）
周知のように、ディジタル無線通信においては、周波数
有効利用の観点から高多値の直交振幅変調（ＱＡＭ）方
式が採用されている。これには、６４ＱＡＭ方式や２５
６ ＱＡＭ方式等の各種のものがある、しかし、このＱ
ＡＭ方式は、例えば第７図に示す如く、位相平面上の信
号点配置態様が正方形となるので、高多値になるに従い
変調波のピーク電力対平均電力比が大きくなり、送信電
力増幅器等の非線形歪を受は易くなる。
有効利用の観点から高多値の直交振幅変調（ＱＡＭ）方
式が採用されている。これには、６４ＱＡＭ方式や２５
６ ＱＡＭ方式等の各種のものがある、しかし、このＱ
ＡＭ方式は、例えば第７図に示す如く、位相平面上の信
号点配置態様が正方形となるので、高多値になるに従い
変調波のピーク電力対平均電力比が大きくなり、送信電
力増幅器等の非線形歪を受は易くなる。
そこで、例えば第８図に示す如く、位相平面上の信号点
配置が階段状となるようにし、以てピーク電力の低減を
図るようにした直交振幅変調方式（５ＴＥＰ’ＰＥＤ−
５ＱＵＡＲＥ ＱＡＭ方式：以下、単にｒｓｓ−ＱＡＭ
Ｊ方式という）が提案されている（特開昭６１−７７４
５２号公報）、第８図は２５６ＳＳ−ＱＡＭ方式の信号
点配置を示し、最外殻信号点を結ぶ外形状は正８角形と
なっており、通常のＱＡＭ方式の正方形各頂点付近の信
号点を削除した形状となっている。
配置が階段状となるようにし、以てピーク電力の低減を
図るようにした直交振幅変調方式（５ＴＥＰ’ＰＥＤ−
５ＱＵＡＲＥ ＱＡＭ方式：以下、単にｒｓｓ−ＱＡＭ
Ｊ方式という）が提案されている（特開昭６１−７７４
５２号公報）、第８図は２５６ＳＳ−ＱＡＭ方式の信号
点配置を示し、最外殻信号点を結ぶ外形状は正８角形と
なっており、通常のＱＡＭ方式の正方形各頂点付近の信
号点を削除した形状となっている。
ところで、２５６ Ｓ Ｓ−ＱＡＭ変調波を正しく復調
するためには自動振幅制御信号（ＡＧＣ）、搬送波再生
信号（ＡＰＣ）、ＤＣオフセット制御信号および伝搬路
でのフェージング歪等を等化するトランスバーサル形等
化器のタップ制御信号等を生成するために、理想値から
の信号点のずれを表す誤差信号が必要となるが、トラン
スバーサル形等化器を含めた復調系全体が正しく引き込
まない間は正しい誤差信号が得られない、即ち、誤差信
号は第９図に示す如く各信号点の理想値からの上方向へ
のずれを“１”、下方向へのずれを０”として表現する
が、本来信号点位置Ｂで受かるべき信号が信号点位置Ａ
と同Ｂの中央の閾値を超えて信号点位置Ａ側に寄った信
号点位置Ｘで受信された場合、誤差信号は“°０”とな
るからこの誤差信号は信号点位置Ａで受かるべき信号が
下方にずれて受信されたことを示すことになり誤った誤
差信号である。この誤った誤差信号に基づいて生成した
制御信号で制御されるとトランスバーサル形等化器を含
めた復調系全体が発散してしまうので、このような場合
、従来では各制御信号を一旦初期値にリセットするよう
にし、そのリセット期間中、各制御信号の発生回路はそ
の動作を中止するようにしている。
するためには自動振幅制御信号（ＡＧＣ）、搬送波再生
信号（ＡＰＣ）、ＤＣオフセット制御信号および伝搬路
でのフェージング歪等を等化するトランスバーサル形等
化器のタップ制御信号等を生成するために、理想値から
の信号点のずれを表す誤差信号が必要となるが、トラン
スバーサル形等化器を含めた復調系全体が正しく引き込
まない間は正しい誤差信号が得られない、即ち、誤差信
号は第９図に示す如く各信号点の理想値からの上方向へ
のずれを“１”、下方向へのずれを０”として表現する
が、本来信号点位置Ｂで受かるべき信号が信号点位置Ａ
と同Ｂの中央の閾値を超えて信号点位置Ａ側に寄った信
号点位置Ｘで受信された場合、誤差信号は“°０”とな
るからこの誤差信号は信号点位置Ａで受かるべき信号が
下方にずれて受信されたことを示すことになり誤った誤
差信号である。この誤った誤差信号に基づいて生成した
制御信号で制御されるとトランスバーサル形等化器を含
めた復調系全体が発散してしまうので、このような場合
、従来では各制御信号を一旦初期値にリセットするよう
にし、そのリセット期間中、各制御信号の発生回路はそ
の動作を中止するようにしている。
（発明が解決しようとする問題点）
このように、従来のＳＳ−ＱＡＭ方式における復調装置
にあっては、復調系全体が正しく引き込まない間は正し
い制御信号による制御が行えないので各制御信号を初期
値にリセットする操作が必要であり、このリセット期間
中ではトランスバーサル形等化器はその等化動作を中止
することになる。そうすると、フェージング等によって
一旦同期外れを生じた場合には、フェージング歪が十分
に減少するまで復調系は引き込まず、この間トランスバ
ーサル形等化器は本来的に備える等化能力を発揮できな
いという問題点がある。
にあっては、復調系全体が正しく引き込まない間は正し
い制御信号による制御が行えないので各制御信号を初期
値にリセットする操作が必要であり、このリセット期間
中ではトランスバーサル形等化器はその等化動作を中止
することになる。そうすると、フェージング等によって
一旦同期外れを生じた場合には、フェージング歪が十分
に減少するまで復調系は引き込まず、この間トランスバ
ーサル形等化器は本来的に備える等化能力を発揮できな
いという問題点がある。
本発明は、このような問題点に鑑みなされたもので、そ
の目的は、ＳＳ−ＱＡＭ方式における復調装置において
、復調系が同期外れを生じても正しい制御信号の生成を
可能にする正しい誤差信号を取得できるようにするため
の有効領域判定信号発生回路を提供することにある。
の目的は、ＳＳ−ＱＡＭ方式における復調装置において
、復調系が同期外れを生じても正しい制御信号の生成を
可能にする正しい誤差信号を取得できるようにするため
の有効領域判定信号発生回路を提供することにある。
（問題点を解決するための手段）
前記問題点を解決するために、本発明の有効領域判定信
号発生回路は次の如き構成を有する。
号発生回路は次の如き構成を有する。
即ち、本発明の有効領域判定信号発生回路は、位相平面
上の信号点配置が偕段状となるようにする高多値直交振
幅変調方式を採用するディジタル無線通信システムにお
ける復調装置において用いられる有効領域判定信号発生
回路であって； この有効領域判定信号発生回路は、復
調装置において取得された互いに直交関係にあるＰチャ
ネルとＱチャネルの各ベースバンド信号のそれぞれにつ
いてディジタル化処理を行う第１および第２のＡ／Ｄ変
換器と； 前記第１および第２のＡ／Ｄ変換器の出力デ
ィジタル信号を受けてその出力ディジタル信号の標本点
位置における論理状態を検出しその論理状態が位相平面
上の前記階段状の信号点配置において最外殼信号点位置
の外側を示すとき有効領域判定信号を出力する有効領域
判定回路と； を備えたことを特徴とするものである。
上の信号点配置が偕段状となるようにする高多値直交振
幅変調方式を採用するディジタル無線通信システムにお
ける復調装置において用いられる有効領域判定信号発生
回路であって； この有効領域判定信号発生回路は、復
調装置において取得された互いに直交関係にあるＰチャ
ネルとＱチャネルの各ベースバンド信号のそれぞれにつ
いてディジタル化処理を行う第１および第２のＡ／Ｄ変
換器と； 前記第１および第２のＡ／Ｄ変換器の出力デ
ィジタル信号を受けてその出力ディジタル信号の標本点
位置における論理状態を検出しその論理状態が位相平面
上の前記階段状の信号点配置において最外殼信号点位置
の外側を示すとき有効領域判定信号を出力する有効領域
判定回路と； を備えたことを特徴とするものである。
（作 用）
次に、前記の如く構成される本発明の有効領域判定信号
発生回路の作用を説明する。
発生回路の作用を説明する。
位相平面上の信号点配置において、その配置領域内で得
られる誤差信号は第９図で示した如く誤りを含むが、配
置領域の外側、即ち最外殼信号点位置の外側で得られる
誤差信号はその最外殼信号点位置で受信されるべき信号
についての誤差信号であると言える点に着目し、本発明
では最外殼信号点位置の外側領域のみを有効領域と定め
るのである。
られる誤差信号は第９図で示した如く誤りを含むが、配
置領域の外側、即ち最外殼信号点位置の外側で得られる
誤差信号はその最外殼信号点位置で受信されるべき信号
についての誤差信号であると言える点に着目し、本発明
では最外殼信号点位置の外側領域のみを有効領域と定め
るのである。
このように、本発明の有効領域判定信号発生回路によれ
ば、復調装置において取得された互いに直交関係にある
ＰチャネルとＱチャネルの各ベースバンド信号のそれぞ
れについてディジタル化処理をし、その各ディジタル信
号の標本点位置における論理状態が位相平面上の階段状
の信号点配置において最外殼信号点位置の外側を示すと
き有効領域判定信号を出力するようにしたので、復調系
が同期外れを起こしていても正しい誤差信号を得ること
、つまり正しい制御信号を生成できるので、トランスバ
ーサル形等化器等の制御系を速やかに収束させることが
できる。故に、従来の如きリセット操作が不要となるか
ら、トランスバーサル形等化器は休止させることなくそ
の等化能力を発揮させることができる効果がある。
ば、復調装置において取得された互いに直交関係にある
ＰチャネルとＱチャネルの各ベースバンド信号のそれぞ
れについてディジタル化処理をし、その各ディジタル信
号の標本点位置における論理状態が位相平面上の階段状
の信号点配置において最外殼信号点位置の外側を示すと
き有効領域判定信号を出力するようにしたので、復調系
が同期外れを起こしていても正しい誤差信号を得ること
、つまり正しい制御信号を生成できるので、トランスバ
ーサル形等化器等の制御系を速やかに収束させることが
できる。故に、従来の如きリセット操作が不要となるか
ら、トランスバーサル形等化器は休止させることなくそ
の等化能力を発揮させることができる効果がある。
（実 施 例）
以下、本発明の実施例を図面を参照して説明する。
第１図は本発明の一実施例に係る有効領域判定信号発生
回路を示す、第１図において、１１．１２はＡ／Ｄ変換
器、１３は有効領域判定回路である。
回路を示す、第１図において、１１．１２はＡ／Ｄ変換
器、１３は有効領域判定回路である。
図外の復調装置で取得された互いに直交関係にあるＰチ
ャネルとＱチャネルの多値ベースバンド信号はそれぞれ
入力端子１．同２を介してＡ／Ｄ変換器１１．同１２へ
入力する。また入力端子３に印加されるクロック信号は
Ａ／Ｄ変換器１１゜同１２および有効領域判定回路１３
へ識別タイミング等を決定する動作クロックとして与え
られる。
ャネルとＱチャネルの多値ベースバンド信号はそれぞれ
入力端子１．同２を介してＡ／Ｄ変換器１１．同１２へ
入力する。また入力端子３に印加されるクロック信号は
Ａ／Ｄ変換器１１゜同１２および有効領域判定回路１３
へ識別タイミング等を決定する動作クロックとして与え
られる。
ここに、ＰチャネルとＱチャネルの多値ベースバンド信
号のそれぞれは、本実施例が２５６ＳＳ−ＱＡＭ方式（
第８図）を対象とするから、１８値の信号となる。
号のそれぞれは、本実施例が２５６ＳＳ−ＱＡＭ方式（
第８図）を対象とするから、１８値の信号となる。
Ａ／Ｄ変換器１１．同１２は、第２図に示す変換則に従
って入力信号（１８値のベースバンド信号）を７ビツト
の２値ディジタル信号（５ビツトのデータ信号（Ｄｔ〜
Ｄ５）と２ビツトの誤差信号（Ｅｌ、Ｅ２）からなる）
に変換し、それぞれの出力信号を有効領域判定回路１３
へ出力する。ここに、Ａ／Ｄ変換器１１はＰチャネルに
ついてのものであるから、その出力信号は５ビツトのデ
ータ信号Ｄ１２．同Ｄ２２．同り８２．同Ｄ４９．同Ｄ
５ｐおよび２ビツトの誤差信号Ｅ１２．同Ｅ２ｐからな
る。同様に、Ａ／Ｄ変換器１２はＱチャネルについての
ものであるから、その出力信号は５ビツトのデータ信号
Ｄ Ｉ＋ａ＋同Ｄ２Ｑ＋同Ｄ３ｑ、同Ｄ４９．同Ｄ５ｑ
および２ビツトの誤差信号Ｅ１ｑ、同Ｅ２．．からなる
。なお、誤差信号Ｅ１ｑ＋同Ｅｌｐは第９図で示したも
のと同一のものである。
って入力信号（１８値のベースバンド信号）を７ビツト
の２値ディジタル信号（５ビツトのデータ信号（Ｄｔ〜
Ｄ５）と２ビツトの誤差信号（Ｅｌ、Ｅ２）からなる）
に変換し、それぞれの出力信号を有効領域判定回路１３
へ出力する。ここに、Ａ／Ｄ変換器１１はＰチャネルに
ついてのものであるから、その出力信号は５ビツトのデ
ータ信号Ｄ１２．同Ｄ２２．同り８２．同Ｄ４９．同Ｄ
５ｐおよび２ビツトの誤差信号Ｅ１２．同Ｅ２ｐからな
る。同様に、Ａ／Ｄ変換器１２はＱチャネルについての
ものであるから、その出力信号は５ビツトのデータ信号
Ｄ Ｉ＋ａ＋同Ｄ２Ｑ＋同Ｄ３ｑ、同Ｄ４９．同Ｄ５ｑ
および２ビツトの誤差信号Ｅ１ｑ、同Ｅ２．．からなる
。なお、誤差信号Ｅ１ｑ＋同Ｅｌｐは第９図で示したも
のと同一のものである。
有効領域判定回路１３では、Ａ／Ｄ変換器１１と同１２
の各出力ディジタル信号を受けてその出力ディジタル信
号の標本点位置における論理状態を検出しその論理状態
が第８図に示す信号点配置において最外殼信号点位置の
外側を示すとき出力信号Ｓを“１“とじ、他の場合は“
０″とし、それを出力端子４へ出力する。
の各出力ディジタル信号を受けてその出力ディジタル信
号の標本点位置における論理状態を検出しその論理状態
が第８図に示す信号点配置において最外殼信号点位置の
外側を示すとき出力信号Ｓを“１“とじ、他の場合は“
０″とし、それを出力端子４へ出力する。
即ち、第９図で示した如く、受信信号が位相平面上の信
号点配置領域内にあるときは、その誤差信号（Ｅｌ、、
Ｅｌ、）は誤りを含む。ところが、第３図において、
信号点値ＷＣは最外殼信号点位置を示すが、この信号点
値ｆｃの外側の位置Ｙで信号受信があったとすれば、信
号点位置Ｃの上方には信号点位置は存在しないから、位
置Ｙで受信された信号はこれに最も近い信号点位置Ｃで
受信されるべき信号がずれて受信された確率が極めて高
いと言える。つまり、位置Ｙでの受信信号についての誤
差信号（Ｅｌ９またはＥｌ、）は“１″であるが、これ
は正しい誤差信号を与えているということができる。
号点配置領域内にあるときは、その誤差信号（Ｅｌ、、
Ｅｌ、）は誤りを含む。ところが、第３図において、
信号点値ＷＣは最外殼信号点位置を示すが、この信号点
値ｆｃの外側の位置Ｙで信号受信があったとすれば、信
号点位置Ｃの上方には信号点位置は存在しないから、位
置Ｙで受信された信号はこれに最も近い信号点位置Ｃで
受信されるべき信号がずれて受信された確率が極めて高
いと言える。つまり、位置Ｙでの受信信号についての誤
差信号（Ｅｌ９またはＥｌ、）は“１″であるが、これ
は正しい誤差信号を与えているということができる。
そこで、本発明では、第４図に斜線で示す如く信号点配
置領域の外側を有効領域、内側と無効領域と定め、有効
領域に入った受信信号の誤差信号（Ｅｌ−、Ｅｌｑ）の
みを用いるのである。その結果、正しい制御信号の発生
が可能となる。
置領域の外側を有効領域、内側と無効領域と定め、有効
領域に入った受信信号の誤差信号（Ｅｌ−、Ｅｌｑ）の
みを用いるのである。その結果、正しい制御信号の発生
が可能となる。
次に、有効領域判定回路１３は個別的論理素子で構成し
ても良いが、ここではＲＯＭ （Ｒｅａｄ ＯｎｌｙＭ
ｅｍｏｒｙ）を用いて構成する場合を説明する。
ても良いが、ここではＲＯＭ （Ｒｅａｄ ＯｎｌｙＭ
ｅｍｏｒｙ）を用いて構成する場合を説明する。
即ち、ＲＯＭはＡ／Ｄ変換器１１．同１２の各出力ディ
ジタル信号の標本点位置における論理状態をアドレス情
報とするものであるが、このＲＯＭにはそのアドレス情
報と信号点配置とを関連付けるテーブルを予め設定して
おくのである。
ジタル信号の標本点位置における論理状態をアドレス情
報とするものであるが、このＲＯＭにはそのアドレス情
報と信号点配置とを関連付けるテーブルを予め設定して
おくのである。
第１表はこのＲＯＭに設定されるテーブルの一例と示し
、以下このテーブルの設定手順を説明する。
、以下このテーブルの設定手順を説明する。
第４図の４つの各象限の対称性から第５図に示す如く第
１象限について考えると、第５図の斜線部分の領域（有
効領域）は第６図（ａ）〜同（ｆ）に示す６つの領域に
分解できる。これらは互いに重複する部分もあるが、第
６図（ａ）はＱ軸上の信号レベルが値９以上であり、こ
れは第２図において誤差信号Ｅ ２（Ｑ軸上であるから
Ｅ２Ｑとなるが）が°゛１１パ合である。第６図（ｂ）
はＰ軸上の第 １ 表 信号レベルが値９以上であり、これは第２図において誤
差信号Ｅ２ｐが“１”の場合である。
１象限について考えると、第５図の斜線部分の領域（有
効領域）は第６図（ａ）〜同（ｆ）に示す６つの領域に
分解できる。これらは互いに重複する部分もあるが、第
６図（ａ）はＱ軸上の信号レベルが値９以上であり、こ
れは第２図において誤差信号Ｅ ２（Ｑ軸上であるから
Ｅ２Ｑとなるが）が°゛１１パ合である。第６図（ｂ）
はＰ軸上の第 １ 表 信号レベルが値９以上であり、これは第２図において誤
差信号Ｅ２ｐが“１”の場合である。
第６図（ｃ）はＰ軸上の信号レベルが値５以上（Ｄ ２
−＝ １ 、 Ｅ 、、＝ １ ＞ 、Ｑ軸上の信号レ
ベルが値８以上（Ｄ２−、 Ｄ３−、 Ｄ４−、 Ｅｔ
、が共に°“１″）である。以下同様に、第６図（ｆ）
はＰ軸上の信号レベルが値８以上（Ｄ２１１．Ｄ３つ、
Ｄ４ｐ、 Ｅｔａが共に１”）、Ｑ軸上の信号レベル
が値５以上（Ｄ２−＝ １ 、 Ｅｔｑ＝ １ ）であ
る。第１表はこのようにして設定したものであって、同
表中「×ｊ印は“０″または“１″のいずれでも良いこ
とを示す。
−＝ １ 、 Ｅ 、、＝ １ ＞ 、Ｑ軸上の信号レ
ベルが値８以上（Ｄ２−、 Ｄ３−、 Ｄ４−、 Ｅｔ
、が共に°“１″）である。以下同様に、第６図（ｆ）
はＰ軸上の信号レベルが値８以上（Ｄ２１１．Ｄ３つ、
Ｄ４ｐ、 Ｅｔａが共に１”）、Ｑ軸上の信号レベル
が値５以上（Ｄ２−＝ １ 、 Ｅｔｑ＝ １ ）であ
る。第１表はこのようにして設定したものであって、同
表中「×ｊ印は“０″または“１″のいずれでも良いこ
とを示す。
斯くして、Ｄｌｐ〜Ｄ ｓｐ、Ｅ １０．Ｅ ２Ｅ１．
Ｄ ＩＱ〜Ｄ ５ｑ ＋ Ｅ ＩＱ 、Ｅ２Ｑの１４ビ
ツトのディジタル信号のビットパターンが第６図（ａ）
〜同（ｆ＞の領域を示すときは出力信号Ｓは“°１″と
なり、有効領域判定信号を発生できることになる。そし
て、Ｓ＝１のとき得られるデータ信号および誤差信号の
みを確からしい信号として各制御に用い、他は放棄する
のである。
Ｄ ＩＱ〜Ｄ ５ｑ ＋ Ｅ ＩＱ 、Ｅ２Ｑの１４ビ
ツトのディジタル信号のビットパターンが第６図（ａ）
〜同（ｆ＞の領域を示すときは出力信号Ｓは“°１″と
なり、有効領域判定信号を発生できることになる。そし
て、Ｓ＝１のとき得られるデータ信号および誤差信号の
みを確からしい信号として各制御に用い、他は放棄する
のである。
（発明の効果）
以上説明したように、本発明の有効領域判定信号発生回
路によれば、復調装置において取得された互いに直交関
係にあるＰチャネルとＱチャネルの各ベースバンド信号
のそれぞれについてディジタル化処理をし、その各ディ
ジタル信号の標本点位置における論理状態が位相平面上
の階段状の信号点配置において最外殼信号点位置の外側
を示すとき有効領域判定信号を出力するようにしたので
、復調系が同期外れを起こしていても正しい誤差信号を
得ること、つまり正しい制御信号を生成できるので、ト
ランスバーサル形等化器等の制御系を速やかに収束させ
ることができる。故に、従来の如きリセット操作が不要
となるから、トランスバーサル形等化器は休止させるこ
となくその等化能力を発揮させることができる効果があ
る。
路によれば、復調装置において取得された互いに直交関
係にあるＰチャネルとＱチャネルの各ベースバンド信号
のそれぞれについてディジタル化処理をし、その各ディ
ジタル信号の標本点位置における論理状態が位相平面上
の階段状の信号点配置において最外殼信号点位置の外側
を示すとき有効領域判定信号を出力するようにしたので
、復調系が同期外れを起こしていても正しい誤差信号を
得ること、つまり正しい制御信号を生成できるので、ト
ランスバーサル形等化器等の制御系を速やかに収束させ
ることができる。故に、従来の如きリセット操作が不要
となるから、トランスバーサル形等化器は休止させるこ
となくその等化能力を発揮させることができる効果があ
る。
第１図は本発明の一実施例に係る有効領域判定信号発生
回路の構成ブロック図、第２図はＡ／Ｄ変換器の入力信
号と出力信号の関係図、第３図は有効領域判定の原理説
明図、第４図は２５６ＳＳ−ＱＡＭ方式における有効領
域を示す図、第５図は第４図中の第１象限における有効
領域を示す図、第６図は有効領域を分解して示す図、第
７図は２５６ＱＡＭ方式の信号点配置図、第８図は２５
６ＳＳ−ＱＡＭ方式の信号点配置図、第９図は従来の誤
差信号判定方式の説明図である。 １１．１２・・・・・・Ａ／Ｄ変換器、 １３・・・・
・・有効領域判定回路。 代理人 弁理士 八 幡 義 博 りｌ］−、り４１号 シト、ζ９５１リイ／ｌイｒｉＪ １１４７へ淀イ苔う
ラ゛づ中ミろ對二ｅａ−σワ１１鴫二λ入；イ多１］挙
／ 閃 弗３ 図 第 タ 図 ＤＩ Ｄ２ ０３ Ｄ４Ｅ１ ０５ Ｅ２Ａ／Ｄ尖捜
盗０人朕〃襠号 娶 ？ 図 ２６６３５−ＱＡＮ方武ｌ二お゛げる肩効、キ囁メ祇第
４ 図 挙／象脹ｌＣお（ブる扇如列城 第 、３ 口
回路の構成ブロック図、第２図はＡ／Ｄ変換器の入力信
号と出力信号の関係図、第３図は有効領域判定の原理説
明図、第４図は２５６ＳＳ−ＱＡＭ方式における有効領
域を示す図、第５図は第４図中の第１象限における有効
領域を示す図、第６図は有効領域を分解して示す図、第
７図は２５６ＱＡＭ方式の信号点配置図、第８図は２５
６ＳＳ−ＱＡＭ方式の信号点配置図、第９図は従来の誤
差信号判定方式の説明図である。 １１．１２・・・・・・Ａ／Ｄ変換器、 １３・・・・
・・有効領域判定回路。 代理人 弁理士 八 幡 義 博 りｌ］−、り４１号 シト、ζ９５１リイ／ｌイｒｉＪ １１４７へ淀イ苔う
ラ゛づ中ミろ對二ｅａ−σワ１１鴫二λ入；イ多１］挙
／ 閃 弗３ 図 第 タ 図 ＤＩ Ｄ２ ０３ Ｄ４Ｅ１ ０５ Ｅ２Ａ／Ｄ尖捜
盗０人朕〃襠号 娶 ？ 図 ２６６３５−ＱＡＮ方武ｌ二お゛げる肩効、キ囁メ祇第
４ 図 挙／象脹ｌＣお（ブる扇如列城 第 、３ 口
Claims (2)
- （１）位相平面上の信号点配置が階段状となるようにす
る高多値直交振幅変調方式を採用するディジタル無線通
信システムにおける復調装置において用いられる有効領
域判定信号発生回路であって；この有効領域判定信号発
生回路は、復調装置において取得された互いに直交関係
にあるＰチャネルとＱチャネルの各ベースバンド信号の
それぞれについてディジタル化処理を行う第１および第
２のＡ／Ｄ変換器と；前記第１および第２のＡ／Ｄ変換
器の出力ディジタル信号を受けてその出力ディジタル信
号の標本点位置における論理状態を検出しその論理状態
が位相平面上の前記階段状の信号点配置において最外殼
信号点位置の外側を示すとき有効領域判定信号を出力す
る有効領域判定回路と；を備えたことを特徴とする有効
領域判定信号発生回路。 - （２）前記有効領域判定回路は、前記出力ディジタル信
号の標本点位置における論理状態をアドレス情報とする
ものであってそのアドレス情報と前記階段状の信号点配
置における信号点位置とを関連付けるテーブルが予め設
定される記憶手段からなることを特徴とする特許請求の
範囲第（１）項記載の有効領域判定信号発生回路。
Priority Applications (6)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62336101A JP2701280B2 (ja) | 1987-12-30 | 1987-12-30 | 有効領域判定信号発生回路 |
| CA000581582A CA1273069A (en) | 1987-10-30 | 1988-10-28 | Validity decision circuit capable of correctly deciding validity of an error signal in a multilevel quadrature amplitude demodulator |
| US07/264,150 US4859956A (en) | 1987-10-30 | 1988-10-28 | Validity decision circuit capable of correctly deciding validity of an error signal in a multilevel quadrature amplitude demodulator |
| DE88118159T DE3882484T2 (de) | 1987-10-30 | 1988-10-31 | Gültigkeitsentscheidungsschaltung mit der Fähigkeit, über die Gültigkeit eines Fehlersignals in einem Mehrebenen-QAM-Demodulator zu entscheiden. |
| AU24548/88A AU601665B2 (en) | 1987-10-30 | 1988-10-31 | Validity decision circuit capable of correctly deciding validity of an error signal in a multilevel quadrature amplitude demodulator |
| EP88118159A EP0314196B1 (en) | 1987-10-30 | 1988-10-31 | Validity decision circuit capable of correctly deciding validity of an error signal in a multilevel quadrature amplitude demodulator |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62336101A JP2701280B2 (ja) | 1987-12-30 | 1987-12-30 | 有効領域判定信号発生回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH01176146A true JPH01176146A (ja) | 1989-07-12 |
| JP2701280B2 JP2701280B2 (ja) | 1998-01-21 |
Family
ID=18295705
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP62336101A Expired - Fee Related JP2701280B2 (ja) | 1987-10-30 | 1987-12-30 | 有効領域判定信号発生回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2701280B2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH04298142A (ja) * | 1991-03-26 | 1992-10-21 | Nec Corp | クロック同期回路 |
Citations (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6010818A (ja) * | 1983-06-29 | 1985-01-21 | Fujitsu Ltd | 自動等化方式 |
| JPS6177452A (ja) * | 1984-09-25 | 1986-04-21 | Nec Corp | 多値直交振幅変調方法および装置 |
| JPS6235741A (ja) * | 1985-08-08 | 1987-02-16 | Nec Corp | 搬送波再生回路 |
| JPS6245256A (ja) * | 1985-08-23 | 1987-02-27 | Nec Corp | 符号誤り訂正装置 |
-
1987
- 1987-12-30 JP JP62336101A patent/JP2701280B2/ja not_active Expired - Fee Related
Patent Citations (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6010818A (ja) * | 1983-06-29 | 1985-01-21 | Fujitsu Ltd | 自動等化方式 |
| JPS6177452A (ja) * | 1984-09-25 | 1986-04-21 | Nec Corp | 多値直交振幅変調方法および装置 |
| JPS6235741A (ja) * | 1985-08-08 | 1987-02-16 | Nec Corp | 搬送波再生回路 |
| JPS6245256A (ja) * | 1985-08-23 | 1987-02-27 | Nec Corp | 符号誤り訂正装置 |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH04298142A (ja) * | 1991-03-26 | 1992-10-21 | Nec Corp | クロック同期回路 |
Also Published As
| Publication number | Publication date |
|---|---|
| JP2701280B2 (ja) | 1998-01-21 |
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| Date | Code | Title | Description |
|---|---|---|---|
| LAPS | Cancellation because of no payment of annual fees |