JPH01172668A - 通信先のインタフェース回路の故障検出装置 - Google Patents
通信先のインタフェース回路の故障検出装置Info
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- JPH01172668A JPH01172668A JP62329503A JP32950387A JPH01172668A JP H01172668 A JPH01172668 A JP H01172668A JP 62329503 A JP62329503 A JP 62329503A JP 32950387 A JP32950387 A JP 32950387A JP H01172668 A JPH01172668 A JP H01172668A
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- B—PERFORMING OPERATIONS; TRANSPORTING
- B60—VEHICLES IN GENERAL
- B60W—CONJOINT CONTROL OF VEHICLE SUB-UNITS OF DIFFERENT TYPE OR DIFFERENT FUNCTION; CONTROL SYSTEMS SPECIALLY ADAPTED FOR HYBRID VEHICLES; ROAD VEHICLE DRIVE CONTROL SYSTEMS FOR PURPOSES NOT RELATED TO THE CONTROL OF A PARTICULAR SUB-UNIT
- B60W30/00—Purposes of road vehicle drive control systems not related to the control of a particular sub-unit, e.g. of systems using conjoint control of vehicle sub-units, or advanced driver assistance systems for ensuring comfort, stability and safety or drive control systems for propelling or retarding the vehicle
- B60W30/18—Propelling the vehicle
-
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- F16H61/00—Control functions within control units of change-speed- or reversing-gearings for conveying rotary motion ; Control of exclusively fluid gearing, friction gearing, gearings with endless flexible members or other particular types of gearing
- F16H61/12—Detecting malfunction or potential malfunction, e.g. fail safe; Circumventing or fixing failures
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-
- F—MECHANICAL ENGINEERING; LIGHTING; HEATING; WEAPONS; BLASTING
- F16—ENGINEERING ELEMENTS AND UNITS; GENERAL MEASURES FOR PRODUCING AND MAINTAINING EFFECTIVE FUNCTIONING OF MACHINES OR INSTALLATIONS; THERMAL INSULATION IN GENERAL
- F16H—GEARING
- F16H63/00—Control outputs from the control unit to change-speed- or reversing-gearings for conveying rotary motion or to other devices than the final output mechanism
- F16H63/40—Control outputs from the control unit to change-speed- or reversing-gearings for conveying rotary motion or to other devices than the final output mechanism comprising signals other than signals for actuating the final output mechanisms
- F16H63/50—Signals to an engine or motor
- F16H63/502—Signals to an engine or motor for smoothing gear shifts
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
（産業上の利用分野）
本発明は、通信先のインタフェース回路の故障検出装置
に係り、特に、車両用変速機の電子制御装置と連係する
エンジンの電子制御装置のインタフェース回路の故障検
出装置に関する。
に係り、特に、車両用変速機の電子制御装置と連係する
エンジンの電子制御装置のインタフェース回路の故障検
出装置に関する。
（従来の技術）
従来から、電子制御式自動変速機において、変速フィー
リングの向上が図られており、変速時には、変速機（Ｔ
／Ｍ）コントローラより、エンジン（Ｅ／Ｇ）コントロ
ーラに信号を送り、Ｅ／Ｇコントローラによりエンジン
トルクを落とし、同時にＴ／Ｍコントローラがライン圧
を落とすという制御を行っていた。
リングの向上が図られており、変速時には、変速機（Ｔ
／Ｍ）コントローラより、エンジン（Ｅ／Ｇ）コントロ
ーラに信号を送り、Ｅ／Ｇコントローラによりエンジン
トルクを落とし、同時にＴ／Ｍコントローラがライン圧
を落とすという制御を行っていた。
以下、その構成を図を用いて詳細に説明する。
第６図は係る従来の制御システムの概略構成図である。
この図に示すように、自動変速機の変速を行う際には、
変速ショックを低減するために、Ｔ／Ｍコントローラ１
の通信回路３を介して、信号を送り、その信号はＥ／Ｇ
コントローラ５のインタフェース回路７を介して、Ｅ／
Ｇコントローラ５のＣＰＵ （中央処理装置）６に取り
込まれ、Ｅ／Ｇコントローラ５の出力ステージ８からエ
ンジントルク・リダクション信号Ｓ！がＥ／Ｇｌｌに送
られる。一方、Ｔ／Ｍコントローラ１においては、同時
に出力ステージ４を介して、Ｔ／ＭＩＯヘライン圧リダ
クション信号Ｓ１を送り、ライン圧を落として、Ｅ／Ｇ
系統とＴ／Ｍ系統との協働により、変速ショックを和ら
げた変速制御を行うようにしていた。
変速ショックを低減するために、Ｔ／Ｍコントローラ１
の通信回路３を介して、信号を送り、その信号はＥ／Ｇ
コントローラ５のインタフェース回路７を介して、Ｅ／
Ｇコントローラ５のＣＰＵ （中央処理装置）６に取り
込まれ、Ｅ／Ｇコントローラ５の出力ステージ８からエ
ンジントルク・リダクション信号Ｓ！がＥ／Ｇｌｌに送
られる。一方、Ｔ／Ｍコントローラ１においては、同時
に出力ステージ４を介して、Ｔ／ＭＩＯヘライン圧リダ
クション信号Ｓ１を送り、ライン圧を落として、Ｅ／Ｇ
系統とＴ／Ｍ系統との協働により、変速ショックを和ら
げた変速制御を行うようにしていた。
（発明が解決しようとする問題点）
しかしながら、上記した従来の制御方式では、Ｅ／Ｇコ
ントローラ５のインタフェース回路７において、例えば
、走行時の振動等によりプルアンプ用抵抗が断線又はシ
ョートをして、故障したような場合は、変速時にＴ／Ｍ
コントローラ１よりＥ／Ｇコントローラ５へ信号を送っ
ても、その信号をＥ／Ｇコントローラ５が読み取ること
ができない、その結果、Ｅ／Ｇコントローラ５からＥ／
Ｇｌｌへのニシントルク・リダクション信号Ｓ２を送る
ことができず、エンジントルクが落ちないにもかかわら
ず、Ｔ／Ｍコントローラ１はライン圧リダクション信号
Ｓ、を送り、ライン圧を落としてしまうため、Ｔ／Ｍ系
統とＥ／Ｇ系統の連係制御が十分機能せず、変速ショッ
クを回避できなかったり、摩擦材の損傷等が生じるとい
った問題があった。
ントローラ５のインタフェース回路７において、例えば
、走行時の振動等によりプルアンプ用抵抗が断線又はシ
ョートをして、故障したような場合は、変速時にＴ／Ｍ
コントローラ１よりＥ／Ｇコントローラ５へ信号を送っ
ても、その信号をＥ／Ｇコントローラ５が読み取ること
ができない、その結果、Ｅ／Ｇコントローラ５からＥ／
Ｇｌｌへのニシントルク・リダクション信号Ｓ２を送る
ことができず、エンジントルクが落ちないにもかかわら
ず、Ｔ／Ｍコントローラ１はライン圧リダクション信号
Ｓ、を送り、ライン圧を落としてしまうため、Ｔ／Ｍ系
統とＥ／Ｇ系統の連係制御が十分機能せず、変速ショッ
クを回避できなかったり、摩擦材の損傷等が生じるとい
った問題があった。
このように、複数のコントロールユニット間にて通信を
行い、同時に制御対象を同じくする制御を行うようなシ
ステムの場合、成るユニットが相手側ユニットのインタ
フェース回路の故障時、それを検出できず、不具合であ
るといった問題があった。
行い、同時に制御対象を同じくする制御を行うようなシ
ステムの場合、成るユニットが相手側ユニットのインタ
フェース回路の故障時、それを検出できず、不具合であ
るといった問題があった。
本発明は、上記問題点を除去し、Ｔ／Ｍ系統とＥ／Ｇ系
統の連係制御を行い、変速時等の円滑な制御をなし得る
通信先のインタフェース回路の故障検出装置を提供する
ことを目的とする。
統の連係制御を行い、変速時等の円滑な制御をなし得る
通信先のインタフェース回路の故障検出装置を提供する
ことを目的とする。
（問題点を解決するための手段）
本発明は、上記問題点を解決するために、車両用変速機
の電子制御装置と車両用エンジンの電子制御装置間で信
号を授受して車両の制御を行うシステムにおいて、前記
車両用変速機の電子制御装置からの出力信号を通信回路
から、前記車両用エンジンの電子制御装置のインタフェ
ース回路を介して取り込むようにすると共に、前記イン
タフェース回路の異常を検出するモニタ回路を前記車両
用変速機の電子制御装置内に設けるようにしたものであ
る。
の電子制御装置と車両用エンジンの電子制御装置間で信
号を授受して車両の制御を行うシステムにおいて、前記
車両用変速機の電子制御装置からの出力信号を通信回路
から、前記車両用エンジンの電子制御装置のインタフェ
ース回路を介して取り込むようにすると共に、前記イン
タフェース回路の異常を検出するモニタ回路を前記車両
用変速機の電子制御装置内に設けるようにしたものであ
る。
（作用及び発明の効果）
本発明によれば、上記したように、Ｔ／Ｍコントローラ
内にＥ／Ｇコントローラのインタフェース回路のモニタ
回路を設けることにより、Ｅ／Ｇコントローラのインタ
フェース回路の異常を検出することができる。従って、
Ｅ／Ｇコントローラのインタフェース回路の異常により
、Ｔ／Ｍコントローラから、変速時のエンジントルクの
減少を指令したにもかかわらず、エンジントルクが落ち
なくなってしまったような場合には、その事ｂＡ輪対処
して、Ｔ／Ｍコントローラからライン圧の低減を行わず
、ライン圧を保持し、フェールセーフ制御を行うことが
できる。
内にＥ／Ｇコントローラのインタフェース回路のモニタ
回路を設けることにより、Ｅ／Ｇコントローラのインタ
フェース回路の異常を検出することができる。従って、
Ｅ／Ｇコントローラのインタフェース回路の異常により
、Ｔ／Ｍコントローラから、変速時のエンジントルクの
減少を指令したにもかかわらず、エンジントルクが落ち
なくなってしまったような場合には、その事ｂＡ輪対処
して、Ｔ／Ｍコントローラからライン圧の低減を行わず
、ライン圧を保持し、フェールセーフ制御を行うことが
できる。
このようにして、車両の変速制御目的に応じたＴ／Ｍコ
ントローラとＥ／Ｇコントローラとの密接な連係のもと
に、変速フィーリングが良好な変速制御を行うこうとが
できる。
ントローラとＥ／Ｇコントローラとの密接な連係のもと
に、変速フィーリングが良好な変速制御を行うこうとが
できる。
（実施例）
以下、本発明の実施例について図面を参照しながら詳細
に説明する。
に説明する。
第１図は本発明の車両用変速機の電子制御装置における
通信相手側のインタフェース回路の故障検出システムの
全体構成図、第２図はその故障検出システムの具体的な
回路構成図である。
通信相手側のインタフェース回路の故障検出システムの
全体構成図、第２図はその故障検出システムの具体的な
回路構成図である。
これらの図に示すように、本発明においては、Ｔ／Ｍコ
ントローラ２０内に通信相手であるＥ／Ｇコントローラ
５のインタフェース回路７の故障をモニタするモニタ回
路２３を設けるようにしており、第２図において、Ｔ／
Ｍコントローラ２０の通信回路２２、モニタ回路２３及
びＥ／Ｇコントローラ５の具体的回路構成が示されてい
る。即ち、通信回路２２は、ＣＰＵ２１に接続される負
論理Ｎ０７回路２５、電源５ｖとＮＯＴ回路２５の出力
側に接続される抵抗２６、負論理Ｎ０７回路２５の出力
側とＮＰＮ ）ランジスタのベースに接続される抵抗２
７、ＮＰＮ）ランジスタのベースとエミッタ及びアース
間に接続される抵抗２８、ＮＰＮ ）ランジスタ２９、
電源１２ＶとＮＰＮ トランジスタ２９のコレクタ間に
接続される抵抗３０、ＮＰＮ）ランジスタ２９のコレク
タとこの通信回路２２の出力端に接続される抵抗３１か
らなる。
ントローラ２０内に通信相手であるＥ／Ｇコントローラ
５のインタフェース回路７の故障をモニタするモニタ回
路２３を設けるようにしており、第２図において、Ｔ／
Ｍコントローラ２０の通信回路２２、モニタ回路２３及
びＥ／Ｇコントローラ５の具体的回路構成が示されてい
る。即ち、通信回路２２は、ＣＰＵ２１に接続される負
論理Ｎ０７回路２５、電源５ｖとＮＯＴ回路２５の出力
側に接続される抵抗２６、負論理Ｎ０７回路２５の出力
側とＮＰＮ ）ランジスタのベースに接続される抵抗２
７、ＮＰＮ）ランジスタのベースとエミッタ及びアース
間に接続される抵抗２８、ＮＰＮ ）ランジスタ２９、
電源１２ＶとＮＰＮ トランジスタ２９のコレクタ間に
接続される抵抗３０、ＮＰＮ）ランジスタ２９のコレク
タとこの通信回路２２の出力端に接続される抵抗３１か
らなる。
モニタ回路２３は、通信回路２２の出力端と正論理Ｎ０
７回路の入力側間に接続される抵抗３２、正論理Ｎ０７
回路の入力側とアース間に接続される抵抗３３、ＣＰ
Ｕ２１に接続される正論理Ｎ０７回路３４からなる。
７回路の入力側間に接続される抵抗３２、正論理Ｎ０７
回路の入力側とアース間に接続される抵抗３３、ＣＰ
Ｕ２１に接続される正論理Ｎ０７回路３４からなる。
Ｅ／Ｇコントローラ５のインタフェース回路７は、その
入力端と電源１２Ｖ間に接続される入力回路部（プルア
ンプ）抵抗ＲＡ、その入力端と正論理ＮＯＴ回路間に接
続される抵抗３５、その抵抗３５とＣＰＵ６間に接続さ
れる正論理Ｎ０７回路３６からなる。
入力端と電源１２Ｖ間に接続される入力回路部（プルア
ンプ）抵抗ＲＡ、その入力端と正論理ＮＯＴ回路間に接
続される抵抗３５、その抵抗３５とＣＰＵ６間に接続さ
れる正論理Ｎ０７回路３６からなる。
また、Ｔ／Ｍコントローラ２０とＥ／Ｇコントローラ５
間は通信線！で接続されている。
間は通信線！で接続されている。
なお、上記した抵抗素子の抵抗値の一例を示すと以下の
通りである。
通りである。
抵抗２６は４．７にΩ、抵抗２７は２．２にΩ、抵抗２
８は４７にΩ、抵抗３０は１００にΩ、抵抗３１は２２
Ω、抵抗３２はＩＯＫΩ、抵抗３３はＩＯＫΩ、抵抗３
５はＩＯＫΩである。
８は４７にΩ、抵抗３０は１００にΩ、抵抗３１は２２
Ω、抵抗３２はＩＯＫΩ、抵抗３３はＩＯＫΩ、抵抗３
５はＩＯＫΩである。
次に、上記した制御システムの動作について、説明する
。
。
まず、Ｅ／Ｇコントローラ５が正常時の場合、各箇所の
電圧は第３図の通りであり、この図において、 Ｌａ ”Ｌｍ ＝Ｌｃ ＝Ｌｎ ＝ＯＶＨＡ ＝ Ｈｅ
−５Ｖ Ｈｓ ”１１．４Ｖ ゛、“１２×（抵抗３０＋抵抗３１） ／ ｒ （（抵
抗３０＋抵抗３１）と抵抗ＲＡの合成並列抵抗値〕＋（
抵抗３２＋抵抗３３）１ Ｈｃ ＝Ｃｌ０Ｋ／ （ＩＯＫ ＋ ｌ０Ｋ） ） Ｘ
Ｈａ −５，７Ｖここで、インバータ入力電圧ｖｃが
、 ｖ、 ≦１．５１：：テ、■。＝Ｈ１１−５Ｖ出力ＶＣ
≦３．５■にて、ＶＤ＝Ｌ、−ＯＶ小出力なる。
電圧は第３図の通りであり、この図において、 Ｌａ ”Ｌｍ ＝Ｌｃ ＝Ｌｎ ＝ＯＶＨＡ ＝ Ｈｅ
−５Ｖ Ｈｓ ”１１．４Ｖ ゛、“１２×（抵抗３０＋抵抗３１） ／ ｒ （（抵
抗３０＋抵抗３１）と抵抗ＲＡの合成並列抵抗値〕＋（
抵抗３２＋抵抗３３）１ Ｈｃ ＝Ｃｌ０Ｋ／ （ＩＯＫ ＋ ｌ０Ｋ） ） Ｘ
Ｈａ −５，７Ｖここで、インバータ入力電圧ｖｃが
、 ｖ、 ≦１．５１：：テ、■。＝Ｈ１１−５Ｖ出力ＶＣ
≦３．５■にて、ＶＤ＝Ｌ、−ＯＶ小出力なる。
つまり、ＣＰ Ｕ２１からの出力信号がＬｏｗレベルの
場合は、ＮＰＮ トランジスタ２９はオンであり、■、
及び■、はＬｏ−レベルであり、ＮＯＴ回路３４で変換
されて、ｃ Ｐ Ｕ２１に旧ｇｈレベルの信号が入力さ
れる。一方、ＣＰＵ２１からの出力信号が旧［ｈレベル
の場合は、ＮＰＮ トランジスタ２９はオフとなり、■
、及び■、は抵抗ＲＡが正常値であるためＩｌｉｇｈレ
ベルとなり、ＮＯＴ回路３４で変換されて、ＣＰ Ｕ２
１ニＬｏ−レベルの信号が入力される。
場合は、ＮＰＮ トランジスタ２９はオンであり、■、
及び■、はＬｏ−レベルであり、ＮＯＴ回路３４で変換
されて、ｃ Ｐ Ｕ２１に旧ｇｈレベルの信号が入力さ
れる。一方、ＣＰＵ２１からの出力信号が旧［ｈレベル
の場合は、ＮＰＮ トランジスタ２９はオフとなり、■
、及び■、は抵抗ＲＡが正常値であるためＩｌｉｇｈレ
ベルとなり、ＮＯＴ回路３４で変換されて、ＣＰ Ｕ２
１ニＬｏ−レベルの信号が入力される。
次に、Ｅ／Ｇコントローラ５の入力回路部抵抗ＲＡ又は
通信ｙＡ１が断線した場合は、各箇所の電圧は第４図の
通りであり、この図において、Ｌｓ ’ ＝ （（
ＩＯＫ ＋１０Ｋ） ／ （１００Ｋ ＋２２＋１
０に＋１０Ｋ）） Ｘ１２＝ ２．０ＶＬｃ ’
＝ Ｃｌ０Ｋ／ （１０に＋１０Ｋ））ＸＬｗ
’−１，ＯＶ となる。
通信ｙＡ１が断線した場合は、各箇所の電圧は第４図の
通りであり、この図において、Ｌｓ ’ ＝ （（
ＩＯＫ ＋１０Ｋ） ／ （１００Ｋ ＋２２＋１
０に＋１０Ｋ）） Ｘ１２＝ ２．０ＶＬｃ ’
＝ Ｃｌ０Ｋ／ （１０に＋１０Ｋ））ＸＬｗ
’−１，ＯＶ となる。
つまり、ＣＰ Ｕ２１からの出力信号がし０１ルベルの
場合は、ＮＰＮ ）ランジスタ２９はオンであり、ｖＩ
及び■。はＬｏ−レベルであり、ＮＯＴ回路３４で変換
されて、ＣＰ ［２１に旧ｇｈレベルの信号が入力され
る。一方、ＣＰ Ｕ２１からの出力信号が旧ｇｈレベル
の場合は、ＮＰＮ Ｉ−ランジスタ２９はオフとなるが
、実質的に抵抗ＲＡがωとなり、抵抗３０、抵抗３１、
抵抗３２及び抵抗３３の直列回路が形成され、その分圧
された電圧２．Ｏｖがｖｌとなるが、Ｌｏｗレベルであ
り、更に、ＶＣは抵抗３２と抵抗３３とで分圧されて、
１．０ ＶのＬＯＮレベルとなる。従って、そのＬｏｗ
レベルがＮＯＴ回路３４で変換されて、ＣＰＵ２１にｌ
ｌｉｇｈベルの信号が入力される。
場合は、ＮＰＮ ）ランジスタ２９はオンであり、ｖＩ
及び■。はＬｏ−レベルであり、ＮＯＴ回路３４で変換
されて、ＣＰ ［２１に旧ｇｈレベルの信号が入力され
る。一方、ＣＰ Ｕ２１からの出力信号が旧ｇｈレベル
の場合は、ＮＰＮ Ｉ−ランジスタ２９はオフとなるが
、実質的に抵抗ＲＡがωとなり、抵抗３０、抵抗３１、
抵抗３２及び抵抗３３の直列回路が形成され、その分圧
された電圧２．Ｏｖがｖｌとなるが、Ｌｏｗレベルであ
り、更に、ＶＣは抵抗３２と抵抗３３とで分圧されて、
１．０ ＶのＬＯＮレベルとなる。従って、そのＬｏｗ
レベルがＮＯＴ回路３４で変換されて、ＣＰＵ２１にｌ
ｌｉｇｈベルの信号が入力される。
ここで、入力回路部抵抗ＲＡが正常時はＣＰｔＪ２１か
らの出力信号がｌｌｉｇｈレベルの場合は、ＶＤはＬｏ
−レベルであるべきところ（第３図参照）、逆にＩｌｉ
ｇｈベルになるので、ＣＰＵ２１において、異常と判定
することができ、入力回路部抵抗ＲＡの断線を検出する
ことができる。
らの出力信号がｌｌｉｇｈレベルの場合は、ＶＤはＬｏ
−レベルであるべきところ（第３図参照）、逆にＩｌｉ
ｇｈベルになるので、ＣＰＵ２１において、異常と判定
することができ、入力回路部抵抗ＲＡの断線を検出する
ことができる。
次に、Ｅ／Ｇコントローラ５の入力回路部抵抗ＲＡがシ
ョートした場合は、各箇所の電圧は第５図の通りであり
、この図において、 Ｈａ ’ ＝１２Ｖ ＩＴ、’工６■ となる。
ョートした場合は、各箇所の電圧は第５図の通りであり
、この図において、 Ｈａ ’ ＝１２Ｖ ＩＴ、’工６■ となる。
つまり、ＣＰＵ２１からの出力信号がＬｏ−レベルの場
合は、ＮＰＮ ）ランジスタ２９はオンであるが、入力
回路部抵抗ＲＡがショートしているため、インタフェー
ス回路７の１２Ｖ電源がそのままＶｌｌとして印加され
、■、はその１２Ｖの■、が抵抗３２と抵抗３３とで分
圧されて、６ＶのＩｌｉｇｈレヘルとレベ。
合は、ＮＰＮ ）ランジスタ２９はオンであるが、入力
回路部抵抗ＲＡがショートしているため、インタフェー
ス回路７の１２Ｖ電源がそのままＶｌｌとして印加され
、■、はその１２Ｖの■、が抵抗３２と抵抗３３とで分
圧されて、６ＶのＩｌｉｇｈレヘルとレベ。
その旧ｇｈレベルがＮＯＴ回路３４で変換されて、ＣＰ
Ｕ２１にＬｏｗレベルの信号が入力される。
Ｕ２１にＬｏｗレベルの信号が入力される。
ここで、入力回路部抵抗ＲＡが正常時はＣＰＵ２１から
の出力信号がＬｏｗレベルの場合は、■、は旧ｇｈレベ
ルであるべきところ（第３図参照）、逆にＬｏ−レベル
になるので、ＣＰ Ｕ２１において、異常と判定するこ
とができ、入力回路部抵抗ＲＡのショートを検出するこ
とができる。
の出力信号がＬｏｗレベルの場合は、■、は旧ｇｈレベ
ルであるべきところ（第３図参照）、逆にＬｏ−レベル
になるので、ＣＰ Ｕ２１において、異常と判定するこ
とができ、入力回路部抵抗ＲＡのショートを検出するこ
とができる。
上記したＥ／Ｇコントローラ５のインタフェース回路７
に各故障が生じた場合には、Ｔ／Ｍコントローラ２０の
ＣＰＵ２１からは出力ステージ２４を介してＴ／Ｍのラ
イン圧リダクション信号ｓ２は出力しない。
に各故障が生じた場合には、Ｔ／Ｍコントローラ２０の
ＣＰＵ２１からは出力ステージ２４を介してＴ／Ｍのラ
イン圧リダクション信号ｓ２は出力しない。
一方、上記したＥ／Ｇコントローラ５のインタフェース
回路７が正常である場合には、Ｅ／Ｇコントローラ５は
、Ｅ／Ｇ出力トルクリダクション信号Ｓ１が出力ステー
ジ８を介して出力され、例。
回路７が正常である場合には、Ｅ／Ｇコントローラ５は
、Ｅ／Ｇ出力トルクリダクション信号Ｓ１が出力ステー
ジ８を介して出力され、例。
えば、Ｅ／Ｇｌｌのインジェクタの燃料噴射量制御やイ
グナイタの点火時期制御を行い、Ｅ／Ｇ出力トルクを低
減する。
グナイタの点火時期制御を行い、Ｅ／Ｇ出力トルクを低
減する。
一方、Ｔ／Ｍ２０においては、出力ステージ２４を介シ
フ Ｔ ／ Ｍ １０へライン圧リダクション信号Ｓ
＋が出力され、例えば、プライマリ・レギュレータ・パ
ルプの制御を行い、ライン圧を低減する。
フ Ｔ ／ Ｍ １０へライン圧リダクション信号Ｓ
＋が出力され、例えば、プライマリ・レギュレータ・パ
ルプの制御を行い、ライン圧を低減する。
このようにして、車両の変速制御目的に応じたＴ／Ｍコ
ントローラとＥ／Ｇコントローラとの密接な連係が図ら
れ、変速フィーリングが良好な変速制御を行うこうとが
できる。
ントローラとＥ／Ｇコントローラとの密接な連係が図ら
れ、変速フィーリングが良好な変速制御を行うこうとが
できる。
なお、本発明は上記実施例に限定されるものではなく、
本発明の趣旨に基づき種々の変形が可能であり、それら
を本発明の範囲から排除するものではない。
本発明の趣旨に基づき種々の変形が可能であり、それら
を本発明の範囲から排除するものではない。
第１図は本発明の車両用変速機の電子制御装置における
通信相手側のインタフェース回路の故障検出システムの
全体構成図、第２図はその故障検出システムの具体的な
回路構成図、第３図はその故障検出システムの正常時の
動作を示す図、第４図及び第５図はその故障検出システ
ムの異常時の動作を示す図、第６図は従来の制御システ
ムの全体構成図である。 ５・・・Ｅ／Ｇコントローラ、６．２１・・・ＣＵＰ、
７・・・インタフェース回路、２０・・・Ｔ／Ｍコント
ローラ、２２・・・通信回路、２３・・・モニタ回路、
８．２４・・・出力ステージ、２５・・・負論理Ｎ０７
回路、２６．２７．２８．３０゜３１、３２．３３．３
５・・・抵抗、２９・・・ＮＰＮ ）ランジスタ、３４
、３６・・・正論理Ｎ０７回路、ＲＡ・・・入力回路部
（プルアンプ）抵抗。
通信相手側のインタフェース回路の故障検出システムの
全体構成図、第２図はその故障検出システムの具体的な
回路構成図、第３図はその故障検出システムの正常時の
動作を示す図、第４図及び第５図はその故障検出システ
ムの異常時の動作を示す図、第６図は従来の制御システ
ムの全体構成図である。 ５・・・Ｅ／Ｇコントローラ、６．２１・・・ＣＵＰ、
７・・・インタフェース回路、２０・・・Ｔ／Ｍコント
ローラ、２２・・・通信回路、２３・・・モニタ回路、
８．２４・・・出力ステージ、２５・・・負論理Ｎ０７
回路、２６．２７．２８．３０゜３１、３２．３３．３
５・・・抵抗、２９・・・ＮＰＮ ）ランジスタ、３４
、３６・・・正論理Ｎ０７回路、ＲＡ・・・入力回路部
（プルアンプ）抵抗。
Claims (2)
- （１）車両用変速機の電子制御装置と車両用エンジンの
電子制御装置間で信号を授受して車両の制御を行うシス
テムであって、前記車両用変速機の電子制御装置からの
出力信号を通信回路から、前記車両用エンジンの電子制
御装置のインタフェース回路を介して取り込むようにす
ると共に、前記インタフェース回路の異常を検出するモ
ニタ回路を前記車両用変速機の電子制御装置内に設ける
ようにしたことを特徴とする通信先のインタフェース回
路の故障検出装置。 - （２）前記モニタ回路の入力側を前記通信回路の出力側
に接続してなる特許請求の範囲第１項記載の通信先のイ
ンタフェース回路の故障検出装置。（３）前記インタフ
ェース回路の異常は該インタフェース回路のプルアップ
用抵抗の断線又はショト又は通信線の断線であることを
特徴とする特許請求の範囲第１項記載の通信先のインタ
フェース回路の故障検出装置。
Priority Applications (3)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62329503A JPH01172668A (ja) | 1987-12-28 | 1987-12-28 | 通信先のインタフェース回路の故障検出装置 |
| DE3841400A DE3841400A1 (de) | 1987-12-28 | 1988-12-08 | Vorrichtung zum detektieren der fehlfunktion einer schnittstellenschaltung am anderen ende einer verbindungsleitung |
| US07/508,465 US5019810A (en) | 1987-12-28 | 1990-04-13 | Apparatus for detecting malfunction of interface circuit in communication line between controllers in a vehicle control system |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62329503A JPH01172668A (ja) | 1987-12-28 | 1987-12-28 | 通信先のインタフェース回路の故障検出装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH01172668A true JPH01172668A (ja) | 1989-07-07 |
Family
ID=18222101
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP62329503A Pending JPH01172668A (ja) | 1987-12-28 | 1987-12-28 | 通信先のインタフェース回路の故障検出装置 |
Country Status (3)
| Country | Link |
|---|---|
| US (1) | US5019810A (ja) |
| JP (1) | JPH01172668A (ja) |
| DE (1) | DE3841400A1 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
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| DE19651538C2 (de) * | 1995-12-11 | 2001-10-18 | Jatco Corp | Übertragungsvorrichtung für eine Steuervorrichtung |
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| DE4129783C1 (ja) * | 1991-09-07 | 1992-11-19 | Mercedes-Benz Aktiengesellschaft, 7000 Stuttgart, De | |
| DE4230585B4 (de) * | 1992-09-12 | 2005-06-23 | Bayerische Motoren Werke Ag | Verfahren zur Überwachung einer unidirektionalen Eindrahtschnittstelle |
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1987
- 1987-12-28 JP JP62329503A patent/JPH01172668A/ja active Pending
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1988
- 1988-12-08 DE DE3841400A patent/DE3841400A1/de not_active Ceased
-
1990
- 1990-04-13 US US07/508,465 patent/US5019810A/en not_active Expired - Fee Related
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Also Published As
| Publication number | Publication date |
|---|---|
| US5019810A (en) | 1991-05-28 |
| DE3841400A1 (de) | 1989-07-06 |
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