JPH01171272A - ゲートターンオフサイリスタ - Google Patents
ゲートターンオフサイリスタInfo
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- JPH01171272A JPH01171272A JP32914287A JP32914287A JPH01171272A JP H01171272 A JPH01171272 A JP H01171272A JP 32914287 A JP32914287 A JP 32914287A JP 32914287 A JP32914287 A JP 32914287A JP H01171272 A JPH01171272 A JP H01171272A
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- JP
- Japan
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- short
- layer
- circuit layers
- cathode
- cathode segments
- Prior art date
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- Pending
Links
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- 230000000149 penetrating effect Effects 0.000 claims abstract description 4
- 230000035945 sensitivity Effects 0.000 description 4
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- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 description 1
- 230000007797 corrosion Effects 0.000 description 1
- 238000005260 corrosion Methods 0.000 description 1
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Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/02—Semiconductor bodies ; Multistep manufacturing processes therefor
- H01L29/06—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions
- H01L29/08—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions with semiconductor regions connected to an electrode carrying current to be rectified, amplified or switched and such electrode being part of a semiconductor device which comprises three or more electrodes
- H01L29/083—Anode or cathode regions of thyristors or gated bipolar-mode devices
- H01L29/0834—Anode regions of thyristors or gated bipolar-mode devices, e.g. supplementary regions surrounding anode regions
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- Engineering & Computer Science (AREA)
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- Thyristors (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、ゲート電極の設けられるPベース層に隣接す
るNベース層がPエミッタ層と部分的にアノード電極と
短絡されるアノードカソード型でかつNベース層のPエ
ミッタ層側に高不純物濃度のN形バフファ層が付加され
たゲートターンオフ(GT○)サイリスタに関する。
るNベース層がPエミッタ層と部分的にアノード電極と
短絡されるアノードカソード型でかつNベース層のPエ
ミッタ層側に高不純物濃度のN形バフファ層が付加され
たゲートターンオフ(GT○)サイリスタに関する。
第2図に示すGTOサイリスタは、通常のサイリスタ構
造のようにPエミッタ層1.Nベース層2、Pベース層
3.Nベース層4の4層を有し、Pエミッタ層1にアノ
ード電極5.Nエミッタ層4のセグメント部にカソード
電極6.セグメント部間のPベース層3にゲート電極7
が設けられ、さらにNベース層2のPエミッタ層7側に
はN0バッファ層21が形成され、その層とPエミッタ
層1を貫通するN9シツ一ト層22を介してアノード電
極5によりPエミッタ1111と短絡される公知のアノ
ードショート型GTOサイリスクである。すなわち、N
゛バツフア1121付加することによりNベース層2の
幅を小さくできるため過剰キャリアの蓄積が少なく、加
えてN0層22を介してのアノードカソードから過剰キ
ャリアを速やかに外部電極に排出できる。従ってテール
電流が少なく、ターンオフ損失が少ないという利点を有
する。
造のようにPエミッタ層1.Nベース層2、Pベース層
3.Nベース層4の4層を有し、Pエミッタ層1にアノ
ード電極5.Nエミッタ層4のセグメント部にカソード
電極6.セグメント部間のPベース層3にゲート電極7
が設けられ、さらにNベース層2のPエミッタ層7側に
はN0バッファ層21が形成され、その層とPエミッタ
層1を貫通するN9シツ一ト層22を介してアノード電
極5によりPエミッタ1111と短絡される公知のアノ
ードショート型GTOサイリスクである。すなわち、N
゛バツフア1121付加することによりNベース層2の
幅を小さくできるため過剰キャリアの蓄積が少なく、加
えてN0層22を介してのアノードカソードから過剰キ
ャリアを速やかに外部電極に排出できる。従ってテール
電流が少なく、ターンオフ損失が少ないという利点を有
する。
このようなバッファ層21を付加したアノードショート
型GTOサイリスタはゲートトリガ感度が著しく低下す
る欠点を有する。いま、第2図においてサイリスクが点
弧する条件を考える。カソード電極6から供給された電
子電流が点線8で示すようにN′″バッファ層21を通
過してショート層22に流れる間に電位降下を生じ、こ
の電位降下によってアノード側のPN接合が順バイアス
されて正孔がNベース層2に注入されることによって点
弧する。従って点弧の条件は ΔV腐□xI>y、i ・・−・・−・・−・・・−
・・・−・−・(11となる、ここでΔVはアノード電
極5とPエミッタ層1中央部との間の電位降下、RはN
゛バッファ層21のショート層22間の抵抗であり、■
はN+バッファ層21を流れる電子電流でゲートトリガ
電流に比例し、またVblは拡散電位差である。従って
N′″バッファ層21の不純物濃度を高くするとRが小
さくなり、ゲートトリガ電流が大きくなる。
型GTOサイリスタはゲートトリガ感度が著しく低下す
る欠点を有する。いま、第2図においてサイリスクが点
弧する条件を考える。カソード電極6から供給された電
子電流が点線8で示すようにN′″バッファ層21を通
過してショート層22に流れる間に電位降下を生じ、こ
の電位降下によってアノード側のPN接合が順バイアス
されて正孔がNベース層2に注入されることによって点
弧する。従って点弧の条件は ΔV腐□xI>y、i ・・−・・−・・−・・・−
・・・−・−・(11となる、ここでΔVはアノード電
極5とPエミッタ層1中央部との間の電位降下、RはN
゛バッファ層21のショート層22間の抵抗であり、■
はN+バッファ層21を流れる電子電流でゲートトリガ
電流に比例し、またVblは拡散電位差である。従って
N′″バッファ層21の不純物濃度を高くするとRが小
さくなり、ゲートトリガ電流が大きくなる。
本発明の目的は、上述のようなバッファ層を付加したア
ノードショート型GTOサイリスタの欠点を除去して、
カソード電極から供給された電子がPエミッタ層により
多く注入されるようにし、ゲートトリガ感度を向上させ
ることにある。
ノードショート型GTOサイリスタの欠点を除去して、
カソード電極から供給された電子がPエミッタ層により
多く注入されるようにし、ゲートトリガ感度を向上させ
ることにある。
上記の目的を達成するために、本発明は、複数のカソー
ドセグメントのNエミッタ層、ゲート電極が設けられる
Pベース層およびNベース層が順次隣接し、Nベース層
がPエミッタ層側に高不純物濃度のN形バッファ層を有
し、そのN形バッファ層とアノード電極の間にPエミッ
タ層を貫通するN形シ町−ト層を有するGTOサイリス
クにおいて、N形ショート層の数がカソードセグメント
の数より少ないものとする。
ドセグメントのNエミッタ層、ゲート電極が設けられる
Pベース層およびNベース層が順次隣接し、Nベース層
がPエミッタ層側に高不純物濃度のN形バッファ層を有
し、そのN形バッファ層とアノード電極の間にPエミッ
タ層を貫通するN形シ町−ト層を有するGTOサイリス
クにおいて、N形ショート層の数がカソードセグメント
の数より少ないものとする。
N゛バンファ層21の不純物濃度を高くするとRが小さ
くなりゲートトリガ電流は大きくなるが、N゛バッファ
層21の不純物濃度を一定とすると、ショート層22間
の距離に比例してRが大きくなり、+11式より■が小
さくなる。そこで、1個のカソードセグメント46に対
してショート層22を1〜数個配置していた従来のアノ
ードショート構造を改め、カソードセグメントの数より
ショート層の数を少なくすれば、ショート層間の距離が
大きくなってゲートトリガ電流を小さくすることができ
る。
くなりゲートトリガ電流は大きくなるが、N゛バッファ
層21の不純物濃度を一定とすると、ショート層22間
の距離に比例してRが大きくなり、+11式より■が小
さくなる。そこで、1個のカソードセグメント46に対
してショート層22を1〜数個配置していた従来のアノ
ードショート構造を改め、カソードセグメントの数より
ショート層の数を少なくすれば、ショート層間の距離が
大きくなってゲートトリガ電流を小さくすることができ
る。
第1図は本発明の一実施例の断面構造を示し、Pエミッ
タ層1を貫通してN0バッファ層21およびNベース層
2をアノード電極5に短絡するショート層22の数はカ
ソードセグメント4.6の数の二分の−となっている。
タ層1を貫通してN0バッファ層21およびNベース層
2をアノード電極5に短絡するショート層22の数はカ
ソードセグメント4.6の数の二分の−となっている。
従ってショート層22間互間の距離はカソードセグメン
ト間の距離の2倍になっている。しかし、ショート層の
数はセグメントの数の二分の−に限定されるものでなく
、ゲートトリガ感度とターンオフ損失とに関連して適宜
の距離を隔ててショート層を形成することが育効である
。
ト間の距離の2倍になっている。しかし、ショート層の
数はセグメントの数の二分の−に限定されるものでなく
、ゲートトリガ感度とターンオフ損失とに関連して適宜
の距離を隔ててショート層を形成することが育効である
。
本発明によれば、アノードシ町−ト型GT○サイリスタ
のベース層にバッファ層を付加した場合のバッファ層か
らショート層に流れ込む電子電流を、ショート層の数を
カソードセグメントの数より少なくすることにより制限
してPエミッタ層に注入されるようにすることにより、
ターンオフ損失が少なくゲートトリガ感度の高いGTO
サイリスクが得られる。
のベース層にバッファ層を付加した場合のバッファ層か
らショート層に流れ込む電子電流を、ショート層の数を
カソードセグメントの数より少なくすることにより制限
してPエミッタ層に注入されるようにすることにより、
ターンオフ損失が少なくゲートトリガ感度の高いGTO
サイリスクが得られる。
第1図は本発明の一実施例の断面図、第2図は従来のア
ノードショート型GTOサイリスタの断面図である。
ノードショート型GTOサイリスタの断面図である。
Claims (1)
- (1)複数のカソードセグメントのNエミッタ層、ゲー
ト電極の設けられるPベース層およびNベース層が順次
隣接し、Nベース層がPエミッタ層側に高不純物濃度の
N形バッファ層を有し、該N形バッファ層とアノード電
極の間にPエミッタ層を貫通するN形ショート層を有す
るものにおいて、N形ショート層の数がカソードセグメ
ントの数より少ないことを特徴とするゲートターンオフ
サイリスタ。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP32914287A JPH01171272A (ja) | 1987-12-25 | 1987-12-25 | ゲートターンオフサイリスタ |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP32914287A JPH01171272A (ja) | 1987-12-25 | 1987-12-25 | ゲートターンオフサイリスタ |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH01171272A true JPH01171272A (ja) | 1989-07-06 |
Family
ID=18218105
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP32914287A Pending JPH01171272A (ja) | 1987-12-25 | 1987-12-25 | ゲートターンオフサイリスタ |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH01171272A (ja) |
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH02263470A (ja) * | 1989-04-04 | 1990-10-26 | Hitachi Ltd | ゲートターンオフサイリスタ |
JPH03101268A (ja) * | 1989-09-14 | 1991-04-26 | Hitachi Ltd | ゲートターンオフサイリスタ |
US5574297A (en) * | 1994-04-04 | 1996-11-12 | Mitsubishi Denki Kabushiki Kaisha | Gate turnoff thyristor with reduced gate trigger current |
Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS59163865A (ja) * | 1983-03-08 | 1984-09-14 | Toshiba Corp | ゲ−トタ−ンオフサイリスタ |
JPS6220713A (ja) * | 1985-07-22 | 1987-01-29 | Nippon Denso Co Ltd | 空調装置の騒音低減装置 |
-
1987
- 1987-12-25 JP JP32914287A patent/JPH01171272A/ja active Pending
Patent Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS59163865A (ja) * | 1983-03-08 | 1984-09-14 | Toshiba Corp | ゲ−トタ−ンオフサイリスタ |
JPS6220713A (ja) * | 1985-07-22 | 1987-01-29 | Nippon Denso Co Ltd | 空調装置の騒音低減装置 |
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH02263470A (ja) * | 1989-04-04 | 1990-10-26 | Hitachi Ltd | ゲートターンオフサイリスタ |
JPH03101268A (ja) * | 1989-09-14 | 1991-04-26 | Hitachi Ltd | ゲートターンオフサイリスタ |
US5574297A (en) * | 1994-04-04 | 1996-11-12 | Mitsubishi Denki Kabushiki Kaisha | Gate turnoff thyristor with reduced gate trigger current |
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