JPH01107650A - 位相制御回路 - Google Patents
位相制御回路Info
- Publication number
- JPH01107650A JPH01107650A JP26407987A JP26407987A JPH01107650A JP H01107650 A JPH01107650 A JP H01107650A JP 26407987 A JP26407987 A JP 26407987A JP 26407987 A JP26407987 A JP 26407987A JP H01107650 A JPH01107650 A JP H01107650A
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- Pending
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- 238000001514 detection method Methods 0.000 claims description 4
- 239000003990 capacitor Substances 0.000 abstract description 6
- 230000005611 electricity Effects 0.000 abstract 1
- 238000000034 method Methods 0.000 description 3
- 238000010586 diagram Methods 0.000 description 2
- 229910008903 TmF3 Inorganic materials 0.000 description 1
- 230000008878 coupling Effects 0.000 description 1
- 238000010168 coupling process Methods 0.000 description 1
- 238000005859 coupling reaction Methods 0.000 description 1
Landscapes
- Power Conversion In General (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〈産業上の利用分野〉
この発明は、空調機器の対流用ファンモータの回転数制
御などに用いられる位相ｉ制御回路に関するものである
。
御などに用いられる位相ｉ制御回路に関するものである
。
〈従来の技術〉
交流電力制御回路に用いられる制御素子としては１〜ラ
イアツクが広く知られており、また最近ではグーＩ・入
力を光結合により行なつ−で精度向上を図ったフォトト
ライアック（ＴＬＰ＞も用いられている。このトライア
ックなどを用いた交流電力制御方式としては、位相制御
方式がある。この位相制御方式では、上記のトライアッ
クなどは位相制御素子とじて用いられる。
イアツクが広く知られており、また最近ではグーＩ・入
力を光結合により行なつ−で精度向上を図ったフォトト
ライアック（ＴＬＰ＞も用いられている。このトライア
ックなどを用いた交流電力制御方式としては、位相制御
方式がある。この位相制御方式では、上記のトライアッ
クなどは位相制御素子とじて用いられる。
〈発明が解決しようとする問題点〉
ところで、ＴＬＰ等の位相制御素子を用いた場合、これ
らの素子は入力信号に対するオン。
らの素子は入力信号に対するオン。
オフ感度が低いことから、電源電圧がゼロクロスしても
素子がオフせず、このため、位相制御が精度良く行なえ
なくなるという問題がある。
素子がオフせず、このため、位相制御が精度良く行なえ
なくなるという問題がある。
〈問題点を解決するための手段〉
この発明は、交流電圧の略せロクロスを検出するゼロク
ロス検出手段と、この略ゼロクロス検出後で前記交流電
圧の半サイクル毎に積分信号を出力する積分回路と、こ
の積分信号値と所定の基準レベル値とを比較する比較手
段と、前記積分信号値が前記所定の基準レベル値以上の
位相の間は前記交流電圧を負荷に供給する位相制御手段
とを備え、更に、前記略ゼロクロス検出時には前記比較
回路に入力される前記積分値を前記基準レベル値より小
さく制限する停止手段を有してなることを要旨とする。
ロス検出手段と、この略ゼロクロス検出後で前記交流電
圧の半サイクル毎に積分信号を出力する積分回路と、こ
の積分信号値と所定の基準レベル値とを比較する比較手
段と、前記積分信号値が前記所定の基準レベル値以上の
位相の間は前記交流電圧を負荷に供給する位相制御手段
とを備え、更に、前記略ゼロクロス検出時には前記比較
回路に入力される前記積分値を前記基準レベル値より小
さく制限する停止手段を有してなることを要旨とする。
〈作 用〉
上記手段を用いることで、位相制御手段が作動停止（Ｏ
ＦＦ）すべき位相においてはこの位相ｔＩＩＩ御手段合
手段的に作動停止でき、位相制御を精度良く行なうこと
ができる。
ＦＦ）すべき位相においてはこの位相ｔＩＩＩ御手段合
手段的に作動停止でき、位相制御を精度良く行なうこと
ができる。
〈実施例〉
以下、添付図面を用いて実施例を詳細に説明する。
第１図において、商用交流電源などの交流電源１は、全
波整流回路２に入力され、この整流回路２は第２図（Ａ
）のような仝波整流波形（図中Ａ点における出力波形）
を出力する。この出力は、抵抗Ｒ４を介してトランジス
タＴｒｉのベースに入力され、トランジスタＴｒｌは、
第２図（８）に示した通り、上記仝波整流波形の略ゼロ
クロス（略ゼロボルト）付近で０ＦＦＬ、またその他の
位相ではＯＮの状態となり、このＯＮ、ＯＦＦを上記交
流電源１の半サイクル毎に繰り返す。一方、このトラン
ジスタＴｒｌの次段に設けられたトランジスタＴｒ２は
、第２図（Ｃ）のようなＯＮ、ＯＦＦ動作を繰り返す。
波整流回路２に入力され、この整流回路２は第２図（Ａ
）のような仝波整流波形（図中Ａ点における出力波形）
を出力する。この出力は、抵抗Ｒ４を介してトランジス
タＴｒｉのベースに入力され、トランジスタＴｒｌは、
第２図（８）に示した通り、上記仝波整流波形の略ゼロ
クロス（略ゼロボルト）付近で０ＦＦＬ、またその他の
位相ではＯＮの状態となり、このＯＮ、ＯＦＦを上記交
流電源１の半サイクル毎に繰り返す。一方、このトラン
ジスタＴｒｌの次段に設けられたトランジスタＴｒ２は
、第２図（Ｃ）のようなＯＮ、ＯＦＦ動作を繰り返す。
また、トランジスタＴｒ１のコレクタ側に設けられたコ
ンデンサＣには、このトランジスタＴｒｉがＯＮの期間
、抵抗Ｒ１並びにダイオードＤ１を介して充電電流が流
れ、従ってこの期間はコンデンサＣは充電される。この
ため、図中Ｂ点の電位は、第２図（［））のような積分
波形となり、この積分波形信号が上記交流電源１の半サ
イクル毎に出力される。
ンデンサＣには、このトランジスタＴｒｉがＯＮの期間
、抵抗Ｒ１並びにダイオードＤ１を介して充電電流が流
れ、従ってこの期間はコンデンサＣは充電される。この
ため、図中Ｂ点の電位は、第２図（［））のような積分
波形となり、この積分波形信号が上記交流電源１の半サ
イクル毎に出力される。
上記の積分波形信号はコンパレータ３の（−）側入力端
子に入力される。このコンパレータ３の（＋）側入力喘
子には、抵抗Ｒ１１、トランジスタＴｒ３、抵抗Ｒ９を
介して、マイコン４の端子１からの出力が入力される。
子に入力される。このコンパレータ３の（＋）側入力喘
子には、抵抗Ｒ１１、トランジスタＴｒ３、抵抗Ｒ９を
介して、マイコン４の端子１からの出力が入力される。
この端子１からは、後述するファンモータ６の回転数を
制御し、低速回転時には高電位（以下゛Ｈ”）、中速回
転時には低電位（以下“Ｌ″）がそれぞれ出力され、従
ってこの出力が“Ｈ″、“Ｌ ｍｅの時には、トランジ
スタＴｒ３、抵抗Ｒ９を介してコンパレータ３の（＋）
側入力端子の電位は、それぞれ“Ｌ″、“Ｈｍｅとなる
。
制御し、低速回転時には高電位（以下゛Ｈ”）、中速回
転時には低電位（以下“Ｌ″）がそれぞれ出力され、従
ってこの出力が“Ｈ″、“Ｌ ｍｅの時には、トランジ
スタＴｒ３、抵抗Ｒ９を介してコンパレータ３の（＋）
側入力端子の電位は、それぞれ“Ｌ″、“Ｈｍｅとなる
。
そして、例えば低速回転時には、コンパレータ３の（−
）側入力端子、並びに（＋）側入力端子の入り電圧は第
２図（Ｄ）においてそれぞれ実線。
）側入力端子、並びに（＋）側入力端子の入り電圧は第
２図（Ｄ）においてそれぞれ実線。
点線で示したようになる。そしてこの口４、コンパレー
タ３の出力は、（−）側入力値が（＋）側入力値より大
きい位相のみ゛′Ｌパとなり、逆の位相では“ト１″と
なる。この出力は第２図（Ｅ）に示した通りであり、こ
の出力はフォトトライアック（ＴＬＰ＞５の発光ダイオ
ード部に入力され、従って、ＴＬＰ５は第２図（Ｆ）に
示したタイミングでＯＮ、ＯＦＦを、前記交流電源の半
サイクル毎に繰り返し、このＴＬＰ６のトライアック部
を介して交流電源１に接続されたファンモータ（ＦＭ＞
６には、第２図（Ｇ）に示した位相でこの交流電源１か
ら電力が供給される。
タ３の出力は、（−）側入力値が（＋）側入力値より大
きい位相のみ゛′Ｌパとなり、逆の位相では“ト１″と
なる。この出力は第２図（Ｅ）に示した通りであり、こ
の出力はフォトトライアック（ＴＬＰ＞５の発光ダイオ
ード部に入力され、従って、ＴＬＰ５は第２図（Ｆ）に
示したタイミングでＯＮ、ＯＦＦを、前記交流電源の半
サイクル毎に繰り返し、このＴＬＰ６のトライアック部
を介して交流電源１に接続されたファンモータ（ＦＭ＞
６には、第２図（Ｇ）に示した位相でこの交流電源１か
ら電力が供給される。
尚、第１図において、マイコン４の端子２は通常の運転
時は“Ｈｅｅであり、始動時などにおいて強制的にファ
ンモータ６を高速回転させたい時のみ“Ｌ ｅｅとなる
。
時は“Ｈｅｅであり、始動時などにおいて強制的にファ
ンモータ６を高速回転させたい時のみ“Ｌ ｅｅとなる
。
以上の構成のこの実施例において、トランジスタＴｒｉ
がＯＮからＯＦＦになった時、コンデンサＣに蓄積され
た充電電荷はダイオードＤ２と抵抗Ｒ２を介して放電さ
れ、コンデンサＣにはリセットがかかる。そしてこのよ
うに１〜ランジスタＴｒ１がＯＮしてリセッＩ〜がかか
った時には、第２図（Ｄ）のように、トランジスタＴｒ
２がＯＮして図中Ｂ点の電位が強制的に下がることから
、上記コンパレータ３の出力は常に“Ｈｔｏとなり、こ
の結果ＴＬＰ５の動作は必ずＯＦＦとなって確実な位相
制御が行なえるようになる。
がＯＮからＯＦＦになった時、コンデンサＣに蓄積され
た充電電荷はダイオードＤ２と抵抗Ｒ２を介して放電さ
れ、コンデンサＣにはリセットがかかる。そしてこのよ
うに１〜ランジスタＴｒ１がＯＮしてリセッＩ〜がかか
った時には、第２図（Ｄ）のように、トランジスタＴｒ
２がＯＮして図中Ｂ点の電位が強制的に下がることから
、上記コンパレータ３の出力は常に“Ｈｔｏとなり、こ
の結果ＴＬＰ５の動作は必ずＯＦＦとなって確実な位相
制御が行なえるようになる。
ここで、１〜ランジスタｌｒ２を設りない場合、ゼロク
ロス検出によりトランジスタＴｒｉがＯＦＦした時には
コンパレータ３の（−）側入力端子の電位が電源電圧付
近まで上昇するため、コンパレータ３の出力が“Ｌ ｍ
ｍとなってＴｍＦ３がＯＮとなってしまい、位相制御が
不確実になるという不都合が生じる。
ロス検出によりトランジスタＴｒｉがＯＦＦした時には
コンパレータ３の（−）側入力端子の電位が電源電圧付
近まで上昇するため、コンパレータ３の出力が“Ｌ ｍ
ｍとなってＴｍＦ３がＯＮとなってしまい、位相制御が
不確実になるという不都合が生じる。
尚、以上の実施例ではトランジスタＴｒ１゜Ｔｒ２をそ
れぞれゼロクロス検出手段、電力停止手段として用いた
が、これらを夫々、コンパレータやオペアンプあるいは
Ｆ Ｅ Ｔなどを用いて構成してもよいことは勿論であ
る。
れぞれゼロクロス検出手段、電力停止手段として用いた
が、これらを夫々、コンパレータやオペアンプあるいは
Ｆ Ｅ Ｔなどを用いて構成してもよいことは勿論であ
る。
また、位相制御手段としては上記の他、サイリスタ、地
形式のトライアックなどからなるものを用いてもよい。
形式のトライアックなどからなるものを用いてもよい。
〈発明の効果〉
以上のようにこの発明によれば、簡単な回路構成ζ少な
い部品点数で構成でき、また精度のよい位相制御を行な
える位相制御回路を提供できる。
い部品点数で構成でき、また精度のよい位相制御を行な
える位相制御回路を提供できる。
第１図は実施例の位相制御回路を有して構成されるファ
ンモータ制御回路を示した回路図、第２図（Ａ）〜（Ｇ
）はこの回路の各部におＣプる信号を示した波形図であ
る。 ２・・・仝波整流回路、３・・・コンパレータ、４・・
・マイコン、５・・・フォトトライアック、６・・・フ
ァンモータ。 特許出願人 三洋電機株式会社
ンモータ制御回路を示した回路図、第２図（Ａ）〜（Ｇ
）はこの回路の各部におＣプる信号を示した波形図であ
る。 ２・・・仝波整流回路、３・・・コンパレータ、４・・
・マイコン、５・・・フォトトライアック、６・・・フ
ァンモータ。 特許出願人 三洋電機株式会社
Claims (1)
- １、交流電圧の略ゼロクロスを検出するゼロクロス検出
手段と、この略ゼロクロス検出後で前記交流電圧の半サ
イクル毎に積分信号を出力する積分回路と、この積分信
号値と所定の基準レベル値とを比較する比較手段と、前
記積分信号値が前記所定の基準レベル値以上の位相の間
は前記交流電圧を負荷に供給する位相制御手段とを備え
、更に、前記略ゼロクロス検出時には前記比較回路に入
力される前記積分値を前記基準レベル値より小さく制限
する停止手段を有してなることを特徴とする位相制御回
路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP26407987A JPH01107650A (ja) | 1987-10-20 | 1987-10-20 | 位相制御回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP26407987A JPH01107650A (ja) | 1987-10-20 | 1987-10-20 | 位相制御回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH01107650A true JPH01107650A (ja) | 1989-04-25 |
Family
ID=17398223
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP26407987A Pending JPH01107650A (ja) | 1987-10-20 | 1987-10-20 | 位相制御回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH01107650A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2007062657A (ja) * | 2005-09-01 | 2007-03-15 | Nissan Motor Co Ltd | 自動車のピラーとその製造方法 |
-
1987
- 1987-10-20 JP JP26407987A patent/JPH01107650A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2007062657A (ja) * | 2005-09-01 | 2007-03-15 | Nissan Motor Co Ltd | 自動車のピラーとその製造方法 |
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