JP7424141B2 - 炭化珪素半導体装置及びその製造方法 - Google Patents
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- HBMJWWWQQXIZIP-UHFFFAOYSA-N silicon carbide Chemical compound [Si+]#[C-] HBMJWWWQQXIZIP-UHFFFAOYSA-N 0.000 title claims description 69
- 229910010271 silicon carbide Inorganic materials 0.000 title claims description 69
- 239000004065 semiconductor Substances 0.000 title claims description 39
- 238000004519 manufacturing process Methods 0.000 title claims description 28
- 230000007547 defect Effects 0.000 claims description 62
- 239000013078 crystal Substances 0.000 claims description 28
- 230000002950 deficient Effects 0.000 claims description 22
- 229920002120 photoresistant polymer Polymers 0.000 claims description 20
- 239000012535 impurity Substances 0.000 claims description 8
- 244000000626 Daucus carota Species 0.000 claims description 4
- 235000002767 Daucus carota Nutrition 0.000 claims description 4
- 239000010410 layer Substances 0.000 description 22
- 238000000034 method Methods 0.000 description 16
- 230000000694 effects Effects 0.000 description 10
- 235000012431 wafers Nutrition 0.000 description 9
- 230000000052 comparative effect Effects 0.000 description 4
- 239000011248 coating agent Substances 0.000 description 3
- 238000000576 coating method Methods 0.000 description 3
- 239000000758 substrate Substances 0.000 description 3
- IJGRMHOSHXDMSA-UHFFFAOYSA-N Atomic nitrogen Chemical compound N#N IJGRMHOSHXDMSA-UHFFFAOYSA-N 0.000 description 2
- 239000011229 interlayer Substances 0.000 description 2
- 229910052782 aluminium Inorganic materials 0.000 description 1
- XAGFODPZIPBFFR-UHFFFAOYSA-N aluminium Chemical compound [Al] XAGFODPZIPBFFR-UHFFFAOYSA-N 0.000 description 1
- 230000015556 catabolic process Effects 0.000 description 1
- 230000006866 deterioration Effects 0.000 description 1
- 238000005530 etching Methods 0.000 description 1
- 230000005669 field effect Effects 0.000 description 1
- 238000010438 heat treatment Methods 0.000 description 1
- 238000002513 implantation Methods 0.000 description 1
- 238000007689 inspection Methods 0.000 description 1
- 238000009413 insulation Methods 0.000 description 1
- 239000000463 material Substances 0.000 description 1
- 229910044991 metal oxide Inorganic materials 0.000 description 1
- 150000004706 metal oxides Chemical class 0.000 description 1
- 150000004767 nitrides Chemical class 0.000 description 1
- 229910052757 nitrogen Inorganic materials 0.000 description 1
- 238000000206 photolithography Methods 0.000 description 1
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- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/02—Semiconductor bodies ; Multistep manufacturing processes therefor
- H01L29/04—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their crystalline structure, e.g. polycrystalline, cubic or particular orientation of crystalline planes
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- H01L22/00—Testing or measuring during manufacture or treatment; Reliability measurements, i.e. testing of parts without further processing to modify the parts as such; Structural arrangements therefor
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- H01L22/12—Measuring as part of the manufacturing process for structural parameters, e.g. thickness, line width, refractive index, temperature, warp, bond strength, defects, optical inspection, electrical measurement of structural dimensions, metallurgic measurement of diffusions
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- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/66—Types of semiconductor device ; Multistep manufacturing processes therefor
- H01L29/68—Types of semiconductor device ; Multistep manufacturing processes therefor controllable by only the electric current supplied, or only the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched
- H01L29/76—Unipolar devices, e.g. field effect transistors
- H01L29/772—Field effect transistors
- H01L29/78—Field effect transistors with field effect produced by an insulated gate
- H01L29/7827—Vertical transistors
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- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/02—Semiconductor bodies ; Multistep manufacturing processes therefor
- H01L29/06—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions
- H01L29/0684—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions characterised by the shape, relative sizes or dispositions of the semiconductor regions or junctions between the regions
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- H01—ELECTRIC ELEMENTS
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- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/02—Semiconductor bodies ; Multistep manufacturing processes therefor
- H01L29/06—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions
- H01L29/08—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions with semiconductor regions connected to an electrode carrying current to be rectified, amplified or switched and such electrode being part of a semiconductor device which comprises three or more electrodes
- H01L29/0843—Source or drain regions of field-effect devices
- H01L29/0847—Source or drain regions of field-effect devices of field-effect transistors with insulated gate
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- H—ELECTRICITY
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- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/02—Semiconductor bodies ; Multistep manufacturing processes therefor
- H01L29/12—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by the materials of which they are formed
- H01L29/16—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by the materials of which they are formed including, apart from doping materials or other impurities, only elements of Group IV of the Periodic Table
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- H—ELECTRICITY
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- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/02—Semiconductor bodies ; Multistep manufacturing processes therefor
- H01L29/30—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by physical imperfections; having polished or roughened surface
- H01L29/34—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by physical imperfections; having polished or roughened surface the imperfections being on the surface
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- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/66—Types of semiconductor device ; Multistep manufacturing processes therefor
- H01L29/66007—Multistep manufacturing processes
- H01L29/66053—Multistep manufacturing processes of devices having a semiconductor body comprising crystalline silicon carbide
- H01L29/66068—Multistep manufacturing processes of devices having a semiconductor body comprising crystalline silicon carbide the devices being controllable only by the electric current supplied or the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched, e.g. three-terminal devices
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- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/66—Types of semiconductor device ; Multistep manufacturing processes therefor
- H01L29/68—Types of semiconductor device ; Multistep manufacturing processes therefor controllable by only the electric current supplied, or only the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched
- H01L29/76—Unipolar devices, e.g. field effect transistors
- H01L29/772—Field effect transistors
- H01L29/78—Field effect transistors with field effect produced by an insulated gate
- H01L29/7801—DMOS transistors, i.e. MISFETs with a channel accommodating body or base region adjoining a drain drift region
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Description
図1は、実施の形態1に係る炭化珪素半導体装置を示す断面図である。以下、特に説明が無ければ半導体装置とはMOSFET(Metal Oxide Semiconductor Field Effect Transistor)を意味している。炭化珪素基板1の上にN型の炭化珪素層2がエピタキシャル成長されている。炭化珪素層2は、結晶欠陥が存在する欠陥領域3を有する。P型の複数のウエル領域4が炭化珪素層2に形成されている。P型コンタクト領域5及びN型のソース領域6がウエル領域4に形成されている。なお、P型コンタクト領域5は無くてもよい。
図12及び図13は、実施の形態2に係る半導体装置の製造方法を示す断面図である。実施の形態1と同様に結晶欠陥を検査し、ウエル領域4を形成する。次に、図12に示すように、炭化珪素層2の上面全面に第1のポジレジスト18を塗布する。次に、欠陥領域3において第1のポジレジスト18の上に第2のポジレジスト19をインクジェット塗布により形成する。インクジェット塗布機として、数um径で局所的にレジスト塗布が可能な市販の装置を用いる。
実施の形態1と同様に結晶欠陥を検査し、ウエル領域4を形成する。次に、炭化珪素層2の上面全面にレジストを塗布する。図10と同様に、露光及び現像したレジストをマスクとしてウエル領域4にNを注入してソース領域6を形成する。ここで、本実施の形態では市販のマスクレス露光機によりレジストを露光する。マスクレス露光機によって、ソース領域6を形成するための通常のマスクデータと、欠陥領域3の位置を合わせたマスクデータとをウエハごとに生成・準備する。そして、現像後のレジストが欠陥領域3に残るように、マスクレス露光機により生成されたマスクデータに基づいてレジストを露光する。よって、不純物を注入しても欠陥領域3にソース領域6が形成されないため、実施の形態1と同様の効果を得ることができる。その他の構成及び効果は実施の形態1と同様である。なお、マスクレス露光機での露光に際して用いられるレジストはポジレストでもネガレジストでもよい。また、チップ単位で露光してもウエハ単位で露光してもよい。
図14は、実施の形態4に係る半導体装置の製造方法を示す平面図である。図15は、実施の形態4に係る半導体装置の製造方法を示す断面図である。実施の形態1と同様に結晶欠陥を検査し、ウエル領域4を形成する。次に、炭化珪素層2の上面全面に窒化膜又は酸化膜などの絶縁膜20をCVDにより形成する。絶縁膜20の厚みは2um程度であるが、それ以上厚くてもよい。次に、レジストを全面に塗布し、露光及び現像により欠陥領域3の上方のレジストを残す。このレジストをマスクとして絶縁膜20をエッチングした後、レジストを除去する。これにより、図14に示すように、欠陥領域3の上方に絶縁膜20が残る。
図16及び図17は、実施の形態5に係る半導体装置の製造方法を示す断面図である。実施の形態1と同様に結晶欠陥を検査し、ウエル領域4を形成する。次に、図16に示すように、ソース領域6の形成予定領域が開口した通常のレジストパターン22を用いてNを注入して、複数のウエル領域4にそれぞれソース領域6を形成する。この際、欠陥領域3が存在するウエル領域4も含めて全てのウエル領域4にソース領域6を形成する。その後、レジストパターン22を除去する。
Claims (7)
- 100um以下の三角欠陥、ダウンフォール欠陥、又はキャロット欠陥を含む結晶欠陥が存在する欠陥領域を有する第1導電型の炭化珪素層と、
前記炭化珪素層に形成された第2導電型の複数のウエル領域と、
前記ウエル領域に形成された第1導電型のソース領域と、
前記炭化珪素層、前記ウエル領域及び前記ソース領域の上に形成されたゲート酸化膜と、
前記ゲート酸化膜の上に形成されたゲート電極と、
前記ウエル領域及び前記ソース領域に接続されたソース電極とを備え、
前記欠陥領域には前記ソース領域が形成されていないことを特徴とする炭化珪素半導体装置。 - 第1導電型の炭化珪素層のエピタキシャル成長による100um以下の三角欠陥、ダウンフォール欠陥、又はキャロット欠陥を含む結晶欠陥を検査して前記結晶欠陥が存在する欠陥領域の位置を特定する工程と、
前記炭化珪素層に第2導電型の複数のウエル領域を形成する工程と、
前記ウエル領域に第1導電型のソース領域を形成する工程と、
前記炭化珪素層、前記ウエル領域及び前記ソース領域の上にゲート酸化膜を形成する工程と、
前記ゲート酸化膜の上にゲート電極を形成する工程と、
前記ウエル領域及び前記ソース領域に接続されたソース電極を形成する工程とを備え、
前記欠陥領域には前記ソース領域が形成されていないことを特徴とする炭化珪素半導体装置の製造方法。 - 前記炭化珪素層の上にネガレジストを塗布する工程と、
前記ソース領域の形成予定領域以外にある前記ネガレジストを露光する工程と、
前記欠陥領域にある前記ネガレジストを局所的にレーザー露光する工程と、
露光及びレーザー露光した前記ネガレジストを現像する工程と、
現像した前記ネガレジストをマスクとして前記ウエル領域に不純物を注入して前記ソース領域を形成する工程とを備えることを特徴とする請求項2に記載の炭化珪素半導体装置の製造方法。 - 前記炭化珪素層の上に第1のポジレジストを塗布する工程と、
前記欠陥領域において前記第1のポジレジストの上に第2のポジレジストを形成する工程と、
前記ソース領域の形成予定領域にある前記第1及び第2のポジレジストを露光及び現像する工程と、
現像した前記第1及び第2のポジレジストをマスクとして前記ウエル領域に不純物を注入して前記ソース領域を形成する工程とを備え、
現像後の前記第1のポジレジストが前記欠陥領域に残ることを特徴とする請求項2に記載の炭化珪素半導体装置の製造方法。 - 前記炭化珪素層の上にレジストを塗布する工程と、
露光及び現像した前記レジストをマスクとして前記ウエル領域に不純物を注入して前記ソース領域を形成する工程とを備え、
現像後の前記レジストが前記欠陥領域に残るように、マスクレス露光機により前記レジストを露光することを特徴とする請求項2に記載の炭化珪素半導体装置の製造方法。 - 前記欠陥領域の上に絶縁膜を形成する工程と、
前記炭化珪素層の上に、前記ソース領域の形成予定領域が開口したレジストパターンを形成する工程と、
前記レジストパターンと前記絶縁膜をマスクとして前記ウエル領域に不純物を注入して前記ソース領域を形成する工程とを備えることを特徴とする請求項2に記載の炭化珪素半導体装置の製造方法。 - 前記複数のウエル領域にそれぞれ前記ソース領域を形成する工程と、
前記欠陥領域に第2導電型の不純物を注入することで前記欠陥領域に存在する前記ソース領域を取り消す工程とを備えることを特徴とする請求項2に記載の炭化珪素半導体装置の製造方法。
Priority Applications (5)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2020049005A JP7424141B2 (ja) | 2020-03-19 | 2020-03-19 | 炭化珪素半導体装置及びその製造方法 |
US17/021,958 US11489040B2 (en) | 2020-03-19 | 2020-09-15 | Silicon carbide semiconductor device and method for manufacturing the same |
DE102020128282.6A DE102020128282A1 (de) | 2020-03-19 | 2020-10-28 | Siliziumcarbid-Halbleitervorrichtung und Verfahren zu deren Herstellung |
CN202110270261.5A CN113497118A (zh) | 2020-03-19 | 2021-03-12 | 碳化硅半导体装置及其制造方法 |
US17/820,304 US12027576B2 (en) | 2020-03-19 | 2022-08-17 | Method for manufacturing silicon carbide semiconductor device |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2020049005A JP7424141B2 (ja) | 2020-03-19 | 2020-03-19 | 炭化珪素半導体装置及びその製造方法 |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2021150490A JP2021150490A (ja) | 2021-09-27 |
JP7424141B2 true JP7424141B2 (ja) | 2024-01-30 |
Family
ID=77552575
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2020049005A Active JP7424141B2 (ja) | 2020-03-19 | 2020-03-19 | 炭化珪素半導体装置及びその製造方法 |
Country Status (4)
Country | Link |
---|---|
US (2) | US11489040B2 (ja) |
JP (1) | JP7424141B2 (ja) |
CN (1) | CN113497118A (ja) |
DE (1) | DE102020128282A1 (ja) |
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- 2020-03-19 JP JP2020049005A patent/JP7424141B2/ja active Active
- 2020-09-15 US US17/021,958 patent/US11489040B2/en active Active
- 2020-10-28 DE DE102020128282.6A patent/DE102020128282A1/de active Pending
-
2021
- 2021-03-12 CN CN202110270261.5A patent/CN113497118A/zh active Pending
-
2022
- 2022-08-17 US US17/820,304 patent/US12027576B2/en active Active
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DE102020128282A1 (de) | 2021-09-23 |
US11489040B2 (en) | 2022-11-01 |
US20210296433A1 (en) | 2021-09-23 |
JP2021150490A (ja) | 2021-09-27 |
US12027576B2 (en) | 2024-07-02 |
CN113497118A (zh) | 2021-10-12 |
US20220392997A1 (en) | 2022-12-08 |
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