JP7343084B2 - リードフレーム及びその製造方法 - Google Patents
リードフレーム及びその製造方法 Download PDFInfo
- Publication number
- JP7343084B2 JP7343084B2 JP2023541129A JP2023541129A JP7343084B2 JP 7343084 B2 JP7343084 B2 JP 7343084B2 JP 2023541129 A JP2023541129 A JP 2023541129A JP 2023541129 A JP2023541129 A JP 2023541129A JP 7343084 B2 JP7343084 B2 JP 7343084B2
- Authority
- JP
- Japan
- Prior art keywords
- lead
- die pad
- lead frame
- rough
- rough surface
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Active
Links
- 238000004519 manufacturing process Methods 0.000 title claims description 133
- 239000004065 semiconductor Substances 0.000 claims description 369
- 229910052751 metal Inorganic materials 0.000 claims description 337
- 239000002184 metal Substances 0.000 claims description 337
- 238000007747 plating Methods 0.000 claims description 251
- 239000000758 substrate Substances 0.000 claims description 198
- 238000000034 method Methods 0.000 claims description 108
- 238000007789 sealing Methods 0.000 claims description 102
- 238000007788 roughening Methods 0.000 claims description 29
- 238000012545 processing Methods 0.000 claims description 16
- 239000003513 alkali Substances 0.000 claims description 6
- 238000002360 preparation method Methods 0.000 claims description 5
- 239000010410 layer Substances 0.000 description 364
- 229920005989 resin Polymers 0.000 description 105
- 239000011347 resin Substances 0.000 description 105
- 238000005530 etching Methods 0.000 description 71
- 238000010586 diagram Methods 0.000 description 36
- 239000010949 copper Substances 0.000 description 32
- 239000000243 solution Substances 0.000 description 32
- RYGMFSIKBFXOCR-UHFFFAOYSA-N Copper Chemical compound [Cu] RYGMFSIKBFXOCR-UHFFFAOYSA-N 0.000 description 30
- 229910052802 copper Inorganic materials 0.000 description 30
- BQCADISMDOOEFD-UHFFFAOYSA-N Silver Chemical compound [Ag] BQCADISMDOOEFD-UHFFFAOYSA-N 0.000 description 26
- QAOWNCQODCNURD-UHFFFAOYSA-N Sulfuric acid Chemical compound OS(O)(=O)=O QAOWNCQODCNURD-UHFFFAOYSA-N 0.000 description 26
- 239000000853 adhesive Substances 0.000 description 26
- 230000001070 adhesive effect Effects 0.000 description 26
- 229910052709 silver Inorganic materials 0.000 description 26
- 239000004332 silver Substances 0.000 description 26
- 230000002093 peripheral effect Effects 0.000 description 21
- MHAJPDPJQMAIIY-UHFFFAOYSA-N Hydrogen peroxide Chemical compound OO MHAJPDPJQMAIIY-UHFFFAOYSA-N 0.000 description 18
- ATJFFYVFTNAWJD-UHFFFAOYSA-N Tin Chemical compound [Sn] ATJFFYVFTNAWJD-UHFFFAOYSA-N 0.000 description 18
- 239000003822 epoxy resin Substances 0.000 description 17
- 229920000647 polyepoxide Polymers 0.000 description 17
- 229910000881 Cu alloy Inorganic materials 0.000 description 15
- 239000011247 coating layer Substances 0.000 description 15
- 238000009713 electroplating Methods 0.000 description 15
- 230000007774 longterm Effects 0.000 description 15
- PXHVJJICTQNCMI-UHFFFAOYSA-N nickel Substances [Ni] PXHVJJICTQNCMI-UHFFFAOYSA-N 0.000 description 14
- 230000000149 penetrating effect Effects 0.000 description 14
- 239000007788 liquid Substances 0.000 description 12
- KDLHZDBZIXYQEI-UHFFFAOYSA-N palladium Substances [Pd] KDLHZDBZIXYQEI-UHFFFAOYSA-N 0.000 description 12
- 239000011241 protective layer Substances 0.000 description 11
- 229920001971 elastomer Polymers 0.000 description 10
- 239000010931 gold Substances 0.000 description 10
- 238000012856 packing Methods 0.000 description 10
- 230000000052 comparative effect Effects 0.000 description 9
- 239000000463 material Substances 0.000 description 9
- 238000000465 moulding Methods 0.000 description 9
- VEXZGXHMUGYJMC-UHFFFAOYSA-N Hydrochloric acid Chemical compound Cl VEXZGXHMUGYJMC-UHFFFAOYSA-N 0.000 description 8
- 239000002585 base Substances 0.000 description 7
- 238000012986 modification Methods 0.000 description 7
- 230000004048 modification Effects 0.000 description 7
- 239000012756 surface treatment agent Substances 0.000 description 7
- PCHJSUWPFVWCPO-UHFFFAOYSA-N gold Chemical compound [Au] PCHJSUWPFVWCPO-UHFFFAOYSA-N 0.000 description 6
- 229910052737 gold Inorganic materials 0.000 description 6
- 238000000691 measurement method Methods 0.000 description 6
- 229920005992 thermoplastic resin Polymers 0.000 description 6
- 229920001187 thermosetting polymer Polymers 0.000 description 6
- 229910001316 Ag alloy Inorganic materials 0.000 description 5
- 229910001020 Au alloy Inorganic materials 0.000 description 5
- 229910052759 nickel Inorganic materials 0.000 description 5
- BASFCYQUMIYNBI-UHFFFAOYSA-N platinum Substances [Pt] BASFCYQUMIYNBI-UHFFFAOYSA-N 0.000 description 5
- NNFCIKHAZHQZJG-UHFFFAOYSA-N potassium cyanide Chemical compound [K+].N#[C-] NNFCIKHAZHQZJG-UHFFFAOYSA-N 0.000 description 5
- LFAGQMCIGQNPJG-UHFFFAOYSA-N silver cyanide Chemical compound [Ag+].N#[C-] LFAGQMCIGQNPJG-UHFFFAOYSA-N 0.000 description 5
- 229940098221 silver cyanide Drugs 0.000 description 5
- 239000003353 gold alloy Substances 0.000 description 4
- 239000007769 metal material Substances 0.000 description 4
- 229910052763 palladium Inorganic materials 0.000 description 4
- 238000000206 photolithography Methods 0.000 description 4
- 238000012360 testing method Methods 0.000 description 4
- 229910000640 Fe alloy Inorganic materials 0.000 description 3
- KWYUFKZDYYNOTN-UHFFFAOYSA-M Potassium hydroxide Chemical compound [OH-].[K+] KWYUFKZDYYNOTN-UHFFFAOYSA-M 0.000 description 3
- HEMHJVSKTPXQMS-UHFFFAOYSA-M Sodium hydroxide Chemical compound [OH-].[Na+] HEMHJVSKTPXQMS-UHFFFAOYSA-M 0.000 description 3
- 229910045601 alloy Inorganic materials 0.000 description 3
- 239000000956 alloy Substances 0.000 description 3
- 239000007864 aqueous solution Substances 0.000 description 3
- 239000004020 conductor Substances 0.000 description 3
- 230000007797 corrosion Effects 0.000 description 3
- 238000005260 corrosion Methods 0.000 description 3
- 238000001746 injection moulding Methods 0.000 description 3
- 238000005259 measurement Methods 0.000 description 3
- 238000005096 rolling process Methods 0.000 description 3
- 229920002050 silicone resin Polymers 0.000 description 3
- 239000007787 solid Substances 0.000 description 3
- 238000001721 transfer moulding Methods 0.000 description 3
- 229910021578 Iron(III) chloride Inorganic materials 0.000 description 2
- 229910000990 Ni alloy Inorganic materials 0.000 description 2
- 238000013459 approach Methods 0.000 description 2
- 230000015572 biosynthetic process Effects 0.000 description 2
- 238000004140 cleaning Methods 0.000 description 2
- 239000003086 colorant Substances 0.000 description 2
- 230000000694 effects Effects 0.000 description 2
- 230000008595 infiltration Effects 0.000 description 2
- 238000001764 infiltration Methods 0.000 description 2
- RBTARNINKXHZNM-UHFFFAOYSA-K iron trichloride Chemical compound Cl[Fe](Cl)Cl RBTARNINKXHZNM-UHFFFAOYSA-K 0.000 description 2
- 239000011159 matrix material Substances 0.000 description 2
- 230000003287 optical effect Effects 0.000 description 2
- 230000003595 spectral effect Effects 0.000 description 2
- 239000007921 spray Substances 0.000 description 2
- DJQYKWDYUQPOOE-OGRLCSSISA-N (2s,3s)-2-[4-[(1s)-1-amino-3-methylbutyl]triazol-1-yl]-1-[4-[4-[4-[(2s,3s)-2-[4-[(1s)-1-amino-3-methylbutyl]triazol-1-yl]-3-methylpentanoyl]piperazin-1-yl]-6-[2-[2-(2-prop-2-ynoxyethoxy)ethoxy]ethylamino]-1,3,5-triazin-2-yl]piperazin-1-yl]-3-methylpentan- Chemical compound Cl.N1([C@@H]([C@@H](C)CC)C(=O)N2CCN(CC2)C=2N=C(NCCOCCOCCOCC#C)N=C(N=2)N2CCN(CC2)C(=O)[C@H]([C@@H](C)CC)N2N=NC(=C2)[C@@H](N)CC(C)C)C=C([C@@H](N)CC(C)C)N=N1 DJQYKWDYUQPOOE-OGRLCSSISA-N 0.000 description 1
- 229920001342 Bakelite® Polymers 0.000 description 1
- QPLDLSVMHZLSFG-UHFFFAOYSA-N Copper oxide Chemical compound [Cu]=O QPLDLSVMHZLSFG-UHFFFAOYSA-N 0.000 description 1
- 239000005751 Copper oxide Substances 0.000 description 1
- 239000004593 Epoxy Substances 0.000 description 1
- 238000010521 absorption reaction Methods 0.000 description 1
- 239000002253 acid Substances 0.000 description 1
- 229910000431 copper oxide Inorganic materials 0.000 description 1
- 238000005238 degreasing Methods 0.000 description 1
- 238000013461 design Methods 0.000 description 1
- 238000011156 evaluation Methods 0.000 description 1
- 238000010438 heat treatment Methods 0.000 description 1
- 230000007257 malfunction Effects 0.000 description 1
- 239000000203 mixture Substances 0.000 description 1
- 239000002245 particle Substances 0.000 description 1
- 235000011962 puddings Nutrition 0.000 description 1
- 238000010008 shearing Methods 0.000 description 1
- 239000002356 single layer Substances 0.000 description 1
- 239000000725 suspension Substances 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/48—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
- H01L23/488—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
- H01L23/495—Lead-frames or other flat leads
- H01L23/49541—Geometry of the lead-frame
- H01L23/49548—Cross section geometry
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/48—Manufacture or treatment of parts, e.g. containers, prior to assembly of the devices, using processes not provided for in a single one of the subgroups H01L21/06 - H01L21/326
- H01L21/4814—Conductive parts
- H01L21/4821—Flat leads, e.g. lead frames with or without insulating supports
- H01L21/4828—Etching
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/48—Manufacture or treatment of parts, e.g. containers, prior to assembly of the devices, using processes not provided for in a single one of the subgroups H01L21/06 - H01L21/326
- H01L21/4814—Conductive parts
- H01L21/4821—Flat leads, e.g. lead frames with or without insulating supports
- H01L21/4842—Mechanical treatment, e.g. punching, cutting, deforming, cold welding
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/50—Assembly of semiconductor devices using processes or apparatus not provided for in a single one of the subgroups H01L21/06 - H01L21/326, e.g. sealing of a cap to a base of a container
- H01L21/56—Encapsulations, e.g. encapsulation layers, coatings
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/50—Assembly of semiconductor devices using processes or apparatus not provided for in a single one of the subgroups H01L21/06 - H01L21/326, e.g. sealing of a cap to a base of a container
- H01L21/56—Encapsulations, e.g. encapsulation layers, coatings
- H01L21/561—Batch processing
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/50—Assembly of semiconductor devices using processes or apparatus not provided for in a single one of the subgroups H01L21/06 - H01L21/326, e.g. sealing of a cap to a base of a container
- H01L21/60—Attaching or detaching leads or other conductive members, to be used for carrying current to or from the device in operation
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/28—Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection
- H01L23/31—Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection characterised by the arrangement or shape
- H01L23/3107—Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection characterised by the arrangement or shape the device being completely enclosed
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/28—Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection
- H01L23/31—Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection characterised by the arrangement or shape
- H01L23/3107—Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection characterised by the arrangement or shape the device being completely enclosed
- H01L23/3142—Sealing arrangements between parts, e.g. adhesion promotors
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/48—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
- H01L23/488—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
- H01L23/495—Lead-frames or other flat leads
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/48—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
- H01L23/488—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
- H01L23/495—Lead-frames or other flat leads
- H01L23/49503—Lead-frames or other flat leads characterised by the die pad
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/48—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
- H01L23/488—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
- H01L23/495—Lead-frames or other flat leads
- H01L23/49503—Lead-frames or other flat leads characterised by the die pad
- H01L23/49513—Lead-frames or other flat leads characterised by the die pad having bonding material between chip and die pad
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/48—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
- H01L23/488—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
- H01L23/495—Lead-frames or other flat leads
- H01L23/49517—Additional leads
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/48—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
- H01L23/488—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
- H01L23/495—Lead-frames or other flat leads
- H01L23/49541—Geometry of the lead-frame
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/48—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
- H01L23/488—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
- H01L23/495—Lead-frames or other flat leads
- H01L23/49579—Lead-frames or other flat leads characterised by the materials of the lead frames or layers thereon
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/48—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
- H01L23/488—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
- H01L23/495—Lead-frames or other flat leads
- H01L23/49579—Lead-frames or other flat leads characterised by the materials of the lead frames or layers thereon
- H01L23/49582—Metallic layers on lead frames
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/48—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
- H01L23/50—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor for integrated circuit devices, e.g. power bus, number of leads
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/564—Details not otherwise provided for, e.g. protection against moisture
-
- C—CHEMISTRY; METALLURGY
- C23—COATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; CHEMICAL SURFACE TREATMENT; DIFFUSION TREATMENT OF METALLIC MATERIAL; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL; INHIBITING CORROSION OF METALLIC MATERIAL OR INCRUSTATION IN GENERAL
- C23C—COATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; SURFACE TREATMENT OF METALLIC MATERIAL BY DIFFUSION INTO THE SURFACE, BY CHEMICAL CONVERSION OR SUBSTITUTION; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL
- C23C18/00—Chemical coating by decomposition of either liquid compounds or solutions of the coating forming compounds, without leaving reaction products of surface material in the coating; Contact plating
- C23C18/16—Chemical coating by decomposition of either liquid compounds or solutions of the coating forming compounds, without leaving reaction products of surface material in the coating; Contact plating by reduction or substitution, e.g. electroless plating
- C23C18/18—Pretreatment of the material to be coated
- C23C18/20—Pretreatment of the material to be coated of organic surfaces, e.g. resins
- C23C18/22—Roughening, e.g. by etching
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/02—Bonding areas; Manufacturing methods related thereto
- H01L2224/04—Structure, shape, material or disposition of the bonding areas prior to the connecting process
- H01L2224/05—Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
- H01L2224/0554—External layer
- H01L2224/0555—Shape
- H01L2224/05552—Shape in top view
- H01L2224/05554—Shape in top view being square
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/10—Bump connectors; Manufacturing methods related thereto
- H01L2224/15—Structure, shape, material or disposition of the bump connectors after the connecting process
- H01L2224/16—Structure, shape, material or disposition of the bump connectors after the connecting process of an individual bump connector
- H01L2224/161—Disposition
- H01L2224/16151—Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
- H01L2224/16221—Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
- H01L2224/16245—Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being metallic
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/10—Bump connectors; Manufacturing methods related thereto
- H01L2224/15—Structure, shape, material or disposition of the bump connectors after the connecting process
- H01L2224/17—Structure, shape, material or disposition of the bump connectors after the connecting process of a plurality of bump connectors
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
- H01L2224/31—Structure, shape, material or disposition of the layer connectors after the connecting process
- H01L2224/32—Structure, shape, material or disposition of the layer connectors after the connecting process of an individual layer connector
- H01L2224/321—Disposition
- H01L2224/32151—Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
- H01L2224/32221—Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
- H01L2224/32245—Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being metallic
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/42—Wire connectors; Manufacturing methods related thereto
- H01L2224/47—Structure, shape, material or disposition of the wire connectors after the connecting process
- H01L2224/48—Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
- H01L2224/4805—Shape
- H01L2224/4809—Loop shape
- H01L2224/48091—Arched
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/42—Wire connectors; Manufacturing methods related thereto
- H01L2224/47—Structure, shape, material or disposition of the wire connectors after the connecting process
- H01L2224/48—Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
- H01L2224/481—Disposition
- H01L2224/48151—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
- H01L2224/48221—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
- H01L2224/48245—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being metallic
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/42—Wire connectors; Manufacturing methods related thereto
- H01L2224/47—Structure, shape, material or disposition of the wire connectors after the connecting process
- H01L2224/48—Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
- H01L2224/481—Disposition
- H01L2224/48151—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
- H01L2224/48221—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
- H01L2224/48245—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being metallic
- H01L2224/48247—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being metallic connecting the wire to a bond pad of the item
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/42—Wire connectors; Manufacturing methods related thereto
- H01L2224/47—Structure, shape, material or disposition of the wire connectors after the connecting process
- H01L2224/49—Structure, shape, material or disposition of the wire connectors after the connecting process of a plurality of wire connectors
- H01L2224/491—Disposition
- H01L2224/4912—Layout
- H01L2224/49171—Fan-out arrangements
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/73—Means for bonding being of different types provided for in two or more of groups H01L2224/10, H01L2224/18, H01L2224/26, H01L2224/34, H01L2224/42, H01L2224/50, H01L2224/63, H01L2224/71
- H01L2224/732—Location after the connecting process
- H01L2224/73251—Location after the connecting process on different surfaces
- H01L2224/73265—Layer and wire connectors
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/93—Batch processes
- H01L2224/95—Batch processes at chip-level, i.e. with connecting carried out on a plurality of singulated devices, i.e. on diced chips
- H01L2224/97—Batch processes at chip-level, i.e. with connecting carried out on a plurality of singulated devices, i.e. on diced chips the devices being connected to a common substrate, e.g. interposer, said common substrate being separable into individual assemblies after connecting
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/48—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
- H01L23/488—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
- H01L23/495—Lead-frames or other flat leads
- H01L23/49572—Lead-frames or other flat leads consisting of thin flexible metallic tape with or without a film carrier
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
- H01L24/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L24/10—Bump connectors ; Manufacturing methods related thereto
- H01L24/15—Structure, shape, material or disposition of the bump connectors after the connecting process
- H01L24/16—Structure, shape, material or disposition of the bump connectors after the connecting process of an individual bump connector
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
- H01L24/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L24/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
- H01L24/31—Structure, shape, material or disposition of the layer connectors after the connecting process
- H01L24/32—Structure, shape, material or disposition of the layer connectors after the connecting process of an individual layer connector
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
- H01L24/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L24/42—Wire connectors; Manufacturing methods related thereto
- H01L24/47—Structure, shape, material or disposition of the wire connectors after the connecting process
- H01L24/48—Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
- H01L24/73—Means for bonding being of different types provided for in two or more of groups H01L24/10, H01L24/18, H01L24/26, H01L24/34, H01L24/42, H01L24/50, H01L24/63, H01L24/71
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/15—Details of package parts other than the semiconductor or other solid state devices to be connected
- H01L2924/181—Encapsulation
-
- H—ELECTRICITY
- H05—ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
- H05K—PRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
- H05K2203/00—Indexing scheme relating to apparatus or processes for manufacturing printed circuits covered by H05K3/00
- H05K2203/03—Metal processing
- H05K2203/0307—Providing micro- or nanometer scale roughness on a metal surface, e.g. by plating of nodules or dendrites
Landscapes
- Engineering & Computer Science (AREA)
- Physics & Mathematics (AREA)
- Condensed Matter Physics & Semiconductors (AREA)
- General Physics & Mathematics (AREA)
- Computer Hardware Design (AREA)
- Microelectronics & Electronic Packaging (AREA)
- Power Engineering (AREA)
- Manufacturing & Machinery (AREA)
- Geometry (AREA)
- Lead Frames For Integrated Circuits (AREA)
- ing And Chemical Polishing (AREA)
- Structures Or Materials For Encapsulating Or Coating Semiconductor Devices Or Solid State Devices (AREA)
Description
以下、図1乃至図7Dを参照して第1の実施形態について説明する。以下、本開示の実施形態について図面を参照しながら説明する。なお、図面は模式的または概念的なものであり、各部材の寸法、部材間の大きさの比等は、必ずしも現実のものと同一とは限らない。また、同じ部材等を表す場合であっても、図面により互いの寸法や比が異なって表される場合もある。また、本明細書に添付した図面においては、理解を容易にするために、各部の形状、縮尺、縦横の寸法比等を、実物から変更したり、誇張したりしている場合がある。
本開示のリードフレームの実施形態について説明する。本実施形態に係るリードフレーム100は、半導体装置200(図3及び図4参照)を作製するために用いられるものである。リードフレーム100は、複数のパッケージ領域100Aを備えている。複数のパッケージ領域100Aは、多列及び多段(マトリックス状)に配置されている。なお、図1においては、1つのパッケージ領域100Aを中心としたリードフレーム100の一部のみを示している。
本開示の半導体装置の実施形態について説明する。図3及び図4に示すように、半導体装置200は、複数のリード部110と、ダイパッド部120と、半導体素子210と、接続部材220と、封止部230とを備えている。
図1及び図2に示すリードフレーム100の製造方法を例として説明する。図6A~図6Hは、本実施形態に係るリードフレームの製造方法を説明するための工程図である。
図6A及び図6Bに示すように、第1面310A及び当該第1面310Aに対向する第2面310Bを有する金属基板310を準備する(図6A参照)。なお、本実施形態で使用できる金属基板310としては、純銅基板、銅合金基板、42合金(Ni42%のFe合金)基板等が挙げられるが、純銅基板または銅合金基板であることが好ましい。また、金属基板310は、第1面310A及び第2面310Bに対して脱脂を行い、洗浄処理を施したものを使用してもよい。
次に、金属基板310の第1面310A及び第2面310Bにそれぞれ感光性レジスト320を塗布し、これを乾燥させる(図6B参照)。なお、本実施形態で使用できる感光性レジスト320としては、従来公知のものを使用できる。
次に、金属基板310の下面側に金属基板を支持する支持層360を設ける(図6G参照)。支持層360は、例えば、レジスト層であってもよい。支持層360を設けた後、金属基板310のうち被覆層350に覆われていない部分を粗化することにより粗面を形成する(図6G参照)。具体的には、リード部110の上面のうち金属めっき層112が形成される領域よりも外側(ダイパッド部120から遠い側)の上面、リード部110の側壁面、インナーリード部111の下面、ダイパッド部120の上面及びダイパッド部120の側壁面に粗面が形成される。粗面を形成するには、例えば、金属基板310に対してマイクロエッチング液を供給する。これにより、被覆層350で覆われている部分を除き、金属基板310全体に粗面を形成できる。なお、マイクロエッチング液とは、金属表面を僅かに溶かし、微細な凹凸の粗面を形成できる表面処理剤である。本実施形態において使用され得るマイクロエッチング液としては、硫酸又は塩酸を主成分として含有するもの、過酸化水素と硫酸を主成分として含有するもの等が挙げられる。
図3及び図4に示す半導体装置200の製造方法を例として説明する。図7A~図7Dは、本実施形態に係る半導体装置の製造方法を説明するための工程図である。
以下、実施例及び比較例を挙げて本開示をさらに詳細に説明するが、本開示は、下記の実施例等に何ら限定されるものではない。
図1及び図2に示す構成を有する。リードフレーム100を準備した。リードフレーム100において、リード部110の上面及び側壁面、並びにダイパッド部120の上面及び側壁面が、CIELab色空間のうちのa*値が17.53、b*値が14.80及び山頂点の算術平均曲率Spcが2431.46mm-1、並びに算術平均高さSaが0.14μmの粗面により構成されていた。なお、a*値及びb*値は、分光濃度・測色計eXact(X-rite社製)を用いて測定し、山頂点の算術平均曲率Spc及び算術平均高さSaは、レーザー顕微鏡VK-X260(キーエンス社製、測定部)、レーザー顕微鏡VK-X250(キーエンス社製、コントローラー部)を用いて測定した。
リード部110の上面及び側壁面、並びにダイパッド部120の上面及び側壁面が、CIELab色空間のうちのa*値が16.03、b*値が13.84及び山頂点の算術平均曲率Spcが2952.08mm-1、並びに算術平均高さSaが0.17μmの粗面により構成されている以外は、実施例1と同様の構成を有するリードフレーム100を準備した。
リード部110の上面及び側壁面、並びにダイパッド部120の上面及び側壁面が、CIELab色空間のうちのa*値が15.39、b*値が13.16及び山頂点の算術平均曲率Spcが3523.76mm-1、並びに算術平均高さSaが0.22μmの粗面により構成されている以外は、実施例1と同様の構成を有するリードフレーム100を準備した。
リード部110の上面及び側壁面、並びにダイパッド部120の上面及び側壁面が、CIELab色空間のうちのa*値が14.65、b*値が12.86及び山頂点の算術平均曲率Spcが3378.00mm-1、並びに算術平均高さSaが0.21μmの粗面により構成されている以外は、実施例1と同様の構成を有するリードフレーム100を準備した。
リード部110の上面及び側壁面、並びにダイパッド部120の上面及び側壁面が、CIELab色空間のうちのa*値が18.59、b*値が17.29及び山頂点の算術平均曲率Spcが629.05mm-1、並びに算術平均高さSaが0.11μmの粗面により構成されている以外は、実施例1と同様の構成を有するリードフレームを準備した。
リード部110の上面及び側壁面、並びにダイパッド部120の上面及び側壁面が、CIELab色空間のうちのa*値が10.06、b*値が7.18及び山頂点の算術平均曲率Spcが986.96mm-1、並びに算術平均高さSaが0.09μmの粗化されていない非粗化面により構成されている以外は、実施例1と同様の構成を有するリードフレームを準備した。
実施例1~4及び比較例1~2の各リードフレームの粗面の状態をSEM及びレーザー顕微鏡で観察し、実施例1~4及び比較例1~2の各リードフレームのせん断強さを測定した。結果を表1に示す。なお、せん断強さは、モールド樹脂密着強度試験(プリンカップ試験)として、リードフレーム上にモールド樹脂を成型し、せん断方向を与えることによって計測する。モールド樹脂は、EME-631(住友ベークライト社製)を使用し、成型時間120秒、成型温度175±5℃、成型圧力10MPaでモールド樹脂成型を行い、その後、175℃で6時間硬化処理を行った。なお、成型したモールド樹脂のサイズは、高さ4mm、底面直径4mm、上面直径3mmとし、底面側をリードフレームに成型した。その後、リードフレームを接合強度試験機DAGE4000(ノードソン社製)に固定し、リードフレーム上のモールド樹脂の横方向からせん断荷重1kg、速度0.1mm/秒の荷重をかけることで、せん断強さを測定した。
次に、第2の実施形態について、図8乃至図17を参照して説明する。なお、以下の各図において、同一部分には同一の符号を付しており、一部詳細な説明を省略する場合がある。
まず、図8乃至図10により、本実施形態によるリードフレームの概略について説明する。図8乃至図10は、本実施形態によるリードフレームを示す図である。
次に、図11乃至図13により、本実施形態による半導体装置について説明する。図11乃至図13は、本実施形態による半導体装置(フリップチップタイプ)を示す図である。
次に、図8及び図9に示すリードフレーム10の製造方法について、図14(a)-(i)を用いて説明する。図14(a)-(i)は、リードフレーム10の製造方法を示す断面図(図9に対応する図)である。
次に、図11及び図12に示す半導体装置20の製造方法について、図15(a)-(d)を用いて説明する。図15(a)-(d)は、半導体装置20の製造方法を示す断面図(図12に対応する図)である。
次に、図17(a)-(d)により、ダイパッド平滑面領域11e及びリード平滑面領域12eの変形例について説明する。図17(a)-(d)は、それぞれダイパッド平滑面領域11e及びリード平滑面領域12e(以下、単に平滑面領域11e、12eともいう)と、ダイパッド粗面領域11f及びリード粗面領域12f(以下、単に粗面領域11f、12fともいう)を示す拡大平面図である。
次に第3の実施形態について、図18乃至図25を参照して説明する。図18乃至図25は、第3の実施形態を示す図である。図18乃至図25において、図8乃至図17に示す形態と同一部分には同一の符号を付して詳細な説明は省略する。
まず、図18及び図19により、本実施形態によるリードフレームの概略について説明する。図18及び図19は、本実施形態によるリードフレームを示す図である。
次に、図20乃至図22により、本実施形態による半導体装置について説明する。図20乃至図22は、本実施形態による半導体装置(フリップチップタイプ)を示す図である。
次に、図18及び図19に示すリードフレーム10の製造方法について、図23(a)-(i)を用いて説明する。図23(a)-(i)は、リードフレーム10の製造方法を示す断面図(図19に対応する図)である。
図24(a)-(d)に示すように、本実施形態による半導体装置20の製造方法は、第2の実施形態による半導体装置20の製造方法と略同様にして行うことができる。この場合、半導体素子21の各電極21aは、それぞれバンプ26を介して、ダイパッド11及びリード部12に電気的に接続される。
次に、図26乃至図29を参照して第4の実施形態について説明する。図26乃至図29は第4の実施形態を示す図である。図26乃至図29に示す第4の実施形態は、主として、ダイパッド11及びリード部12の表面に金属層25が設けられている点が異なるものであり、他の構成は上述した第3の実施形態と略同一である。図26乃至図29において、図8乃至図17に示す第2の実施形態、及び、図18乃至図25に示す第3の実施形態と同一部分には同一の符号を付して詳細な説明は省略する。
図26は本実施形態によるリードフレーム10Aを示す断面図であり、図27は本実施形態による半導体装置20Aを示す断面図である。
次に、図26に示すリードフレーム10Aの製造方法について、図28(a)-(j)を用いて説明する。図28(a)-(j)において、図23(a)-(i)に示す構成と同一部分には同一の符号を付して詳細な説明は省略する。
本実施形態による半導体装置20Aの製造方法は、図24(a)-(d)に示す半導体装置20の製造方法と略同様にして行うことができる。この場合、半導体素子21の各電極21aは、それぞれバンプ26及び金属層25を介して、ダイパッド11及びリード部12に電気的に接続される。
第5の実施形態について、図30乃至図37を参照して説明する。図30乃至図37は、第5の実施形態を示す図である。図30乃至図37において、図8乃至図29に示す実施形態と同一部分には同一の符号を付して詳細な説明は省略する。
まず、図30及び図31により、本実施形態によるリードフレームの概略について説明する。図30及び図31は、本実施形態によるリードフレームを示す図である。
次に、図32乃至図34により、本実施形態による半導体装置について説明する。図32乃至図34は、本実施形態による半導体装置(フリップチップタイプ)を示す図である。
次に、図30及び図31に示すリードフレーム10の製造方法について、図35(a)-(j)を用いて説明する。図35(a)-(j)は、リードフレーム10の製造方法を示す断面図(図31に対応する図)である。
図36(a)-(d)に示すように、本実施形態による半導体装置20の製造方法は、第2の実施形態による半導体装置20の製造方法と略同様にして行うことができる。この場合、半導体素子21の各電極21aと、ダイパッド11及びリード部12とが、それぞれバンプ26及び金属層25を介して互いに電気的に接続される。
次に、図38乃至図41を参照して第6の実施形態について説明する。図38乃至図41は第6の実施形態を示す図である。図38乃至図41に示す第6の実施形態は、主として、リード部12の表面に粗面が形成されている点が異なるものであり、他の構成は上述した第5の実施形態と略同一である。図38乃至図41において、図8乃至図37に示す実施形態と同一部分には同一の符号を付して詳細な説明は省略する。
図38は本実施形態によるリードフレーム10Aを示す断面図であり、図39は本実施形態による半導体装置20Aを示す断面図である。
次に、図38に示すリードフレーム10Aの製造方法について、図40(a)-(j)を用いて説明する。図40(a)-(j)において、図35(a)-(j)に示す構成と同一部分には同一の符号を付して詳細な説明は省略する。
本実施形態による半導体装置20Aの製造方法は、図36(a)-(d)に示す半導体装置20の製造方法と略同様にして行うことができる。
次に、図42乃至図45を参照して第7の実施形態について説明する。図42乃至図45は第7の実施形態を示す図である。図42乃至図45に示す第7の実施形態は、主として、リード部12の表面に凹部18が形成されている点が異なるものであり、他の構成は上述した第5の実施形態と略同一である。図42乃至図45において、図8乃至図41に示す実施形態と同一部分には同一の符号を付して詳細な説明は省略する。
図42は本実施形態によるリードフレーム10Bを示す断面図であり、図43は本実施形態による半導体装置20Bを示す断面図である。
次に、図42に示すリードフレーム10Bの製造方法について、図44(a)-(j)を用いて説明する。図44(a)-(j)において、図35(a)-(j)に示す構成と同一部分には同一の符号を付して詳細な説明は省略する。
本実施形態による半導体装置20Bの製造方法は、図36(a)-(d)に示す半導体装置20の製造方法と略同様にして行うことができる。
次に、図46乃至図49を参照して第8の実施形態について説明する。図46乃至図49は第8の実施形態を示す図である。図46乃至図49に示す第8の実施形態は、主として、凹部18の内面が粗面となっている点が異なるものであり、他の構成は上述した第7の実施形態と略同一である。図46乃至図49において、図8乃至図45に示す実施形態と同一部分には同一の符号を付して詳細な説明は省略する。
図46は本実施形態によるリードフレーム10Cを示す断面図であり、図47は本実施形態による半導体装置20Cを示す断面図である。
次に、図46に示すリードフレーム10Cの製造方法について、図48(a)-(j)を用いて説明する。図48(a)-(j)において、図35(a)-(j)に示す構成と同一部分には同一の符号を付して詳細な説明は省略する。
本実施形態による半導体装置20Cの製造方法は、図36(a)-(d)に示す半導体装置20の製造方法と略同様にして行うことができる。
第9の実施形態について、図50乃至図57を参照して説明する。図50乃至図57は、第9の実施形態を示す図である。図50乃至図57において、図8乃至図49に示す実施形態と同一部分には同一の符号を付して詳細な説明は省略する。
まず、図50及び図51により、本実施形態によるリードフレームの概略について説明する。図50及び図51は、本実施形態によるリードフレームを示す図である。
次に、図52及び図53により、本実施形態による半導体装置について説明する。図52及び図53は、本実施形態による半導体装置(QFNタイプ)を示す図である。
次に、図50及び図51に示すリードフレーム10の製造方法について、図54(a)-(e)及び図55(a)-(h)を用いて説明する。図54(a)-(e)及び図55(a)-(h)は、リードフレーム10の製造方法を示す断面図(図51に対応する図)である。
次に、図52及び図53に示す半導体装置20の製造方法について、図56(a)-(e)を用いて説明する。図56(a)-(e)は、半導体装置20の製造方法を示す断面図(図53に対応する図)である。
次に、図58により、本実施形態によるリードフレーム10の変形例について説明する。図58は、変形例によるリードフレーム10を示す断面図である。図58において、図50乃至図57に示す形態と同一部分には同一の符号を付して詳細な説明は省略する。
Claims (16)
- 複数のリード部を備え、
前記リード部の上面の少なくとも一部及び前記リード部の側壁面は、粗化された粗面であり、
前記粗面のCIELab色空間のうちのa*値が12~19の範囲であり、b*値が12~17の範囲である、リードフレーム。 - 複数のリード部を備え、
前記リード部の上面の少なくとも一部及び前記リード部の側壁面は、粗化された粗面であり、
前記粗面の山頂点の算術平均曲率Spcが700mm-1以上である、リードフレーム。 - 前記粗面の算術平均高さSaが0.12μm以上である、請求項2に記載のリードフレーム。
- 前記リード部の上面の一部及び前記リード部の側壁面が前記粗面であり、
前記リード部の前記上面のうちの前記粗面ではない面に金属めっき層が設けられている、請求項1又は2に記載のリードフレーム。 - 前記金属めっき層は、Agめっき層、Niめっき層、Pdめっき層、及びAuめっき層のうちの少なくとも1つを含む、請求項4に記載のリードフレーム。
- 前記リード部は、前記リード部の下面側から薄肉化されたインナーリード部を含み、
前記インナーリード部の下面は前記粗面である、請求項1又は2に記載のリードフレーム。 - 半導体素子を搭載するダイパッド部をさらに備え、
前記ダイパッド部の周囲に前記複数のリード部が配置され、
前記ダイパッド部の上面及び前記ダイパッド部の側壁面は前記粗面である、請求項1又は2に記載のリードフレーム。 - 前記リードフレームは、前記複数のリード部を少なくとも封止する封止部を備える半導体装置を製造するために用いられるものであって、
前記封止部と接触する前記リード部の上面及び前記リード部の側壁面は粗化された粗面である、請求項1又は2に記載のリードフレーム。 - 第1面及び当該第1面に対向する第2面を有する金属基板を準備する金属基板準備工程と、
前記金属基板を加工することにより複数のリード部を形成する金属基板加工工程と、
前記リード部の上面の少なくとも一部及び前記リード部の側壁面を粗化して粗面を形成する粗面形成工程と
を含み、
前記粗面形成工程において、前記粗面のCIELab色空間におけるa*値が12~19の範囲、b*値が12~17の範囲となるように粗化する、リードフレームの製造方法。 - 第1面及び当該第1面に対向する第2面を有する金属基板を準備する金属基板準備工程と、
前記金属基板を加工することにより複数のリード部を形成する金属基板加工工程と、
前記リード部の上面の少なくとも一部及び前記リード部の側壁面を粗化して粗面を形成する粗面形成工程と
を含み、
前記粗面形成工程において、前記粗面の山頂点の算術平均曲率Spcが700mm-1以上となるように粗化する、リードフレームの製造方法。 - 前記粗面形成工程において、前記粗面の算術平均高さSaが0.12μm以上となるように粗化する請求項10に記載のリードフレームの製造方法。
- 前記粗面形成工程後に、前記リード部にアルカリ処理を施す請求項9又は10に記載のリードフレームの製造方法。
- 前記リード部の前記上面の一部に金属めっき層が設けられており、
前記粗面形成工程において、前記リード部における前記金属めっき層が設けられていない前記上面及び前記側壁面を粗化する請求項9又は10に記載のリードフレームの製造方法。 - 前記金属めっき層は、Agめっき層、Niめっき層、Pdめっき層、及びAuめっき層のうちの少なくとも1つを含む請求項13に記載のリードフレームの製造方法。
- 前記金属基板加工工程において、前記リード部の下面側から薄肉化されたインナーリード部を含む前記リード部を形成し、
前記粗面形成工程において、前記インナーリード部の下面に前記粗面を形成する請求項9又は10に記載のリードフレームの製造方法。 - 前記金属基板加工工程において、半導体素子を搭載するダイパッド部を、前記ダイパッド部の周囲に前記複数のリード部が配置されるように形成し、
前記粗面形成工程において、前記ダイパッド部の上面及び前記ダイパッド部の側壁面、並びに前記リード部の上面の少なくとも一部及び前記リード部の側壁面を粗化して前記粗面を形成する工程を含む請求項9又は10に記載のリードフレームの製造方法。
Priority Applications (4)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2023113314A JP7414181B2 (ja) | 2021-09-03 | 2023-07-10 | リードフレーム及びその製造方法 |
JP2023216133A JP7540579B2 (ja) | 2021-09-03 | 2023-12-21 | リードフレーム及びその製造方法 |
JP2024082632A JP2024105666A (ja) | 2021-09-03 | 2024-05-21 | リードフレーム及びその製造方法 |
JP2024100595A JP2024123171A (ja) | 2021-09-03 | 2024-06-21 | リードフレーム及びその製造方法 |
Applications Claiming Priority (11)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2021144291 | 2021-09-03 | ||
JP2021144288 | 2021-09-03 | ||
JP2021144291 | 2021-09-03 | ||
JP2021144288 | 2021-09-03 | ||
JP2021185138 | 2021-11-12 | ||
JP2021185138 | 2021-11-12 | ||
JP2021185144 | 2021-11-12 | ||
JP2021185144 | 2021-11-12 | ||
JP2022058471 | 2022-03-31 | ||
JP2022058471 | 2022-03-31 | ||
PCT/JP2022/033037 WO2023033126A1 (ja) | 2021-09-03 | 2022-09-01 | リードフレーム及びその製造方法 |
Related Child Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2023113314A Division JP7414181B2 (ja) | 2021-09-03 | 2023-07-10 | リードフレーム及びその製造方法 |
Publications (3)
Publication Number | Publication Date |
---|---|
JPWO2023033126A1 JPWO2023033126A1 (ja) | 2023-03-09 |
JPWO2023033126A5 JPWO2023033126A5 (ja) | 2023-08-25 |
JP7343084B2 true JP7343084B2 (ja) | 2023-09-12 |
Family
ID=85412430
Family Applications (5)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2023541129A Active JP7343084B2 (ja) | 2021-09-03 | 2022-09-01 | リードフレーム及びその製造方法 |
JP2023113314A Active JP7414181B2 (ja) | 2021-09-03 | 2023-07-10 | リードフレーム及びその製造方法 |
JP2023216133A Active JP7540579B2 (ja) | 2021-09-03 | 2023-12-21 | リードフレーム及びその製造方法 |
JP2024082632A Pending JP2024105666A (ja) | 2021-09-03 | 2024-05-21 | リードフレーム及びその製造方法 |
JP2024100595A Pending JP2024123171A (ja) | 2021-09-03 | 2024-06-21 | リードフレーム及びその製造方法 |
Family Applications After (4)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2023113314A Active JP7414181B2 (ja) | 2021-09-03 | 2023-07-10 | リードフレーム及びその製造方法 |
JP2023216133A Active JP7540579B2 (ja) | 2021-09-03 | 2023-12-21 | リードフレーム及びその製造方法 |
JP2024082632A Pending JP2024105666A (ja) | 2021-09-03 | 2024-05-21 | リードフレーム及びその製造方法 |
JP2024100595A Pending JP2024123171A (ja) | 2021-09-03 | 2024-06-21 | リードフレーム及びその製造方法 |
Country Status (5)
Country | Link |
---|---|
US (2) | US20240145356A1 (ja) |
JP (5) | JP7343084B2 (ja) |
KR (1) | KR20240051069A (ja) |
TW (1) | TWI846042B (ja) |
WO (1) | WO2023033126A1 (ja) |
Families Citing this family (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP7413626B1 (ja) | 2023-05-02 | 2024-01-16 | 長華科技股▲ふん▼有限公司 | リードフレーム及びその製造方法 |
Citations (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2007287765A (ja) | 2006-04-13 | 2007-11-01 | Denso Corp | 樹脂封止型半導体装置 |
JP2017022267A (ja) | 2015-07-10 | 2017-01-26 | Shマテリアル株式会社 | リードフレームの製造方法 |
JP2017168871A (ja) | 2017-06-29 | 2017-09-21 | 大日本印刷株式会社 | 半導体装置の製造方法、リードフレームの製造方法、半導体装置の多面付け体、および半導体装置 |
JP2020167207A (ja) | 2019-03-28 | 2020-10-08 | 大口マテリアル株式会社 | 半導体素子搭載用部品、リードフレーム及び半導体素子搭載用基板 |
Family Cites Families (11)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP4357728B2 (ja) | 2000-09-29 | 2009-11-04 | 大日本印刷株式会社 | 樹脂封止型半導体装置 |
US7049683B1 (en) * | 2003-07-19 | 2006-05-23 | Ns Electronics Bangkok (1993) Ltd. | Semiconductor package including organo-metallic coating formed on surface of leadframe roughened using chemical etchant to prevent separation between leadframe and molding compound |
JP4301068B2 (ja) | 2004-01-09 | 2009-07-22 | 株式会社デンソー | 樹脂封止型半導体装置およびその製造方法 |
JP4857594B2 (ja) * | 2005-04-26 | 2012-01-18 | 大日本印刷株式会社 | 回路部材、及び回路部材の製造方法 |
US20120097545A1 (en) * | 2010-05-20 | 2012-04-26 | Toru Imori | Silver electroplated and/or silver alloy electroplated article having an oxidation layer on its surface |
TWI522244B (zh) * | 2012-02-13 | 2016-02-21 | 群康科技(深圳)有限公司 | 電子裝置及其積層結構及積層結構的製造方法 |
JP6493952B2 (ja) * | 2014-08-26 | 2019-04-03 | 大口マテリアル株式会社 | リードフレーム及びその製造方法 |
JP6685112B2 (ja) | 2015-11-18 | 2020-04-22 | 株式会社三井ハイテック | リードフレーム及びリードフレームパッケージ、並びにこれらの製造方法 |
TWI637470B (zh) * | 2016-04-19 | 2018-10-01 | 東芝股份有限公司 | 半導體封裝及其之製造方法 |
JP2019040994A (ja) | 2017-08-25 | 2019-03-14 | ルネサスエレクトロニクス株式会社 | 半導体装置およびその製造方法 |
DE112021001570T5 (de) * | 2020-03-11 | 2022-12-22 | Rohm Co., Ltd. | Halbleiterbauteil |
-
2022
- 2022-09-01 US US18/279,608 patent/US20240145356A1/en active Pending
- 2022-09-01 JP JP2023541129A patent/JP7343084B2/ja active Active
- 2022-09-01 WO PCT/JP2022/033037 patent/WO2023033126A1/ja active Application Filing
- 2022-09-01 KR KR1020237029193A patent/KR20240051069A/ko active Search and Examination
- 2022-09-02 TW TW111133356A patent/TWI846042B/zh active
-
2023
- 2023-07-10 JP JP2023113314A patent/JP7414181B2/ja active Active
- 2023-09-29 US US18/375,193 patent/US20240030114A1/en active Pending
- 2023-12-21 JP JP2023216133A patent/JP7540579B2/ja active Active
-
2024
- 2024-05-21 JP JP2024082632A patent/JP2024105666A/ja active Pending
- 2024-06-21 JP JP2024100595A patent/JP2024123171A/ja active Pending
Patent Citations (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2007287765A (ja) | 2006-04-13 | 2007-11-01 | Denso Corp | 樹脂封止型半導体装置 |
JP2017022267A (ja) | 2015-07-10 | 2017-01-26 | Shマテリアル株式会社 | リードフレームの製造方法 |
JP2017168871A (ja) | 2017-06-29 | 2017-09-21 | 大日本印刷株式会社 | 半導体装置の製造方法、リードフレームの製造方法、半導体装置の多面付け体、および半導体装置 |
JP2020167207A (ja) | 2019-03-28 | 2020-10-08 | 大口マテリアル株式会社 | 半導体素子搭載用部品、リードフレーム及び半導体素子搭載用基板 |
Also Published As
Publication number | Publication date |
---|---|
JP2024123171A (ja) | 2024-09-10 |
US20240145356A1 (en) | 2024-05-02 |
JP2024029078A (ja) | 2024-03-05 |
WO2023033126A1 (ja) | 2023-03-09 |
JP2024105666A (ja) | 2024-08-06 |
JPWO2023033126A1 (ja) | 2023-03-09 |
JP7414181B2 (ja) | 2024-01-16 |
TW202320243A (zh) | 2023-05-16 |
US20240030114A1 (en) | 2024-01-25 |
JP2023134601A (ja) | 2023-09-27 |
TWI846042B (zh) | 2024-06-21 |
KR20240051069A (ko) | 2024-04-19 |
JP7540579B2 (ja) | 2024-08-27 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
TWI429045B (zh) | Circuit member, manufacturing method of circuit member, laminated structure of semiconductor device and circuit member surface | |
JP4091050B2 (ja) | 半導体装置の製造方法 | |
US20080087996A1 (en) | Semiconductor device and manufacturing method of the same | |
JP2024123171A (ja) | リードフレーム及びその製造方法 | |
JP2011176271A (ja) | Ledパッケージ及びその製造方法 | |
JP2005057067A (ja) | 半導体装置およびその製造方法 | |
JP6736719B1 (ja) | 半導体素子搭載用部品、リードフレーム及び半導体素子搭載用基板 | |
JP2000188366A (ja) | 半導体装置 | |
JP2008187045A (ja) | 半導体装置用リードフレームとその製造方法、半導体装置 | |
JP2021150638A (ja) | リードフレーム、リードフレームの製造方法及び半導体装置の製造方法 | |
JP7193284B2 (ja) | リードフレーム及びリードフレームの製造方法 | |
TW201407732A (zh) | 封裝結構及其製造方法 | |
JP2007201324A (ja) | 電子装置の実装構造および電子部品の実装方法 | |
TW200901422A (en) | Pre-plated leadframe having enhanced encapsulation adhesion | |
JP6733941B1 (ja) | 半導体素子搭載用基板 | |
TW202435373A (zh) | 導線框架及其製造方法 | |
CN116941034A (zh) | 引线框及其制造方法 | |
JP2021150462A (ja) | リードフレーム、リードフレームの製造方法及び半導体装置の製造方法 | |
US10305007B2 (en) | Multi-row LED wiring member and method for manufacturing the same | |
JP2006269719A (ja) | 電子装置 | |
JP7380750B2 (ja) | リードフレームおよび半導体装置 | |
JP7365588B2 (ja) | リードフレームおよび半導体装置 | |
JP2018081961A (ja) | 半導体装置用リードフレームとその製造方法および樹脂封止型半導体装置 | |
KR101297662B1 (ko) | 리드프레임의 제조방법 | |
JP2023174472A (ja) | リードフレーム及びその製造方法 |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A521 | Request for written amendment filed |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20230705 |
|
A621 | Written request for application examination |
Free format text: JAPANESE INTERMEDIATE CODE: A621 Effective date: 20230705 |
|
A871 | Explanation of circumstances concerning accelerated examination |
Free format text: JAPANESE INTERMEDIATE CODE: A871 Effective date: 20230705 |
|
TRDD | Decision of grant or rejection written | ||
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20230801 |
|
A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20230814 |
|
R150 | Certificate of patent or registration of utility model |
Ref document number: 7343084 Country of ref document: JP Free format text: JAPANESE INTERMEDIATE CODE: R150 |