JP7309920B2 - 多接合ledのトンネル接合、多接合led、及びその製作方法 - Google Patents

多接合ledのトンネル接合、多接合led、及びその製作方法 Download PDF

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Description

本発明は、多接合LEDのトンネル接合、多接合LED、及びその製作方法に関し、半導体の光電技術分野に属する。
赤外発光ダイオードとは、赤外線を発光することができるダイオードであり、安全監視、ウェアラブル装置、赤外線通信、赤外線遠隔制御装置、センサー用光源、及び夜間照明などの分野、特にガス検出の分野に適用されている。その中で、安全監視、夜間照明システムは、赤外発光ダイオードの輝度に対する要求が比較的高いため、多接合LEDを直列接続することが一般的な解決方法とされ、即ち、エピタキシャル成長を行っている際に、トンネル接合を用いて各サブ素子を直列接続することであり、また、高いピーク電流密度のトンネル接合のエピタキシャル成長がその重要な技術である。できるだけ高いトンネルピーク電流を得るために、トンネル接合材料の選択、ドーピング源の選択、ドーピング濃度、及び成長技術などを考えなければならない。
赤外発光ダイオードは、主にAlGaAsの材料系のものであるため、それ自身が光吸収効果を有し、且つ比較的大きな直列接続の電気抵抗が発生するので、多接合LEDのトンネル接合の材料を選択することは重要である。高効率、低光吸収、低電圧のトンネル接合構造を完成させるために、以下のことを満たさなければならない。1、トンネル接合のp型領域及びn型領域の厚さは、できる限り薄くすること(15nm未満)。2、光吸収を避けるために、トンネル接合のp型領域及びn型領域の材料のバンドギャップは、主ピークの波長よりも大きい必要があること(Eg>hv)。3、トンネル接合のp型領域及びn型領域の濃度は、1E1019cm-3を超える必要があること。
多接合LEDの実際応用においては、大型且つ高輝度製品のニーズ(例えば、車両用灯具、舞台照明、虹彩認識などの製品)に伴い、素子の注入電流が大きくなって、トンネル接合のピーク電流密度に対する要求が高くなる。低いバンドギャップのトンネル接合は、光吸収現象が存在するので、素子の発光輝度に対して深刻な影響を与える。このため、トンネル接合の半導体材料のバンドギャップを低くして、高いピーク電流密度を高めるという方法は通用しない。
従来技術に存在する上記の問題によって、本発明は、多接合LEDのトンネル接合、多接合LED、及びその製作方法を提供する。
本発明の第1の形態によれば、多接合LEDのトンネル接合には、高濃度にドーピングされたP型のAlX1Ga1-X1Asと、AlX2Ga1-X2Asの第1のグレーデッド層と、高濃度にドーピングされたN型のGaIn1-YPと、AlX3Ga1-X3Asの第2のグレーデッド層と、が順に含まれている。
前記高濃度にドーピングされたP型のAlX1Ga1-X1AsのX1は、0~0.8の範囲内にあることが好ましい。
前記高濃度にドーピングされたP型のAlX1Ga1-X1Asのドーピング濃度は、1E19cm-3以上であることが好ましい。
前記高濃度にドーピングされたP型のAlX1Ga1-X1Asは、ドーピング濃度が1E19~2E20cm-3の範囲内にあるCドーピングのP型のAlX1Ga1-X1Asであることが好ましい。
前記高濃度にドーピングされたP型のAlX1Ga1-X1Asの厚さは、10~100nmの範囲内にあることが好ましい。
前記高濃度にドーピングされたN型のGaIn1-YPのYは、0.45~0.7の範囲内にあることが好ましい。
前記高濃度にドーピングされたN型のGaIn1-YPのドーピング濃度は、1E19cm-3以上であることが好ましい。
前記高濃度にドーピングされたN型のGaIn1-YPは、Teドーピング濃度が1E19~2E20cm-3の範囲内にあるTeドーピングのN型のGaIn1-YPであることが更に好ましい。
本発明の他の実施形態として、前記高濃度にドーピングされたN型のGaIn1-YPは、Teドーピング濃度が1E19~2E20cm-3の範囲内にあり且つSiドーピング濃度が5E18~2E19cm-3の範囲内にあるTeとSiとの混合ドーピングのN型のGaIn1-YPであることが更に好ましい。前記TeとSiとのドーピング濃度の割合が5:3~2:1にあることが更に好ましい。
前記高濃度にドーピングされたN型のGaIn1-YPの厚さは、10~100nmの範囲内にあることが好ましい。
前記AlX2Ga1-X2Asの第1のグレーデッド層は、高濃度にドーピングされたP型のAlX1Ga1-X1Asと高濃度にドーピングされたN型のGaIn1-YPとの間に介在され、且つ前記AlX2Ga1-X2Asの第1のグレーデッド層におけるAlの相対含有量は、高濃度にドーピングされたP型のAlX1Ga1-X1Asから高濃度にドーピングされたN型のGaIn1-YPの方へ徐々に減少することが好ましい。前記AlX2Ga1-X2Asの第1のグレーデッド層におけるAlの相対含有量は、高濃度にドーピングされたP型のAlX1Ga1-X1Asから高濃度にドーピングされたN型のGaIn1-YPの方へ直線的に減少することが更に好ましい。
前記AlX2Ga1-X2Asの第1のグレーデッド層は、ドーピング濃度が1E19~5E19cm-3の範囲内にあるCドーピングのP型のAlX2Ga1-X2Asのグレーデッド層であることが好ましい。
前記AlX2Ga1-X2Asの第1のグレーデッド層の厚さは、10~50nmの範囲内にあることが好ましい。
前記AlX3Ga1-X3Asの第2のグレーデッド層は、高濃度にドーピングされたN型のGaIn1-YPの上にあり、且つ前記AlX3Ga1-X3Asの第2のグレーデッド層におけるAlの相対含有量は、高濃度にドーピングされたN型のGaIn1-YPから離れる方へ徐々に増加することが好ましい。前記AlX3Ga1-X3Asの第2のグレーデッド層におけるAlの相対含有量は、高濃度にドーピングされたN型のGaIn1-YPから離れる方へ直線的に増加することが更に好ましい。
前記AlX3Ga1-X3Asの第2のグレーデッド層は、ドーピング濃度が1E19~5E19cm-3の範囲内にあるTeドーピングのN型のAlX3Ga1-X3Asのグレーデッド層であることが好ましい。
前記AlX3Ga1-X3Asの第2のグレーデッド層の厚さは、10~50nmの範囲内にあることが好ましい。
本発明の第2の形態によれば、多接合LED構造は、第1のLEDIのエピタキシャル構造と、第2のLEDIIのエピタキシャル構造と、を少なくとも含んでいる多接合LED構造であって、前記第1のLEDIのエピタキシャル構造と前記第2のLEDIIのエピタキシャル構造との間に、上記のトンネル接合を具えている。
前記第1のLEDIのエピタキシャル構造と前記第2のLEDIIのエピタキシャル構造の放射波長は、760nm~1100nmの範囲内にある赤外線であることが好ましい。
同時に、本発明は、第1のLEDIのエピタキシャル構造を形成するステップと、前記第1のLEDIのエピタキシャル構造の上に、高濃度にドーピングされたP型のAlX1Ga1-X1Asと、AlX2Ga1-X2Asの第1のグレーデッド層と、高濃度にドーピングされたN型のGaIn1-YPと、AlX3Ga1-X3Asの第2のグレーデッド層と、を含むトンネル接合構造を形成するステップと、前記トンネル接合構造の上に第2のLEDIIのエピタキシャル構造を形成するステップと、を含む多接合LED構造の製作方法を提供する。これで、双接合LED構造を形成し、この方法に従って多接合LED素子の構造にエピタキシャル成長を続いて行なうことができる。各LEDのエピタキシャルのサブ構造には、n型の半導体層と、活性層と、p型の半導体層と、が含まれることは一般的であるが、腐食防止層、オーミックコンタクト層、透明導電層といった機能層を含むこともできる。
上記によれば、本発明で設計の多接合LEDに用いられるトンネル接合及び多接合LEDは、以下の有利な効果を有する。
(1)高濃度にドーピングされたN型のGaIn1-YPを用いて、そのGaIn1-YPのバンドギャップが比較的に大きいので、不可視光線に対する光吸収効果を効果的に減少して、素子の輝度を向上させることができ、且つ直列接続による電気抵抗を効果的に減らして電圧を減らすことができる。
(2)高濃度にドーピングされたP型のAlX1Ga1-X1Asと高濃度にドーピングされたN型のGaIn1-YPとの間にAlX2Ga1-X2Asの第1のグレーデッド層を加えることにより、高濃度にドーピングされたP型のAlX1Ga1-X1Asと高濃度にドーピングされたN型のGaIn1-YPとの間の界面にあるアルミニウムの相対含有量の差が比較的大きいことによる格子不整合が発生する欠陥の問題を効果的に改善することができ、界面の品質と結晶体の成長品質とを効果的に向上させることができると共に、AsとPとの切り替えを効果的に実現し、直列接続による電気抵抗を減らして作業電圧を低くし、ひいては光電変換効率を向上させることもできる。
(3)高濃度にドーピングされたN型のGaIn1-YPの上にAlGaAs被覆層を続けて成長させる。ここで、高いAl成分が合成している際に、突起及び水点(Ga-rich又はAl-rich)が発生してエピタキシャル層と不整合となることを防ぐために、Alの成分、成長速度、温度の変化が有効にコントロールされるべきである。本発明は、AlX3Ga1-X3Asの第2のグレーデッド層を加えることによって、Al成分の相対含有量が高濃度にドーピングされたN型のGaIn1-YPからAlGaAs被覆層の方へ徐々に増加して、AlGaAs被覆層の結晶体の成長品質を改善して、直列接続による電気抵抗を減らして作業電圧を低くすることができる。
(4)N型のGaIn1-YPは、高い割合のTeと低い割合のSiとの混合ドーピングと合わせて、高濃度にドーピングされるN++GaInPを効果的に成長し、高い発光効率を有する赤外光LED発光デバイスを製作することができる。
本発明の更なる特徴及び利点は、後続の明細書において説明し、且つ一部が明細書から明らかになり、或いは本発明を実施することにより理解することができる、本発明の目的及び他の利点は、明細書、特許請求の範囲、及び図面に具体的に指されている構造によって、実現且つ取得され得る。
図面は本発明に対する一層の理解のために供するものであり、また明細書の一部を構成し、本発明の実施例と共に本発明の解釈に用いられ得るが、本発明に対して限定するものではない。この他、図面のデータは概要を説明するものであり、比率に応じて描かれたものではない。
本発明に実施される多接合LED構造が示される模式図である。 図1に示される多接合LED構造のトンネル接合の領域を拡大する拡大模式図である。 第1の実施例の成長基板の上に第1のLEDIのエピタキシャル構造を形成することを説明する模式図である。 第1の実施例において第1のLEDIのエピタキシャル構造の上にトンネル接合を形成することを説明する模式図である。 第1の実施例においてトンネル接合の上に第2のLEDIIのエピタキシャル構造を形成することを説明する模式図である。 第1の実施例の製作方法において、双接合LEDのエピタキシャル構造がボンディング技術を経て導電基板に移転されて得られた構造が示される模式図である。 第1の実施例の製作方法において、成長基板が取り除かれた双接合LEDのエピタキシャル構造に、第1の電極を作成し、エッチング技術によりAlGaAs窓層を露出し、AlGaAs窓層に表面粗化を行なうステップにより得られた構造が示される模式図である。 第1の実施例の製作方法において、導電基板の上に第2の電極を作成するステップにより得られた構造が示される模式図である。
以下は特定の具体的な実施例を通して本発明の実施方式を説明する。通常の知識を有する者は、本明細書に開示される内容により本発明の他の利点および効果を簡単に理解することができる。本発明は、他の異なる具体的な実施方式を通して実施または応用を施すことができ、本明細書における各項の細目は異なる観点および応用に基づいて、本発明の精神から外れない限り、各種の修飾または変更を実行することができる。
なお、本実施例において提供される図示は、模式の方式で基本的な考え方のみ説明する。図中では、本発明に関する部品のみ示しており、実際に実施するときの部品の数、形状、および寸方に従って描くものではない。実際に実施するときに各部品の形態、数量、および比率は、任意の変更にすることができ、且つその部品は構成形態がより複雑であり得る。
第1の実施例
図1は本発明に実施される多接合LED構造が示される模式図であり、その多接合LED構造は、第1のLEDIのエピタキシャル構造と、第2のLEDIIのエピタキシャル構造と、を少なくとも含んでおり、且つ、トンネル接合005を介して第1のLEDIのエピタキシャル構造及び第2のLEDIIのエピタキシャル構造を連接している。図2はトンネル接合005の領域を拡大する模式図を示しており、そのトンネル接合500は、高濃度にドーピングされたP型のAlX1Ga1-X1As501と、AlX2Ga1-X2Asの第1のグレーデッド層502と、高濃度にドーピングされたN型のGaIn1-YP503と、AlX3Ga1-X3Asの第2のグレーデッド層504と、を順に含んでいる。
以下、製作方法と合わせて本実施例の多接合LED構造について説明する。
まず、MOCVDのシステムにおいて、N型のドーピングの方位(100)の結晶面のずれ角が2°にあるGaAsを採用して成長基板001とし、その厚さが約350μmにあり、ドーピング濃度が1E18cm-3~3E18cm-3の範囲内にあり、且つこの基板の上に第1のLEDIのN型層002と、活性層003と、P型層004と、を成長して、第1のLEDIのエピタキシャル構造とする。その中で、N型層002は、N型のGaAsオーミックコンタクト層と、N型のAlGaAs窓層と、N型のAlGaAs被覆層と、ドーピングされていないAlGaAs下空間隔離層と、を含むことができる。活性層003は、760nm~1100nmの範囲内にある放射を提供し、且つドーピングされていない多重量子井戸構造であることができるが、それに限定されない。一実施例として、多重量子井戸層とエピタキシャル層との積み重ね構造においては、具体的に、その井戸層は、InGaAs、InGaAsP材料であり、厚さが3~15nmの範囲内にあり、且つ障壁層は、AlGaAs、AlGaAsP、GaAsP材料であり、厚さが5~50nmの範囲内にあり、量子井戸の対数が1~25対の範囲内にあるが、対数が3~12対の範囲内にあることが好ましく、井戸層の元素含有量を調整することによって活性層の放射の波長範囲を調整することができる。P型層004は、P型のAlGaAs被覆層と、ドーピングされていないAlGaAs上空間隔離層と、を含むことができる。
現在、従来のトンネル接合は、GaAs、AlGaAs材料から作成されたものであり、そのGaAs、AlGaAs材料の自身が光吸収効果を具えているので、不可視光線において双接合LEDの特性を達成することができない。そこで、本発明は、N型のGaInPの高バンドギャップ及び高濃度ドーピングの特性により、第1のLEDI構造と、第2のLEDII構造と、複数のLEDエピタキシャル構造と、を効果的に接合することを提供して、トンネル接合の光吸収作用を低減することができる。
次に、LEDIのP型層004の上に、トンネル接合005を形成することができる。図2に示されるように、まず、AlX1Ga1-X1As:C又はInAlX1a1-X1As:C(X1=0~0.8、Z<0.05)を成長して、超薄型高濃度にドーピングされたP型層501とし、その厚さが10nm~100nmの範囲内にあり、ドーピング濃度が1E19cm-3~2E20cm-3の範囲内にあることができる。
高濃度にドーピングされたP型のAlX1Ga1-X1As層において、高濃度にドーピングされたN型のGaIn1-YPを直接に成長するため、AsとPとを直接に切り替えることで界面の箇所に欠陥が容易に発生するので、界面の品質及び後続のエピタキシャル成長される結晶体の品質に影響を与えて、発光ダイオードの作業電圧に影響を与える。従って、本発明は、高濃度にドーピングされたP型のAlX1Ga1-X1Asと高濃度にドーピングされたN型のGaIn1-YPとの間に、AlX2Ga1-X2Asの第1のグレーデッド層502を導入することによって、AsとPとの効果的な切り替えを実現し、界面の品質及び結晶体の成長品質を効果的に改善し、直列接続による電気抵抗を減らして、作業電圧を低くし、発光ダイオードの発光効率を向上させることができる。また、上記のAlX2Ga1-X2Asの第1のグレーデッド層502におけるAlの相対含有量は、高濃度にドーピングされたP型のAlX1Ga1-X1Asから高濃度にドーピングされたN型のGaIn1-YPの方へ徐々に減少する。上記のAlX2Ga1-X2Asの第1のグレーデッド層におけるAlの相対含有量は、高濃度にドーピングされたP型のAlX1Ga1-X1Asから高濃度にドーピングされたN型のGaIn1-YPの方へ直線的に減少することが更に好ましい。上記のAlX2Ga1-X2Asの第1のグレーデッド層は、ドーピング濃度が1E19~5E19cm-3の範囲内にあるCドーピングのP型のAlX2Ga1-X2Asのグレーデッド層である。上記のAlX2Ga1-X2Asの第1のグレーデッド層の厚さは、10~50nmの範囲内にある。
次に、AlX2Ga1-X2Asの第1のグレーデッド層502の上に、高濃度にドーピングされたN型のGaIn1-YP503を成長する。上記の高濃度にドーピングされたN型のGaIn1-YPは、Yが0.45~0,7の範囲内にあり、厚さが10nm~100nmの範囲内にある。上記の高濃度にドーピングされたN型のGaIn1-YPは、Teドーピング濃度が1E19~2E20cm-3の範囲内にあるTeドーピングのN型のGaIn1-YPであることができる。
高濃度にドーピングされたN型のGaIn1-YPの上にAlGaAs被覆層を続いて成長する必要がある。ここで、高いAl成分が合成している際に、突起及び水点(Ga-rich又はAl-rich)がエピタキシャル層との不整合となることを防ぐために、Alの成分、成長速度、温度の変化が有効に控えられるべきである。本発明は、高濃度にドーピングされたN型のGaIn1-YP503の上にAlX3Ga1-X3Asの第2のグレーデッド層504を成長することによって、Al成分の相対含有量が高濃度にドーピングされたN型のGaIn1-YPからAlGaAs被覆層へ徐々に増加して、高濃度にドーピングされたN型のGaIn1-YPとAlGaAs被覆層との間の界面にあるアルミニウムの相対含有量の差が比較的大きいことによる格子不整合が発生する欠陥の問題を効果的に改善して、AlGaAs被覆層における結晶体の成長品質を改善して、直列接続による電気抵抗を減らして、作業電圧を低くすることができる。上記のAlX3Ga1-X3Asの第2のグレーデッド層におけるAlの相対含有量は、高濃度にドーピングされたN型のGaIn1-YPから離れる方へ直線的に増加することが更に好ましい。上記のAlX3Ga1-X3Asの第2のグレーデッド層504は、厚さが10~50nmの範囲内にあり、ドーピング濃度が11E19~5E19cm-3の範囲内にある。
そして、トンネル接合005の上に、LEDIIのN型層006と活性層007とP型層008とを対称に成長して、第2のLEDIIのエピタキシャル構造とする。その中で、N型層006は、N型のAlGaAs被覆層と、ドーピングされていないAlGaAs下空間隔離層と、を含むことができる。活性層007は、それぞれが量子井戸及び障壁から構成される多重量子井戸構造とするInGaAs/AlGaAsを採用することができ、MQW障壁層の成分を調整することによって、ピーク値の波長が760nm~1100nmの範囲内にある赤外線を放射することができ、活性層における障壁層の周期の数が1~25個の範囲内にあり、活性層の総厚さが20~500nmの範囲内にある。P型層008は、P型のGaPオーミックコンタクト層と、P型のGaInP電流障壁層と、P型のAlGaAs窓層と、P型のAlGaAs被覆層と、ドーピングされていないAlGaAs上空間隔離層と、を含むことができる。
以下、850nmの双接合LEDを例として、技術方法と合わせて双接合LEDの構造に対して具体的に説明する。
まず、n型のドーピングの方位(100)の結晶面のずれ角が2°にあるGaAsを採用して成長基板001とし、その厚さが約350μmにあり、ドーピング濃度が1E18cm-3~3E18cm-3の範囲内にある。この基板の上に、第1のLEDIのエピタキシャル構造を成長する。図3に示されるように、該第1のLEDIのエピタキシャル構造は、以下の順に積み重なったエピタキシャル層を含んでおり、即ち、SiドーピングのGaAsから構成された緩和層201と、GaInPから構成された腐食防止層202と、SiドーピングのGaAsから構成されたN型のオーミックコンタクト層203と、N型のAlGaAs窓層204と、N型のAlGaAs被覆層205と、ドーピングされていないAlGaAs下空間隔離層206と、In0.2Ga0.8As井戸層/Al0.2Ga0.8As障壁層の対から構成される活性層003と、ドーピングされていないAlGaAs上空間隔離層401と、CドーピングのAlGaAsから構成されたP型のAlGaAs被覆層402と、を順に含んでいる。
本実施例では、有機金属気相成長装置(MOCVD装置)を採用して、直径が100mmにあり且つ厚さが350μmにあるGaAs成長基板の上に第1のLEDIのエピタキシャル構造を成長する。エピタキシャル層を成長する際に、III族元素の構成原料として、トリメチルアルミニウム((CHAl)と、トリメチルガリウム((CHGa)と、トリメチルインジウム((CHIn)と、を用いる。ドーピングについて、四臭化炭素(Carbon tetrabromide)CBr4と、ジエチルテルル(Diethvl tellurium)Te(Cと、ジシラン(Si)と、ジエチル亜鉛(Diethylzinc)Zn(Cと、を用いてドーピングの原料とする。また、V族元素の構成原料として、ホスフィン(PH)及びアルシン(AsH)を用いる。
GaAsから構成された緩和層201は、基板と半導体のエピタキシャル積層材料との間にある結晶格子の差によりエピタキシャル成長の質が悪くなるという問題を改善することができ、且つその厚さが約0.3μmにある。GaInPから構成された腐食防止層202は、厚さが約100nmにあり、エッチングを止めるための界面を提供することができ、具体的に、例えば半導体のエピタキシャル積層を他の基板の上に転写する場合、ヒ化ガリウム基板を取り除く必要があるため、そのエッチングを止める層はエッチング技術において用いられる溶液がオーミックコンタクト層に対してエッチングを行なうことを防止することができる。
SiドーピングのGaAsから構成されたオーミックコンタクト層203は、比較的に高いN型のドーピング濃度を有し、例えば1E18cm-3を超え、且つ2E18cm-3を超えることが好ましい。オーミックコンタクト層203は、厚さが200nm未満にあり、且つ厚さが30~100nmの範囲内にあることが好ましい。N型のAlGaAs窓層204は、電流拡張層であり、そのドーピング濃度が1E18cm-3にあり、厚さが約4μm~7μmの範囲内に設定されている。N型のAlGaAs被覆層205は、N型のドーピング濃度が5E17cm-3~2E18cm-3の範囲内にあり、厚さが約0.5μmにある。ドーピングされていないAlGaAs下空間隔離層206は、厚さが約300nm~1μmの範囲内にある。井戸層は、ドーピングされていない上に厚さが約5.5nmにあるIn0.2Ga0.8Asであり、障壁層は、ドーピングされていない上に厚さが約15nmにあるAl0.2Ga0.8Asである。MQWの井戸及び障壁の対数は、10対であることが好ましい。ドーピングされていないAlGaAs上空間隔離層401は、厚さが300nm~1μmの範囲内にある。CドーピングのAlGaAsから構成されたP型のAlGaAs被覆層402は、キャリア濃度が1E18cm-3にあり、且つ厚さが約0.3μm~0.8μmの範囲内にある。
次に、第1のLEDIのエピタキシャル構造の上に、トンネル接合005を成長し、図4に示されるように、該トンネル接合は、以下の積み重ね構造を順に含んでおり、即ち、高濃度にドーピングされたP型のAl0.30.7As501と、AlX2Ga1-X2Asの第1のグレーデッド層502と、高濃度にドーピングされたN型のGa0.6In0.4P503と、AlX3Ga1-X3Asの第2のグレーデッド層504と、を順に含んでいる。まず、第1のLEDIのエピタキシャル構造の上に、Al0.3Ga0.7As:Cを成長して、超薄型高濃度にドーピングされたP型層501とし、その厚さが50nmにあり、ドーピング濃度が8E19cm-3にあることができる。次に、高濃度にドーピングされたP型のAl0.30.7As層の上に、AlX2Ga1-X2Asの第1のグレーデッド層502を成長し、該AlX2Ga1-X2Asの第1のグレーデッド層の厚さは30nmにあり、上記のAlX2Ga1-X2Asの第1のグレーデッド層におけるAlの相対含有量は、高濃度にドーピングされたP型のAl0.3Ga0.7Asから高濃度にドーピングされたN型のGaIn1-YPの方へ直線的に減少する。上記のAlX2Ga1-X2Asの第1のグレーデッド層501は、ドーピング濃度が3E19cm-3にあるCドーピングのP型のAlX2Ga1-X2Asのグレーデッド層である。そして、AlX2Ga1-X2Asの第1のグレーデッド層の上に、高濃度にドーピングされたN型のGa0.6In0.4P503を成長し、上記の高濃度にドーピングされたN型のGa0.6In0.4P503の厚さが50nmにある。上記の高濃度にドーピングされたN型のGaIn1-YPは、Teドーピング濃度が8E19cm-3にあるTeドーピングのN型のGaIn1-YPであることができる。最後に、高濃度にドーピングされたN型のGa0.6In0.4Pの上に、AlX3Ga1-X3Asの第2のグレーデッド層504を成長する。上記のAlX3Ga1-X3Asの第2のグレーデッド層504におけるAlの相対含有量は、高濃度にドーピングされたN型のGaIn1-YPから離れる方へ直線的に増加する。AlX3Ga1-X3Asの第2のグレーデッド層504は、厚さが30nmにあり、且つドーピング濃度が3E19cm-3にあることができる。
そして、トンネル接合005の上に、第2のLEDIIのエピタキシャル構造を対称に成長する。図5に示されるように、第2のLEDIIのエピタキシャル構造は、以下の積み重ねたエピタキシャル層を順に含んでおり、即ち、N型の被覆層601と、ドーピングされていないAlGaAs下空間隔離層602と、In0.2Ga0.8As井戸層/Al0.2Ga0.8As障壁層の対から構成された活性層007と、ドーピングされていないAlGaAs上空間隔離層801と、CドーピングのAlGaAsから構成されたP型のAlGaAs被覆層802と、P型のAlGaAs窓層803と、P型のGaInP電流障壁層804と、P型のGaPオーミックコンタクト層805と、を順に含んでいる。
N型のAlGaAs被覆層601は、N型のドーピング濃度が5E17~2E18cm-3の範囲内にあり、ドーピング濃度が1E18cm-3にあることが好ましく、且つ厚さが約0.5μmにある。ドーピングされていないAlGaAs下空間隔離層602は、厚さが約80nmにある。井戸層は、ドーピングされていなく、且つ厚さが約5.5nmにあるIn0.2Ga0.8Asである。障壁層は、ドーピングされていなく、且つ厚さが約15nmにあるAl0.2Ga0.8Asである。MQWの井戸層及び障壁層の対数は10対であることが好ましい。ドーピングされていないAlGaAs上空間隔離層801は、厚さが約0.2μmにある。CドーピングのAlGaAsから構成されたP型のAlGaAs被覆層802は、キャリア濃度が1.5E18cm-3にあり、且つ厚さが約0.4μmにある。P型のAlGaAs窓層803は、厚さが1μmにあり、且つドーピング濃度が5E17~1E18cm-3の範囲内にある。P型のGaInP電流障壁層804は、厚さが約10nm~30nmの範囲内にあり、且つキャリア濃度が1E18~3E18cm-3の範囲内にある。P型のGaPオーミックコンタクト層805は、厚さが約30~60nmの範囲内にあり、且つキャリア濃度が6E19cm-3にある。
そして、チップ技術のプロセスを実行する。まず、図6に示されるように、P型のGaPオーミックコンタクト層805の一側に反射層009を作成する。反射層の一側にボンディング層(図示せず)を設置し、ボンディング技術を通して双接合LEDのエピタキシャル構造を導電基板010となるようにボンディングを行う。次に、図7に示されるように、エッチング技術を通して成長基板001をN型のオーミックコンタクト層203が露出するまで取り除く。N型のオーミックコンタクト層の上に第1の電極011を形成して、第1の電極011及びN型のオーミックコンタクト層203の間に良好なオーミックコンタクトを形成する。そして、第1の電極011を覆うマスクフィルムを形成する。第1の電極の周囲にあるオーミックコンタクト層203に対してAlGaAs窓層204が露出するようにエッチングを行ない、そしてAlGaAs窓層204に対してエッチングを行なうことによってパターン化又は粗面化をして、光の抽出効率を高める。最後に、図8に示されるように、導電基板010の裏面側に第2の電極012を形成し、これによって第1の電極011と第2の電極012との間、及び半導体のエピタキシャル積層同士の間に電流が流れることができる。
最後に、顧客のサイズに対するニーズに応じて、エッチングや分割などの技術を通して、ユニット化の双接合LEDの発光ダイオードを取得することができる。
第2の実施例
第1の実施例と異なっているのは、本実施例における高濃度にドーピングされたN型のGaIn1-YPが、Teドーピング濃度が1E19~2E20cm-3の範囲内にあり且つSiドーピング濃度が5E18~2E19cm-3の範囲内にあるTeとSiの混合ドーピングのN型のGaIn1-YPであることである。上記のTeとSiとのドーピング濃度の割合が5:3~2:1にあることが更に好ましい。それ以外に、第1の実施例と同様な条件で多接合LEDに対してトンネル接合の作成を行なう。
本実施例では、高い割合のTeと低い割合のSiとの混合ドーピングの方式によって、N型のGaIn1-YPの高濃度のドーピングを実現し、研究の結果高い割合のTeと低い割合のSiとの混合ドーピングがエピタキシャル層の表面の品質を改善することができることがわかっている。
42milチップを例とすると、他の構造及び条件が同じである場合、トンネル接合として高濃度にドーピングされたN型のGaIn1-YPを採用した場合、トンネル接合として高濃度にドーピングされたN型のAlGaAsを採用した場合と比較すると、350mAのテスト電流においてVf値が0.43V低下し、輝度が7.5%増大することができる。これは、高濃度にドーピングされたN型のGaIn1-YPを採用するからこそ得られたことであり、不可視光線に対する光吸収効果を効果的に減少して、素子の輝度を向上させることができ、且つ直列接続による電気抵抗を効果的に減らして電圧を減らすことができる。同時に、AlX2Ga1-X2Asの第1のグレーデッド層及びAlX3Ga1-X3Asの第2のグレーデッド層を加えることにより、界面の品質と結晶体の成長品質とを効果的に向上させることができると共に、AsとPとの切り替えを効果的に実現し、直列接続による電気抵抗を減らして作業電圧を低くし、ひいては光電変換効率を向上させることができる。
上記した実施例は、本発明の原理およびその効果を例示的に説明するのみであり、本発明を限定するものではない。通常の知識を有する者であれば、本発明の精神および範疇に違反しない限り、上記した実施例に対して修飾または変更を実行することができる。従って、技術分野に属する通常の知識を有する者により、本発明が開示した精神および技術的思想から逸脱しない限りでなされた一切の同等な修飾または変更も、本発明の特許請求の範囲に包含されるべきである。
001 成長基板
002 LEDIのN型層
003 LEDIの活性層
004 LEDIのP型層
005 トンネル接合
006 LEDIIのN型層
007 LEDIIの活性層
008 LEDIIのP型層
201 緩和層
202 腐食防止層
203 N型のオーミックコンタクト層
204 N型のAlGaAs窓層
205、601 N型のAlGaAs被覆層
206、602 ドーピングされていないAlGaAs下空間隔離層
401、801 ドーピングされていないAlGaAs上空間隔離層
402、802 P型のAlGaAs被覆層
803 P型のAlGaAs窓層
804 P型のGaInP電流障壁層
805 P型のGaPオーミックコンタクト層
501 高濃度にドーピングされたP型のAlX1Ga1-X1As
502 AlX2Ga1-X2Asの第1のグレーデッド層
503 高濃度にドーピングされたN型のGaIn1-Y
504 AlX3Ga1-X3Asの第2のグレーデッド層
009 反射層
010 導電基板
011 第1の電極
012 第2の電極

以下に本願の出願当初の特許請求の範囲に記載された発明を付記する。
[C1]
高濃度にドーピングされたP型のAl X1 Ga 1-X1 Asと、
Al X2 Ga 1-X2 Asの第1のグレーデッド層と、
高濃度にドーピングされたN型のGa In 1-Y Pと、
Al X3 Ga 1-X3 Asの第2のグレーデッド層と、を含んでいる、ことを特徴とする多接合LEDのトンネル接合。
[C2]
前記高濃度にドーピングされたP型のAl X1 Ga 1-X1 AsのX1は、0~0.8の範囲内にある、ことを特徴とするC1に記載の多接合LEDのトンネル接合。
[C3]
前記高濃度にドーピングされたP型のAl X1 Ga 1-X1 Asのドーピング濃度は、1E19cm -3 以上である、ことを特徴とするC1に記載の多接合LEDのトンネル接合。
[C4]
前記高濃度にドーピングされたP型のAl X1 Ga 1-X1 Asは、ドーピング濃度が1E19~2E20cm -3 の範囲内にあるCドーピングのP型のAl X1 Ga 1-X1 Asである、ことを特徴とするC1に記載の多接合LEDのトンネル接合。
[C5]
前記高濃度にドーピングされたP型のAl X1 Ga 1-X1 Asの厚さは、10~100nmの範囲内にある、ことを特徴とするC1に記載の多接合LEDのトンネル接合。
[C6]
前記高濃度にドーピングされたN型のGa In 1-Y PのYは、0.45~0.7の範囲内にある、ことを特徴とするC1に記載の多接合LEDのトンネル接合。
[C7]
前記高濃度にドーピングされたN型のGa In 1-Y Pのドーピング濃度は、1E19cm -3 以上である、ことを特徴とするC1に記載の多接合LEDのトンネル接合。
[C8]
前記高濃度にドーピングされたN型のGa In 1-Y Pは、Teドーピング濃度が1E19~2E20cm -3 の範囲内にあるTeドーピングのN型のGa In 1-Y Pである、ことを特徴とするC1に記載の多接合LEDのトンネル接合。
[C9]
前記高濃度にドーピングされたN型のGa In 1-Y Pは、Teドーピング濃度が1E19~2E20cm -3 の範囲内にあり且つSiドーピング濃度が5E18~2E19cm -3 の範囲内にあるTeとSiとの混合ドーピングのN型のGa In 1-Y Pである、ことを特徴とするC1に記載の多接合LEDのトンネル接合。
[C10]
前記高濃度にドーピングされたN型のGa In 1-Y Pは、TeとSiとのドーピング濃度の割合が5:3~2:1にあるTeとSiとの混合ドーピングのN型のGa In 1-Y Pである、ことを特徴とするC9に記載の多接合LEDのトンネル接合。
[C11]
前記高濃度にドーピングされたN型のGa In 1-Y Pの厚さは、10~100nmの範囲内にある、ことを特徴とするC1に記載の多接合LEDのトンネル接合。
[C12]
前記Al X2 Ga 1-X2 Asの第1のグレーデッド層は、高濃度にドーピングされたP型のAl X1 Ga 1-X1 Asと高濃度にドーピングされたN型のGa In 1-Y Pとの間に介在され、且つ前記Al X2 Ga 1-X2 Asの第1のグレーデッド層におけるAlの相対含有量は、高濃度にドーピングされたP型のAl X1 Ga 1-X1 Asから高濃度にドーピングされたN型のGa In 1-Y Pの方へ徐々に減少する、ことを特徴とするC1に記載の多接合LEDのトンネル接合。
[C13]
前記Al X2 Ga 1-X2 Asの第1のグレーデッド層におけるAlの相対含有量は、高濃度にドーピングされたP型のAl X1 Ga 1-X1 Asから高濃度にドーピングされたN型のGa In 1-Y Pの方へ直線的に減少する、ことを特徴とするC12に記載の多接合LEDのトンネル接合。
[C14]
前記Al X2 Ga 1-X2 Asの第1のグレーデッド層は、ドーピング濃度が1E19~5E19cm -3 の範囲内にあるCドーピングのP型のAl X2 Ga 1-X2 Asのグレーデッド層である、ことを特徴とするC1に記載の多接合LEDのトンネル接合。
[C15]
前記Al X2 Ga 1-X2 Asの第1のグレーデッド層の厚さは、10~50nmの範囲内にある、ことを特徴とするC1に記載の多接合LEDのトンネル接合。
[C16]
前記Al X3 Ga 1-X3 Asの第2のグレーデッド層は、高濃度にドーピングされたN型のGa In 1-Y Pの上にあり、且つ前記Al X3 Ga 1-X3 Asの第2のグレーデッド層におけるAlの相対含有量は、高濃度にドーピングされたN型のGa In 1-Y Pから離れる方へ徐々に増加する、ことを特徴とするC1に記載の多接合LEDのトンネル接合。
[C17]
前記Al X3 Ga 1-X3 Asの第2のグレーデッド層におけるAlの相対含有量は、高濃度にドーピングされたN型のGa In 1-Y Pから離れる方へ直線的に増加する、ことを特徴とするC16に記載の多接合LEDのトンネル接合。
[C18]
前記Al X3 Ga 1-X3 Asの第2のグレーデッド層は、ドーピング濃度が1E19~5E19cm -3 の範囲内にあるTeドーピングのN型のAl X3 Ga 1-X3 Asのグレーデッド層である、ことを特徴とするC1に記載の多接合LEDのトンネル接合。
[C19]
前記Al X3 Ga 1-X3 Asの第2のグレーデッド層の厚さは、10~50nmの範囲内にある、ことを特徴とするC1に記載の多接合LEDのトンネル接合。
[C20]
第1のLEDIのエピタキシャル構造と、第2のLEDIIのエピタキシャル構造と、を少なくとも含んでいる多接合LED構造であって、
前記第1のLEDIのエピタキシャル構造と前記第2のLEDIIのエピタキシャル構造との間に、C1~19のいずれか一項に記載のトンネル接合を具えている、ことを特徴とする多接合LED構造。
[C21]
前記第1のLEDIのエピタキシャル構造と前記第2のLEDIIのエピタキシャル構造の放射波長は、760nm~1100nmの範囲内にある赤外線である、ことを特徴とするC20に記載の多接合LED構造。
[C22]
第1のLEDIのエピタキシャル構造を形成するステップと、
前記第1のLEDIのエピタキシャル構造の上に、高濃度にドーピングされたP型のAl X1 Ga 1-X1 Asと、Al X2 Ga 1-X2 Asの第1のグレーデッド層と、高濃度にドーピングされたN型のGa In 1-Y Pと、Al X3 Ga 1-X3 Asの第2のグレーデッド層と、を含むトンネル接合構造を形成するステップと、
前記トンネル接合構造の上に第2のLEDIIのエピタキシャル構造を形成するステップと、を含む、ことを特徴とする多接合LED構造の製作方法。
[C23]
前記高濃度にドーピングされたP型のAl X1 Ga 1-X1 AsのX1は、0~0.8の範囲内にある、ことを特徴とするC22に記載の多接合LED構造の製作方法。
[C24]
前記高濃度にドーピングされたP型のAl X1 Ga 1-X1 Asは、ドーピング濃度が1E19~2E20cm -3 の範囲内にあるCドーピングのP型のAl X1 Ga 1-X1 Asである、ことを特徴とするC22に記載の多接合LED構造の製作方法。
[C25]
前記高濃度にドーピングされたP型のAl X1 Ga 1-X1 Asの厚さは、10~100nmの範囲内にある、ことを特徴とするC22に記載の多接合LED構造の製作方法。
[C26]
前記高濃度にドーピングされたN型のGa In 1-Y PのYは、0.45~0.7の範囲内にある、ことを特徴とするC22に記載の多接合LED構造の製作方法。
[C27]
前記高濃度にドーピングされたN型のGa In 1-Y Pは、Teドーピング濃度が1E19~2E20cm -3 の範囲内にあるTeドーピングのN型のGa In 1-Y Pである、ことを特徴とするC22に記載の多接合LED構造の製作方法。
[C28]
前記高濃度にドーピングされたN型のGa In 1-Y Pは、Teドーピング濃度が1E19~2E20cm -3 の範囲内にあり且つSiドーピング濃度が5E18~2E19cm -3 の範囲内にあるTeとSiとの混合ドーピングのN型のGa In 1-Y Pである、ことを特徴とするC22に記載の多接合LED構造の製作方法。
[C29]
前記高濃度にドーピングされたN型のGa In 1-Y Pは、TeとSiとのドーピング濃度の割合が5:3~2:1にあるTeとSiとの混合ドーピングのN型のGa In 1-Y Pである、ことを特徴とするC28に記載の多接合LED構造の製作方法。
[C30]
前記高濃度にドーピングされたN型のGa In 1-Y Pの厚さは、10~100nmの範囲内にある、ことを特徴とするC22に記載の多接合LED構造の製作方法。
[C31]
前記Al X2 Ga 1-X2 Asの第1のグレーデッド層は、高濃度にドーピングされたP型のAl X1 Ga 1-X1 Asと高濃度にドーピングされたN型のGa In 1-Y Pとの間に介在され、且つ前記Al X2 Ga 1-X2 Asの第1のグレーデッド層におけるAlの相対含有量は、高濃度にドーピングされたP型のAl X1 Ga 1-X1 Asから高濃度にドーピングされたN型のGa In 1-Y Pの方へ徐々に減少する、ことを特徴とするC22に記載の多接合LED構造の製作方法。
[C32]
前記Al X2 Ga 1-X2 Asの第1のグレーデッド層におけるAlの相対含有量は、高濃度にドーピングされたP型のAl X1 Ga 1-X1 Asから高濃度にドーピングされたN型のGa In 1-Y Pの方へ直線的に減少する、ことを特徴とするC31に記載の多接合LED構造の製作方法。
[C33]
前記Al X2 Ga 1-X2 Asの第1のグレーデッド層は、ドーピング濃度が1E19~5E19cm -3 の範囲内にあるCドーピングのP型のAl X2 Ga 1-X2 Asのグレーデッド層である、ことを特徴とするC22に記載の多接合LED構造の製作方法。
[C34]
前記Al X2 Ga 1-X2 Asの第1のグレーデッド層の厚さは、10~50nmの範囲内にある、ことを特徴とするC22に記載の多接合LED構造の製作方法。
[C35]
前記Al X3 Ga 1-X3 Asの第2のグレーデッド層は、高濃度にドーピングされたN型のGa In 1-Y Pの上にあり、且つ前記Al X3 Ga 1-X3 Asの第2のグレーデッド層におけるAlの相対含有量は、高濃度にドーピングされたN型のGa In 1-Y Pから離れる方へ徐々に増加する、ことを特徴とするC22に記載の多接合LED構造の製作方法。
[C36]
前記Al X3 Ga 1-X3 Asの第2のグレーデッド層におけるAlの相対含有量は、高濃度にドーピングされたN型のGa In 1-Y Pから離れる方へ直線的に増加する、ことを特徴とするC35に記載の多接合LED構造の製作方法。
[C37]
前記Al X3 Ga 1-X3 Asの第2のグレーデッド層は、ドーピング濃度が1E19~5E19cm -3 の範囲内にあるTeドーピングのN型のAl X3 Ga 1-X3 Asのグレーデッド層である、ことを特徴とするC22に記載の多接合LED構造の製作方法。
[C38]
前記Al X3 Ga 1-X3 Asの第2のグレーデッド層の厚さは、10~50nmの範囲内にある、ことを特徴とするC22に記載の多接合LED構造の製作方法。
[C39]
前記第1のLEDIのエピタキシャル構造と前記第2のLEDIIのエピタキシャル構造の放射波長は、760nm~1100nmの範囲内にある赤外線である、ことを特徴とするC22に記載の多接合LED構造の製作方法。

Claims (35)

  1. 高濃度にドーピングされたP型のAlX1Ga1-X1Asと、
    AlX2Ga1-X2Asの第1のグレーデッド層と、
    高濃度にドーピングされたN型のGaIn1-YPと、
    AlX3Ga1-X3Asの第2のグレーデッド層と、を含み、前記高濃度にドーピングされたN型のGa In 1-Y Pは、
    高い割合のTeと低い割合のSiとの混合ドーピングのN型のGa In 1-Y Pであり、Teドーピング濃度が1E19~2E20cm -3 の範囲内にあり且つSiドーピング濃度が5E18~2E19cm -3 の範囲内にあるTeとSiとの混合ドーピングのN型のGa In 1-Y Pである、ことを特徴とする多接合LEDのトンネル接合。
  2. 前記高濃度にドーピングされたP型のAlX1Ga1-X1AsのX1は、0~0.8の範囲内にある、ことを特徴とする請求項1に記載の多接合LEDのトンネル接合。
  3. 前記高濃度にドーピングされたP型のAlX1Ga1-X1Asのドーピング濃度は、1E19cm-3以上である、ことを特徴とする請求項1に記載の多接合LEDのトンネル接合。
  4. 前記高濃度にドーピングされたP型のAlX1Ga1-X1Asは、ドーピング濃度が1E19~2E20cm-3の範囲内にあるCドーピングのP型のAlX1Ga1-X1Asである、ことを特徴とする請求項1に記載の多接合LEDのトンネル接合。
  5. 前記高濃度にドーピングされたP型のAlX1Ga1-X1Asの厚さは、10~100nmの範囲内にある、ことを特徴とする請求項1に記載の多接合LEDのトンネル接合。
  6. 前記高濃度にドーピングされたN型のGaIn1-YPのYは、0.45~0.7の範囲内にある、ことを特徴とする請求項1に記載の多接合LEDのトンネル接合。
  7. 前記高濃度にドーピングされたN型のGaIn1-YPのドーピング濃度は、1E19cm-3以上である、ことを特徴とする請求項1に記載の多接合LEDのトンネル接合。
  8. 前記高濃度にドーピングされたN型のGaIn1-YにおけるTeとSiとのドーピング濃度の割合が5:3~2:1にあることを特徴とする請求項に記載の多接合LEDのトンネル接合。
  9. 前記高濃度にドーピングされたN型のGaIn1-YPの厚さは、10~100nmの範囲内にある、ことを特徴とする請求項1に記載の多接合LEDのトンネル接合。
  10. 前記AlX2Ga1-X2Asの第1のグレーデッド層は、高濃度にドーピングされたP型のAlX1Ga1-X1Asと高濃度にドーピングされたN型のGaIn1-YPとの間に介在され、且つ前記AlX2Ga1-X2Asの第1のグレーデッド層におけるAlの相対含有量は、高濃度にドーピングされたP型のAlX1Ga1-X1Asから高濃度にドーピングされたN型のGaIn1-YPの方へ徐々に減少する、ことを特徴とする請求項1に記載の多接合LEDのトンネル接合。
  11. 前記AlX2Ga1-X2Asの第1のグレーデッド層におけるAlの相対含有量は、高濃度にドーピングされたP型のAlX1Ga1-X1Asから高濃度にドーピングされたN型のGaIn1-YPの方へ直線的に減少する、ことを特徴とする請求項10に記載の多接合LEDのトンネル接合。
  12. 前記AlX2Ga1-X2Asの第1のグレーデッド層は、ドーピング濃度が1E19~5E19cm-3の範囲内にあるCドーピングのP型のAlX2Ga1-X2Asのグレーデッド層である、ことを特徴とする請求項1に記載の多接合LEDのトンネル接合。
  13. 前記AlX2Ga1-X2Asの第1のグレーデッド層の厚さは、10~50nmの範囲内にある、ことを特徴とする請求項1に記載の多接合LEDのトンネル接合。
  14. 前記AlX3Ga1-X3Asの第2のグレーデッド層は、高濃度にドーピングされたN型のGaIn1-YPの上にあり、且つ前記AlX3Ga1-X3Asの第2のグレーデッド層におけるAlの相対含有量は、高濃度にドーピングされたN型のGaIn1-YPから離れる方へ徐々に増加する、ことを特徴とする請求項1に記載の多接合LEDのトンネル接合。
  15. 前記AlX3Ga1-X3Asの第2のグレーデッド層におけるAlの相対含有量は、高濃度にドーピングされたN型のGaIn1-YPから離れる方へ直線的に増加する、ことを特徴とする請求項14に記載の多接合LEDのトンネル接合。
  16. 前記AlX3Ga1-X3Asの第2のグレーデッド層は、ドーピング濃度が1E19~5E19cm-3の範囲内にあるTeドーピングのN型のAlX3Ga1-X3Asのグレーデッド層である、ことを特徴とする請求項1に記載の多接合LEDのトンネル接合。
  17. 前記AlX3Ga1-X3Asの第2のグレーデッド層の厚さは、10~50nmの範囲内にある、ことを特徴とする請求項1に記載の多接合LEDのトンネル接合。
  18. 第1のLEDIのエピタキシャル構造と、第2のLEDIIのエピタキシャル構造と、を少なくとも含んでいる多接合LED構造であって、
    前記第1のLEDIのエピタキシャル構造と前記第2のLEDIIのエピタキシャル構造との間に、請求項1~17のいずれか一項に記載のトンネル接合を具えている、ことを特徴とする多接合LED構造。
  19. 前記第1のLEDIのエピタキシャル構造と前記第2のLEDIIのエピタキシャル構造の放射波長は、760nm~1100nmの範囲内にある赤外線である、ことを特徴とする請求項18に記載の多接合LED構造。
  20. 第1のLEDIのエピタキシャル構造を形成するステップと、
    前記第1のLEDIのエピタキシャル構造の上に、高濃度にドーピングされたP型のAlX1Ga1-X1Asと、AlX2Ga1-X2Asの第1のグレーデッド層と、高濃度にドーピングされたN型のGaIn1-YPと、AlX3Ga1-X3Asの第2のグレーデッド層と、を含むトンネル接合構造を形成するステップと、
    前記トンネル接合構造の上に第2のLEDIIのエピタキシャル構造を形成するステップと、を含み、前記高濃度にドーピングされたN型のGa In 1-Y Pは、高い割合のTeと低い割合のSiとの混合ドーピングのN型のGa In 1-Y Pであり、Teドーピング濃度が1E19~2E20cm -3 の範囲内にあり且つSiドーピング濃度が5E18~2E19cm -3 の範囲内にあるTeとSiとの混合ドーピングのN型のGa In 1-Y Pである、ことを特徴とする多接合LED構造の製作方法。
  21. 前記高濃度にドーピングされたP型のAlX1Ga1-X1AsのX1は、0~0.8の範囲内にある、ことを特徴とする請求項20に記載の多接合LED構造の製作方法。
  22. 前記高濃度にドーピングされたP型のAlX1Ga1-X1Asは、ドーピング濃度が1E19~2E20cm-3の範囲内にあるCドーピングのP型のAlX1Ga1-X1Asである、ことを特徴とする請求項20に記載の多接合LED構造の製作方法。
  23. 前記高濃度にドーピングされたP型のAlX1Ga1-X1Asの厚さは、10~100nmの範囲内にある、ことを特徴とする請求項20に記載の多接合LED構造の製作方法。
  24. 前記高濃度にドーピングされたN型のGaIn1-YPのYは、0.45~0.7の範囲内にある、ことを特徴とする請求項20に記載の多接合LED構造の製作方法。
  25. 前記高濃度にドーピングされたN型のGaIn1-YにおけるTeとSiとのドーピング濃度の割合が5:3~2:1にあることを特徴とする請求項20に記載の多接合LED構造の製作方法。
  26. 前記高濃度にドーピングされたN型のGaIn1-YPの厚さは、10~100nmの範囲内にある、ことを特徴とする請求項20に記載の多接合LED構造の製作方法。
  27. 前記AlX2Ga1-X2Asの第1のグレーデッド層は、高濃度にドーピングされたP型のAlX1Ga1-X1Asと高濃度にドーピングされたN型のGaIn1-YPとの間に介在され、且つ前記AlX2Ga1-X2Asの第1のグレーデッド層におけるAlの相対含有量は、高濃度にドーピングされたP型のAlX1Ga1-X1Asから高濃度にドーピングされたN型のGaIn1-YPの方へ徐々に減少する、ことを特徴とする請求項20に記載の多接合LED構造の製作方法。
  28. 前記AlX2Ga1-X2Asの第1のグレーデッド層におけるAlの相対含有量は、高濃度にドーピングされたP型のAlX1Ga1-X1Asから高濃度にドーピングされたN型のGaIn1-YPの方へ直線的に減少する、ことを特徴とする請求項27に記載の多接合LED構造の製作方法。
  29. 前記AlX2Ga1-X2Asの第1のグレーデッド層は、ドーピング濃度が1E19~5E19cm-3の範囲内にあるCドーピングのP型のAlX2Ga1-X2Asのグレーデッド層である、ことを特徴とする請求項20に記載の多接合LED構造の製作方法。
  30. 前記AlX2Ga1-X2Asの第1のグレーデッド層の厚さは、10~50nmの範囲内にある、ことを特徴とする請求項20に記載の多接合LED構造の製作方法。
  31. 前記AlX3Ga1-X3Asの第2のグレーデッド層は、高濃度にドーピングされたN型のGaIn1-YPの上にあり、且つ前記AlX3Ga1-X3Asの第2のグレーデッド層におけるAlの相対含有量は、高濃度にドーピングされたN型のGaIn1-YPから離れる方へ徐々に増加する、ことを特徴とする請求項20に記載の多接合LED構造の製作方法。
  32. 前記AlX3Ga1-X3Asの第2のグレーデッド層におけるAlの相対含有量は、高濃度にドーピングされたN型のGaIn1-YPから離れる方へ直線的に増加する、ことを特徴とする請求項31に記載の多接合LED構造の製作方法。
  33. 前記AlX3Ga1-X3Asの第2のグレーデッド層は、ドーピング濃度が1E19~5E19cm-3の範囲内にあるTeドーピングのN型のAlX3Ga1-X3Asのグレーデッド層である、ことを特徴とする請求項20に記載の多接合LED構造の製作方法。
  34. 前記AlX3Ga1-X3Asの第2のグレーデッド層の厚さは、10~50nmの範囲内にある、ことを特徴とする請求項20に記載の多接合LED構造の製作方法。
  35. 前記第1のLEDIのエピタキシャル構造と前記第2のLEDIIのエピタキシャル構造の放射波長は、760nm~1100nmの範囲内にある赤外線である、ことを特徴とする請求項20に記載の多接合LED構造の製作方法。
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Families Citing this family (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN114824021B (zh) * 2021-01-19 2023-07-11 东莞市中麒光电技术有限公司 一种微型led显示模块及其制作方法
CN114335215B (zh) * 2022-03-15 2022-06-14 南昌凯迅光电股份有限公司 一种带有渐变隧穿结的砷化镓太阳电池及其制作方法
CN117638644A (zh) * 2023-12-12 2024-03-01 天津赛米卡尔科技有限公司 具有非均匀折射率分布的多结fp激光器及制备方法

Citations (11)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2002050790A (ja) 2000-08-04 2002-02-15 Hitachi Cable Ltd 化合物半導体発光ダイオードアレイ
JP2010080757A (ja) 2008-09-26 2010-04-08 Rohm Co Ltd 半導体発光素子
JP2010232638A (ja) 2009-03-03 2010-10-14 Hitachi Cable Ltd 発光素子用エピタキシャルウェハおよび発光素子
JP2011192913A (ja) 2010-03-16 2011-09-29 Denso Corp 半導体レーザ構造
US20130049034A1 (en) 2011-08-31 2013-02-28 Yi Chieh Lin Light-emitting device
CN103367480A (zh) 2013-07-19 2013-10-23 中国科学院苏州纳米技术与纳米仿生研究所 GaAs隧道结及其制备方法
US20140332754A1 (en) 2013-05-09 2014-11-13 Qingdao Jason Electric Co., Ltd. Semiconductor light-emitting device
JP2017157667A (ja) 2016-03-01 2017-09-07 学校法人 名城大学 窒化物半導体発光素子
US20180076354A1 (en) 2015-03-27 2018-03-15 Ohio State Innovation Foundation Ultraviolet light emitting diodes with tunnel junction
JP2018201009A (ja) 2017-05-25 2018-12-20 昭和電工株式会社 発光ダイオードおよびトンネル接合層の製造方法
CN109786531A (zh) 2019-01-30 2019-05-21 吉林大学 一种基于极化诱导原理的AlGaN基隧穿结结构及其制备方法

Family Cites Families (8)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR970011140B1 (ko) * 1993-12-08 1997-07-07 한국전자통신연구원 공명 투과광전 소자의 구조
US6765238B2 (en) * 2002-09-12 2004-07-20 Agilent Technologies, Inc. Material systems for semiconductor tunnel-junction structures
CN1275337C (zh) * 2003-09-17 2006-09-13 北京工大智源科技发展有限公司 高效高亮度多有源区隧道再生白光发光二极管
JP2009059918A (ja) * 2007-08-31 2009-03-19 Sumitomo Electric Ind Ltd 光半導体デバイス
CN201466053U (zh) * 2009-07-07 2010-05-12 扬州乾照光电有限公司 发光二极管
CN105633226A (zh) * 2015-12-31 2016-06-01 天津三安光电有限公司 一种具有双结的红外光发光二极管
CN106067493B (zh) * 2016-07-26 2018-05-22 中山德华芯片技术有限公司 一种微晶格失配量子阱太阳能电池及其制备方法
US10439103B2 (en) * 2017-05-25 2019-10-08 Showa Denko K. K. Light-emitting diode and method for manufacturing tunnel junction layer

Patent Citations (11)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2002050790A (ja) 2000-08-04 2002-02-15 Hitachi Cable Ltd 化合物半導体発光ダイオードアレイ
JP2010080757A (ja) 2008-09-26 2010-04-08 Rohm Co Ltd 半導体発光素子
JP2010232638A (ja) 2009-03-03 2010-10-14 Hitachi Cable Ltd 発光素子用エピタキシャルウェハおよび発光素子
JP2011192913A (ja) 2010-03-16 2011-09-29 Denso Corp 半導体レーザ構造
US20130049034A1 (en) 2011-08-31 2013-02-28 Yi Chieh Lin Light-emitting device
US20140332754A1 (en) 2013-05-09 2014-11-13 Qingdao Jason Electric Co., Ltd. Semiconductor light-emitting device
CN103367480A (zh) 2013-07-19 2013-10-23 中国科学院苏州纳米技术与纳米仿生研究所 GaAs隧道结及其制备方法
US20180076354A1 (en) 2015-03-27 2018-03-15 Ohio State Innovation Foundation Ultraviolet light emitting diodes with tunnel junction
JP2017157667A (ja) 2016-03-01 2017-09-07 学校法人 名城大学 窒化物半導体発光素子
JP2018201009A (ja) 2017-05-25 2018-12-20 昭和電工株式会社 発光ダイオードおよびトンネル接合層の製造方法
CN109786531A (zh) 2019-01-30 2019-05-21 吉林大学 一种基于极化诱导原理的AlGaN基隧穿结结构及其制备方法

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