JP7202987B2 - 高性能で、電力効率の良い、プログラマブルな画像処理のためのアーキテクチャ - Google Patents
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Description
本発明は、一般に、画像処理に関し、特に、高性能で、電力効率の良い、プログラマブルな画像処理のためのアーキテクチャに関する。
画像処理は、典型的には、アレイに編成されたピクセル値の処理を含む。ここで、空間的に編成された二次元アレイは、画像の二次元的性質を捕捉する(追加の次元は、時間(例えば二次元画像のシーケンス)およびデータタイプ(例えば色)を含み得る。典型的なケースでは、アレイ化されたピクセル値は、静止画像または動きの画像を捕捉するためにフレームのシーケンスを生成したカメラによって提供される。伝統的な画像プロセッサは、典型的には、2つの極端な側面のいずれかに分類される。
装置が記載される。装置は画像処理ユニット(IPU)を含む。画像処理ユニットはネットワークを含む。画像処理ユニットは、プログラムコードの実行によって複数の重なり合うステンシルを同時に処理するよう二次元シフトレジスタアレイ構造に結合される実行ユニットレーンのアレイを各々が含む複数のステンシルプロセッサ回路を含む。画像処理ユニットは、複数のステンシルプロセッサとネットワークとの間にそれぞれ結合される複数のシート生成部を含む。シート生成部は、ステンシルプロセッサによる処理のために、画像データの入力ライングループを画像データの入力シートに解析し、ステンシルプロセッサから受け取った画像データの出力シートから画像データの出力ライングループを形成
する。画像処理ユニットは、ネットワークに結合され、生成側ステンシルプロセッサから消費側ステンシルプロセッサに向かう方向にライングループを通過させて全体のプログラムフローを実現する複数のラインバッファユニットを含む。
以下の説明および添付の図面は、本発明の実施形態を例示するために使用される。
a.画像プロセッサハードウェアアーキテクチャおよび動作
図1は、ハードウェアで実現される画像プロセッサのためのアーキテクチャ100の実施形態を示す。画像プロセッサは、例えば、シミュレートされた環境内で仮想プロセッサ用に書かれたプログラムコードを、ハードウェアプロセッサによって実際に実行されるプログラムコードに変換するコンパイラによって対象とされてもよい。図4に示すように、アーキテクチャ100は、複数のラインバッファユニット101_1~101_Mを含み、それらは、複数のステンシルプロセッサユニット102_1~102_Nおよび対応するシート生成部ユニット103_1~103_Nに、ネットワーク104(例えば、ネットワークオンチップ(NOC)(オンチップスイッチネットワーク、オンチップリングネットワークまたは他の種類のネットワークを含む))を介して相互接続される。一実施形態では、どのラインバッファユニットが、ネットワーク104を介してどのシート生成部および対応するステンシルプロセッサに接続してもよい。
画像データのより小さな領域に解析し、次いでライングループをネットワーク104を介して特定のシート生成部に渡す。ある完全な(full)単数のライングループを、例えば、フレームの複数の連続した完全な行または列のデータで構成することができる(簡単にするために、本明細書では主に連続した行と称する)。シート生成部は、画像データのライングループを「シート」と呼ばれる画像データのより小さな領域にさらに解析し、そのシートを対応するステンシルプロセッサに提示する。
ステンシルプロセッサは、垂直方向および水平方向の両方に重なるステンシルを有するように設計されてもよいことを認識することが適切である。
ロセッサが最初のシートの処理と同じ態様で新たなシートに対して動作するにつれ、ステンシルは単に右に移動し続ける。
図3は、ステンシルプロセッサ300の実施形態を示す。図3において見られるように、ステンシルプロセッサは、データ計算ユニット301、スカラープロセッサ302および関連するメモリ303およびI/Oユニット304を含む。データ計算ユニット301は、実行レーンのアレイ305、二次元シフトアレイ構造306、およびアレイの特定の行または列に関連する別個のランダムアクセスメモリ307を含む。
された命令をデコードする論理回路系、または、よりMIMDのような設計の場合、命令をフェッチおよびデコードする論理回路系を含むことができる。MIMDのようなアプローチに関しては、ここでは集中プログラム制御アプローチが主に記載されているが、より分散型のアプローチが様々な代替実施形態(例えば、アレイ305の各実行レーン内のプログラムコードおよびプログラムコントローラを含む)において実施されてもよい。
スメモリは、4つの実行レーン行状と2つの実行レーン列状にまたがる実行レーンアレイの「領域」に割り当てられてもよい。簡略化のために、アプリケーションの残りの部分は、主に、行および/または列に基づく割り当てスキームを指す)。ここで、実行レーンのカーネル動作が、それが(一部の画像処理ルーチンが必要とする場合がある)二次元シフトレジスタアレイ406の外にあるピクセル値を処理することを必要とする場合、画像データの面は、ハロー領域409からランダムアクセスメモリ407にさらにこぼれ出ることができる。例えば、ハードウェアが実行レーンアレイの右端の実行レーンの右側にわずか4つの記憶素子のハロー領域を含む場合の6X6ステンシルを考える。この場合、ステンシルを完全に処理するために、データをハロー409の右端からさらに右側にシフトする必要があるであろう。ハロー領域409の外側にシフトされたデータは、ランダムアクセスメモリ407にこぼれ出る。ランダムアクセスメモリ407および図3のステンシルプロセッサの他の適用例を以下でさらに説明する。
)実行レーンの位置にシフトした新しい値とともに加算される。結果はR1に書き込まれる。図5dで見られるように、図5cについて上述したのと同じプロセスが繰り返され、結果のR1に対して、今度は上側実行レーンにおける値A+B+C、および下側実行レーンにおけるF+G+H値を含ませるようにする。この時点で、両方の実行レーンはそれらのそれぞれのステンシルの上側の行を処理している。(左側に存在する場合には)実行レーンアレイの左側でハロー領域に、またはハロー領域が存在しない場合にはランダムアクセスメモリにこぼれ出ることは、実行レーンアレイの左側には存在しないことに注目されたい。
いずれか(ただ)1つの内容が置き換えられることによって、実現される。同じレジスタがその内容がシフトアウトされて同じサイクルでシフトインされる内容で置き換えられるのが一般的であるかもしれないが、マルチプレクサ構成603,604は、同じサイクル中に同じレジスタファイル内で異なるシフトソースおよびシフトターゲットレジスタを可能にする。
図7は、仮想画像処理環境701と、実際の画像処理ハードウェア703と、仮想処理
環境701のために書かれたよりハイレベルのコードを、実際のハードウェア703が物理的に実行するオブジェクトコードに変換するためのコンパイラ702とを含む、画像プロセッサ技術プラットフォームのハイレベル図である。以下でより詳細に説明するように、仮想処理環境701は、アプリケーションの構成プロセスの容易な視覚化のために開発および調整できるアプリケーションの点で、広く汎用性が高い。開発者704によるプログラムコード開発努力が完了すると、コンパイラ702は、仮想処理環境701内で書かれたコードを、実際のハードウェア703に対して対象とされるオブジェクトコードに変換する。
域を定義するX、Y値として表される)、シートおよび/またはライングループサイズ(例えば、画像サイズと同じ点で指定されるが、より小さい寸法を有する)などを含む。さらに、ラインバッファユニット701は、少なくともラインバッファユニット801によって管理されるライングループを書き込む作成側カーネルの数および読み取る消費側カーネルの数などの追加の構成情報でプログラミングされてもよい。画像データに関連するチャネルの数および/または寸法も、典型的には、構成情報として含まれる。
書き込まれるまで、要求はアイドル状態にされる。
図10aは、仮想環境内で書かれたアプリケーションソフトウェアが取ることができる構造および形態の例を示す。図10aにおいて見られるように、プログラムコードは、入力画像データ1001の1つ以上のフレームを処理して、入力画像データ1001上で何らかの全体的な変換を行い得る。変換は、開発者によって明示されたオーケストレーションされたシーケンスで入力画像データに対して動作するプログラムコード1002の1つ以上のカーネルの動作によって実現される。
タスク:畳み込み、ノイズ除去、色空間変換、エッジおよびコーナー検出、シャープニング、ホワイトバランス、γ補正、トーンマッピング、行列乗算、画像レジストレーション、ピラミッド構築、ウェーブレット変換、ブロック状離散コサイン、およびフーリエ変換のうちの1つ以上を提供するようカーネルを含んでもよい。
する。具体的には、ラインバッファユニット1101_1(LBU_1)、1101_2(LBU_2)、1101_3(LBU_3)、1101_4(LBU_4)は、それぞれカーネルK1、K2、K3、K4を実行するステンシルプロセッサ1102_1,1102_2,1102_3,1102_4にそれぞれ供給を行なう。ステンシルプロセッサ1102_1,1102_2,1102_3,1102_4も、それぞれラインバッファユニット1101_2(LBU_2)、1101_3(LBU_3)、1101_4(LBU_4)、1101_5(LBU_5)に供給を行なう。
上述した様々な画像プロセッサアーキテクチャの特徴は、必ずしも従来の意味での画像処理に限定されず、したがって、画像プロセッサを再特徴付けしてもよい(またはしなくてもよい)他のアプリケーションに適用することができることを指摘することが適切である。例えば、実際のカメラ画像の処理とは対照的に、アニメーションの作成および/または生成および/またはレンダリングにおいて上述した様々な画像プロセッサアーキテクチャの特徴のいずれかが使用される場合、画像プロセッサはグラフィックス処理ユニットとして徳経づけられてもよい。さらに、上述した画像プロセッサアーキテクチャの特徴は、ビデオ処理、視覚処理、画像認識および/または機械学習などの他の技術的用途にも適用することができる。このように適用されて、画像プロセッサは、より汎用的なプロセッサ(例えば、コンピューティングシステムのCPUの一部であるか、またはその一部である
)と(例えばコプロセッサとして)一体化されてもよく、またはコンピューティングシステム内のスタンドアロンプロセッサであってもよい。
中型機能を実行する。メモリ制御機能1217は、システムメモリ1202とインタフェースして、システムメモリ1202との間でデータの書込/読出を行う。電力管理制御ユニット1212は、システム1200の電力消費を全体的に制御する。
Claims (18)
- 二次元シフトレジスタアレイと処理要素の二次元アレイとを備えるプロセッサであって、前記二次元シフトレジスタアレイ内の各シフトレジスタは、前記処理要素の二次元アレイ内のそれぞれの処理要素に専用であり、
各処理要素は、カーネルプログラムの命令を実行するように構成され、前記命令は、
前記二次元シフトレジスタアレイに、二次元シフトレジスタ構造内で、前記二次元シフトレジスタアレイに格納された入力データのシートをシフトさせ、
各処理要素に、前記処理要素に専用のシフトレジスタの各々から、前記二次元シフトレジスタ構造上のシーケンス内の複数の入力値を読み込ませ、前記複数の入力値は、前記入力データのシートの二次元領域に関連付けられ、
前記命令は、さらに、各処理要素に、前記入力データのシートを前記二次元シフトレジスタ構造内でシフトしながら、前記処理要素に専用のシフトレジスタの各々から読み取られる前記複数の入力値の各々を用いて、それぞれの結果の出力値を計算させる、プロセッサ。 - 前記処理要素の二次元アレイによって計算された出力値のシートを受け取り、前記出力値のシートをラインバッファに提供するように構成されたシート生成部と通信するように構成される、請求項1に記載のプロセッサ。
- 前記ラインバッファは、前記出力値のシートを受け取り、前記出力値のシートを1つ以上の消費側プロセッサ提供するように構成される、請求項2に記載のプロセッサ。
- 前記シート生成部は、作成側ラインバッファからライングループを受け取り、前記プロセッサの前記二次元シフトレジスタアレイに後続の入力値のシートをロードするように構成される、請求項2に記載のプロセッサ。
- 前記プロセッサ、前記シート生成部、および前記ラインバッファは、画像処理パイプラインの部分を実現するように構成される、請求項4に記載のプロセッサ。
- 前記シート生成部は、出力値のシートを複数のラインバッファに書き込むように構成される、請求項4に記載のプロセッサ。
- 前記二次元シフトレジスタアレイの各シフトレジスタは、前記処理要素の二次元アレイ内のそれぞれの処理要素に専用である、請求項1~6のいずれかに記載のプロセッサ。
- 前記二次元シフトレジスタアレイにおける第1のシフトレジスタから第2のシフトレジスタへのデータの各シフトは、前記第2のシフトレジスタに先に格納された値を置換する、請求項1~7のいずれかに記載のプロセッサ。
- 前記入力データのシートを前記二次元シフトレジスタ構造内でシフトしながら、各処理要素は、各処理要素に専用の同じそれぞれのシフトレジスタから、前記複数のそれぞれの入力値を読み出す、請求項1~8のいずれかに記載のプロセッサ。
- 二次元シフトレジスタアレイと処理要素の二次元アレイとを備えるプロセッサによって実行される方法であって、前記二次元シフトレジスタアレイ内の各シフトレジスタは、前記処理要素の二次元アレイ内のそれぞれの処理要素に専用であり、前記方法は、
前記処理要素の二次元アレイ内の各処理要素によって、前記二次元シフトレジスタアレイに、二次元シフトレジスタ構造内で、前記二次元シフトレジスタアレイに格納された入力データのシートをシフトさせ、各処理要素に、前記処理要素に専用のシフトレジスタの各々から、前記二次元シフトレジスタ構造上のシーケンス内の複数の入力値を読み込ませるカーネルプログラムの命令を実行することを備え、前記複数の入力値は、前記入力データのシートの二次元領域に関連付けられ、
前記処理要素の二次元アレイ内の各処理要素によって、前記入力データのシートを前記二次元シフトレジスタ構造内でシフトしながら、前記処理要素に専用のシフトレジスタの各々から読み取られる複数の入力値の各々を用いて、それぞれの結果の出力値を計算することを備える、方法。 - シート生成部によって、前記処理要素の二次元アレイによって計算された出力値のシートを受け取り、前記出力値のシートをラインバッファに提供するシート生成部と通信することをさらに備える、請求項10に記載の方法。
- 1つ以上の消費側プロセッサによって、前記ラインバッファを介して、前記出力値のシートを受け取ることをさらに備える、請求項11に記載の方法。
- 前記シート生成部と通信することで、前記プロセッサの前記二次元シフトレジスタアレイに後続の入力値のシートをロードすることをさらに備える、請求項11に記載の方法。
- 前記プロセッサは、画像処理パイプラインの部分を実現する、請求項13に記載の方法。
- 前記シート生成部から、複数のラインバッファに書き込むための出力値のシートを取得することをさらに備える、請求項13に記載の方法。
- 前記二次元シフトレジスタアレイの各シフトレジスタは、前記処理要素の二次元アレイ内のそれぞれの処理要素に専用である、請求項10~15のいずれかに記載の方法。
- 前記二次元シフトレジスタアレイにおいて第1のシフトレジスタから第2のシフトレジスタにデータをシフトすることは、前記第2のシフトレジスタに先に格納された値を置換することを含む、請求項10~16のいずれかに記載の方法。
- 前記入力データのシートを前記二次元シフトレジスタ構造内でシフトしながら、各処理要素によって、各処理要素に専用の同じそれぞれのシフトレジスタから、前記複数のそれぞれの入力値を読み出すことをさらに備える、請求項10~17のいずれかに記載の方法。
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