JP7147498B2 - 回路装置、発振器、電子機器及び移動体 - Google Patents
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Description
図1に本実施形態の回路装置20の構成例を示す。回路装置20は、デジタル電源回路30と、アナログ電源回路40と、デジタル回路50と、アナログ回路60を含む。回路装置20は、IC(Integrated Circuit)と呼ばれる集積回路装置であり、デジタル及びアナログの混載ICである。
次に本実施形態の回路装置20の詳細例について説明する。図2に本実施形態の回路装置20の詳細な第1の構成例を示す。図2では、アナログ回路60として発振回路62と出力回路80が設けられている。また電源電圧VDDHは電源端子TVDDを介して外部から回路装置20に供給されている。電源端子TVDDは例えばICのパッドなどにより実現される。また回路装置20はタイミング制御回路52を含み、タイミング制御回路52がアナログ電源回路40に対してモード設定信号SMODを出力する。このモード設定信号SMODに基づいてアナログ電源回路40の第1、第2のモードの切り替えが行われる。またタイミング制御回路52は、アナログ回路60の出力回路80に対して出力イネーブル信号OUTENを出力する。なおタイミング制御回路52は、説明の便宜上、図2ではデジタル回路50と別のブロックとして示しているが、実際にはタイミング制御回路52はデジタル回路50に含まれる回路である。
次に電源回路であるアナログ電源回路40の詳細な構成例につい説明する。図8に、電源電圧であるアナログ電源電圧を生成するアナログ電源回路40の第1の構成例を示す。本実施形態ではアナログ電源回路40は、ノイズ低減用のローパスフィルター44を含む。ローパスフィルター44は例えば抵抗やキャパシターなどの受動素子で構成されるパッシブフィルターである。そして第1のモードは、ローパスフィルター44を信号が通過しないモードである。例えば第1のモードはローパスフィルター44を信号がスルーするモードである。例えば第1のモードでは、当該信号は、ローパスフィルター44の信号経路を通過せずにスイッチSWを介したバイパス経路を通過する。一方、第2のモードは、ローパスフィルター44を信号が通過するモードである。例えば第2のモードでは、当該信号がローパスフィルターの信号経路を通過することで、当該信号に対するローパスフィルター処理が行われる。そしてアナログ電源回路40は、当該信号に基づいてアナログ電源電圧VDDAを生成する。ここで当該信号は、アナログ電源回路40の内部信号である。具体的には図8では、アナログ電源回路40はアナログ電源電圧VDDAを生成するためのアンプ回路42を含み、当該信号はアンプ回路42の出力信号である。
図13に本実施形態の発振器4の構成例を示す。発振器4は、本実施形態の回路装置20と振動子10を含む。振動子10は回路装置20に電気的に接続されている。例えば振動子10及び回路装置20を収納するパッケージの内部配線、ボンディグワイヤー又は金属バンプ等を用いて、振動子10と回路装置20は電気的に接続されている。
図14に、本実施形態の回路装置20を含む電子機器500の構成例を示す。電子機器500は、振動子10、回路装置20、処理装置520を含む。また電子機器500は、アンテナANT、通信インターフェース510、操作インターフェース530、表示部540、メモリー550を含むことができる。振動子10と回路装置20により発振器4が構成される。なお電子機器500は図14の構成に限定されず、これらの一部の構成要素を省略したり、他の構成要素を追加するなどの種々の変形実施が可能である。
SMOD…モード設定信号、OSCK…発振信号、OUTCK…クロック信号、
PLCK…クロック信号、OUTEN…出力イネーブル信号、
TFC…周波数変更期間、SW…スイッチ、
RA1、RA2、RB1、RD1、RD2…抵抗、CB1…キャパシター、
TA1、TA2、TC1~TC5、TD1…トランジスター、
4…発振器、10…振動子、20…回路装置、30…デジタル電源回路、
32…アンプ回路、36…電圧分割回路、40…アナログ電源回路、
42…アンプ回路、44…ローパスフィルター、46…電圧分割回路、
50…デジタル回路、52…タイミング制御回路、60…アナログ回路、
62…発振回路、64…PLL回路、65…比較回路、66…チャージポンプ回路、
67…ローパスフィルター、68…発振回路、69…バッファー回路、
70…分周回路、71…デルタシグマ変調回路、80…出力回路、
90…処理回路、92…インターフェース回路、
206…自動車、207…車体、208…制御装置、209…車輪、
500…電子機器、510…通信インターフェース、520…処理装置、
530…操作インターフェース、540…表示部、550…メモリー
Claims (14)
- デジタル回路と、
前記デジタル回路にデジタル電源電圧を供給するデジタル電源回路と、
アナログ回路と、
前記アナログ回路にアナログ電源電圧を供給するアナログ電源回路と、
を含み、
前記アナログ電源回路は、
動作モードとして、第1のモードと第2のモードとを有し、
前記第1のモードは、前記第2のモードよりも電源供給の起動が速いモードであり、
前記第2のモードは、前記第1のモードよりも低ノイズで電源供給を行うモードであり、
前記アナログ電源回路は、
前記デジタル電源回路が前記デジタル電源電圧を前記デジタル回路に供給した後に、前記動作モードが前記第1のモードから前記第2のモードに切り替わることを特徴とする回路装置。 - 請求項1に記載の回路装置において、
前記アナログ電源回路は、ノイズ低減用のローパスフィルターを含み、
前記第1のモードは、前記ローパスフィルターを信号が通過しないモードであり、前記第2のモードは、前記ローパスフィルターを前記信号が通過するモードであり、前記アナログ電源回路は、前記信号に基づいて前記アナログ電源電圧を生成することを特徴とする回路装置。 - デジタル回路と、
前記デジタル回路にデジタル電源電圧を供給するデジタル電源回路と、
アナログ回路と、
前記アナログ回路にアナログ電源電圧を供給するアナログ電源回路と、
を含み、
前記アナログ電源回路は、
第1の入力端子に基準電圧が入力されるアンプ回路と、
第1の電源ノードと前記アナログ電源電圧の出力ノードとの間に設けられるトランジスターと、
前記アンプ回路の出力端子のノードと前記トランジスターのゲートのノードとの間に設けられるローパスフィルターと、
前記アンプ回路の前記出力端子のノードと前記トランジスターの前記ゲートのノードとの間において、前記ローパスフィルターに対して並列に設けられるスイッチと、
前記アナログ電源電圧の前記出力ノードと第2の電源ノードとの間に設けられ、前記アナログ電源電圧を分圧した電圧を、前記アンプ回路の第2の入力端子へ出力する電圧分割回路と、
を含み、
前記アナログ電源回路は、
動作モードとして、第1のモードと第2のモードとを有し、
前記スイッチは、
前記第1のモードにおいてオンになり、前記第2のモードにおいてオフになり、
前記アナログ電源回路は、
前記デジタル電源回路が前記デジタル電源電圧を前記デジタル回路に供給した後に、前記動作モードが前記第1のモードから前記第2のモードに切り替わることを特徴とする回路装置。 - 請求項1乃至3のいずれか一項に記載の回路装置において、
前記アナログ電源回路は、
前記第1のモードで前記アナログ電源電圧を前記アナログ回路に供給した後に、前記第2のモードで前記アナログ電源電圧を前記アナログ回路に供給することを特徴とする回路装置。 - 請求項1乃至4のいずれか一項に記載の回路装置において、
前記アナログ回路は、発振により発振信号を生成する発振回路を含み、
前記アナログ電源回路は、
前記第1のモードで前記アナログ電源電圧を前記発振回路に供給した後に、前記第2のモードで前記アナログ電源電圧を前記発振回路に供給することを特徴とする回路装置。 - 請求項1乃至4のいずれか一項に記載の回路装置において、
前記アナログ回路は、クロック信号を生成するPLL回路を含み、
前記アナログ電源回路は、
前記第1のモードで前記アナログ電源電圧を前記PLL回路に供給した後に、前記第2のモードで前記アナログ電源電圧を前記PLL回路に供給することを特徴とする回路装置。 - デジタル回路と、
前記デジタル回路にデジタル電源電圧を供給するデジタル電源回路と、
アナログ回路と、
前記アナログ回路にアナログ電源電圧を供給するアナログ電源回路と、
を含み、
前記アナログ電源回路は、
動作モードとして、第1のモードと第2のモードとを有し、
前記第1のモードは、前記第2のモードよりも電源供給の起動が速いモードであり、
前記第2のモードは、前記第1のモードよりも低ノイズで電源供給を行うモードであり、
前記アナログ回路は、クロック信号を生成するPLL回路を含み、
前記PLL回路の周波数変更期間において、前記アナログ電源回路は、前記第2のモードから前記第1のモードに切り替わり、
前記周波数変更期間の終了後に、前記アナログ電源回路は、前記第1のモードから前記第2のモードに切り替わることを特徴とする回路装置。 - デジタル回路と、
前記デジタル回路にデジタル電源電圧を供給するデジタル電源回路と、
アナログ回路と、
前記アナログ回路にアナログ電源電圧を供給するアナログ電源回路と、
を含み、
前記アナログ電源回路は、
第1の入力端子に基準電圧が入力されるアンプ回路と、
第1の電源ノードと前記アナログ電源電圧の出力ノードとの間に設けられるトランジスターと、
前記アンプ回路の出力端子のノードと前記トランジスターのゲートのノードとの間に設けられるローパスフィルターと、
前記アンプ回路の前記出力端子のノードと前記トランジスターの前記ゲートのノードとの間において、前記ローパスフィルターに対して並列に設けられるスイッチと、
前記アナログ電源電圧の前記出力ノードと第2の電源ノードとの間に設けられ、前記アナログ電源電圧を分圧した電圧を、前記アンプ回路の第2の入力端子へ出力する電圧分割回路と、
を含み、
前記アナログ電源回路は、
動作モードとして、第1のモードと第2のモードとを有し、
前記スイッチは、
前記第1のモードにおいてオンになり、前記第2のモードにおいてオフになり、
前記アナログ回路は、クロック信号を生成するPLL回路を含み、
前記PLL回路の周波数変更期間において、前記アナログ電源回路は、前記第2のモードから前記第1のモードに切り替わり、
前記周波数変更期間の終了後に、前記アナログ電源回路は、前記第1のモードから前記第2のモードに切り替わることを特徴とする回路装置。 - 請求項1乃至8のいずれか一項に記載の回路装置において、
前記アナログ回路は、前記アナログ電源回路から前記アナログ電源電圧が供給されて出力信号を出力する出力回路を含み、
前記出力回路は、
前記アナログ電源回路が前記第1のモードから前記第2のモードに切り替わった後に、前記出力信号を出力することを特徴とする回路装置。 - 請求項1乃至9のいずれか一項に記載の回路装置において、
前記アナログ電源回路の前記動作モードを前記第1のモード又は前記第2のモードに設定するタイミング制御回路を含むことを特徴とする回路装置。 - 請求項1乃至10のいずれか一項に記載の回路装置において、
前記デジタル電源回路は、
第1の入力端子に基準電圧が入力されるアンプ回路と、
第1の電源ノードと、前記デジタル電源電圧の出力ノードとの間に設けられるトランジスターと、
前記デジタル電源電圧の前記出力ノードと第2の電源ノードとの間に設けられ、前記デジタル電源電圧を分圧した電圧を、前記アンプ回路の第2の入力端子へ出力する電圧分割回路と、
を含むことを特徴とする回路装置。 - 振動子と、
請求項1乃至11のいずれか一項に記載の回路装置であって、前記振動子を発振させる発振回路を含む回路装置と、
を含むことを特徴とする発振器。 - 請求項1乃至11のいずれか一項に記載の回路装置を含むことを特徴とする電子機器。
- 請求項1乃至11のいずれか一項に記載の回路装置を含むことを特徴とする移動体。
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