JP6979973B2 - 低電圧バッテリを有する電子デバイスに電力供給するためのシステム、装置、および方法 - Google Patents
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Description
本出願は、2016年6月1日に出願され、「SYSTEMS, APPARATUS, AND METHODS FOR POWERING ELECTRONIC DEVICES WITH LOW VOLTAGE BATTERIES」(整理番号BHC154009(BHDD-067/L))と題された、米国仮特許出願第62/344,383号の優先権を主張し、この米国仮特許出願の全体が、あらゆる目的のために、参照により本明細書に組み込まれている。
- 停止開始のため、マイクロコントローラ114は、命令に応答して、GPIO_OUTピンをLowに設定する
- イネーブルピン108は、抵抗器110によりLowになる
- DC-DC昇圧器102はオフになる
- 出力電圧116は減衰する
- 出力電圧116がBORレベル(代表的な閾値は1.5Vから2.0Vまで様々である)まで減衰すると、マイクロコントローラ114は、リセットし、すべてのピンは、即座に、プルアップ抵抗器を用いて入力として振る舞う
- GPIO_OUTピンにおけるノード118上の信号レベルは、内部プルアップ抵抗器により、BORレベル(1.5V〜2.0V)に等しくなる
- 昇圧器102を有効化する代表的な電圧は、0.75Vであり、したがってBOR閾値は、DC-DC昇圧器102を再度有効化するために十分大きい
- 昇圧器102は、再度動作し始めることになり、電圧116をマイクロコントローラ114に供給する
- マイクロコントローラ114は、信号「ラッチ電力」を生成することになり、サイクルを再開することになる
すなわち、図1の回路100は、停止の試みをバッテリ104が尽きるまで無限にループ化することになる。すなわち、そうした回路100は自動的にひとりでに(例えばプログラムで)停止できない。
- マイクロコントローラ503は、ラッチ電力1信号508をプルダウンし、同時にラッチ電力2信号517は、プルアップされる
- トランジスタ521は、ONになり、ノード516およびピン507をプルダウンする
- DC-DC昇圧器502は動作を停止し、出力電圧509は減衰していく
- 出力電圧509がBORレベル(例えば、1.8V程度)に達すると、マイクロコントローラ503は、すべてのピンをリセットして「プルアップ抵抗器を用いた入力状態」に置き、マイクロコントローラ503は、動作を停止し、信号508と信号517の両方は、Highになる
- トランジスタ521のベースは、信号517がHighなので、依然としてマイクロコントローラ503からバイアスがかけられたままであり、したがって、トランジスタ521は、ONにとどまって、ノード516をグラウンドにプルダウンし、イネーブルピン507は、Lowであり、昇圧器502は、動作していない
- 出力電圧509は、減衰し続ける
- 出力電圧509が0.5Vに等しくなると、トランジスタ521は制御を失い、ノード516の信号レベルは、出力電圧(例えば、約0.5Vの最悪のケース)に等しくなる場合がある
- 抵抗器519、520、523によって形成される分割器(信号508を一定率で減じる)により、イネーブルピン507は、昇圧器502を再度有効化するために必要とされる最低電圧未満のままである
- 出力電圧509は、ゼロになるまで減衰し続ける
- マイクロコントローラ1018は、(例えば、ソフトウェア命令を介して)GPIO_OUTピン(および結果としてラッチ電力ライン1020)を論理Lowに設定する
- ノード1012(イネーブルピン)は、抵抗器1014によりLowになる
- SDC1002は、動作を停止する
- SDC出力電圧(ノード1016)は、減衰し始める
- 出力電圧(ノード1016)がSVS閾値(例えば2V)に近づくと、SVS出力(制御ライン1026)はプルダウンされる
- SVS出力(制御ライン1026)は、SDC出力電圧(ノード1016)がおよそ0.85Vより下に低下するまで、論理Lowのままである。およそ0.85Vおよびそれより下のとき、SVS1004は、制御を失い、SVS出力(制御ライン1026)は、再度フローティング状態になり得る
- しかし、およそ0.85Vの電圧は、マイクロコントローラ1018の動作範囲よりかなり下であり、そのためマイクロコントローラのすべてのピンは、非アクティブ(フローティング状態)であり、SDC1002を再度有効化させられない
- SDC出力電圧(ノード1016)がさらに減衰した場合、マイクロコントローラ1018の電圧低下リセット(BOR)閾値は、SVS1004がSDC1002をOFF状態に維持している間、クリアされる
102 昇圧器
104 バッテリ
106 ノード
108 昇圧器イネーブルピン
110 抵抗器
112 モーメンタリスイッチ
114 マイクロコントローラ
116 昇圧器出力電圧
118 ノード
120 ダイオード
300 回路
302 昇圧器イネーブルライン
304 ポート
306 NPNトランジスタ
308 抵抗器
310 抵抗器
400 タイミング図
402 VCC
404 信号A
406 信号B
408 昇圧器イネーブル信号
410 出力
500 回路
501 バッテリ、アルカリ電池
502 DC-DC昇圧器
503 マイクロコントローラ
505 モーメンタリスイッチ
506 ライン
507 イネーブルピン
508 ラッチ電力1、ラッチ電力1信号
509 出力電圧、システム電圧
512 トランジスタ
513 抵抗器
515 ダイオード
516 ノード
517 ラッチ電力2、ラッチ電力2信号
518 ライン
519 抵抗器
520 抵抗器
521 トランジスタ、シリコンNPNトランジスタ
523 抵抗器
524 抵抗器
600 タイミング図
602 起動シーケンス
604 切断シーケンス
800 回路
805 トグルスイッチ
900 回路
902 バッテリ絶縁プルタブ
904 スイッチ
906 抵抗器
1000 回路
1002 降圧コンバータ、SDC
1004 供給電圧監視器、SVS
1006A バッテリ
1006B バッテリ
1008 ノード
1010 モーメンタリスイッチ
1012 ノード
1014 プルダウン抵抗器
1016 ノード
1018 マイクロコントローラ
1020 ラッチ電力ライン
1022 抵抗器
1024 ダイオード
1026 制御ライン
1100 タイミング図
Claims (17)
- ベース、エミッタ、およびコレクタを有する第1のトランジスタと、
出力ポート、システム電源端子、および入力ポートを有するマイクロコントローラと、
前記マイクロコントローラの前記出力ポートから生成され、DC-DC昇圧器のイネーブルピンに結合される第1の信号と、
前記マイクロコントローラの前記出力ポートから生成され、前記第1のトランジスタの前記ベースに結合される第2の信号であって、前記第1の信号の反転バージョンである、第2の信号と
前記第1のトランジスタの前記コレクタと前記DC-DC昇圧器の前記イネーブルピンとの間に直列に結合される第1の抵抗器、グラウンドと前記DC-DC昇圧器の前記イネーブルピンとの間に結合される第2の抵抗器、および前記第1の信号を生成する前記マイクロコントローラの前記出力ポートと前記第1のトランジスタの前記コレクタとの間に結合される第3の抵抗器から形成される抵抗分割器と
を備え、
前記第1のトランジスタの前記エミッタが、グラウンドに結合される、回路。 - 入力、前記イネーブルピン、および出力端子を有する前記DC-DC昇圧器と、
前記DC-DC昇圧器の前記入力に結合されるバッテリと、
前記バッテリと前記DC-DC昇圧器の前記イネーブルピンとの間に結合されるモーメンタリスイッチと
をさらに備え、
前記DC-DC昇圧器の前記出力端子が、前記マイクロコントローラの前記システム電源端子に結合される、請求項1に記載の回路。 - 前記第1の抵抗器の値、前記第2の抵抗器の値、および前記第3の抵抗器の値が、前記マイクロコントローラの電圧低下リセット機能によって前記DC-DC昇圧器が再度有効化されることを防止するように選択される、請求項1に記載の回路。
- ベース、エミッタ、およびコレクタを有する第2のトランジスタであって、前記ベースが、モーメンタリスイッチに結合され、前記エミッタが、グラウンドに結合され、前記コレクタが、前記DC-DC昇圧器の出力端子に結合される、第2のトランジスタをさらに備える、請求項1に記載の回路。
- 前記第2のトランジスタの前記コレクタが、前記マイクロコントローラの前記入力ポートにさらに結合される、請求項4に記載の回路。
- 前記モーメンタリスイッチと前記DC-DC昇圧器の前記イネーブルピンとの間に結合されるダイオードをさらに備える、請求項5に記載の回路。
- 回路により、デバイスに電力供給する方法であって、
マイクロコントローラにより、前記マイクロコントローラの出力ポートから第1の信号を生成するステップであって、前記マイクロコントローラが、前記出力ポート、システム電源端子、および入力ポートを有する、ステップと、
前記マイクロコントローラにより、DC-DC昇圧器のイネーブルピンに前記第1の信号を送信するステップと、
前記マイクロコントローラにより、前記マイクロコントローラの前記出力ポートから第2の信号を生成するステップであって、前記第2の信号が、前記第1の信号の反転バージョンである、ステップと、
前記マイクロコントローラにより、第1のトランジスタのベースに前記第2の信号を送信するステップであって、前記第1のトランジスタが、前記ベース、エミッタ、およびコレクタを有し、前記エミッタが、グラウンドに結合される、ステップと
を含み、
前記回路が、前記マイクロコントローラの電圧低下リセット機能によって前記DC-DC昇圧器が再度有効化されることを防止するために、前記第1のトランジスタの前記コレクタと前記DC-DC昇圧器の前記イネーブルピンとの間に直列に結合される第1の抵抗器、グラウンドと前記DC-DC昇圧器の前記イネーブルピンとの間に結合される第2の抵抗器、および前記第1の信号を生成する前記マイクロコントローラの前記出力ポートと前記第1のトランジスタの前記コレクタとの間に結合される第3の抵抗器から形成される抵抗分割器を備える、方法。 - 前記回路が、入力、前記イネーブルピン、および出力端子を備える前記DC-DC昇圧器を備え、前記出力端子が、前記マイクロコントローラの前記システム電源端子に結合され、
前記DC-DC昇圧器の前記入力にバッテリが結合され、
前記バッテリと前記DC-DC昇圧器の前記イネーブルピンとの間にモーメンタリスイッチが結合される、ものである、
請求項7に記載の方法。 - 前記マイクロコントローラにより、前記第1の信号を低論理値に、前記第2の信号を高論理値にプログラム的に設定するステップと、
前記マイクロコントローラにより、前記第2の信号に応答して、前記DC-DC昇圧器の前記イネーブルピンを低論理レベルにするために、前記第1のトランジスタにバイアスをかけるステップと、
前記マイクロコントローラにより、前記イネーブルピンが低論理レベルにされることに応答して、前記DC-DC昇圧器を無効化するステップと、
前記マイクロコントローラにより、前記DC-DC昇圧器の出力端子の出力電圧が、電圧低下リセットレベルまで減衰できるようにするステップと
をさらに含む、請求項7に記載の方法。 - 前記マイクロコントローラにより、前記DC-DC昇圧器の前記減衰する出力電圧が前記電圧低下リセットレベルに達することに応答して、前記マイクロコントローラをリセットするステップと、
前記マイクロコントローラにより、前記第1の信号と前記第2の信号の両方を高論理レベルに設定するステップと
をさらに含む、請求項9に記載の方法。 - 前記マイクロコントローラにより、前記DC-DC昇圧器の前記イネーブルピンを低論理レベルに維持するために、前記第2の信号に応答して、前記第1のトランジスタの前記バイアスを維持するステップと、
前記マイクロコントローラにより、前記DC-DC昇圧器の前記出力端子の前記出力電圧がさらに減衰できるようにするステップと、
前記マイクロコントローラにより、前記抵抗分割器を使用して、前記DC-DC昇圧器が再度有効化されることを防止するステップと
をさらに含む、請求項10に記載の方法。 - 出力ポート、システム電源端子、入力ポート、データ端子、および制御端子を有するマイクロコントローラと、
血糖センサを受け入れるためのセンサポートであって、前記マイクロコントローラの前記データ端子および前記制御端子に結合される、センサポートと、
前記マイクロコントローラの前記出力ポートから生成され、DC-DC昇圧器のイネーブルピンに結合される第1の信号と、
ベース、エミッタ、およびコレクタを有する第1のトランジスタと、
前記マイクロコントローラの前記出力ポートから生成され、前記第1のトランジスタの前記ベースに結合される第2の信号であって、前記第1の信号の反転バージョンである、第2の信号と
を備え、
前記第1のトランジスタの前記エミッタが、グラウンドに結合され、
前記第1のトランジスタの前記コレクタと前記DC-DC昇圧器の前記イネーブルピンとの間に直列に結合される第1の抵抗器、グラウンドと前記DC-DC昇圧器の前記イネーブルピンとの間に結合される第2の抵抗器、および前記第1の信号を生成する前記マイクロコントローラの前記出力ポートと前記第1のトランジスタの前記コレクタとの間に結合される第3の抵抗器から形成される抵抗分割器を備える、システム。 - 入力、前記イネーブルピン、および出力端子を有する前記DC-DC昇圧器と、
前記DC-DC昇圧器の前記入力に結合されるバッテリと、
前記バッテリと前記DC-DC昇圧器の前記イネーブルピンとの間に結合されるモーメンタリスイッチと
をさらに備え、
前記DC-DC昇圧器の前記出力端子が、前記マイクロコントローラの前記システム電源端子に結合される、請求項12に記載のシステム。 - 前記第1の抵抗器の値、前記第2の抵抗器の値、および前記第3の抵抗器の値が、前記マイクロコントローラの電圧低下リセット機能によって前記DC-DC昇圧器が再度有効化されることを防止するように選択される、請求項12に記載のシステム。
- ベース、エミッタ、およびコレクタを有する第2のトランジスタであって、前記ベースが、モーメンタリスイッチに結合され、前記エミッタが、グラウンドに結合され、前記コレクタが、前記DC-DC昇圧器の出力端子に結合される、第2のトランジスタをさらに備える、請求項14に記載のシステム。
- 前記第2のトランジスタの前記コレクタが、前記マイクロコントローラの前記入力ポートにさらに結合される、請求項15に記載のシステム。
- 前記モーメンタリスイッチと前記DC-DC昇圧器の前記イネーブルピンとの間に結合されるダイオードをさらに備える、請求項16に記載のシステム。
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