JP6806719B2 - 半導体装置の製造方法、基板処理装置およびプログラム - Google Patents

半導体装置の製造方法、基板処理装置およびプログラム Download PDF

Info

Publication number
JP6806719B2
JP6806719B2 JP2018005763A JP2018005763A JP6806719B2 JP 6806719 B2 JP6806719 B2 JP 6806719B2 JP 2018005763 A JP2018005763 A JP 2018005763A JP 2018005763 A JP2018005763 A JP 2018005763A JP 6806719 B2 JP6806719 B2 JP 6806719B2
Authority
JP
Japan
Prior art keywords
film
substrate
cyclic structure
treatment
contained
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Active
Application number
JP2018005763A
Other languages
English (en)
Other versions
JP2019125714A (ja
Inventor
良知 橋本
良知 橋本
貴史 新田
貴史 新田
広樹 山下
広樹 山下
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Kokusai Electric Corp
Original Assignee
Kokusai Electric Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Kokusai Electric Corp filed Critical Kokusai Electric Corp
Priority to JP2018005763A priority Critical patent/JP6806719B2/ja
Priority to US16/248,392 priority patent/US10763101B2/en
Priority to KR1020190005703A priority patent/KR102146180B1/ko
Publication of JP2019125714A publication Critical patent/JP2019125714A/ja
Application granted granted Critical
Publication of JP6806719B2 publication Critical patent/JP6806719B2/ja
Active legal-status Critical Current
Anticipated expiration legal-status Critical

Links

Images

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02107Forming insulating materials on a substrate
    • H01L21/02109Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates
    • H01L21/02112Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates characterised by the material of the layer
    • H01L21/02123Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates characterised by the material of the layer the material containing silicon
    • H01L21/02126Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates characterised by the material of the layer the material containing silicon the material containing Si, O, and at least one of H, N, C, F, or other non-metal elements, e.g. SiOC, SiOC:H or SiONC
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02107Forming insulating materials on a substrate
    • H01L21/02225Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer
    • H01L21/0226Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer formation by a deposition process
    • H01L21/02263Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer formation by a deposition process deposition from the gas or vapour phase
    • H01L21/02271Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer formation by a deposition process deposition from the gas or vapour phase deposition by decomposition or reaction of gaseous or vapour phase compounds, i.e. chemical vapour deposition
    • H01L21/0228Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer formation by a deposition process deposition from the gas or vapour phase deposition by decomposition or reaction of gaseous or vapour phase compounds, i.e. chemical vapour deposition deposition by cyclic CVD, e.g. ALD, ALE, pulsed CVD
    • CCHEMISTRY; METALLURGY
    • C23COATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; CHEMICAL SURFACE TREATMENT; DIFFUSION TREATMENT OF METALLIC MATERIAL; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL; INHIBITING CORROSION OF METALLIC MATERIAL OR INCRUSTATION IN GENERAL
    • C23CCOATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; SURFACE TREATMENT OF METALLIC MATERIAL BY DIFFUSION INTO THE SURFACE, BY CHEMICAL CONVERSION OR SUBSTITUTION; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL
    • C23C16/00Chemical coating by decomposition of gaseous compounds, without leaving reaction products of surface material in the coating, i.e. chemical vapour deposition [CVD] processes
    • C23C16/04Coating on selected surface areas, e.g. using masks
    • C23C16/045Coating cavities or hollow spaces, e.g. interior of tubes; Infiltration of porous substrates
    • CCHEMISTRY; METALLURGY
    • C23COATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; CHEMICAL SURFACE TREATMENT; DIFFUSION TREATMENT OF METALLIC MATERIAL; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL; INHIBITING CORROSION OF METALLIC MATERIAL OR INCRUSTATION IN GENERAL
    • C23CCOATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; SURFACE TREATMENT OF METALLIC MATERIAL BY DIFFUSION INTO THE SURFACE, BY CHEMICAL CONVERSION OR SUBSTITUTION; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL
    • C23C16/00Chemical coating by decomposition of gaseous compounds, without leaving reaction products of surface material in the coating, i.e. chemical vapour deposition [CVD] processes
    • C23C16/22Chemical coating by decomposition of gaseous compounds, without leaving reaction products of surface material in the coating, i.e. chemical vapour deposition [CVD] processes characterised by the deposition of inorganic material, other than metallic material
    • C23C16/30Deposition of compounds, mixtures or solid solutions, e.g. borides, carbides, nitrides
    • C23C16/36Carbonitrides
    • CCHEMISTRY; METALLURGY
    • C23COATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; CHEMICAL SURFACE TREATMENT; DIFFUSION TREATMENT OF METALLIC MATERIAL; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL; INHIBITING CORROSION OF METALLIC MATERIAL OR INCRUSTATION IN GENERAL
    • C23CCOATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; SURFACE TREATMENT OF METALLIC MATERIAL BY DIFFUSION INTO THE SURFACE, BY CHEMICAL CONVERSION OR SUBSTITUTION; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL
    • C23C16/00Chemical coating by decomposition of gaseous compounds, without leaving reaction products of surface material in the coating, i.e. chemical vapour deposition [CVD] processes
    • C23C16/44Chemical coating by decomposition of gaseous compounds, without leaving reaction products of surface material in the coating, i.e. chemical vapour deposition [CVD] processes characterised by the method of coating
    • CCHEMISTRY; METALLURGY
    • C23COATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; CHEMICAL SURFACE TREATMENT; DIFFUSION TREATMENT OF METALLIC MATERIAL; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL; INHIBITING CORROSION OF METALLIC MATERIAL OR INCRUSTATION IN GENERAL
    • C23CCOATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; SURFACE TREATMENT OF METALLIC MATERIAL BY DIFFUSION INTO THE SURFACE, BY CHEMICAL CONVERSION OR SUBSTITUTION; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL
    • C23C16/00Chemical coating by decomposition of gaseous compounds, without leaving reaction products of surface material in the coating, i.e. chemical vapour deposition [CVD] processes
    • C23C16/44Chemical coating by decomposition of gaseous compounds, without leaving reaction products of surface material in the coating, i.e. chemical vapour deposition [CVD] processes characterised by the method of coating
    • C23C16/455Chemical coating by decomposition of gaseous compounds, without leaving reaction products of surface material in the coating, i.e. chemical vapour deposition [CVD] processes characterised by the method of coating characterised by the method used for introducing gases into reaction chamber or for modifying gas flows in reaction chamber
    • C23C16/45523Pulsed gas flow or change of composition over time
    • C23C16/45525Atomic layer deposition [ALD]
    • C23C16/45553Atomic layer deposition [ALD] characterized by the use of precursors specially adapted for ALD
    • CCHEMISTRY; METALLURGY
    • C23COATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; CHEMICAL SURFACE TREATMENT; DIFFUSION TREATMENT OF METALLIC MATERIAL; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL; INHIBITING CORROSION OF METALLIC MATERIAL OR INCRUSTATION IN GENERAL
    • C23CCOATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; SURFACE TREATMENT OF METALLIC MATERIAL BY DIFFUSION INTO THE SURFACE, BY CHEMICAL CONVERSION OR SUBSTITUTION; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL
    • C23C16/00Chemical coating by decomposition of gaseous compounds, without leaving reaction products of surface material in the coating, i.e. chemical vapour deposition [CVD] processes
    • C23C16/44Chemical coating by decomposition of gaseous compounds, without leaving reaction products of surface material in the coating, i.e. chemical vapour deposition [CVD] processes characterised by the method of coating
    • C23C16/52Controlling or regulating the coating process
    • CCHEMISTRY; METALLURGY
    • C23COATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; CHEMICAL SURFACE TREATMENT; DIFFUSION TREATMENT OF METALLIC MATERIAL; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL; INHIBITING CORROSION OF METALLIC MATERIAL OR INCRUSTATION IN GENERAL
    • C23CCOATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; SURFACE TREATMENT OF METALLIC MATERIAL BY DIFFUSION INTO THE SURFACE, BY CHEMICAL CONVERSION OR SUBSTITUTION; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL
    • C23C16/00Chemical coating by decomposition of gaseous compounds, without leaving reaction products of surface material in the coating, i.e. chemical vapour deposition [CVD] processes
    • C23C16/56After-treatment
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02107Forming insulating materials on a substrate
    • H01L21/02109Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates
    • H01L21/02112Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates characterised by the material of the layer
    • H01L21/02123Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates characterised by the material of the layer the material containing silicon
    • H01L21/02126Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates characterised by the material of the layer the material containing silicon the material containing Si, O, and at least one of H, N, C, F, or other non-metal elements, e.g. SiOC, SiOC:H or SiONC
    • H01L21/02131Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates characterised by the material of the layer the material containing silicon the material containing Si, O, and at least one of H, N, C, F, or other non-metal elements, e.g. SiOC, SiOC:H or SiONC the material being halogen doped silicon oxides, e.g. FSG
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02107Forming insulating materials on a substrate
    • H01L21/02109Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates
    • H01L21/02112Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates characterised by the material of the layer
    • H01L21/02123Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates characterised by the material of the layer the material containing silicon
    • H01L21/02167Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates characterised by the material of the layer the material containing silicon the material being a silicon carbide not containing oxygen, e.g. SiC, SiC:H or silicon carbonitrides
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02107Forming insulating materials on a substrate
    • H01L21/02109Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates
    • H01L21/02205Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates the layer being characterised by the precursor material for deposition
    • H01L21/02208Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates the layer being characterised by the precursor material for deposition the precursor containing a compound comprising Si
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02107Forming insulating materials on a substrate
    • H01L21/02109Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates
    • H01L21/02205Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates the layer being characterised by the precursor material for deposition
    • H01L21/02208Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates the layer being characterised by the precursor material for deposition the precursor containing a compound comprising Si
    • H01L21/02211Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates the layer being characterised by the precursor material for deposition the precursor containing a compound comprising Si the compound being a silane, e.g. disilane, methylsilane or chlorosilane
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02107Forming insulating materials on a substrate
    • H01L21/02225Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer
    • H01L21/02227Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer formation by a process other than a deposition process
    • H01L21/0223Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer formation by a process other than a deposition process formation by oxidation, e.g. oxidation of the substrate
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02107Forming insulating materials on a substrate
    • H01L21/02225Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer
    • H01L21/02227Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer formation by a process other than a deposition process
    • H01L21/02247Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer formation by a process other than a deposition process formation by nitridation, e.g. nitridation of the substrate
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02107Forming insulating materials on a substrate
    • H01L21/02296Forming insulating materials on a substrate characterised by the treatment performed before or after the formation of the layer
    • H01L21/02318Forming insulating materials on a substrate characterised by the treatment performed before or after the formation of the layer post-treatment
    • H01L21/02321Forming insulating materials on a substrate characterised by the treatment performed before or after the formation of the layer post-treatment introduction of substances into an already existing insulating layer
    • H01L21/02323Forming insulating materials on a substrate characterised by the treatment performed before or after the formation of the layer post-treatment introduction of substances into an already existing insulating layer introduction of oxygen
    • H01L21/02326Forming insulating materials on a substrate characterised by the treatment performed before or after the formation of the layer post-treatment introduction of substances into an already existing insulating layer introduction of oxygen into a nitride layer, e.g. changing SiN to SiON
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02107Forming insulating materials on a substrate
    • H01L21/02296Forming insulating materials on a substrate characterised by the treatment performed before or after the formation of the layer
    • H01L21/02318Forming insulating materials on a substrate characterised by the treatment performed before or after the formation of the layer post-treatment
    • H01L21/02337Forming insulating materials on a substrate characterised by the treatment performed before or after the formation of the layer post-treatment treatment by exposure to a gas or vapour
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02107Forming insulating materials on a substrate
    • H01L21/02296Forming insulating materials on a substrate characterised by the treatment performed before or after the formation of the layer
    • H01L21/02318Forming insulating materials on a substrate characterised by the treatment performed before or after the formation of the layer post-treatment
    • H01L21/02337Forming insulating materials on a substrate characterised by the treatment performed before or after the formation of the layer post-treatment treatment by exposure to a gas or vapour
    • H01L21/0234Forming insulating materials on a substrate characterised by the treatment performed before or after the formation of the layer post-treatment treatment by exposure to a gas or vapour treatment by exposure to a plasma
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02365Forming inorganic semiconducting materials on a substrate
    • H01L21/02518Deposited layers
    • H01L21/02521Materials
    • H01L21/02538Group 13/15 materials
    • H01L21/0254Nitrides
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
    • H01L21/18Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
    • H01L21/30Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
    • H01L21/324Thermal treatment for modifying the properties of semiconductor bodies, e.g. annealing, sintering
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/67Apparatus specially adapted for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus specially adapted for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components ; Apparatus not specifically provided for elsewhere
    • H01L21/67005Apparatus not specifically provided for elsewhere
    • H01L21/67011Apparatus for manufacture or treatment
    • H01L21/67017Apparatus for fluid treatment
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/67Apparatus specially adapted for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus specially adapted for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components ; Apparatus not specifically provided for elsewhere
    • H01L21/67005Apparatus not specifically provided for elsewhere
    • H01L21/67011Apparatus for manufacture or treatment
    • H01L21/67098Apparatus for thermal treatment

Landscapes

  • Engineering & Computer Science (AREA)
  • Chemical & Material Sciences (AREA)
  • Physics & Mathematics (AREA)
  • Condensed Matter Physics & Semiconductors (AREA)
  • General Physics & Mathematics (AREA)
  • Manufacturing & Machinery (AREA)
  • Computer Hardware Design (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Power Engineering (AREA)
  • Chemical Kinetics & Catalysis (AREA)
  • Materials Engineering (AREA)
  • General Chemical & Material Sciences (AREA)
  • Mechanical Engineering (AREA)
  • Metallurgy (AREA)
  • Organic Chemistry (AREA)
  • Plasma & Fusion (AREA)
  • Inorganic Chemistry (AREA)
  • Chemical Vapour Deposition (AREA)
  • Formation Of Insulating Films (AREA)

Description

本発明は、半導体装置の製造方法、基板処理装置およびプログラムに関する。
半導体装置の製造工程の一工程として、基板上に、シリコン酸炭窒化膜(SiOCN膜)等の膜を形成する処理が行われることがある(例えば特許文献1参照)。また、基板上に、ボラジン環骨格を含むシリコン硼炭窒化膜(SiBCN膜)等の膜を形成する処理が行われることがある(例えば特許文献2参照)。
特開2011−238894号公報 特開2014−056871号公報
本発明の目的は、表面にトレンチやホール等の凹部が形成された基板上に、シームレスかつボイドフリーの膜を形成することが可能な技術を提供することにある。
本発明の一態様によれば、
表面に凹部が形成された基板に対して、シリコンと炭素とで構成される環状構造およびハロゲンを含む原料を供給する工程と、前記基板に対して窒化剤を供給する工程と、を非同時に行うサイクルを、前記原料に含まれる前記環状構造が保持される条件下で、所定回数行うことにより、前記基板の表面に形成された前記凹部内を埋め込むように、前記環状構造および窒素を含む第1膜を形成する工程と、
前記基板に対して、前記第1膜に含まれる前記環状構造が保持される条件下で、酸化剤を供給して、ポストトリートメントを行う工程と、
を行い、
前記第1膜を形成する工程では、シームまたはボイドを有する前記第1膜を形成し、
前記ポストトリートメントを行う工程では、前記第1膜を酸化させて、前記環状構造および酸素を含む第2膜に変換させることで、前記第1膜が有していた前記シームまたは前記ボイドを消滅させる技術が提供される。
本発明によれば、表面にトレンチやホール等の凹部が形成された基板上に、シームレスかつボイドフリーの膜を形成することが可能となる。
本発明の一実施形態で好適に用いられる基板処理装置の縦型処理炉の概略構成図であり、処理炉部分を縦断面図で示す図である。 本発明の一実施形態で好適に用いられる基板処理装置の縦型処理炉の概略構成図であり、処理炉部分を図1のA−A線断面図で示す図である。 本発明の一実施形態で好適に用いられる基板処理装置のコントローラの概略構成図であり、コントローラの制御系をブロック図で示す図である。 本発明の一実施形態の基板処理シーケンスを示すフロー図である。 原料として用いられる1,1,3,3−テトラクロロ−1,3−ジシラシクロブタンの化学構造式を示す図である。 (a)〜(c)は、ウエハの表面に形成された凹部内を埋め込むように成膜処理を行う際のウエハ断面拡大図を示す図であり、(d)は、成膜処理後にポストトリートメント処理を行った後のウエハ断面拡大図を示す図である。 成膜処理とポストトリートメント処理とを行うことで形成された膜の膜厚と、成膜処理を行うことで形成された成膜直後の膜の膜厚とを比較して示した図である。
成膜手法として一般的に知られるCVD(Chemical Vapor Deposition)法は三次元的な基板面に対して成膜速度が等方的でない。平面ではない基板面、例えばトレンチ形状のパターン、あるいはホール形状のパターンあるいはその両者が形成された基板表面に成膜を行う場合、既存のCVD法ではトレンチやホール内部の膜厚制御が困難である。特にトレンチあるいはホール内において、底部の膜厚が上部の膜厚に比べて薄くなってしまい膜厚差が生じてしまう(段差被覆性(ステップカバレッジ)が低下してしまう)が、これはCVD法においては気相反応した分子を溝内の各所に均一に供給することが困難なためである。また、底部と上部の膜厚差はトレンチあるいはホール形状におけるアスペクト比が大きいパターンほど膜厚の差異が大きくなる(段差被覆性が悪化する)ことが知られている。さらに、トレンチあるいはホール等のパターン上部の膜形成が底部よりも速い速度で進み、開口部が閉塞してしまった場合、閉塞した以後はトレンチあるいはホール等のパターン内部への気相反応した分子もしくは原料ガスの供給が妨げられシームやボイドが発生する課題も生じる。
これに対して三次元的な基板面に対して等方的な成膜速度が得られるALD(Atomic Layer Deposition)法による成膜を用いることが考えられるが、逆テーパー形状のトレンチやホール等のパターンへの成膜に対しては前述のパターン上部閉塞の課題が生じる。
また、所定の膜厚の膜をパターン上に形成した後、その膜をエッチングすることでパターン内の膜形状を制御する方法、あるいは前述の成膜とエッチングを複数回繰り返す手法(デポエッチデポ)が用いられるが、これらの手法においては所望の膜厚と形状を両立した膜を得るまでに要する時間が増大し、且つ成膜処理を行う装置のみでなく、エッチング処理を行う装置が必要であるため生産効率の低下や生産コストの増大などが課題となる。
上述した課題に対し、SiとCとで構成される環状構造およびハロゲンとしての塩素(Cl)を含む原料と窒化剤とを用いて、基板の表面に形成されたトレンチやホール等の凹部内を埋め込むようにSiとCとで構成される環状構造を含むSiCN膜を形成し、そのSiCN膜に対してO含有雰囲気下でポストトリートメント処理を行うことで、SiCN膜がSiOC膜に変換され、その際、増膜(膜の膨張)が生じ、SiCN膜に発生したシームやボイドが消滅することを本発明者等は見出した。本発明は、本発明者等が見出した上記知見に基づくものである。
<本発明の一実施形態>
以下、本発明の一実施形態について、図1〜図5を用いて説明する。
(1)基板処理装置の構成
図1に示すように、処理炉202は加熱機構(温度調整部)としてのヒータ207を有する。ヒータ207は円筒形状であり、保持板に支持されることにより垂直に据え付けられている。ヒータ207は、ガスを熱で活性化(励起)させる活性化機構(励起部)としても機能する。
ヒータ207の内側には、ヒータ207と同心円状に反応管203が配設されている。反応管203は、例えば石英(SiO2)または炭化シリコン(SiC)等の耐熱性材料により構成され、上端が閉塞し下端が開口した円筒形状に形成されている。反応管203の筒中空部には、処理室201が形成される。処理室201は、基板としてのウエハ200を収容可能に構成されている。
処理室201内には、ノズル249a,249bが、反応管203の下部側壁を貫通するように設けられている。ノズル249a,249bには、ガス供給管232a,232bがそれぞれ接続されている。
ガス供給管232a,232bには、ガス流の上流側から順に、流量制御器(流量制御部)であるマスフローコントローラ(MFC)241a,241bおよび開閉弁であるバルブ243a,243bがそれぞれ設けられている。ガス供給管232a,232bのバルブ243a,243bよりも下流側には、ガス供給管232c,232dがそれぞれ接続されている。ガス供給管232c,232dには、ガス流の上流側から順に、MFC241c,241dおよびバルブ243c,243dがそれぞれ設けられている。
図2に示すように、ノズル249a,249bは、反応管203の内壁とウエハ200との間における平面視において円環状の空間に、反応管203の内壁の下部より上部に沿って、ウエハ200の配列方向上方に向かって立ち上がるようにそれぞれ設けられている。すなわち、ノズル249a,249bは、ウエハ200が配列されるウエハ配列領域の側方の、ウエハ配列領域を水平に取り囲む領域に、ウエハ配列領域に沿うようにそれぞれ設けられている。ノズル249a,249bの側面には、ガスを供給するガス供給孔250a,250bがそれぞれ設けられている。ガス供給孔250a,250bは、反応管203の中心を向くようにそれぞれ開口しており、ウエハ200に向けてガスを供給することが可能となっている。ガス供給孔250a,250bは、反応管203の下部から上部にわたって複数設けられている。
ガス供給管232aからは、原料として、例えば、SiとCとで構成される環状構造およびハロゲンを含むガスが、MFC241a、バルブ243a、ノズル249aを介して処理室201内へ供給される。原料は、SiソースおよびCソースとして作用する。原料としては、例えば、1,1,3,3−テトラクロロ−1,3−ジシラシクロブタン(C24Cl4Si2、略称:TCDSCB)ガスを用いることができる。図5に、TCDSCBの化学構造式を示す。TCDSCBは、SiとCとで構成される環状構造を含み、ハロゲンとしての塩素(Cl)を含んでいる。以下、このSiとCとで構成される環状構造を、便宜上、単に、環状構造とも称する。TCDSCBに含まれる環状構造の形状は四角形である。この環状構造は、SiとCとが交互に結合してなり、4つのSi−C結合を含んでおり、2つのSi原子と2つのC原子を含んでいる。この環状構造におけるSiにはClが結合しており、Cには水素(H)が結合している。すなわち、TCDSCBは、Si−C結合のほか、Si−Cl結合およびC−H結合をそれぞれ含んでいる。
ガス供給管232bからは、反応体として、例えば、窒素(N)含有ガスが、MFC241b、バルブ243b、ノズル249bを介して処理室201内へ供給される。N含有ガスとしては、例えば、窒化剤(窒化ガス)である窒化水素系ガスを用いることができる。窒化水素系ガスは、NおよびHを含み、NおよびHの2元素のみで構成される物質ともいえ、Nソースとして作用する。窒化水素系ガスとしては、例えば、アンモニア(NH3)ガスを用いることができる。
ガス供給管232bからは、反応体として、例えば、酸素(O)含有ガスが、MFC241b、バルブ243b、ノズル249bを介して処理室201内へ供給される。O含有ガスは、酸化剤(酸化ガス)、すなわち、Oソースとして作用する。O含有ガスとしては、例えば、酸素(O2)ガスを用いることができる。
ガス供給管232c,232dからは、不活性ガスとしての窒素(N2)ガスが、それぞれ、MFC241c,241d、バルブ243c,243d、ガス供給管232a,232b、ノズル249a,249bを介して処理室201内へ供給される。N2ガスは、パージガス、キャリアガス、希釈ガス等として作用する。
主に、ガス供給管232a、MFC241a、バルブ243aにより、原料供給系が構成される。主に、ガス供給管232b、MFC241b、バルブ243bにより、反応体(N含有ガス、O含有ガス)供給系が構成される。N含有ガス供給系は、後述する成膜ステップにおいて窒化剤供給系として機能する。O含有ガス供給系は、後述するポストトリートメントステップにおいて酸化剤供給系として機能する。主に、ガス供給管232c,232d、MFC241c,241d、バルブ243c,243dにより、不活性ガス供給系が構成される。
上述の各種供給系のうち、いずれか、或いは、全ての供給系は、バルブ243a〜243dやMFC241a〜241d等が集積されてなる集積型供給システム248として構成されていてもよい。集積型供給システム248は、ガス供給管232a〜232dのそれぞれに対して接続され、ガス供給管232a〜232d内への各種ガスの供給動作、すなわち、バルブ243a〜243dの開閉動作やMFC241a〜241dによる流量調整動作等が、後述するコントローラ121によって制御されるように構成されている。集積型供給システム248は、一体型、或いは、分割型の集積ユニットとして構成されており、ガス供給管232a〜232d等に対して集積ユニット単位で着脱を行うことができ、集積型供給システム248のメンテナンス、交換、増設等を、集積ユニット単位で行うことが可能なように構成されている。
反応管203の側壁下方には、処理室201内の雰囲気を排気する排気管231が接続されている。排気管231には、処理室201内の圧力を検出する圧力検出器(圧力検出部)としての圧力センサ245および圧力調整器(圧力調整部)としてのAPC(Auto Pressure Controller)バルブ244を介して、真空排気装置としての真空ポンプ246が接続されている。APCバルブ244は、真空ポンプ246を作動させた状態で弁を開閉することで、処理室201内の真空排気および真空排気停止を行うことができ、更に、真空ポンプ246を作動させた状態で、圧力センサ245により検出された圧力情報に基づいて弁開度を調節することで、処理室201内の圧力を調整することができるように構成されている。主に、排気管231、圧力センサ245、APCバルブ244により、排気系が構成される。真空ポンプ246を排気系に含めて考えてもよい。
反応管203の下方には、反応管203の下端開口を気密に閉塞可能な炉口蓋体としてのシールキャップ219が設けられている。シールキャップ219は、例えばSUS等の金属材料により構成され、円盤状に形成されている。シールキャップ219の上面には、反応管203の下端と当接するシール部材としてのOリング220が設けられている。シールキャップ219の下方には、後述するボート217を回転させる回転機構267が設置されている。回転機構267の回転軸255は、シールキャップ219を貫通してボート217に接続されている。回転機構267は、ボート217を回転させることでウエハ200を回転させるように構成されている。シールキャップ219は、反応管203の外部に設置された昇降機構としてのボートエレベータ115によって垂直方向に昇降されるように構成されている。ボートエレベータ115は、シールキャップ219を昇降させることで、ウエハ200を処理室201内外に搬入および搬出(搬送)する搬送装置(搬送機構)として構成されている。
基板支持具としてのボート217は、複数枚、例えば25〜200枚のウエハ200を、水平姿勢で、かつ、互いに中心を揃えた状態で垂直方向に整列させて多段に支持するように、すなわち、間隔を空けて配列させるように構成されている。ボート217は、例えば石英やSiC等の耐熱性材料により構成される。ボート217の下部には、例えば石英やSiC等の耐熱性材料により構成される断熱板218が水平姿勢で多段に支持されている。
反応管203内には、温度検出器としての温度センサ263が設置されている。温度センサ263により検出された温度情報に基づきヒータ207への通電具合を調整することで、処理室201内の温度が所望の温度分布となる。温度センサ263は、反応管203の内壁に沿って設けられている。
図3に示すように、制御部(制御手段)であるコントローラ121は、CPU(Central Processing Unit)121a、RAM(Random Access Memory)121b、記憶装置121c、I/Oポート121dを備えたコンピュータとして構成されている。RAM121b、記憶装置121c、I/Oポート121dは、内部バス121eを介して、CPU121aとデータ交換可能なように構成されている。コントローラ121には、例えばタッチパネル等として構成された入出力装置122が接続されている。
記憶装置121cは、例えばフラッシュメモリ、HDD(Hard Disk Drive)等で構成されている。記憶装置121c内には、基板処理装置の動作を制御する制御プログラムや、後述する基板処理の手順や条件等が記載されたプロセスレシピ等が、読み出し可能に格納されている。プロセスレシピは、後述する基板処理工程における各手順をコントローラ121に実行させ、所定の結果を得ることが出来るように組み合わされたものであり、プログラムとして機能する。以下、このプロセスレシピや制御プログラム等を総称して、単に、プログラムともいう。また、プロセスレシピを、単に、レシピともいう。本明細書においてプログラムという言葉を用いた場合は、レシピ単体のみを含む場合、制御プログラム単体のみを含む場合、または、それらの両方を含む場合がある。RAM121bは、CPU121aによって読み出されたプログラムやデータ等が一時的に保持されるメモリ領域(ワークエリア)として構成されている。
I/Oポート121dは、上述のMFC241a〜241d、バルブ243a〜243d、圧力センサ245、APCバルブ244、真空ポンプ246、ヒータ207、温度センサ263、回転機構267、ボートエレベータ115等に接続されている。
CPU121aは、記憶装置121cから制御プログラムを読み出して実行すると共に、入出力装置122からの操作コマンドの入力等に応じて記憶装置121cからレシピを読み出すように構成されている。CPU121aは、読み出したレシピの内容に沿うように、MFC241a〜241dによる各種ガスの流量調整動作、バルブ243a〜243dの開閉動作、APCバルブ244の開閉動作および圧力センサ245に基づくAPCバルブ244による圧力調整動作、真空ポンプ246の起動および停止、温度センサ263に基づくヒータ207の温度調整動作、回転機構267によるボート217の回転および回転速度調節動作、ボートエレベータ115によるボート217の昇降動作等を制御するように構成されている。
コントローラ121は、外部記憶装置123に格納された上述のプログラムを、コンピュータにインストールすることにより構成することができる。外部記憶装置123は、例えば、HDD等の磁気ディスク、CD等の光ディスク、MO等の光磁気ディスク、USBメモリ等の半導体メモリを含む。記憶装置121cや外部記憶装置123は、コンピュータ読み取り可能な記録媒体として構成されている。以下、これらを総称して、単に、記録媒体ともいう。本明細書において記録媒体という言葉を用いた場合は、記憶装置121c単体のみを含む場合、外部記憶装置123単体のみを含む場合、または、それらの両方を含む場合がある。なお、コンピュータへのプログラムの提供は、外部記憶装置123を用いず、インターネットや専用回線等の通信手段を用いて行ってもよい。
(2)基板処理工程
上述の基板処理装置を用い、半導体装置の製造工程の一工程として、表面にトレンチやホール等の凹部が形成された基板としてのウエハ200上にシリコン酸炭化膜(SiOC膜)を形成するシーケンス例について、主に、図4を用いて説明する。以下の説明において、基板処理装置を構成する各部の動作はコントローラ121により制御される。
図4に示す基板処理シーケンスでは、
表面に凹部が形成されたウエハ200に対して、SiとCとで構成される環状構造およびハロゲンとしてのClを含む原料としてTCDSCBガスを供給するステップ1と、ウエハ200に対して窒化剤としてNH3ガスを供給するステップ2と、を非同時に行うサイクルを、TCDSCBガスに含まれるSiとCとで構成される環状構造が保持される条件下で、所定回数行うことにより、ウエハ200の表面に形成された凹部内を埋め込むように、SiとCとで構成される環状構造およびNを含む第1膜を形成する成膜ステップと、
ウエハ200に対して、第1膜に含まれるSiとCとで構成される環状構造が保持される条件下で、酸化剤としてO2ガスを供給して、ポストトリートメントを行うポストトリートメントステップと、
を行う。
成膜ステップで形成する第1膜は、Si、C、およびNを含みO非含有の膜、すなわち、シリコン炭窒化膜(SiCN膜)となる。なお、成膜ステップでは、NH3ガスに含まれるNを、NにHが結合した状態で、第1膜中に取り込ませる。
ポストトリートメントステップでは、第1膜を酸化させて、SiとCとで構成される環状構造およびOを含む第2膜に変換させる。第2膜は、Si、C、およびOを含む膜、すなわち、シリコン酸炭化膜(SiOC膜)となる。なお、ポストトリートメントステップでは、第1膜に含まれるNを、O2ガスに含まれるOに置換させることで、第1膜を第2膜に変換させる。これにより、第1膜の厚さを第2膜の厚さよりも厚くならしめる。
本明細書では、図4に示す基板処理シーケンスを、便宜上、以下のように示すこともある。以下の変形例等の説明においても、同様の表記を用いることとする。
(TCDSCB→NH3)×n→O2 ⇒ SiOCN
本明細書において「ウエハ」という言葉を用いた場合は、ウエハそのものを意味する場合や、ウエハとその表面に形成された所定の層や膜との積層体を意味する場合がある。本明細書において「ウエハの表面」という言葉を用いた場合は、ウエハそのものの表面を意味する場合や、ウエハ上に形成された所定の層等の表面を意味する場合がある。本明細書において「ウエハ上に所定の層を形成する」と記載した場合は、ウエハそのものの表面上に所定の層を直接形成することを意味する場合や、ウエハ上に形成されている層等の上に所定の層を形成することを意味する場合がある。本明細書において「基板」という言葉を用いた場合も、「ウエハ」という言葉を用いた場合と同義である。
(ウエハチャージおよびボートロード)
複数枚のウエハ200がボート217に装填(ウエハチャージ)される。その後、図1に示すように、複数枚のウエハ200を支持したボート217は、ボートエレベータ115によって持ち上げられて処理室201内へ搬入(ボートロード)される。この状態で、シールキャップ219は、Oリング220を介して反応管203の下端をシールした状態となる。
(圧力調整および温度調整)
処理室201内、すなわち、ウエハ200が存在する空間が所望の圧力(真空度)となるように、真空ポンプ246によって真空排気(減圧排気)される。この際、処理室201内の圧力は圧力センサ245で測定され、この測定された圧力情報に基づきAPCバルブ244がフィードバック制御される。また、処理室201内のウエハ200が所望の処理温度(第1温度)となるように、ヒータ207によって加熱される。この際、処理室201内が所望の温度分布となるように、温度センサ263が検出した温度情報に基づきヒータ207への通電具合がフィードバック制御される。また、回転機構267によるウエハ200の回転を開始する。真空ポンプ246の稼働、ウエハ200の加熱および回転は、いずれも、少なくともウエハ200に対する処理が終了するまでの間は継続して行われる。
(成膜ステップ)
その後、以下のステップ1及びステップ2を順次実施する。
[ステップ1]
このステップでは、処理室201内のウエハ200に対してTCDSCBガスを供給する。具体的には、バルブ243aを開き、ガス供給管232a内へTCDSCBガスを流す。TCDSCBガスは、MFC241aにより流量調整され、ノズル249aを介して処理室201内へ供給され、排気管231から排気される。このとき、ウエハ200に対してTCDSCBガスが供給される。このときバルブ243c,243dを開き、ガス供給管232c,232d内へN2ガスを流すようにしてもよい。
本ステップにおける処理条件としては、
処理温度(第1温度):200〜400℃、好ましくは250〜350℃
処理圧力:1〜20Torr(133〜2666Pa)
TCDSCBガス供給流量:1〜2000sccm
2ガス供給流量(各ガス供給管):0〜10000sccm
各ガス供給時間:1〜120秒、好ましくは5〜60秒
が例示される。
なお、本明細書における「200〜400℃」等の数値範囲の表記は、下限値および上限値がその範囲に含まれることを意味する。例えば「200〜400℃」は、「200℃以上400℃以下」を意味する。他の数値範囲についても同様である。
上述の処理条件、特に温度条件(処理温度200〜400℃)は、TCDSCBに含まれるSiとCとで構成される環状構造の少なくとも一部を、破壊することなく保持(維持)することができる条件である。すなわち、上述の処理条件は、ウエハ200に対して供給されるTCDSCBガス(複数のTCDSCB分子)に含まれる複数の環状構造のうち、少なくとも一部の環状構造が破壊されることなくそのままの形で保持される条件である。本明細書では、SiとCとで構成される環状構造を、単に、環状構造とも称する。
上述の条件下でウエハ200に対してTCDSCBガスを供給することにより、ウエハ200の最表面上に、環状構造およびハロゲンとしてのClを含む第1層(初期層)が形成される。すなわち、第1層として、SiとCとで構成される環状構造およびClを含む層が形成される。第1層中には、TCDSCBガスに含まれる複数の環状構造のうち、少なくとも一部の環状構造が、破壊されることなくそのままの形で取り込まれる。なお、第1層は、環状構造を構成する複数のSi−C結合のうち一部の結合が破壊されることで生成された鎖状構造を含む場合がある。また、第1層は、Si−Cl結合およびC−H結合のうち少なくともいずれかを含む場合がある。
ウエハ200上に第1層を形成した後、バルブ243aを閉じ、処理室201内へのTCDSCBガスの供給を停止する。そして、処理室201内を真空排気し、処理室201内に残留するガス等を処理室201内から排除する。このとき、バルブ243c,243dを開き、処理室201内へN2ガスを供給する。N2ガスはパージガスとして作用する。
原料としては、TCDSCBガスの他、1,1,3,3−テトラクロロ−1,3−ジシラシクロペンタン(C36Cl4Si2)ガス等を用いることができる。すなわち、原料に含まれるSiとCとで構成される環状構造の形状は、四角形である場合に限らない。また、この環状構造は、SiとCとが交互に結合してなる場合に限らない。また、原料としては、1,1,3,3−テトラフルオロ−1,3−ジシラシクロブタン(C244Si2)ガス等を用いることもできる。すなわち、原料に含まれるハロゲンは、Clに限らず、フッ素(F)、臭素(Br)、ヨウ素(I)等であってもよい。
不活性ガスとしては、N2ガスの他、例えば、Arガス、Heガス、Neガス、Xeガス等の各種希ガスを用いることが可能である。この点は、後述するステップ2、ポストトリートメントステップにおいても同様である。
[ステップ2]
ステップ1が終了した後、処理室201内のウエハ200、すなわち、ウエハ200上に形成された第1層に対してNH3ガスを供給する。具体的には、バルブ243b〜243dの開閉制御を、ステップ1におけるバルブ243a,243c,243dの開閉制御と同様の手順で行う。NH3ガスは、MFC241bにより流量調整され、ノズル249bを介して処理室201内へ供給され、排気管231から排気される。このとき、ウエハ200に対してNH3ガスが供給される。
本ステップにおける処理条件としては、
処理温度(第1温度):200〜400℃、好ましくは250〜350℃
処理圧力:1〜30Torr(133〜3999Pa)
NH3ガス供給流量:100〜10000sccm
ガス供給時間:1〜120秒
が例示される。他の処理条件は、ステップ1における処理条件と同様とする。
上述の処理条件、特に温度条件(処理温度200〜400℃)は、ステップ1でウエハ200上に形成された第1層中に含まれるSiとCとで構成される環状構造の少なくとも一部を、破壊することなく保持(維持)することができる条件である。この環状構造を構成するSi−C結合は強固で、SiからCが脱離しにくい状態となる。
そして、上述の条件下でウエハ200に対してNH3ガスを供給することにより、第1層の少なくとも一部を改質(窒化)させることができる。それにより、第1層中からClやH等を脱離させると共に、NH3ガスに含まれるNを、NにHが結合した状態で、第1層中に取り込ませることが可能となる。すなわち、第1層に含まれる環状構造を構成するSiに、NH3ガスに含まれるNを、NにHが結合した状態で結合させることが可能となる。このNHの状態でSiに結合したSi−N結合は弱く、SiからNが脱離しやすい状態となる。
すなわち、上述の条件下でウエハ200に対してNH3ガスを供給することにより、第1層に含まれる環状構造の少なくとも一部を、破壊することなく保持したまま、第2層中にそのまま取り込ませる(残存させる)ことが可能となる。すなわち、第1層の窒化を、第1層に含まれる複数の環状構造のうち、少なくとも一部の環状構造をそのままの形で残すよう、不飽和(不飽和窒化)とすることが可能となる。第1層が窒化されることで、ウエハ200上に、第2層として、SiとCとで構成される環状構造およびNを含む層であるシリコン炭窒化層(SiCN層)が形成される。このSiCN層は、Si、C、およびNを含みO非含有の層となる。なお、第2層中に含まれるCは、SiとCとで構成される環状構造を保持した状態で、第2層中に取り込まれることとなり、第2層中に含まれるNは、NがHに結合した状態で、第2層中に取り込まれることとなる。すなわち、第2層中に含まれるCは、強固なSi−C結合に起因して、脱離しにくい状態となり、第2層中に含まれるNは、脆弱なSi−N結合に起因して、脱離しやすい状態となる。
ウエハ200上に第2層を形成した後、バルブ243bを閉じ、処理室201内へのNH3ガスの供給を停止する。そして、ステップ1と同様の処理手順により、処理室201内に残留するガス等を処理室201内から排除する。
窒化剤(N含有ガス)としては、NH3ガスの他、ジアゼン(N22)ガス、ヒドラジン(N24)ガス、N38ガス、これらの化合物を含むガス等を用いることが可能である。
[所定回数実施]
ステップ1およびステップ2を非同時に、すなわち、同期させることなく交互に行うサイクルを所定回数(n回、nは1以上の整数)行うことにより、ウエハ200上に、第1膜として、SiとCとで構成される環状構造およびNを含む膜であるSiCN膜が形成される。このSiCN膜は、Si、C、およびNを含みO非含有の膜となる。上述のサイクルは、複数回繰り返すのが好ましい。
(パージ)
成膜ステップが終了した後、ガス供給管232c,232dのそれぞれからN2ガスを処理室201内へ供給し、排気管231から排気する。これにより、処理室201内がパージされ、処理室201内に残留するガスや反応副生成物等が処理室201内から除去される。
(ポストトリートメントステップ)
処理室201内のパージが終了した後、ウエハ200上に形成されたアズデポ状態のSiCN膜に対してO含有雰囲気下でポストトリートメント処理を行う。ポストトリートメントステップでは、ウエハ200に対してO2ガスを供給し、SiとCとで構成される環状構造およびNを含む第1膜を酸化させて、この第1膜を、SiとCとで構成される環状構造およびOを含む第2膜に変換させる。第2膜は、Si、C、およびOを含む膜、すなわち、SiOC膜となる。
成膜ステップとポストトリートメントステップとは、同一の処理室201内で、成膜処理後のウエハ200を処理室201内から処理室201外に取り出すことなく、連続的に行う。すなわち、成膜ステップとポストトリートメントステップとをin−situで連続して行う。
すなわち、成膜ステップが終了し、処理室201内のパージが終了した後、成膜処理後のウエハ200を処理室201内に収容した状態で、処理室201内のウエハ200、すなわち、ウエハ200上に形成された第1膜に対してO2ガスを供給する。具体的には、バルブ243b〜243dの開閉制御を、ステップ1におけるバルブ243a,243c,243dの開閉制御と同様の手順で行う。O2ガスは、MFC241bにより流量調整され、ノズル249bを介して処理室201内へ供給され、排気管231から排気される。このとき、ウエハ200に対してO2ガスが供給される。
本ステップにおける処理条件としては、
処理温度(第2温度):室温(25℃)〜600℃
処理圧力:0.5〜760Torr(67〜101325Pa)
2ガス供給流量(各ガス供給管):0〜10000sccm
2ガス供給流量:100〜10000sccm
が例示される。
上述の処理条件、特に温度条件(室温〜600℃)は、成膜ステップにおいて形成されたSiCN膜に含まれるSiとCとで構成される環状構造の少なくとも一部を、破壊することなく保持(維持)することができる条件である。すなわち、上述の処理条件は、ウエハ200上のSiCN膜に含まれる複数の環状構造のうち、少なくとも一部の環状構造が破壊されることなくそのままの形で保持される条件である。
すなわち、上述の条件下では、アズデポ状態のSiCN膜中に含まれる環状構造の少なくとも一部を、破壊することなく保持することが可能となる。つまり、アズデポ状態のSiCN膜に含まれる複数の環状構造のうち、少なくとも一部の環状構造を、そのままの形で膜中に残存させることが可能となる。
また、上述したように、ポストトリートメント処理前のアズデポ状態のSiCN膜においては、膜中の環状構造を構成するSiに、NがNHの状態で結合している。このSiに、NがNHの状態で結合したSi−N結合は脆弱であり、Nは脱離しやすい状態となっている。また、SiCN膜中の環状構造を構成するSi−C結合は強固であり、Cは脱離しにくい状態となっている。
つまり、上述した成膜ステップにおいて形成されたアズデポ状態のSiCN膜に対して、上述の条件下でポストトリートメント処理を行うことにより、このSiCN膜を酸化させ、このSiCN膜中に含まれるSiとCとで構成される環状構造の少なくとも一部を保持しつつ、このSiCN膜中に含まれるNを、酸化剤に含まれるOに置き換える置換反応を生じさせることができる。このときSiCN膜中に含まれるNはHとともに膜中から脱離することとなる。このように、アズデポ状態のSiCN膜を酸化させることで、このSiCN膜をSiOC膜に変換させることができる。そして、SiCN膜がSiOC膜に変換されることで、SiOC膜の厚さを、ポストトリートメント処理前のSiCN膜の厚さよりも厚くすることができ、増膜(膨張)させることが可能となる。
つまり、上述した成膜ステップを行うことにより、図6(a)〜図6(c)に示すように、ウエハ200の表面に形成された凹部内を埋め込むように、SiとCとで構成される環状構造およびNを含む膜であるSiCN膜300を形成すると、成膜直後においては図6(c)に示すように、凹部の開口部が閉塞し、シームやボイドが発生する。
しかし、成膜処理後にポストトリートメント処理を行うことにより、ウエハ200の表面の凹部内を埋め込むように形成されたシームやボイドを有するSiCN膜300を酸化させ、SiCN膜300中に含まれるSiとCとで構成される環状構造の少なくとも一部を保持しつつ、このSiCN膜300をSiOC膜400に変換(改質)させることで、図6(d)に示すように、この膜を増膜(膨張)させることができる。このとき、凹部内のシームやボイドは消滅し、シームレスかつボイドフリーな状態となる。
すなわち、アズデポ状態のSiCN膜に対して、酸化剤を供給してポストトリートメント処理を行うことにより、凹部内のシームやボイドを有するSiCN膜を、SiOC膜に変換させて増膜(膨張)させることで、シームやボイドは消滅し、凹部内にシームレスかつボイドフリーのSiOC膜が形成される。
なお、ポストトリートメント処理を行うことにより形成されるSiOC膜中には、N成分が5%未満程度含まれることがある。また、ポストトリートメント処理の処理条件によっては、このSiOC膜中のN成分が1%未満程度となることもある。このことから、この膜を、SiOCN膜と称することもできる。ただし、ポストトリートメント処理後のSiOCN膜中に含まれるNの濃度は不純物レベルであり、成膜直後のアズデポ状態のSiCN膜中に含まれるNの濃度よりも遥かに低い。
酸化剤(O含有ガス)としては、O2ガスの他、水蒸気(H2O)、O2+H2ガス、亜酸化窒素(N2O)ガス、一酸化窒素(NO)ガス、二酸化窒素(NO2)ガス、過酸化水素(H22)ガス、オゾン(O3)ガス等を用いることが可能である。なお、酸化剤としてO2+H2ガスを用いる場合、H2ガスの代わりに重水素(D2)ガス等を用いることが可能である。
なお、酸化剤としてプラズマ励起させたO2ガス(O2 *)、酸素ラジカル(O*)、および水酸基ラジカル(OH*)等を用いてポストトリートメント処理を行うと、O*、OH*等の酸化力が強すぎて、下地が侵食(酸化)されてしまうことがある。また、膜中のSiとCとで構成される環状構造が破壊されてしまうことがある。酸化剤として、比較的酸化力が弱いO2ガス等を用いることにより、下地酸化を防止することが容易となり、また、膜中のSiとCとで構成される環状構造を破壊することなく保持することが容易となる。また、形成される膜の加工耐性、特にウェットエッチング耐性(HF(フッ化水素)耐性)を向上させることが容易となる。
(アフターパージおよび大気圧復帰)
ポストトリートメントステップが終了した後、ガス供給管232c,232dのそれぞれからN2ガスを処理室201内へ供給し、排気管231から排気する。これにより、処理室201内がパージされ、処理室201内に残留するガスや反応副生成物等が処理室201内から除去される(アフターパージ)。その後、処理室201内の雰囲気が不活性ガスに置換され(不活性ガス置換)、処理室201内の圧力が常圧に復帰される(大気圧復帰)。
(ボートアンロードおよびウエハディスチャージ)
その後、ボートエレベータ115によりシールキャップ219が下降され、反応管203の下端が開口されるとともに、ポストトリートメント処理済のウエハ200が、ボート217に支持された状態で、反応管203の下端から反応管203の外部に搬出(ボートアンロード)される。ポストトリートメント処理済のウエハ200は、反応管203の外部に搬出された後、ボート217より取り出される(ウエハディスチャージ)。
(3)本実施形態による効果
本実施形態によれば、以下に示す1つ又は複数の効果が得られる。
(a)成膜ステップでは、ウエハ200上に形成されるSiCN膜中に、SiとCとで構成される環状構造を含ませることが可能となる。結果として、膜中に強固なSi−C結合が取り込まれ、膜中に含まれるCを脱離しにくくすることが可能となる。
(b)成膜ステップでは、ウエハ200上に形成されるSiCN膜中に、NをNHの状態で含ませることが可能となる。結果として、膜中に脆弱なSi−N結合が形成され、膜中に含まれるNを脱離しやすくすることが可能となる。
(c)ポストトリートメントステップでは、成膜ステップで形成されたSiCN膜に含まれるSiとCとで構成される環状構造を、破壊することなく維持することが可能となる。結果として、膜中にSi−C結合が保持された状態で、膜中のNを酸化剤に含まれるOに置換させることが可能となる。
(d)成膜ステップ後に、ポストトリートメントステップを行うことにより、SiとCとで構成される環状構造を含むSiCN膜が、SiとCとで構成される環状構造を含むSiOC膜に変換されて、増膜(膨張)するため、膜中のシームやボイドが消滅し、凹部内にシームレスかつボイドフリーのSiOC膜を形成することが可能となる。
(e)上述の効果は、TCDSCBガス以外の上述の要件を満たすガスを原料ガスとして用いる場合にも、同様に得ることができる。また、上述の効果は、NH3ガス以外の窒化剤を用いる場合や、O2ガス以外の酸化剤を用いる場合や、N2ガス以外の不活性ガスを用いる場合にも、同様に得ることができる。
<他の実施形態>
以上、本発明の実施形態を具体的に説明した。但し、本発明は上述の実施形態に限定されるものではなく、その要旨を逸脱しない範囲で種々変更可能である。
基板処理に用いられるレシピは、処理内容に応じて個別に用意し、電気通信回線や外部記憶装置123を介して記憶装置121c内に格納しておくことが好ましい。そして、基板処理を開始する際、CPU121aが、記憶装置121c内に格納された複数のレシピの中から、基板処理の内容に応じて、適正なレシピを適宜選択することが好ましい。これにより、1台の基板処理装置で様々な膜種、組成比、膜質、膜厚の膜を、再現性よく形成することができるようになる。また、オペレータの負担を低減でき、操作ミスを回避しつつ、処理を迅速に開始できるようになる。
上述のレシピは、新たに作成する場合に限らず、例えば、基板処理装置に既にインストールされていた既存のレシピを変更することで用意してもよい。レシピを変更する場合は、変更後のレシピを、電気通信回線や当該レシピを記録した記録媒体を介して、基板処理装置にインストールしてもよい。また、既存の基板処理装置が備える入出力装置122を操作し、基板処理装置に既にインストールされていた既存のレシピを直接変更するようにしてもよい。
上述の実施形態では、一度に複数枚の基板を処理するバッチ式の基板処理装置を用いて膜を形成する例について説明した。本発明は上述の実施形態に限定されず、例えば、一度に1枚または数枚の基板を処理する枚葉式の基板処理装置を用いて膜を形成する場合にも、好適に適用できる。また、上述の実施形態では、ホットウォール型の処理炉を有する基板処理装置を用いて膜を形成する例について説明した。本発明は上述の実施形態に限定されず、コールドウォール型の処理炉を有する基板処理装置を用いて膜を形成する場合にも、好適に適用できる。
上記実施形態では、成膜ステップとポストトリートメントステップとを、in−situにて同一処理室内で連続的に行う例について説明した。本発明は上述の実施形態に限定されず、スタンドアローン型装置や、複数の処理室が搬送室の周りに設けられたクラスタ型装置等を用いて、成膜ステップとポストトリートメントステップとを、ex−situにて異なる処理室内で行う場合にも、好適に適用できる。
これらの基板処理装置を用いる場合においても、上述の実施形態や変形例と同様な処理手順、処理条件にて成膜を行うことができ、これらと同様の効果が得られる。
また、上述の実施形態や変形例は、適宜組み合わせて用いることができる。このときの処理手順、処理条件は、例えば、上述の実施形態の処理手順、処理条件と同様とすることができる。
以下、実施例について説明する。
<実施例1>
サンプル1として、図1に示す基板処理装置を用い、図4に示す基板処理シーケンスにより、ウエハ上にSiOC膜を形成した。サンプル1を作製する際、成膜ステップとポストトリートメントステップとを連続的に行った。そして、ポストトリートメントステップ後に、ウエハ上に形成されたSiOC膜の膜厚を測定した。処理条件は、上述の実施形態における処理条件範囲内の所定の条件とした。
サンプル2として、図1に示す基板処理装置を用い、図4に示す基板処理シーケンスの成膜ステップにより、ウエハ上にSiCN膜を形成した。サンプル2を作製する際、成膜ステップのみを行い、ポストトリートメントステップを行わなかった。そして成膜ステップ後に、ウエハ上に形成されたSiCN膜、すなわち、アズデポ状態のSiCN膜の膜厚を測定した。処理条件は、サンプル1を作製する際の成膜ステップにおける処理条件と同様の条件とした。
図7に、サンプル1,2の膜厚の測定結果を示す。図7の縦軸は膜厚(Å)を、横軸はサンプル1,2を示している。この図に示すように、サンプル1の膜厚は183Å(18.3nm)であって、サンプル2の膜厚は154Å(15.4nm)であった。すなわち、成膜処理後にポストトリートメント処理を実施することで、ポストトリートメント処理前と比較して、膜厚は29Å(2.9nm)増膜し、20%程度増膜(膨張)させることができることを確認した。なお、サンプル1のSiOC膜の組成比は、Siが35%、Oが42%、Cが22%、Nが1%であった。すなわち、SiOC膜中にはNが含まれるものの、その濃度は不純物レベルであることを確認した。
すなわち、原料に含まれるSiとCとで構成される環状構造が保持される条件下でSiCN膜を形成し、SiCN膜に含まれる環状構造が保持される条件でポストトリートメント処理を実施することで、SiCN膜中のNがOに置換され、膜厚を増膜(膨張)させることが可能となることを確認できた。
<実施例2>
本実施例では、図1に示す基板処理装置を用い、図4に示す基板処理シーケンスにより、ウエハ表面に形成された幅9nm〜60nm程度、深さ300nm程度のトレンチ内のSiOC膜による埋め込みを行った。なお、実施例では、成膜ステップとポストトリートメントステップとを連続的に行った。また、比較例として、図1に示す基板処理装置を用い、図4に示す基板処理シーケンスの成膜ステップにより、ウエハ表面に形成された幅20nm程度、深さ300nm程度のトレンチ内のSiCN膜による埋め込みを行った。なお、比較例では、成膜ステップのみを行いポストトリートメントステップを行わなかった。そして、それぞれの埋め込み後の膜の断面TEM画像を確認した。
その結果、本実施例においてトレンチ内の埋め込みを行ったSiOC膜には、シームやボイドが確認されなかった。一方、比較例においてトレンチ内の埋め込みを行ったSiCN膜には、シームが確認された。
すなわち、基板の表面に形成されたトレンチやホール等の凹部内を埋め込むように、原料に含まれるSiとCとで構成される環状構造が保持される条件下でSiCN膜を形成し、SiCN膜に含まれる環状構造が保持される条件下でポストトリートメント処理を行うことで、凹部内にシームレスかつボイドフリーのSiOC膜を形成することが可能となることを確認できた。
<本発明の好ましい態様>
以下、本発明の好ましい態様について付記する。
(付記1)
本発明の一態様によれば、
表面に凹部が形成された基板に対して、シリコンと炭素とで構成される環状構造およびハロゲンを含む原料を供給する工程と、前記基板に対して窒化剤を供給する工程と、を非同時に行うサイクルを、前記原料に含まれる前記環状構造が保持される条件下で、所定回数行うことにより、前記基板の表面に形成された前記凹部内を埋め込むように、前記環状構造および窒素を含む(酸素非含有の)第1膜を形成する工程と、
前記基板に対して、前記第1膜に含まれる前記環状構造が保持される条件下で、酸化剤を供給して、ポストトリートメントを行う工程と、
を有する半導体装置の製造方法、または、基板処理方法が提供される。
(付記2)
付記1に記載の方法であって、
前記原料を供給する工程では、前記環状構造および前記ハロゲンを含む第1層を形成し、
前記窒化剤を供給する工程では、前記第1層を窒化させて、前記環状構造および窒素を含む第2層に改質させる。
(付記3)
付記2に記載の方法であって、
前記窒化剤は窒素および水素を含み、
前記窒化剤を供給する工程では、前記窒化剤に含まれる窒素を、窒素に水素が結合した状態で、前記第1層中に取り込ませる。
(付記4)
付記3に記載の方法であって、
前記窒化剤を供給する工程では、前記第1層に含まれるシリコンに、前記窒化剤に含まれる窒素を、窒素に水素が結合した状態で結合させる。
(付記5)
付記3に記載の方法であって、
前記窒化剤を供給する工程では、前記第1層に含まれる前記環状構造を構成するシリコンに、前記窒化剤に含まれる窒素を、窒素に水素が結合した状態で結合させる。
(付記6)
付記1〜5のいずれか1項に記載の方法であって、好ましくは、
前記窒化剤は窒素および水素を含み、
前記第1膜を形成する工程では、前記窒化剤に含まれる窒素を、窒素に水素が結合した状態で、前記第1膜中に取り込ませる。
(付記7)
付記1〜6のいずれか1項に記載の方法であって、好ましくは、
前記ポストトリートメントを行う工程では、前記第1膜を酸化させて、前記環状構造および酸素を含む第2膜に変換させる(前記環状構造および酸素を含む第2膜を形成する)。
(付記8)
付記7に記載の方法であって、好ましくは、
前記ポストトリートメントを行う工程では、前記第1膜に含まれる窒素を前記酸化剤に含まれる酸素に置換させる(置換反応を生じさせる)。
(付記9)
付記7または8に記載の方法であって、好ましくは、
前記ポストトリートメントを行う工程では、前記第1膜を前記第2膜に変換させることで、前記第2膜の厚さを前記第1膜の厚さよりも厚くならしめる。
(付記10)
付記7〜9のいずれか1項に記載の方法であって、好ましくは、
前記第1膜を形成する工程では、シームまたはボイドを有する前記第1膜を形成し、
前記ポストトリートメントを行う工程では、前記第1膜を前記第2膜に変換させることで、前記第1膜が有する前記シームまたは前記ボイドを消滅させる。
(付記11)
付記1〜10のいずれか1項に記載の方法であって、好ましくは、
前記環状構造は、シリコンと炭素とが交互に結合してなる。
(付記12)
付記11に記載の方法であって、好ましくは、
前記環状構造は、4つのシリコン−炭素結合を含む。
(付記13)
付記11または12に記載の方法であって、好ましくは、
前記環状構造は、2つのシリコン原子と2つの炭素原子を含む。
(付記14)
付記11〜13のいずれか1項に記載の方法であって、好ましくは、
前記シリコンと炭素とで構成される環状構造は四角形である。
(付記15)
付記11〜14のいずれか1項に記載の方法であって、好ましくは、
前記環状構造におけるシリコンには前記ハロゲンが結合している
(付記16)
付記11〜15のいずれか1項に記載の方法であって、好ましくは、
前記環状構造における炭素には水素が結合している。
(付記17)
付記1〜16のいずれか1項に記載の方法であって、好ましくは、
前記第1膜を形成する工程と、前記ポストトリートメントを行う工程と、を同一の処理室内で、前記基板を前記処理室内から前記処理室外に取り出すことなく、(in−situで)連続的に行う。
(付記18)
付記1〜17のいずれか1項に記載の方法であって、好ましくは、
前記第1膜を形成する工程における処理温度を200℃以上400℃以下、好ましくは、250℃以上350℃以下とし、前記ポストトリートメントを行う工程における処理温度を室温(25℃)以上600℃以下とする。
(付記19)
本発明の他の態様によれば、
基板に対する処理が行われる処理室と、
前記処理室内の基板に対して、シリコンと炭素とで構成される環状構造およびハロゲンを含む原料を供給する原料供給系と、
前記処理室内の基板に対して窒化剤を供給する窒化剤供給系と、
前記処理室内の基板に対して酸化剤を供給する酸化剤供給系と、
前記処理室内の基板を加熱するヒータと、
前記処理室内において、付記1の各工程(各処理)を行わせるように、前記原料供給系、前記窒化剤供給系、前記酸化剤供給系、および前記ヒータを制御するよう構成される制御部と、
を有する基板処理装置が提供される。
(付記20)
本発明のさらに他の態様によれば、
基板処理装置の処理室内において、付記1の各工程(各手順)をコンピュータによって前記基板処理装置に実行させるプログラム、または、該プログラムを記録したコンピュータ読み取り可能な記録媒体が提供される。
200 ウエハ(基板)

Claims (18)

  1. 表面に凹部が形成された基板に対して、シリコンと炭素とで構成される環状構造およびハロゲンを含む原料を供給する工程と、前記基板に対して窒化剤を供給する工程と、を非同時に行うサイクルを、前記原料に含まれる前記環状構造が保持される条件下で、所定回数行うことにより、前記基板の表面に形成された前記凹部内を埋め込むように、前記環状構造および窒素を含む第1膜を形成する工程と、
    前記基板に対して、前記第1膜に含まれる前記環状構造が保持される条件下で、酸化剤を供給して、ポストトリートメントを行う工程と、
    を有し、
    前記第1膜を形成する工程では、シームまたはボイドを有する前記第1膜を形成し、
    前記ポストトリートメントを行う工程では、前記第1膜を酸化させて、前記環状構造および酸素を含む第2膜に変換させることで、前記第1膜が有していた前記シームまたは前記ボイドを消滅させる半導体装置の製造方法。
  2. 前記原料を供給する工程では、前記環状構造および前記ハロゲンを含む第1層を形成し、
    前記窒化剤を供給する工程では、前記第1層を窒化させて、前記環状構造および窒素を含む第2層に改質させる請求項1に記載の半導体装置の製造方法。
  3. 前記窒化剤は窒素および水素を含み、
    前記窒化剤を供給する工程では、前記窒化剤に含まれる窒素を、窒素に水素が結合した状態で、前記第1層中に取り込ませる請求項2に記載の半導体装置の製造方法。
  4. 前記窒化剤を供給する工程では、前記第1層に含まれるシリコンに、前記窒化剤に含まれる窒素を、窒素に水素が結合した状態で結合させる請求項3に記載の半導体装置の製造方法。
  5. 前記窒化剤を供給する工程では、前記第1層に含まれる前記環状構造を構成するシリコンに、前記窒化剤に含まれる窒素を、窒素に水素が結合した状態で結合させる請求項3に記載の半導体装置の製造方法。
  6. 前記窒化剤は窒素および水素を含み、
    前記第1膜を形成する工程では、前記窒化剤に含まれる窒素を、窒素に水素が結合した状態で、前記第1膜中に取り込ませる請求項1〜5のいずれか1項に記載の半導体装置の製造方法。
  7. 前記ポストトリートメントを行う工程では、前記第1膜に含まれる窒素を前記酸化剤に含まれる酸素に置換させる請求項1〜6のいずれか1項に記載の半導体装置の製造方法。
  8. 前記ポストトリートメントを行う工程では、前記第1膜を前記第2膜に変換させることで、前記第2膜の厚さを前記第1膜の厚さよりも厚くならしめる請求項1〜7のいずれか1項に記載の半導体装置の製造方法。
  9. 前記環状構造は、シリコンと炭素とが交互に結合してなる請求項1〜8のいずれか1項に記載の半導体装置の製造方法。
  10. 前記環状構造は、4つのシリコン−炭素結合を含む請求項9に記載の半導体装置の製造方法。
  11. 前記環状構造は、2つのシリコン原子と2つの炭素原子を含む請求項9または10に記載の半導体装置の製造方法。
  12. 前記シリコンと炭素とで構成される環状構造は四角形である請求項9〜11のいずれか1項に記載の半導体装置の製造方法。
  13. 前記環状構造におけるシリコンには前記ハロゲンが結合している請求項9〜12のいずれか1項に記載の半導体装置の製造方法。
  14. 前記環状構造における炭素には水素が結合している請求項9〜13のいずれか1項に記載の半導体装置の製造方法。
  15. 前記第1膜を形成する工程と、前記ポストトリートメントを行う工程と、を同一の処理室内で、前記基板を前記処理室内から前記処理室外に取り出すことなく、連続的に行う請求項1〜14のいずれか1項に記載の半導体装置の製造方法。
  16. 前記第1膜を形成する工程における処理温度を200℃以上400℃以下とし、前記ポストトリートメントを行う工程における処理温度を室温以上600℃以下とする請求項1〜15のいずれか1項に記載の半導体装置の製造方法。
  17. 基板に対する処理が行われる処理室と、
    前記処理室内の基板に対して、シリコンと炭素とで構成される環状構造およびハロゲンを含む原料を供給する原料供給系と、
    前記処理室内の基板に対して窒化剤を供給する窒化剤供給系と、
    前記処理室内の基板に対して酸化剤を供給する酸化剤供給系と、
    前記処理室内の基板を加熱するヒータと、
    前記処理室内において、表面に凹部が形成された基板に対して、前記原料を供給する処理と、前記基板に対して前記窒化剤を供給する処理と、を非同時に行うサイクルを、前記原料に含まれる前記環状構造が保持される条件下で、所定回数行うことにより、前記基板の表面に形成された前記凹部内を埋め込むように、前記環状構造および窒素を含む第1膜を形成する処理と、前記基板に対して、前記第1膜に含まれる前記環状構造が保持される条件下で、酸化剤を供給して、ポストトリートメントを行う処理と、を行わせ、前記第1膜を形成する処理では、シームまたはボイドを有する前記第1膜を形成し、前記ポストトリートメントを行う処理では、前記第1膜を酸化させて、前記環状構造および酸素を含む第2膜に変換させることで、前記第1膜が有する前記シームまたは前記ボイドを消滅させるように、前記原料供給系、前記窒化剤供給系、前記酸化剤供給系、および前記ヒータを制御するよう構成される制御部と、
    を有する基板処理装置。
  18. 基板処理装置の処理室内において、
    表面に凹部が形成された基板に対して、シリコンと炭素とで構成される環状構造およびハロゲンを含む原料を供給する手順と、前記基板に対して窒化剤を供給する手順と、を非同時に行うサイクルを、前記原料に含まれる前記環状構造が保持される条件下で、所定回数行うことにより、前記基板の表面に形成された前記凹部内を埋め込むように、前記環状構造および窒素を含む第1膜を形成する手順と、
    前記基板に対して、前記第1膜に含まれる前記環状構造が保持される条件下で、酸化剤を供給して、ポストトリートメントを行う手順と、
    前記第1膜を形成する手順において、シームまたはボイドを有する前記第1膜を形成する手順と、
    前記ポストトリートメントを行う手順において、前記第1膜を酸化させて、前記環状構造および酸素を含む第2膜に変換させることで、前記第1膜が有する前記シームまたは前記ボイドを消滅させる手順と、
    をコンピュータによって前記基板処理装置に実行させるプログラム。
JP2018005763A 2018-01-17 2018-01-17 半導体装置の製造方法、基板処理装置およびプログラム Active JP6806719B2 (ja)

Priority Applications (3)

Application Number Priority Date Filing Date Title
JP2018005763A JP6806719B2 (ja) 2018-01-17 2018-01-17 半導体装置の製造方法、基板処理装置およびプログラム
US16/248,392 US10763101B2 (en) 2018-01-17 2019-01-15 Method of manufacturing semiconductor device, substrate processing apparatus, and recording medium
KR1020190005703A KR102146180B1 (ko) 2018-01-17 2019-01-16 반도체 장치의 제조 방법, 기판 처리 장치 및 프로그램

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP2018005763A JP6806719B2 (ja) 2018-01-17 2018-01-17 半導体装置の製造方法、基板処理装置およびプログラム

Publications (2)

Publication Number Publication Date
JP2019125714A JP2019125714A (ja) 2019-07-25
JP6806719B2 true JP6806719B2 (ja) 2021-01-06

Family

ID=67212622

Family Applications (1)

Application Number Title Priority Date Filing Date
JP2018005763A Active JP6806719B2 (ja) 2018-01-17 2018-01-17 半導体装置の製造方法、基板処理装置およびプログラム

Country Status (3)

Country Link
US (1) US10763101B2 (ja)
JP (1) JP6806719B2 (ja)
KR (1) KR102146180B1 (ja)

Families Citing this family (7)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP6814057B2 (ja) * 2017-01-27 2021-01-13 株式会社Kokusai Electric 半導体装置の製造方法、基板処理装置、およびプログラム
WO2019207864A1 (ja) 2018-04-27 2019-10-31 株式会社Kokusai Electric 半導体装置の製造方法、基板処理装置、およびプログラム
JP6980624B2 (ja) * 2018-09-13 2021-12-15 株式会社Kokusai Electric 半導体装置の製造方法、基板処理方法、基板処理装置およびプログラム
JP7023905B2 (ja) * 2019-08-30 2022-02-22 株式会社Kokusai Electric 半導体装置の製造方法、基板処理方法、基板処理装置、およびプログラム
JP7274039B2 (ja) * 2020-02-27 2023-05-15 株式会社Kokusai Electric 基板処理方法、半導体装置の製造方法、基板処理装置、およびプログラム
JP7138130B2 (ja) * 2020-03-04 2022-09-15 株式会社Kokusai Electric 基板処理方法、半導体装置の製造方法、基板処理装置およびプログラム
JP7537003B2 (ja) * 2021-03-22 2024-08-20 株式会社Kokusai Electric 処理方法、半導体装置の製造方法、処理装置、およびプログラム

Family Cites Families (9)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP4285184B2 (ja) 2003-10-14 2009-06-24 東京エレクトロン株式会社 成膜方法及び成膜装置
JP5654862B2 (ja) * 2010-04-12 2015-01-14 株式会社日立国際電気 半導体装置の製造方法、基板処理方法及び基板処理装置
JP6009870B2 (ja) 2012-09-11 2016-10-19 株式会社日立国際電気 半導体装置の製造方法、基板処理方法、基板処理装置およびプログラム
JP6022273B2 (ja) * 2012-09-14 2016-11-09 株式会社日立国際電気 半導体装置の製造方法、基板処理方法、基板処理装置およびプログラム
JP6415808B2 (ja) * 2012-12-13 2018-10-31 株式会社Kokusai Electric 半導体装置の製造方法、基板処理装置およびプログラム
WO2016126911A2 (en) 2015-02-06 2016-08-11 Air Products And Chemicals, Inc. Compositions and methods using same for carbon doped silicon containing films
JP6523186B2 (ja) 2016-02-01 2019-05-29 株式会社Kokusai Electric 半導体装置の製造方法、基板処理装置およびプログラム
US10043796B2 (en) * 2016-02-01 2018-08-07 Qualcomm Incorporated Vertically stacked nanowire field effect transistors
US20170250211A1 (en) * 2016-02-25 2017-08-31 Taiwan Semiconductor Manufacturing Co., Ltd. Semiconductor image sensor device and manufacturing method of the same

Also Published As

Publication number Publication date
US20190221425A1 (en) 2019-07-18
US10763101B2 (en) 2020-09-01
KR20190088024A (ko) 2019-07-25
JP2019125714A (ja) 2019-07-25
KR102146180B1 (ko) 2020-08-19

Similar Documents

Publication Publication Date Title
JP6806719B2 (ja) 半導体装置の製造方法、基板処理装置およびプログラム
JP6980624B2 (ja) 半導体装置の製造方法、基板処理方法、基板処理装置およびプログラム
JP6817845B2 (ja) 半導体装置の製造方法、基板処理装置およびプログラム
KR102288228B1 (ko) 반도체 장치의 제조 방법, 기판 처리 장치 및 프로그램
KR102301992B1 (ko) 반도체 장치의 제조 방법, 기판 처리 방법, 기판 처리 장치 및 프로그램
JP6807458B2 (ja) 半導体装置の製造方法、基板処理装置およびプログラム
WO2021009838A1 (ja) 半導体装置の製造方法、基板処理装置、およびプログラム
US11094532B2 (en) Method of manufacturing semiconductor device, substrate processing apparatus, and recording medium
JP7009615B2 (ja) 半導体装置の製造方法、基板処理方法、基板処理装置、およびプログラム
KR102346410B1 (ko) 반도체 장치의 제조 방법, 기판 처리 방법, 기판 처리 장치 및 프로그램
TWI795711B (zh) 基板處理方法、半導體裝置之製造方法、基板處理裝置及程式
KR102365948B1 (ko) 반도체 장치의 제조 방법, 기판 처리 방법, 기판 처리 장치, 및 프로그램
JP7026200B2 (ja) 半導体装置の製造方法、基板処理方法、基板処理装置、およびプログラム
JP6987948B2 (ja) 半導体装置の製造方法、基板処理方法、基板処理装置、およびプログラム
KR102652256B1 (ko) 기판 처리 방법, 반도체 장치의 제조 방법, 기판 처리 장치 및 프로그램
WO2019058477A1 (ja) 半導体装置の製造方法、基板処理装置およびプログラム

Legal Events

Date Code Title Description
A711 Notification of change in applicant

Free format text: JAPANESE INTERMEDIATE CODE: A712

Effective date: 20180727

A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20180821

RD02 Notification of acceptance of power of attorney

Free format text: JAPANESE INTERMEDIATE CODE: A7422

Effective date: 20180829

A621 Written request for application examination

Free format text: JAPANESE INTERMEDIATE CODE: A621

Effective date: 20190905

A977 Report on retrieval

Free format text: JAPANESE INTERMEDIATE CODE: A971007

Effective date: 20200630

A131 Notification of reasons for refusal

Free format text: JAPANESE INTERMEDIATE CODE: A131

Effective date: 20200706

A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20200902

RD03 Notification of appointment of power of attorney

Free format text: JAPANESE INTERMEDIATE CODE: A7423

Effective date: 20201102

TRDD Decision of grant or rejection written
A01 Written decision to grant a patent or to grant a registration (utility model)

Free format text: JAPANESE INTERMEDIATE CODE: A01

Effective date: 20201110

A61 First payment of annual fees (during grant procedure)

Free format text: JAPANESE INTERMEDIATE CODE: A61

Effective date: 20201204

R150 Certificate of patent or registration of utility model

Ref document number: 6806719

Country of ref document: JP

Free format text: JAPANESE INTERMEDIATE CODE: R150

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250