JP6637864B2 - キャリア基材付き配線基板、キャリア基材付き配線基板の製造方法 - Google Patents

キャリア基材付き配線基板、キャリア基材付き配線基板の製造方法 Download PDF

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Description

キャリア基材付き配線基板、キャリア基材付き配線基板の製造方法に関する。
従来、搭載される半導体素子の高密度化が進み、配線基板の薄型化や、配線パターンの高密度化が要求されている。このような要求に応えるために、高い剛性を有し層間絶縁層よりも厚いコア基板を含まないコアレス基板等の配線基板が提案されている。このような配線基板は、撓みやすく、製造工程やアセンブリ工程においてハンドリングし難い。このため、ハンドリングを改善するため、剛性を有する仮基板に貼り付けられた状態で、製造やアセンブリが行われる(例えば、特許文献1参照)。
特開2016−048768号公報
ところで、配線基板について、内蔵された配線層の断線等の電気的特性を測定する検査の実施が求められている。しかしながら、仮基板によって配線基板の外部接続端子が覆われていると、検査のためのプローブ等を接触させることができない。
本発明の一観点によれば、キャリア基材付き配線基板は、配線基板であって、絶縁層と、前記絶縁層の下面に設けられた配線層と、前記絶縁層の下面を覆うとともに前記配線層の一部を外部接続端子として露出する開口部を有するソルダーレジスト層と、を有する配線基板と、前記ソルダーレジスト層の開口部と連通する開口部を有する接着層と、前記ソルダーレジスト層に前記接着層を介して接着されることによりキャリア基材付き配線基板とされ、前記ソルダーレジスト層の開口部及び前記接着層の開口部と連通し、前記外部接続端子を露出する開口部を有するキャリア基材と、を有し、前記キャリア基材の開口部の開口径及び前記接着層の開口部の開口径は、前記ソルダーレジスト層の開口部の開口径よりも小さく、前記接着層は、前記ソルダーレジスト層から剥離可能であって、前記接着層と前記キャリア基材を前記キャリア基材付き配線基板から除去するための層である
本発明の一観点による方法は、支持体の表面に、配線層と絶縁層とを交互に積層し、前記配線層の一部を外部接続端子として露出する開口部を有するソルダーレジスト層を形成し、前記配線層と前記絶縁層と前記ソルダーレジスト層を有する配線基板を形成する工程と、前記ソルダーレジスト層の上面に接着層を介してキャリア基材を貼付する工程と、前記キャリア基材及び前記接着層に、前記ソルダーレジスト層の開口部と連通して前記外部接続端子を露出し、前記ソルダーレジスト層の開口部の開口径よりも小さな開口径の開口部を形成する工程と、前記キャリア基材及び前記接着層の開口部から接触子を前記外部接続端子に接触させて電気検査を行う工程と、を有する。
本発明の一観点によれば、キャリア基材によってハンドリングを改善するとともに電気的特性検査を可能とすることができる。
(a)はキャリア基材付き配線基板の概略断面図、(b)は別のキャリア基材付き配線基板の概略断面図、(c)はソルダーレジスト層に形成した開口部を示す概略平面図。 (a)(b)はキャリア基材付き配線基板の製造工程を示す概略断面図。 キャリア基材付き配線基板の製造工程を示す概略断面図。 キャリア基材付き配線基板の製造工程を示す概略断面図。 (a)(b)はキャリア基材付き配線基板の製造工程を示す概略断面図。 キャリア基材付き配線基板の製造工程を示す概略断面図。 (a)(b)は半導体装置の製造工程を示す概略断面図。 (a)(b)は半導体装置の製造工程を示す概略断面図。 (a)〜(c)はキャリア基材付き配線基板の製造工程を示す概略平面図。 キャリア基材付き配線基板の概略断面図。 (a)(b)はキャリア基材付き配線基板の製造工程を示す概略断面図。 (a)(b)はキャリア基材付き配線基板の製造工程を示す概略断面図。 キャリア基材付き配線基板の製造工程を示す概略断面図。 キャリア基材付き配線基板の製造工程を示す概略断面図。 (a)(b)はキャリア基材付き配線基板の製造工程を示す概略断面図。 (a)(b)は半導体装置の製造工程を示す概略断面図。 (a)(b)は半導体装置の製造工程を示す概略断面図。 キャリア基材付き配線基板の変形例を示す概略断面図。
以下、添付図面を参照して各実施形態を説明する。
なお、添付図面は、便宜上、特徴を分かりやすくするために特徴となる部分を拡大して示している場合があり、各構成要素の寸法比率などが実際と同じであるとは限らない。また、断面図では、各部材の断面構造を分かりやすくするために、一部の部材のハッチングを梨地模様に代えて示し、一部の部材のハッチングを省略している。なお、本明細書において、「平面視」とは、対象物を図1等の鉛直方向(図中上下方向)から視ることを言い、「平面形状」とは、対象物を図1等の鉛直方向から視た形状のことを言う。
図1(a)に示すように、キャリア基材付き配線基板10は、キャリア基材21と、接着層22と、配線基板30とを有している。キャリア基材21は、接着層22により配線基板30に接着されている。なお、本実施形態において、配線基板の側を上側、キャリア基材21の側を下側として説明する。つまり、配線基板30は、接着層22を介してキャリア基材21の上面に接着されている。
図1(a)に示すように、配線基板30は、配線層31、絶縁層32、配線層33、絶縁層34、配線層35、ソルダーレジスト層36を有している。
配線層31は、絶縁層32の上面側において、絶縁層32に埋め込まれるように形成されている。具体的には、配線層31は、配線層31の上面と絶縁層32の上面が面一となるように、絶縁層32に埋め込まれている。配線層31の上面の一部は、配線基板30に実装される半導体素子51(図7(a)参照)が接続される部品接続端子P1として利用される。絶縁層32は、配線層31の下面及び側面を覆うように形成されている。配線層33は、絶縁層32の下面に形成されている。配線層33は、絶縁層32の下面に形成された配線パターンと、絶縁層32を貫通して配線層31に接続されたビア配線とを有している。絶縁層34は、絶縁層32の下面に、配線層33を覆うように形成されている。配線層35は、絶縁層34の下面に形成されている。配線層35は、絶縁層34の下面に形成された配線パターンと、絶縁層34を貫通して配線層33に接続されたビア配線とを有している。つまり、配線基板30は、配線層31と、絶縁層32と、配線層33と、絶縁層34と、配線層35とが順次積層された構造、所謂コアレス構造を有している。
ソルダーレジスト層36は、絶縁層34の下面に、配線層35の一部を覆うように形成されている。ソルダーレジスト層36は、配線層35の下面の一部を外部接続端子P2として露出する開口部36Xを有している。図1(c)に示すように、開口部36Xは、例えばマトリックス状の配列にて形成される。なお、図1(c)に示す開口部36Xは、配列の一例を概略的に示すものであり、配列方向、配列数はこれに限定されない。
配線層31,33,35の材料としては、例えば、銅(Cu)や銅合金を用いることができる。絶縁層32,34の材料としては、例えば、エポキシ樹脂やポリイミド樹脂などの絶縁性樹脂、又はこれら樹脂にシリカやアルミナ等のフィラーを混入した樹脂材を用いることができる。また、絶縁層32,34の材料としては、例えば、ガラス、アラミド、LCP(Liquid Crystal Polymer)繊維の織布や不織布などの補強材に、エポキシ樹脂やポリイミド樹脂等を主成分とする熱硬化性樹脂を含浸させた補強材入りの絶縁性樹脂を用いることもできる。なお、絶縁層32,34の材料としては、熱硬化性を有する絶縁性樹脂や感光性を有する絶縁性樹脂を用いることができる。
ソルダーレジスト層36の材料として、例えば感光性のドライフィルムレジスト又は液状のフォトレジスト(例えばノボラック系樹脂やアクリル系樹脂等のドライフィルムレジストや液状レジスト)等が用いられる。例えば感光性のドライフィルムレジストを用いる場合には、絶縁層34と配線層35とを、熱圧着したドライフィルムによりラミネートし、そのドライフィルムをフォトリソグラフィ法によりパターニングして開口部36Xを有するソルダーレジスト層36を形成する。また、液状のフォトレジストを用いる場合にも、同様の工程を経て、ソルダーレジスト層36が形成される。
開口部36Xにより露出する配線層35の表面に表面処理層(図示略)を形成してもよい。表面処理層としては、金(Au)層や、ニッケル(Ni)/Au層(Ni層とAu層をこの順番で積層した金属層)、Ni/パラジウム(Pd)/Au層(Ni層とPd層とAu層をこの順番で積層した金属層)等を挙げることができる。又、開口部36Xにより露出する配線層35の表面に、OSP(Organic Solderability Preservative)処理等の酸化防止処理を施して表面処理層を形成してもよい。
次に、キャリア基材21について説明する。
キャリア基材21は、ソルダーレジスト層36の下面36bに、接着層22により接着されている。
キャリア基材21は、ソルダーレジスト層36の開口部36Xと連通する開口部21Xを有している。ソルダーレジスト層36の開口部36Xは、外部接続端子P2を露出するように形成されている。従って、キャリア基材21の開口部21Xは、外部接続端子P2を露出するように形成されている。なお、本実施形態において、キャリア基材21は、接着層22を介してソルダーレジスト層36の下面36bに接着されている。従って、接着層22は、キャリア基材21と同様に、ソルダーレジスト層36の開口部36Xと連通する開口部22Xを有している。
接着層22の材料としては、例えば紫外線の照射によって接着力が低下するものを用いることができる。
キャリア基材21としては、例えばコア基板、金属箔、フィルムを用いることができる。コア基板は、補強材と、補強材に含浸した熱硬化性樹脂の硬化物との複合体であるガラスエポキシ基板である。補強材は、例えば、ガラスクロス(ガラス織布)、ガラス不織布、アラミド織布、アラミド不織布、液晶ポリマ(Liquid Crystal Polymer:LCP)織布、LCP不織布である。熱硬化性の絶縁性樹脂は、例えば、エポキシ樹脂、ポリイミド樹脂、シアネート樹脂である。金属箔の材料としては、例えば銅、ステンレス、等を用いることができる。フィルムの材料としては、例えばエポキシ系樹脂、フェノール系樹脂、ポリイミド系樹脂、等を用いることができる。
本実施形態において、キャリア基材21の開口部21Xの開口径は、ソルダーレジスト層36の開口部36Xの開口径よりも小さく設定されている。キャリア基材21の開口部21Xは、図1(a)において、キャリア基材21の上側(接着層22側)から下側(接着層22側とは反対側)に向かうに連れて径が大きくなるテーパ状に形成されている。具体的には、キャリア基材21の上面(接着層22と接する面)側における開口部21Xの開口径は、キャリア基材21の下面(接着層22と接する面とは反対側の面)側における開口部21Xの開口径よりも小さい。そして、キャリア基材21の上面側における開口部21Xの開口径は、ソルダーレジスト層36の開口部36Xの開口径よりも小さく設定されている。また、キャリア基材21は、ソルダーレジスト層36において、開口部36Xの周囲、つまり開口部36Xを形成する端部の全周を覆うように形成されている。言い換えると、ソルダーレジスト層36の下面36bは、キャリア基材21により覆われている。
キャリア基材21の開口部21Xの平面形状は例えば円形とすることができる。キャリア基材21の開口部21Xの平面形状はこれに限らず、矩形や多角形等を用いることができる。
また、本実施形態では、キャリア基材21の開口部21Xの断面形状をテーパ状で示しているが、これに限定されない。図1(b)に示すように、キャリア基材21の開口部21Xの断面形状を垂直としてもよい。例えば、キャリア基材21の上側(接着層22側)から下側(接着層22側とは反対側)まで径が等しい垂直に形成してもよい。キャリア基材21の開口部21Xの断面形状が垂直な場合もテーパ状と同様に、キャリア基材21の上面側における開口部21Xの開口径は、キャリア基材21の下面側における開口部21Xの開口径よりも小さく設定される。
次に、上述のキャリア基材付き配線基板10の製造工程を説明する。
なお、各図の説明に必要な部材について符号を付し、説明しない部材については符号を省略する場合がある。また、説明の便宜上、最終的に半導体装置の各構成要素となる部分には、最終的な構成要素の符号を付して説明する。
図1(b)に示すように、キャリア基材付き配線基板10は、シート状の基板である。このキャリア基材付き配線基板10は、更に大判の基板(ワーク基板)を切断して形成される。
図9(a)に示すように、ワーク基板40は、複数(図では6つ)のブロックC1(破線の長方形にて示す)を含む大判の基板である。このワーク基板40を、後述するシート切断の工程において切断し、図9(b)に示す複数(図では3つ)のキャリア基材付き配線基板10を形成する。つまり、本実施形態において、シード切断の工程までの各工程は、図9(a)に示すワーク基板40の大きさの各部材について実施される。図9(c)は、ブロックC1の詳細を示した図面である。図9(c)に示すように、本実施形態のキャリア基材付き配線基板10は、例えば、シート状の基板である。キャリア基材付き配線基板10は、例えば平面視略矩形状に形成されている。キャリア基材付き配線基板10は、複数(図では2つ)のブロックC1を有している。複数のブロックC1は、互いに分離して画定されている。各ブロックC1は、マトリックス状に配列された複数の領域C2を含む。各領域C2は、半導体素子の搭載や封止樹脂の工程を経た後、図1(a)に示すキャリア基材21が除去され、実線に沿って切断され、個片化されて半導体装置(半導体パッケージ)となる。図1(a)は、1つの領域C2における概略断面を示している。
以下の説明では、代表的に2つの領域C2を拡大して例示し、キャリア基材付き配線基板10を製造する工程として説明する。そして、必要に応じて、図9(a)に示すワーク基板40等を用いて説明する。
図2(a)に示す工程では、支持基板101と、支持基板101の両面に積層した接着層102及び金属層103とを有する支持体100を形成する。
支持基板101としては、例えば、ガラスクロス(織布)やガラス不織布又はアラミド繊維等にエポキシ系樹脂等の樹脂を含侵させた部材等を用いることができる。接着層102としては、例えば、銅箔、アルミ箔、ニッケル箔、亜鉛箔等の金属箔、セラミック板、アクリルやポリイミド等の樹脂を主成分とする樹脂シート等を用いることができる。金属層103としては、例えば、銅箔等を用いることができる。
図2(b)に示す工程では、支持体100の両面の金属層103上に、配線基板30をそれぞれ形成する。配線基板30は、配線層31、絶縁層32、配線層33、絶縁層34、配線層35、ソルダーレジスト層36を含む。金属層103上に、配線層31、絶縁層32、配線層33、絶縁層34、配線層35、ソルダーレジスト層36を順次積層し、配線基板30を形成する。
先ず、金属層103上に、配線層31を形成する。配線層31は、例えばセミアディティブ法等の各種の配線形成方法を用いて形成できる。例えば、金属層103の表面に、所望の位置に開口部を有するレジスト層を形成する。開口部は、配線層31に対応する部分の金属層103を露出するように形成される。レジスト層の材料としては、感光性のドライフィルムレジスト又は液状のフォトレジスト(例えばノボラック系樹脂やアクリル系樹脂等のドライフィルムレジストや液状レジスト)等を用いることができる。続いて、レジスト層をめっきマスクとして、金属層103の表面に、金属層103をめっき給電層に利用する電解めっき(電解銅めっき)を施し、配線層31を形成する。そして、レジスト層を例えばアルカリ性の剥離液にて除去する。
次に、金属層103の上面に配線層31を覆うように熱硬化性のエポキシ系樹脂等の絶縁性樹脂フィルムをラミネートし、絶縁層32を形成する。なお、液状又はペースト状の熱硬化性のエポキシ系樹脂などの絶縁性樹脂を塗布し、硬化させて絶縁層32を形成してもよい。次に、絶縁層32に、絶縁層32を貫通し配線層31の一部を露出するビアホールを形成する。ビアホールは、例えばCOレーザ等を用いたレーザ加工により形成することができる。必要に応じてデスミア処理を行ってもよい。
次に、配線層33を形成する。配線層33は、例えば、セミアディティブ法によって形成できる。例えば、先ず絶縁層32の上面にシード層を例えば無電解めっき法により形成する。シード層上に所定の箇所に開口部を有するレジスト層を形成する。レジスト層の材料としては、上記したように、感光性のドライフィルムレジスト又は液状のフォトレジスト(例えばノボラック系樹脂やアクリル系樹脂等のドライフィルムレジストや液状レジスト)等を用いることができる。そのレジスト層をめっきマスクとして、シード層をめっき給電層に利用する電解めっき(電解銅めっき)を施し、電解めっき層を形成する。そして、レジスト層を例えばアルカリ性の剥離液にて除去した後、電解めっき層をエッチングマスクとして不要なシード層を除去する。これにより、配線層33が形成される。
次に、上述した絶縁層32を形成する工程と配線層33を形成する工程を繰り返し実施することにより、絶縁層34と配線層35を形成する。所定数の配線層と絶縁層とを積層して配線構造体を形成する。
次に、配線層35及び絶縁層34の上面に、開口部36Xを有するソルダーレジスト層36を形成する。ソルダーレジスト層36は、例えば、感光性の樹脂フィルムをラミネートし、又は液状やペースト状の樹脂を塗布し、当該樹脂をフォトリソグラフィ法により露光・現像して所要の形状にパターニングすることにより得られる。開口部36Xにより、配線層35の上面の一部を外部接続端子P2として露出する。
図3に示す工程では、ソルダーレジスト層36の表面(図1(a)では下面36b)に、接着層22を介して、ソルダーレジスト層36の表面全体を覆うキャリア基材21を貼り付ける。
図4に示す工程では、配線基板30を図3に示す支持基板101から分離する。これにより、配線基板30をキャリア基材21により支持する。
図5(a)に示す工程では、金属層103(図4参照)を例えばエッチングにより除去し、配線層31及び絶縁層32の上面を露出する。
図5(b)に示す工程では、キャリア基材21及び接着層22に開口部21X,22Xを形成し、外部接続端子P2を露出する。開口部21X,22Xは、例えばCOレーザやYAGレーザ等によるレーザ加工法によって形成することができる。この工程において、ソルダーレジスト層36の開口部36Xの開口径よりも小さな開口径の開口部21X,22Xを形成する。
このように、配線基板30に接着したキャリア基材21に開口部21Xを形成することで、位置精度よく開口部21Xを形成することができる。また、キャリア基材21の開口部21Xの開口径は、ソルダーレジスト層36の開口部36Xの開口径よりも小さい。このため、キャリア基材21に開口部21Xを形成する工程において、加工に用いるレーザ光などがソルダーレジスト層36に照射され難いため、ソルダーレジスト層36に対する影響を抑制することができる。
なお、キャリア基材21の開口部21X(接着層22の開口部22Xも同様)は、後述する配線基板30の電気検査に用いるプローブ電極が挿入可能な大きさであればよい。プローブ電極は、配線基板30の外部接続端子P2に応じた位置に配設されている。このため、キャリア基材21の開口部21Xを精度よく形成することで、プローブ電極の挿入及び外部接続端子P2に対してプローブ電極を容易に接触させることができる。
キャリア基材21の開口部21Xは、図5(b)において、キャリア基材21の上側(接着層22側)から下側(接着層22側とは反対側)に向かうに連れて径が大きくなるテーパ状に形成されている。具体的には、キャリア基材21の上面(接着層22と接する面)側における開口部21Xの開口径は、キャリア基材21の下面(接着層22と接する面とは反対側の面)側における開口部21Xの開口径よりも小さい。そして、キャリア基材21の上面側における開口部21Xの開口径は、ソルダーレジスト層36の開口部36Xの開口径よりも小さく設定されている。なお、キャリア基材21の開口部21Xは、これに限らず、垂直としてもよい。
図6に示す工程では、シート切断によってキャリア基材付き配線基板10を形成し、キャリア基材付き配線基板10に含まれる配線基板30の電気検査を実施する。つまり、シート状のキャリア基材付き配線基板10に含まれる領域C2(図1(b)参照)における配線構造の電気検査を行う。
電気検査は、図9(a)に示すワーク基板40を切断し、図9(b)に示すシート状のキャリア基材付き配線基板10を形成した後、このシート状のキャリア基材付き配線基板10に対して実施する。
図6に示すように、シート状のキャリア基材付き配線基板10に対して、電気検査を行う。詳述すると、配線基板30の上面の部品接続端子P1と、配線基板30の下面の外部接続端子P2に、それぞれプローブ端子T1,T2を接触させる。そして、プローブ端子T1,T2を介して、配線基板30における各種の電気検査(オープン、ショート、等)を行う。
配線基板30はキャリア基材21により支持されている。このため、電気検査を行う検査装置に対して配線基板30を容易にハンドリング(搬送)することができる。キャリア基材21は、配線基板30の外部接続端子P2を露出する開口部21Xを有している。従って、キャリア基材21が接着された配線基板30の外部接続端子P2に対して、検査のためのプローブ端子T2を容易に接触させて電気検査を行うことができる。
このように実施される電気検査により、配線基板30について、良否が判定され、判定結果に応じてマーキングされる。例えば、不良品と判定した配線基板30に所定のマーキングを施す。
次に、上記のキャリア基材付き配線基板10を用いた半導体装置の製造工程を説明する。
図7(a)に示す工程では、キャリア基材付き配線基板10の上面に半導体素子51を部品接続端子P1に実装し、半導体素子51を封止する封止樹脂52を形成する。このとき、上述の電気検査においてマーキングされていない配線基板30、つまり良品と判定された配線基板30に対して半導体素子51を実装し、マーキングされた配線基板30、つまり不良品と判定された配線基板30に対して半導体素子51を実装しない。これにより、不良品の配線基板に対して半導体素子51を実装する無駄を省くことができる。また、不良品の配線基板に実装した半導体素子51が無駄になることを防止することができる。
封止樹脂52は、配線基板30の上面と、半導体素子51を覆うように形成される。封止樹脂52の材料としては、例えば、熱硬化性を有するエポキシ系の絶縁性樹脂を用いることができる。なお、絶縁性樹脂としては、熱硬化性を有する樹脂に限定されず、感光性を有する絶縁性樹脂を用いることができる。
図7(b)に示す工程では、キャリア基材21及び接着層22を除去する。例えば、接着層22に紫外線を照射して接着層22の接着力を低下させ、キャリア基材21及び接着層22を除去する。
図8(a)に示す工程では、外部接続端子P2に、実装のためのバンプ61を形成する。バンプ61は、たとえばはんだバンプである。このバンプ61は、外部接続端子P2に搭載したはんだボールや、外部接続端子P2に塗布したはんだペーストをリフローして形成することができる。
図8(b)に示す工程では、個片化した半導体装置70を形成する。図8(a)に示す配線基板30及び封止樹脂52を、図9(c)に示す領域C2に沿ってダイシングブレード等によって切断し、個片化した半導体装置70を得る。
以上記述したように、本実施形態によれば、以下の効果を奏する。
(1)キャリア基材付き配線基板10は、キャリア基材21と接着層22と配線基板30とを有している。配線基板30は、配線層31と、絶縁層32と、配線層33と、絶縁層34と、配線層35とが順次積層された構造、所謂コアレス構造を有している。ソルダーレジスト層36は、絶縁層34の下面に、配線層35の一部を覆うように形成されている。ソルダーレジスト層36は、配線層35の下面の一部を外部接続端子P2として露出する開口部36Xを有している。キャリア基材21は、接着層22を介してソルダーレジスト層36の下面36bに接着されている。このキャリア基材21により、シート状のキャリア基材付き配線基板10を形成した後の電気検査でコアレス構造の配線基板30を容易にハンドリングすることができる。
(2)キャリア基材21と接着層22は、外部接続端子P2を露出する開口部21X,22Xを有している。キャリア基材付き配線基板10の電気検査を行う工程において、その電気検査のためのプローブ端子T2は、キャリア基材21の開口部21Xから挿入され、開口部21Xから露出する外部接続端子P2に接触される。このように、キャリア基材21の開口部21Xによって外部接続端子P2を露出することで、配線基板30の電気検査を、キャリア基材21により支持した状態で行うことができる。
(3)キャリア基材21の開口部21Xの開口径は、ソルダーレジスト層36の開口部36Xの開口径よりも小さい。従って、キャリア基材21は、ソルダーレジスト層36において、開口部36Xの周囲、つまり開口部36Xを形成する端部の全周を覆うように形成されている。言い換えると、ソルダーレジスト層36の下面36bは、キャリア基材21により覆われている。このため、キャリア基材21に開口部21Xを形成する工程において、加工に用いるレーザ光などがソルダーレジスト層36に照射され難いため、ソルダーレジスト層36に対する影響を抑制することができる。また、キャリア基材21の開口部21Xから配線基板30のソルダーレジスト層36が露出していた場合、プローブ端子T2が接触して傷つく問題がある。本実施形態では、キャリア基材21の開口部21Xから配線基板30の電気検査のためのプローブ端子T2を挿入する際に、そのプローブ端子T2がソルダーレジスト層36に接触しない。このため、プローブ端子T2によるソルダーレジスト層36が傷つくのを防止することができる。
(4)図1(a)に示すように、キャリア基材21の開口部21Xは、キャリア基材21の上側(接着層22側)から下側(接着層22側とは反対側)に向かうに連れて径が大きくなるテーパ状に形成されている。キャリア基材21の開口部21Xをテーパ状とすることで、配線基板30の電気検査のためのプローブ端子T2が位置ズレしても、外部接続端子P2に誘導することができる。また、キャリア基材21の下側(接着層22側とは反対側)の開口径が大きいことでプローブ端子T2を容易に挿入することができる。
(5)キャリア基材21は、配線基板30に半導体素子51を搭載する装置や、その半導体素子51を封止樹脂52により封止する装置への搬送のために必要となる。開口部21Xを有していないキャリア基材では、配線基板30の電気検査のためにキャリア基材の剥離や再度接着する工程が必要となる。従って、本実施形態のキャリア基材付き配線基板10では、開口部21Xを有しているため、キャリア基材の剥離や再接着等の工程が不要となるため、工程や製造時間の短縮を図ることができる。
(参考例)
図10は、参考例のキャリア基材付き配線基板200を示す。このキャリア基材付き配線基板200について、上述した実施形態の各部材と同じ構造の部材については同じ符号を付して説明の一部または全てを省略する。
キャリア基材付き配線基板200は、キャリア基材211と、接着層212と、配線基板30とを有している。キャリア基材211は、接着層212により配線基板30に接着されている。なお、本実施形態において、配線基板の側を上側、キャリア基材211の側を下側として説明する。つまり、配線基板30は、接着層212を介してキャリア基材211の上面に接着されている。
配線基板30は、配線層31、絶縁層32、配線層33、絶縁層34、配線層35、ソルダーレジスト層36を有している。
キャリア基材211は、ソルダーレジスト層36の下面36bに、接着層212により接着されている。
キャリア基材211は、ソルダーレジスト層36の開口部36Xと連通する開口部211Xを有している。ソルダーレジスト層36の開口部36Xは、外部接続端子P2を露出するように形成されている。従って、キャリア基材211の開口部211Xは、外部接続端子P2を露出するように形成されている。なお、本実施形態において、キャリア基材211は、接着層212を介してソルダーレジスト層36の下面36bに接着されている。従って、接着層212は、キャリア基材211と同様に、ソルダーレジスト層36の開口部212Xと連通する開口部212Xを有している。
接着層212の材料としては、例えば紫外線の照射によって接着力が低下するものを用いることができる。キャリア基材211としては、例えばコア基板、金属箔、フィルムを用いることができる。
この参考例において、キャリア基材211の開口部211Xの開口径は、ソルダーレジスト層36の開口部36Xの開口径よりも大きく設定されている。従って、キャリア基材211は、ソルダーレジスト層36において、開口部36Xの周囲、つまり開口部36Xを形成する端部の全周はキャリア基材211の開口部211Xから露出されている。
上述したキャリア基材付き配線基板200の製造工程を説明する。
図11(a)に示す工程では、キャリア基材211の上面に接着層212とセパレータ213とを積層し、これらを貫通する開口部214Xを形成する。開口部214Xは、キャリア基材211の開口部211Xと、接着層212の開口部212Xと、セパレータ213の開口部213Xを含む。開口部214Xは、例えばパンチやドリルなどの機械加工、レーザ加工、等により形成することができる。
図11(b)に示す工程では、上述のセパレータ213(図11(a)参照)を剥離する。キャリア基材211と接着層212はそれぞれ開口部211X,212Xを有している。
図12(a)に示す工程では、支持基板101と、支持基板101の両面に積層した接着層102及び金属層103とを有する支持体100を形成する。
支持基板101としては、例えば、ガラスクロス(織布)やガラス不織布又はアラミド繊維等にエポキシ系樹脂等の樹脂を含侵させた部材等を用いることができる。接着層102としては、例えば、銅箔、アルミ箔、ニッケル箔、亜鉛箔等の金属箔、セラミック板、アクリルやポリイミド等の樹脂を主成分とする樹脂シート等を用いることができる。金属層103としては、例えば、銅箔等を用いることができる。
図12(b)に示す工程では、支持体100の両面の金属層103上に、配線基板30を形成する。配線基板30は、配線層31、絶縁層32、配線層33、絶縁層34、配線層35、ソルダーレジスト層36を含む。金属層103上に、配線層31、絶縁層32、配線層33、絶縁層34、配線層35、ソルダーレジスト層36を順次積層する。ソルダーレジスト層36に開口部36Xを形成し、その開口部36Xにより配線層35の上面の一部を外部接続端子P2として露出する。
図13に示す工程では、ソルダーレジスト層36の表面に、接着層212を介して、ソルダーレジスト層36の表面全体を覆うキャリア基材211を貼り付ける。更に、キャリア基材211の表面に、接着層221を介して保護フィルム222を貼り付ける。接着層221としては、例えば紫外線の照射によって接着力が低下するものを用いることができる。保護フィルム222としては、後の工程のエッチング処理に対して耐エッチング性を有する材料を用いることができる。例えば、保護フィルム222の材料として、感光性のドライフィルム(例えばノボラック系樹脂やアクリル系樹脂等のドライフィルム)等を用いることができる。
図14に示す工程では、配線基板30を図13に示す支持基板101から分離する。これにより、配線基板30をキャリア基材211により支持する。
図15(a)に示す工程では、図14に示す金属層103を、例えばエッチングにより除去し、配線層31及び絶縁層32の上面を露出する。この工程において、キャリア基材211の開口部211Xは、接着層221及び保護フィルム222により閉塞されている。従って、エッチング液は、開口部211Xに入り込まない。つまり、外部接続端子P2がエッチング液から保護されている。
図15(b)に示す工程では、保護フィルム222を剥離して外部接続端子P2を露出し、外部接続端子P2及び部品接続端子P1にプローブ端子T2,T1を接触させ、配線基板30の電気検査を実施する。このように実施される電気検査により、個々の配線基板30について、良否が判定され、判定結果に応じてマーキングされる。例えば、不良品と判定した配線基板30に所定のマーキングを施す。
次に、上記のキャリア基材付き配線基板200を用いた半導体装置の製造工程を説明する。
図16(a)に示す工程では、キャリア基材付き配線基板200の上面に半導体素子51を実装し、半導体素子51を封止する封止樹脂52を形成する。このとき、上述の電気検査においてマーキングされていない配線基板30、つまり良品と判定された配線基板30に対して半導体素子51を実装し、マーキングされた配線基板30、つまり不良品と判定された配線基板30に対して半導体素子51を実装しない。これにより、不良品の配線基板に対して半導体素子51を実装する無駄を省くことができる。
封止樹脂52は、配線基板30の上面と、半導体素子51を覆うように形成される。封止樹脂52の材料としては、例えば、熱硬化性を有するエポキシ系の絶縁性樹脂を用いることができる。なお、絶縁性樹脂としては、熱硬化性を有する樹脂に限定されず、感光性を有する絶縁性樹脂を用いることができる。
図16(b)に示す工程では、キャリア基材211及び接着層212を除去する。例えば、接着層212に紫外線を照射して接着層212の接着力を低下させ、キャリア基材211及び接着層212を除去する。
図17(a)に示す工程では、外部接続端子P2に、実装のためのバンプ61を形成する。バンプ61は、たとえばはんだバンプである。このバンプ61は、外部接続端子P2に搭載したはんだボールや、外部接続端子P2に塗布したはんだペーストをリフローして形成することができる。
図17(b)に示す工程では、個片化した半導体装置70を形成する。図17(a)に示す配線基板30を、ダイシングブレード等によって切断し、個片化した半導体装置70を得る。
このように、キャリア基材付き配線基板200によれば、上記実施形態のキャリア基材付き配線基板10と同様に、キャリア基材211により配線基板30を支持した状態でその配線基板30の電気検査を行うことができる。
(変形例)
尚、上記各実施形態は、以下の態様で実施してもよい。
・上記実施形態に対し、キャリア基材付き配線基板の構成を適宜変更してもよい。
図18に示すように、キャリア基材21の下面に、接着層301を介してキャリア基材302を貼り付けるようにしてもよい。このような2層のキャリア基材21,302により剛性が増加し、ハンドリングを容易に行うことができるようになる。また、キャリア基材302によってキャリア基材21の開口部21Xが閉塞されるため、液体や粉塵等の異物が開口部21X内に入り込むのを防止することができる。なお、キャリア基材302に替えて、上記の保護フィルム222(図13参照)を貼り付けるようにしてもよい。キャリア基材302や保護フィルム222は、例えば、図6に示す電気検査後に貼り付けてもよい。また、図3の工程後、図5(b)のようにキャリア基材21及び接着層22に開口部21X,22Xを形成し、外部接続端子P2を露出させる。そして、図4に示す配線基板30を支持基板101から分離する前に、キャリア基材302や保護フィルム222を貼り付けても良い。この場合、電気検査をする際に、キャリア基材302や保護フィルム222を剥離する必要がある。
・上記各形態に対し、キャリア基材の表面及び開口部内(図1(a)ではキャリア基材21の下面及び開口部21X内)に配線を形成してもよい。また、キャリア基材として、配線層と絶縁層とを含むビルドアップ基板やコアを有する配線基板を用いてもよい。
・上記各形態において、キャリア基材付き配線基板10に含まれるブロックC1(図1(b)参照)の数、各ブロックC1に含まれる領域C2の数を適宜変更してもよい。また、キャリア基材付き配線基板10を形成するワーク基板40(図9(a)参照)に含まれるブロックC1の数、つまりワーク基板40により形成するキャリア基材付き配線基板10の数を適宜変更してもよい。
・上記各形態において、配線基板30に含まれる絶縁層及び配線層の数を適宜変更してもよい。
・上記各実施形態に対し、配線基板30の絶縁層32の上面に、部品接続端子P1を露出する開口部を有するソルダーレジスト層を形成してもよい。
10 キャリア基材付き配線基板
21 キャリア基材
21X 開口部
22 接着層
30 配線基板
31,33,35 配線層
32,34 絶縁層
36 ソルダーレジスト層
36X 開口部
P1 部品接続端子
P2 外部接続端子

Claims (10)

  1. キャリア基材付き配線基板は、
    配線基板であって、絶縁層と、前記絶縁層の下面に設けられた配線層と、前記絶縁層の下面を覆うとともに前記配線層の一部を外部接続端子として露出する開口部を有するソルダーレジスト層と、を有する配線基板と、
    前記ソルダーレジスト層の開口部と連通する開口部を有する接着層と、
    前記ソルダーレジスト層に前記接着層を介して接着されることによりキャリア基材付き配線基板とされ、前記ソルダーレジスト層の開口部及び前記接着層の開口部と連通し、前記外部接続端子を露出する開口部を有するキャリア基材と、を有し、
    前記キャリア基材の開口部の開口径及び前記接着層の開口部の開口径は、前記ソルダーレジスト層の開口部の開口径よりも小さく、
    前記接着層は、前記ソルダーレジスト層から剥離可能であって、前記接着層と前記キャリア基材を前記キャリア基材付き配線基板から除去するための層であること、を特徴とするキャリア基材付き配線基板。
  2. 前記キャリア基材は、前記接着層と接する上面と、前記上面とは反対側の下面を有し、
    前記キャリア基材の開口部は、前記キャリア基材の上面における第1開口径、前記キャリア基材の下面において前記第1開口径よりも大きい第2開口径を有し、前記第1開口径は、前記ソルダーレジスト層の開口部の開口径よりも小さいことを特徴とする請求項1に記載のキャリア基材付き配線基板。
  3. 前記配線基板は、交互に積層された複数の絶縁層と複数の配線層とを有し、絵複数の絶縁層のうち最上層の前記絶縁層及び前記配線層のうち最上層前記配線層の上面は露出されており、前記最上層の前記配線層は電子部品を搭載する部品接続端子を有していること、を特徴とする請求項1又は2に記載のキャリア基材付き配線基板。
  4. 前記キャリア基材の開口部は、前記キャリア基材の下面から上面に向けてその開口径が縮小するテーパ状であり、
    前記接着層の開口部は、前記接着層の下面から上面に向けてその開口径が縮小するテーパ状であること、を特徴とする請求項1〜3のいずれか一項に記載のキャリア基材付き配線基板。
  5. 前記接着層は、紫外線の照射により接着力が低下するものであることを特徴とする請求項1〜4のいずれか一項に記載のキャリア基材付き配線基板。
  6. 前記接着層は、接着力を低下させることができるものであることを特徴とする請求項1〜4のいずれか一項に記載のキャリア基材付き配線基板。
  7. 支持体の表面に、配線層と絶縁層とを交互に積層し、前記配線層の一部を外部接続端子として露出する開口部を有するソルダーレジスト層を形成し、前記配線層と前記絶縁層と前記ソルダーレジスト層を有する配線基板を形成する工程と、
    前記ソルダーレジスト層の上面に接着層を介してキャリア基材を貼付する工程と、
    前記キャリア基材及び前記接着層に、前記ソルダーレジスト層の開口部と連通して前記外部接続端子を露出し、前記ソルダーレジスト層の開口部の開口径よりも小さな開口径の開口部を形成する工程と、
    前記キャリア基材及び前記接着層の開口部から接触子を前記外部接続端子に接触させて電気検査を行う工程と、を有するキャリア基材付き配線基板の製造方法。
  8. 前記キャリア基材を貼付する工程の後、前記支持体から前記配線基板を分離する工程を実行した後、前記キャリア基材に開口部を形成すること、を特徴とする請求項に記載のキャリア基材付き配線基板の製造方法。
  9. 前記支持体の上下両面に前記配線基板をそれぞれ形成し、上下の前記ソルダーレジスト層に前記接着層を介して前記キャリア基材をそれぞれ貼付すること、を特徴とする請求項又はに記載のキャリア基材付き配線基板の製造方法。
  10. 前記キャリア基材は、接着層と接する上面と、上面とは反対側の下面を有し、
    前記キャリア基材の開口部は、前記キャリア基材の上面における第1開口径、前記キャリア基材の下面において前記第1開口径よりも大きい第2開口径を有し、前記第1開口径は、前記ソルダーレジスト層の開口部の開口径よりも小さいことを特徴とする請求項のいずれか一項に記載のキャリア基材付き配線基板の製造方法。
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Families Citing this family (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR102450598B1 (ko) * 2017-11-09 2022-10-07 삼성전기주식회사 지지체 부착 인쇄회로기판 및 지지체 부착 인쇄회로기판의 제조방법
JP7007882B2 (ja) 2017-12-08 2022-01-25 新光電気工業株式会社 配線基板及びその製造方法
CN112312681B (zh) * 2019-07-24 2022-05-17 宏启胜精密电子(秦皇岛)有限公司 电路板的制作方法

Family Cites Families (11)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH11238831A (ja) * 1997-12-16 1999-08-31 Shinko Electric Ind Co Ltd テープキャリア及びその製造方法
CN1477703A (zh) * 2002-08-02 2004-02-25 千住金属工业株式会社 焊球组件及其生产方法,形成焊块的方法
JP3727939B2 (ja) * 2003-01-08 2005-12-21 新光電気工業株式会社 半導体装置の製造方法
US20090002059A1 (en) * 2007-06-29 2009-01-01 Kwang Tatt Loo Rail to rail full complementary CMOS isolation gate
JP4895936B2 (ja) * 2007-07-19 2012-03-14 新光電気工業株式会社 導電性ボールの搭載方法
JP5290017B2 (ja) * 2008-03-28 2013-09-18 日本特殊陶業株式会社 多層配線基板及びその製造方法
JP5179920B2 (ja) * 2008-03-28 2013-04-10 日本特殊陶業株式会社 多層配線基板
JP5356876B2 (ja) * 2008-03-28 2013-12-04 日本特殊陶業株式会社 多層配線基板及びその製造方法
US20130024437A1 (en) * 2009-11-23 2013-01-24 Robert George Stevens Activity recordal method and system
US20130244377A1 (en) * 2012-03-13 2013-09-19 Nitto Denko Corporation Heat-resistant pressure-sensitive adhesive tape for production of semiconductor device and method for producing semiconductor device using the tape
JP2016048768A (ja) * 2014-08-28 2016-04-07 日立化成株式会社 配線板及び半導体装置の製造方法

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