JP6540456B2 - 電源装置、電源回路の制御方法及びプログラム - Google Patents
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Description
図1は、第1の実施形態による電源装置の構成例を示す図である。電源装置は、例えばサーバ装置の電源装置であり、電源回路101と制御装置102とを有する。電源回路101は、直流電源111と、スイッチング回路112と、負荷113と、電流検出回路114と、過電流保護回路115と、ゲートドライバ116とを有する。スイッチング回路112は、電解コンデンサ121、nチャネル電界効果トランジスタ122と、トランス123と、ダイオード126,127と、インダクタ128と、電解コンデンサ129と、入力ノードN1,N2と、出力ノードN3,N4とを有する。トランス123は、一次巻線124及び二次巻線125を有する。電界効果トランジスタ122は、窒化ガリウム(GaN)の高電子移動度トランジスタ(HEMT:High Electron Mobility Transistor)が好ましいが、MOS電界効果トランジスタでもよい。HEMTは、高耐圧及び高速スイッチングの利点がある。スイッチング回路112は、直流電源111から例えば12Vの直流入力電圧Viを入力し、直流電圧Viを降圧し、例えば5Vの直流出力電圧Voを負荷113に出力する。負荷113は、プロセッサ又は電子機器等である。入力電圧Viが12Vであり、出力電圧Voが5Vである場合、一次巻線124及び二次巻線125の巻数比は12:5である。
図7は、第2の実施形態による電源装置の構成例を示す図である。図7の電源装置は、図1の電源装置に対して、ローパスフィルタ部144の代わりに、判定部701を設けたものである。以下、本実施形態が第1の実施形態と異なる点を説明する。第1の比較部150は、アナログ補償部143が出力するデューティ比D1が許容範囲の上限値DUより大きい場合には0の値を出力し、アナログ補償部143が出力するデューティ比D1が許容範囲の上限値DU以下である場合には1の値を出力する。第2の比較部151は、アナログ補償部143が出力するデューティ比D1が許容範囲の下限値DLより小さい場合には0の値を出力し、アナログ補償部143が出力するデューティ比D1が許容範囲の下限値DL以上である場合には1の値を出力する。第4の乗算部152は、デューティ比D1が上限値DU及び下限値DLの許容範囲内である場合には1の値を出力し、デューティ比D1が上限値DU及び下限値DLの許容範囲外である場合には0の値を出力する。
102 制御装置
111 直流電源
112 スイッチング回路
113 負荷
114 電流検出回路
115 過電流保護回路
116 ゲートドライバ
131〜133 A/D変換器
134 PWM制御器
135 中央処理ユニット(CPU)
Claims (10)
- 電源回路の出力電圧が目標電圧に近づくように、前記電源回路のスイッチング素子の制御信号のデューティ比を決定するデューティ比決定部と、
電流検出回路により検出された前記電源回路の出力電流を基にデューティ比の許容範囲を演算する許容範囲演算部と、
前記デューティ比決定部により決定されたデューティ比が前記許容範囲内である場合には、前記デューティ比決定部により決定されたデューティ比を出力し、前記デューティ比決定部により決定されたデューティ比が前記許容範囲外である場合には、前記電源回路を停止させる出力部と
を有することを特徴とする電源装置。 - 前記許容範囲演算部は、前記電流検出回路により検出された前記電源回路の出力電流及び前記電源回路の入力電圧を基に、デューティ比の許容範囲を演算することを特徴とする請求項1記載の電源装置。
- 前記許容範囲演算部は、前記電流検出回路により検出された前記電源回路の出力電流、前記電源回路の入力電圧、及び前記目標電圧を基に、デューティ比の許容範囲を演算することを特徴とする請求項1又は2記載の電源装置。
- 前記許容範囲演算部は、前記電流検出回路により検出された前記電源回路の出力電流、前記電源回路の入力電圧、前記目標電圧、及び前記電源回路の配線抵抗を基に、デューティ比の許容範囲を演算することを特徴とする請求項1〜3のいずれか1項に記載の電源装置。
- 前記許容範囲演算部は、
前記電流検出回路により検出された前記電源回路の出力電流に対して前記電源回路の配線抵抗を乗算する第1の乗算部と、
前記第1の乗算部の出力値及び前記目標電圧を加算する加算部と、
前記加算部の出力値を前記電源回路の入力電圧で除算する除算部とを有することを特徴とする請求項1〜4のいずれか1項に記載の電源装置。 - 前記許容範囲演算部は、
前記除算部の出力値に対して第1の係数を乗算することにより、前記許容範囲の上限値を出力する第2の乗算部と、
前記除算部の出力値に対して第2の係数を乗算することにより、前記許容範囲の下限値を出力する第3の乗算部とを有することを特徴とする請求項5記載の電源装置。 - さらに、前記デューティ比決定部により決定されたデューティ比をローパスフィルタリング処理するローパスフィルタ部を有し、
前記出力部は、前記ローパスフィルタ部が出力するデューティ比が前記許容範囲内である場合には、前記デューティ比決定部により決定されたデューティ比を出力し、前記ローパスフィルタ部が出力するデューティ比が前記許容範囲外である場合には、前記電源回路を停止させることを特徴とする請求項1〜6のいずれか1項に記載の電源装置。 - 前記出力部は、前記デューティ比決定部により決定されたデューティ比が前記許容範囲外である持続時間が閾値より短い場合には、前記デューティ比決定部により決定されたデューティ比を出力し、前記デューティ比決定部により決定されたデューティ比が前記許容範囲外である持続時間が前記閾値より長い場合には、前記電源回路を停止させることを特徴とする請求項1〜6のいずれか1項に記載の電源装置。
- デューティ比決定部により、電源回路の出力電圧が目標電圧に近づくように、前記電源回路のスイッチング素子の制御信号のデューティ比を決定し、
許容範囲演算部により、電流検出回路により検出された前記電源回路の出力電流を基にデューティ比の許容範囲を演算し、
出力部により、前記決定されたデューティ比が前記許容範囲内である場合には、前記決定されたデューティ比を出力し、前記決定されたデューティ比が前記許容範囲外である場合には、前記電源回路を停止させる、
処理を有することを特徴とする電源回路の制御方法。 - 電源回路の出力電圧が目標電圧に近づくように、前記電源回路のスイッチング素子の制御信号のデューティ比を決定し、
電流検出回路により検出された前記電源回路の出力電流を基にデューティ比の許容範囲を演算し、
前記決定されたデューティ比が前記許容範囲内である場合には、前記決定されたデューティ比を出力し、前記決定されたデューティ比が前記許容範囲外である場合には、前記電源回路を停止させる、
処理をコンピュータに実行させるプログラム。
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