JP6520574B2 - 液体吐出装置およびヘッドユニット - Google Patents
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Description
このように、圧電素子を駆動する駆動信号の周波数を高めるために、D級増幅のスイッチング周波数を高めようとすると、多くの問題に直面することになる。
なお、源信号とは、圧電素子の変位を規定する駆動信号の源となる信号、すなわち、変調前の信号であって、駆動信号の波形の基準となる信号(規定する信号を含み、アナログ、デジタルを問わない)。変調信号とは、源信号をパルス変調(例えばパルス幅変調、パルス密度変調等)して得られるデジタル信号である。
また、ローパスフィルターは、典型的には、インダクター(コイル)およびコンデンサーで構成されるが、抵抗を加えても良いし、インダクターを抜いて、抵抗およびコンデンサーで構成しても良い。
また、前記第1端子と前記第2端子とは隣り合って位置する構成としても良い。
もし、変調信号の周波数を1MHzよりも低くしてしまうと、再現される駆動信号の波形のエッジが鈍って丸くなってしまう。換言すれば、角が取れて波形が鈍ってしまう。駆動信号の波形が鈍ると、波形の立ち上がり、立ち下がりエッジに応じて動作する圧電素子の変位が緩慢になり、吐出時の尾引きや、吐出不良などを発生させて、印刷の品質を低下させてしまう。
一方、変調信号の周波数を8MHzよりも高くすれば、駆動信号の波形の分解能は高まる。ただし、トランジスターにおけるスイッチング周波数が上昇することによって、スイッチング損失が大きくなり、AB級アンプなどのリニア増幅と比べて、優位性を有する省電力性、省発熱性が損なわれてしまう。
このため、上記一態様に係る液体吐出装置において、前記変調信号の周波数は、1Mz以上8MHz以下であることが好ましい。
この図に示されるように、印刷装置1は、移動体2を、主走査方向に移動(往復動)させる移動機構3を備える。
移動機構3は、移動体2の駆動源となるキャリッジモーター31と、両端が固定されたキャリッジガイド軸32と、キャリッジガイド軸32とほぼ平行に延在し、キャリッジモーター31により駆動されるタイミングベルト33と、を有している。
移動体2のキャリッジ24は、キャリッジガイド軸32に往復動自在に支持されるとともに、タイミングベルト33の一部に固定されている。そのため、キャリッジモーター31によりタイミングベルト33を正逆走行させると、移動体2がキャリッジガイド軸32に案内されて往復動する。
また、移動体2のうち、媒体Pと対向する部分にはヘッドユニット20が設けられる。このヘッドユニット20は、後述するように、多数のノズルからインク滴(液滴)を吐出させるためのものであり、フレキシブルケーブル190を介して各種の制御信号等が供給される構成となっている。
媒体Pが搬送機構4によって搬送されたタイミングで、ヘッドユニット20が当該媒体Pにインク滴を吐出することによって、媒体Pの表面に画像が形成される。
この図に示されるように、印刷装置1では、制御ユニット10とヘッドユニット20とがフレキシブルケーブル190を介して接続される。
制御ユニット10は、制御部100と、キャリッジモーター31と、キャリッジモータードライバー35と、搬送モーター41と、搬送モータードライバー45と、2つの駆動回路50と、を有する。このうち、制御部100は、CPUや、記憶部などを有する一種のマイクロコンピューターであり、媒体Pに形成すべき画像を規定する画像データがホストコンピューター等から供給されたときに、所定のプログラムを実行することによって、各部を制御するための各種の制御信号等を出力する。
第2に、制御部100は、搬送モータードライバー45に対して制御信号Ctr2を供給し、搬送モータードライバー45は、当該制御信号Ctr2にしたがって搬送モーター41を駆動する。これにより、搬送機構4による副走査方向の移動が制御される。
第3に、制御部100は、制御信号Ctr1を介したキャリッジモーター31の駆動に同期して、2つの駆動回路50のうち一方に、駆動信号COM−Aの波形を規定するデジタルのデータdAを供給し、他方に、駆動信号COM−Bの波形を規定するデジタルのデータdBを供給する。データdA、dBは、例えば予め記憶部に記憶されるとともに、制御部100によってキャリッジモーター31の駆動に同期した間隔で読み出されて、それぞれの駆動回路50に供給される。
なお、この例では、2つの駆動回路50によって生成された電圧VBSを共通化してヘッドユニット20に供給する構成となっているが、いずれかの駆動回路50によって生成された電圧VBSのみをヘッドユニット20に供給する構成としても良い。
また、駆動回路50の詳細については後述する。
第4に、制御部100は、ヘッドユニット20に、クロック信号Sck、データ信号Data、制御信号LAT、CHを供給する。
選択制御部210は、選択部230のそれぞれに対して駆動信号COM−A、COM−Bのいずれかを選択すべきか(または、いずれも非選択とすべきか)を、制御部100から供給される制御信号等によって指示し、選択部230は、選択制御部210の指示にしたがって、駆動信号COM−A、COM−Bを選択し、圧電素子60の一端にそれぞれに駆動信号として供給する。なお、図では、この駆動信号の電圧をVoutと表記している。
圧電素子60のそれぞれにおける他端は、駆動回路50で生成された電圧VBSがフレキシブルケーブル190を介して共通に印加されている。
図に示されるように、ヘッドユニット20は、圧電素子60と振動板621とキャビティ(圧力室)631とリザーバー641とノズル651とを含む。このうち、振動板621は、図において上面に設けられた圧電素子60によって変位(屈曲振動)し、インクが充填されるキャビティ631の内部容積を拡大/縮小させるダイヤフラムとして機能する。ノズル651は、ノズルプレート632に設けられるとともに、キャビティ631に連通する開孔部である。
また、圧電素子60は、ヘッドユニット20においてキャビティ631とノズル651とに対応して設けられ、当該圧電素子60は、図1において、選択部230にも対応して設けられる。このため、圧電素子60、キャビティ631、ノズル651および選択部230のセットは、ノズル651(吐出部)毎に設けられることになる。
この図に示されるように、ノズル651は、例えば次のように2列で配列している。詳細には、1列分でみたときには、複数個のノズル651が副走査方向に沿ってピッチPvで配置する一方、2列同士でみたときには、主走査方向にピッチPhだけ離間して、かつ、副走査方向にピッチPvの半分だけシフトした関係となっている。
なお、ノズル651は、カラー印刷する場合には、C(シアン)、M(マゼンタ)、Y(イエロー)、K(ブラック)などの各色に対応したパターンが例えば主走査方向に沿って設けられるが、以下の説明では、簡略化するために、単色で階調を表現する場合について説明する。
すなわち、1回のインク滴の吐出で1ドットが形成される場合、ドット間隔Dは、速度vを、インクの吐出周波数fで除した値(=v/f)、換言すれば、インク滴が繰り返し吐出される周期(1/f)においてヘッドユニット20が移動する距離で示される。
なお、図4Bの例では、ピッチPhがドット間隔Dに対して係数nで比例する関係にして、2列のノズル651から吐出されるインク滴が、媒体Pにおいて同一列で揃うように着弾させている。このため、図4Bに示されるように、副走査方向のドット間隔が、主走査方向のドット間隔の半分となっている。ドットの配列は、図示の例に限られないことは言うまでもない。
また、印刷速度とは別に、解像度を高めるためには、単位面積当たりで形成されるドット数を増やせば良い。ただし、ドット数を増やす場合に、インクを少量にしないと、隣り合うドット同士が結合してしまうだけでなく、インクの吐出周波数fを高めないと、印刷速度が低下する。
このように、高速印刷および高解像度印刷を実現するためには、インクの吐出周波数fを高める必要があるのは、上述した通りである。
そこで、駆動信号COM−A、COM−Bについて説明し、この後、駆動信号COM−A、COM−Bを選択するための構成について説明する。なお、駆動信号COM−A、COM−Bについては、それぞれ駆動回路50によって生成されるが、駆動回路50については、便宜的に、駆動信号COM−A、COM−Bを選択するための構成の後に説明する。
図に示されるように、駆動信号COM−Aは、印刷周期Taのうち、制御信号LATが出力されて(立ち上がって)から制御信号CHが出力されるまでの期間T1に配置された台形波形Adp1と、印刷周期Taのうち、制御信号CHが出力されてから次の制御信号LATが出力されるまでの期間T2に配置された台形波形Adp2とを連続して繰り返した波形となっている。
この図に示されるように、選択制御部210には、クロック信号Sck、データ信号Data、制御信号LAT、CHが制御ユニット10から供給される。選択制御部210では、シフトレジスタ(S/R)212とラッチ回路214とデコーダー216との組が、圧電素子60(ノズル651)のそれぞれに対応して設けられている。
データ信号Dataは、クロック信号Sckに同期してノズル毎に、ヘッドユニット20の主走査に合わせて制御部100からシリアルで供給される。シリアルで供給されたデータ信号Dataを、ノズルに対応して2ビット分、一旦保持するための構成がシフトレジスタ212である。
詳細には、圧電素子60(ノズル)に対応した段数のシフトレジスタ212が互いに縦続接続されるとともに、シリアルで供給されたデータ信号Dataが、クロック信号Sckにしたがって順次後段に転送される構成となっている。
なお、圧電素子60の個数をm(mは複数)としたときに、シフトレジスタ212を区別するために、データ信号Dataが供給される上流側から順番に1段、2段、…、m段と表記している。
デコーダー216は、ラッチ回路214によってラッチされた2ビットのデータ信号Dataをデコードして、制御信号LATと制御信号CHとで規定される期間T1、T2ごとに、選択信号Sa、Sbを出力して、選択部230での選択を規定する。
この図において、ラッチされた2ビットの印刷データDataについては(MSB、LSB)と表記している。デコーダー216は、例えばラッチされた印刷データDataが(0、1)であれば、選択信号Sa、Sbの論理レベルを、期間T1ではそれぞれH、Lレベルとし、期間T2ではそれぞれL、Hレベルとして、出力するということを意味している。
なお、選択信号Sa、Sbの論理レベルについては、クロック信号Sck、印刷データData、制御信号LAT、CHの論理レベルよりも、レベルシフター(図示省略)によって、高振幅論理にレベルシフトされる。
この図に示されるように、選択部230は、インバーター(NOT回路)232a、232bと、トランスファーゲート234a、234bとを有する。
デコーダー216からの選択信号Saは、トランスファーゲート234aにおいて丸印が付されていない正制御端に供給される一方で、インバーター232aによって論理反転されて、トランスファーゲート234aにおいて丸印が付された負制御端に供給される。同様に、選択信号Sbは、トランスファーゲート234bの正制御端に供給される一方で、インバーター232bによって論理反転されて、トランスファーゲート234bの負制御端に供給される。
トランスファーゲート234aの入力端には、駆動信号COM−Aが供給され、トランスファーゲート234bの入力端には、駆動信号COM−Bが供給される。トランスファーゲート234a、234bの出力端同士は、共通接続されるとともに、対応する圧電素子60の一端に接続される。
トランスファーゲート234aは、選択信号SaがHレベルであれば、入力端および出力端の間を導通(オン)させ、選択信号SaがLレベルであれば、入力端と出力端との間を非導通(オフ)させる。トランスファーゲート234bについても同様に選択信号Sbに応じて、入力端および出力端の間をオンオフさせる。
ここで、制御信号LATが立ち上がると、ラッチ回路214のそれぞれは、シフトレジスタ212に保持されたデータ信号Dataを一斉にラッチする。図5において、L1、L2、…、Lmは、データ信号Dataが、1段、2段、…、m段のシフトレジスタ212に対応するラッチ回路214によってラッチされたデータ信号Dataを示している。
すなわち、第1に、デコーダー216は、当該データ信号Dataが(1、1)であって、大ドットのサイズを規定する場合、選択信号Sa、Sbを、期間T1においてH、Lレベルとし、期間T2においてもH、Lレベルとする。第2に、デコーダー216は、当該データ信号Dataが(0、1)であって、中ドットのサイズを規定する場合、選択信号Sa、Sbを、期間T1においてH、Lレベルとし、期間T2においてL、Hレベルとする。第3に、デコーダー216は、当該データ信号Dataが(1、0)であって、小ドットのサイズを規定する場合、選択信号Sa、Sbを、期間T1においてL、Lレベルとし、期間T2においてL、Hレベルとする。第4に、デコーダー216は、当該データ信号Dataが(0、0)であって、非記録を規定する場合、選択信号Sa、Sbを、期間T1においてL、Hレベルとし、期間T2においてL、Lレベルとする。
データ信号Dataが(1、1)であるとき、選択信号Sa、Sbは、期間T1においてH、Lレベルとなるので、トランスファーゲート234aがオンし、トランスファーゲート234bがオフする。このため、期間T1において駆動信号COM−Aの台形波形Adp1が選択される。選択信号Sa、Sbは期間T2においてもH、Lレベルとなるので、選択部230は、駆動信号COM−Aの台形波形Adp2を選択する。
このように期間T1において台形波形Adp1が選択され、期間T2において台形波形Adp2が選択されて、駆動信号として圧電素子60の一端に供給されると、当該圧電素子60に対応したノズル651から、中程度の量のインクが2回にわけて吐出される。このため、媒体Pにはそれぞれのインクが着弾し合体して、結果的に、データ信号Dataで規定される通りの大ドットが形成されることになる。
したがって、ノズルから、中程度および小程度の量のインクが2回にわけて吐出される。このため、媒体Pには、それぞれのインクが着弾して合体して、結果的に、データ信号Dataで規定された通りの中ドットが形成されることになる。
このため、期間T1においてノズル651の開孔部付近のインクが微振動するのみであり、インクは吐出されないので、結果的に、ドットが形成されない、すなわち、データ信号Dataで規定された通りの非記録になる。
なお、図5に示した駆動信号COM−A、COM−Bはあくまでも一例である。実際には、ヘッドユニット20の移動速度や媒体Pの性質などに応じて、予め用意された様々な波形の組み合わせが用いられる。
また、ここでは、圧電素子60が、電圧の上昇に伴って上方向に撓む例で説明したが、電極611、612に供給する電圧を逆転させると、圧電素子60は、電圧の上昇に伴って下方向に撓むことになる。このため、圧電素子60が、電圧の上昇に伴って下方向に撓む構成では、図に例示した駆動信号COM−A、COM−Bが、電圧Vcを基準に反転した波形となる。
一般に、単位期間Tにおいてインク滴がQ(Qは2以上の整数)回吐出可能であって、当該Q回のインク滴の吐出で1ドットが形成される場合、インクの吐出周波数fはQ/Tと表すことができる。
本実施形態のように、媒体Pに異なるサイズのドットを形成する場合の方が、1回のインク滴の吐出で1ドットを形成する場合と比較して、1ドットを形成するために要する時間(周期)が同じでも、1回のインク滴を1回吐出するため時間を短くする必要がある。
なお、2以上のインク滴を結合させないで2以上のドットを形成する第3方法については、特段の説明は要しないであろう。
なお、2つの駆動回路50のうち、他方についても同様な構成であり、データdBから駆動信号COM−Bを出力する点についてのみ異なる。そこで、便宜的に、駆動回路COM−Aを出力する駆動回路50を例にとって説明する。
この図に示されるように、駆動回路50は、LSI500や、トランジスターM3、M4のほか、抵抗やコンデンサーなどの各種素子から構成される。
なお、図10では、駆動信号COM−Aを出力する駆動回路50の構成を示しているが、駆動信号COM−Bを生成する駆動回路50についても同様な構成である。
積分減衰器512は、ピンVfbを介して入力した端子Outの電圧、すなわち、駆動信号COM−Aを減衰するとともに、積分して、加算器504の入力端(+)に供給する。
加算器504は、入力端(+)の電圧から入力端(−)の電圧を差し引いて積分した電圧の信号Abを加算器506の入力端の一方に供給する。
なお、DAC502からNOT回路522までに至る回路(DAC502、加算器504、積分器512、加算器506、減衰器514、コンパレーター520、NOT回路522)の電源電圧は、低振幅の3.3ボルト(電圧Vdd)である。このため、アナログ信号Aaの電圧が最大でも2ボルト程度であるのに対し、駆動信号COM−Aの電圧が最大で40ボルトを超える場合があるので、偏差を求めるにあたって両電圧の振幅範囲を合わせるため、駆動信号COM−Aの電圧を積分減衰器512によって減衰させている。
加算器506から出力される信号Asの電圧は、ピンVfbに供給された信号の減衰電圧から、アナログ信号Aaの電圧を差し引いて、ピンIfbに供給された信号の減衰電圧を加算した電圧である。このため、加算器506による信号Abの電圧は、端子Outから出力される駆動信号COM−Aの減衰電圧から、目標であるアナログ信号Aaの電圧を指し引いた偏差を、当該駆動信号COM−Aの高周波成分で補正した信号ということができる。
Vth1>Vth2
という関係に設定されている。
また、図10に示した構成では、デジタルのデータdAをDAC502によってアナログの信号Aaに変換したが、DAC502を介することなく、例えば制御部100による指示にしたがって外部回路から信号Aaの供給を受けても良い。デジタルのデータdAにしても、アナログの信号Aaにしても、駆動信号COM−Aの波形を生成するにあたっての目標値を規定しているので、源信号であることには変わりはない。
例えば、ゲートドライバー533は、コンパレーター520の出力信号である低論理振幅を入力し、高論理振幅にレベルシフトして、ピンHdrから出力し、ゲートドライバー534は、NOT回路522の出力信号である低論理振幅を入力して、高論理振幅にレベルシフトして、ピンLdrから出力する。
また、ゲートドライバー534の電源電圧のうち、高位側電圧は、ピンGvdを介した10ボルト程度の電圧Vmであり、低位側電圧は、ピンGndを介してグラウンドに接地された電圧のゼロである。ピンGvdは、逆流防止用のダイオードD2のカソード電極に接続され、当該ダイオードD2のアノード電極は、コンデンサーC12の一端とピンBstとに接続される。
なお、昇圧回路541の詳細については後述する。
なお、電圧生成回路543の詳細については後述する。また、コンデンサーC71、C72、C73、C81が外付け部品となっている理由は、LSI500に集積化することが困難であるためである。
上記HPFのカットオフ周波数は、上記LPFのカットオフ周波数よりも低く設定されているので、HPFとLPFとは、駆動信号COM−Aのうち、所定の周波数域の高周波成分を通過させるBPF(Band Pass Filter)として機能する。
ただし、ピンVfbを介した帰還経路の遅延量が大であるために、当該ピンVfbを介した帰還のみでは、自励発振の周波数を、駆動信号COM−Aの精度を十分に確保できるほど高くすることができない。
そこで、本実施形態では、ピンVfbを介した経路とは別に、ピンIfbを介して、駆動信号COM−Aの高周波成分を帰還する経路を設けることによって、回路全体でみたときの遅延を小さくしている。このため、信号Abに、駆動信号COM−Aの高周波成分を加算した信号Asの周波数は、ピンIfbを介した経路が存在しない場合と比較して、駆動信号COM−Aの精度を十分に確保できるほど高くすることができる。
この図に示されるように、信号Asは三角波であり、その発振周波数は、アナログ信号Aaの電圧(入力電圧)に応じて変動する。具体的には、入力電圧が中間値である場合に最も高くなり、入力電圧が中間値から高くなるにつれて、または、低くなるにつれて低くなる。
このため、変調信号Msは、次のようなパルス密度変調信号となる。すなわち、変調信号Msのデューティー比は、入力電圧の中間値でほぼ50%であり、入力電圧が中間値よりも高くなるにつれて大きくなり、入力電圧が中間値よりも低くなるにつれて小さくなる。
したがって、トランジスターM3、M4の接続点における増幅変調信号をインダクターL2およびコンデンサーC10で平滑化した駆動信号COM−Aの電圧は、変調信号Msのデューティー比が大きくなるにつれて高くなり、デューティー比が小さくなるにつれて低くなるので、結果的に、駆動信号COM−Aは、アナログ信号Aaの電圧を拡大した信号となるように制御されて、出力されることになる。
すなわち、回路全体で扱うことができる最小の正パルス幅と負パルス幅はその回路特性で制約されるので、周波数固定のパルス幅変調では、デューティー比の変化幅として所定の範囲(例えば10%から90%までの範囲)しか確保できない。これに対し、パルス密度変調では、入力電圧が中間値から離れるにつれて、発振周波数が低くなるため、入力電圧が高い領域においては、デューティー比をより大きくすることができ、また、入力電圧が低い領域においては、デューティー比をより小さくすることができる。このため、自励発振型パルス密度変調では、デューティー比の変化幅として、より広い範囲(例えば5%から95%までの範囲)を確保することができるのである。
加えて、駆動回路50では、駆動信号COM−Aの帰還経路として、ピンVfbを介した経路だけでなく、ピンIfbを介して高周波成分を帰還する経路があるので、回路全体でみたときの遅延が小さくなる。このため、自励発振の周波数が高くなるので、駆動回路50は、駆動信号COM−Aを精度良く生成することが可能になる。
この図に示される昇圧回路541は、スイッチ(Sw)コントローラー5410と、1極単投形のスイッチSw1〜Sw7とを含み、スイッチコントローラー5410がスイッチSw1〜Sw7のオンオフをそれぞれ制御する構成となっている。
スイッチSW1〜SW7とコンデンサーC71、C72、C73について、便宜的に図において上側の端子を一端と称し、下側の端子と称すると、スイッチSw3の一端と、スイッチSw4の一端と、スイッチSw5の他端とには、3.3ボルトの電圧Vddが印加される。
スイッチSw5の一端は、スイッチSw6の他端と、ピンCp2を介してコンデンサーC71の一端とに接続される。スイッチSw6の一端は、スイッチSw7の他端と、ピンCp4を介してコンデンサーC72の一端とに接続される。
スイッチSw7の他端は、昇圧回路541の出力端である。このため、スイッチSw7の他端における電圧はVmとして、LSI500の電圧生成回路543およびゲートドライバー534に出力されるとともに、ピンGvdを介してコンデンサーC72の一端と、ダイオードD2(図10参照)の電極とに接続される。
スイッチコントローラー5410は、電圧Vmが閾値以下となった場合、第1状態と第2状態とを所定の間隔で交互に切り替える一方、電圧Vmが閾値を上回った場合、第1状態と第2状態との切り替えを停止させる。
この図に示されるように、第1状態において、コンデンサーC71は、一端を高位とした充電により電圧Vddを保持する一方、コンデンサーC72は、それまで保持していた電圧を、他端の電圧Vddに持ち上げて、一端の電圧Vmとして出力する。
この図に示されるように、第2状態において、コンデンサーC71は、それまで保持していた電圧Vddを他端の電圧Vddに持ち上げて、他端がグラウンドに接地された状態のコンデンサーC72に移し替える。このため、コンデンサーC72は、一端を高位として電圧2Vddを保持することになる。
この図に示される電圧生成回路543は、基準電源550と、演算回路551と、例えばPチャネル型のトランジスター552と、抵抗553、554とを含む。
このうち、基準電源550は基準電圧Vrefを出力する。演算回路551は、当該基準電圧Vrefと、端子dの電圧とを入力して、両者の差に応じた電圧を出力してトランジスター552のゲート端子に印加する。トランジスター552のソース端子には、昇圧回路541による電圧Vmが印加され、トランジスター552のドレイン端子は、ピンPsと抵抗553の一端とに接続される。このため、トランジスター552のドレイン端子は、電圧VBSの出力端子となっている。なお、ピンPsとグラウンドとの間には外付け部品のコンデンサーC81が電気的に介挿されている点は上述した通りである。
演算回路551については、端子dの電圧が基準電圧Vrefより低くなるにつれて、出力電圧が低くなる(ゲート・ソース間電圧が高くなる)ように構成されている。
したがって、電圧VBSは、基準電圧Vrefに応じた電圧で均衡する。ただし、実際には、電圧生成回路543における出力応答性が十分に高くはないので、電圧VBSのバックアップ用としてコンデンサーC81が設けられている。
また、電圧生成回路543が電圧VBS(または、端子dの電圧)をモニターして、目標とする電圧から所定値(例えば±1ボルト)以上ずれたら、エラーを制御部100等に通知する構成としても良い。
同図に示されるように、LSI500に対してコンデンサーC71、C72は、コンデンサーC81よりも接近して配置されている。
コンデンサーC71、C72は、昇圧回路541において電圧Vddを3倍に昇圧する際に用いるチャージポンプ用のコンデンサーであり、図13Aに示した第1状態と、図13Bに示した第2状態とで交互に切り替えられる。なんら対策が施されない場合、切り替え時にノイズが生じやすい、という問題点が指摘されているが、本実施形態では、コンデンサーC71、C72が、LSI500に近接して配置されるので、プリント回路基板における配線パターンのインピーダンスの影響が軽減されて、回路の安定動作が図られている。
くわえて、LSI500の機能ブロックでみたときに、電圧生成回路543が昇圧回路541の出力電圧を用いる関係上、コンデンサーC71、C72を用いる昇圧回路541と、コンデンサーC81を用いる電圧生成回路543とは、互いに隣り合うような配置となる(後述する)。よって、LSI500にあっては、ベアチップのピンCp1〜Cp4、Psからワイヤボンディングにより引き出されたリードも近接する。したがって、LSI500の周辺ではコンデンサーC71、C72、C81を接近させて配置させる必要がある。
もちろん、LSI500の周辺には、ほかに図10で示したようなコンデンサー、抵抗などの部品が多く配置させる必要がある。このため、本実施形態では、LSI500に対してコンデンサーC71、C72を優先的に近接して配置させ、その次に、コンデンサーC81を配置させて、限られた基板面積での部品の効率的な配置と、回路の安定化との両立を図っているのである。
さて、図において、大四角形状のベアチップ501の縁端には、小四角形状のパッド電極が複数設けられる。パッド電極からQFPのリード(図15参照)までは、ワイヤボンディングによって放射状に接続される。このため、図15におけるQFPのリードの配置は、図16におけるピンの配置を放射と、ほぼ相似となり、同視して良い。
さて、ベアチップ501にあって、四辺のうち一辺に沿った長手の矩形領域に昇圧回路541が設けられ、上記一辺と直交する一方の辺に沿って電圧生成回路543、ゲートドライバー543、544が設けられる。このため、昇圧回路541が関与するピン(リード)Cp1〜Cp4、特にコンデンサーC72の一端が接続されるピンCp4と、電圧生成回路543が関与するピンPsとは互いに隣り合うことになる。
また、ベアチップ501にあって、昇圧回路541が設けられる一辺と対向する辺側には、低振幅の3.3ボルトを電源とするDAC502からNOT回路522までに至る回路PDMが設けられる。回路PDMは、電圧生成回路543、ゲートドライバー543、544に対して隣り合うように設けられる。
なお、ベアチップ501にあって、昇圧回路541が設けられる一辺と直交する他方の辺に沿った長手の矩形領域には、クロックなどの他のロジック信号を生成する回路Lgcが設けられる。
なお、トランジスターM3、M4との接続点(ピンSw)に現れる増幅変調信号は、変調信号Msと論理振幅が異なるだけであるので、例えば増幅変調信号を減衰した上で、変調信号Msと同様に帰還する構成とすれば良い。
昇圧回路541、電圧生成回路543については、図12、図14に示した回路構成以外であっても良いのは、もちろんである。例えば昇圧回路541による昇圧の際には、コンデンサーC71、C72以外のコンデンサーを用いても良い。
実施形態では、2つの駆動回路50によってそれぞれ個別に生成した2系統の駆動信号COM−A、COM−Bを、選択部230によって選択して(または非選択として)、圧電素子60の一端に供給する構成としたが、例えば1系統の駆動信号に例えば4つの台形波形を繰り返させて、データ信号Dataで規定されるドットのサイズに応じて、いずれかを、または、複数組み合わせて、圧電素子60の一端に供給する構成としても良い。
また、駆動回路50の駆動対象として圧電素子60を例にとって説明したが、駆動回路50を印刷装置から切り離して考えてみたときに、駆動対象としては、圧電素子60に限られず、例えば超音波モーターや、タッチパネル、静電スピーカー、液晶パネルなどの容量性成分を有する負荷のすべてに適用可能である。
Claims (6)
- 駆動信号の元となる源信号をパルス変調した変調信号を生成する変調回路と、
少なくとも第1コンデンサーを用いて昇圧した電圧を出力する昇圧回路と、
前記昇圧回路により昇圧された電圧を電源とし、前記変調信号に基づいて制御信号を生成するゲートドライバーと、
前記制御信号に基づいて増幅変調信号を生成するトランジスター対と、
前記増幅変調信号を平滑化して駆動信号を生成するローパスフィルターと、
前記駆動信号が印加されることで変位する圧電素子と、
前記圧電素子の変位により内部容積が変化するキャビティと、
前記キャビティの内部容積の変化に応じて前記キャビティ内の液体を吐出するために設けられたノズルと、
前記圧電素子の駆動信号が印加される電極と異なる電極にオフセット電圧を出力端子から印加する電圧生成回路と、
前記電圧生成回路の出力端子に一端が電気的に接続された第2コンデンサーと、
を備え、
少なくとも前記昇圧回路と前記電圧生成回路とは集積回路に集積され、
前記第1コンデンサーと前記集積回路との距離は、前記第2コンデンサーと前記集積回路との距離より短い
ことを特徴とする液体吐出装置。 - 前記集積回路は、
前記第1コンデンサーに電気的に接続される第1端子と、前記第2コンデンサーに電気的に接続される第2端子と、を有し、
前記第1コンデンサーと前記第1端子との距離は、前記第2コンデンサーと前記第2端子との距離よりも短い
ことを特徴とする請求項1に記載の液体吐出装置。 - 前記第1端子と前記第2端子とは隣り合って位置する
ことを特徴とする請求項2に記載の液体吐出装置。 - 前記集積回路において、前記昇圧回路が形成された領域と前記電圧生成回路が形成された領域とは隣り合っている
ことを特徴とする請求項3に記載の液体吐出装置。 - 前記変調信号の周波数は、1Mz以上8MHz以下である
ことを特徴とする請求項1に記載の液体吐出装置。 - 制御ユニットからの駆動信号が印加されることで変位する圧電素子と、
前記圧電素子の変位により内部容積が変化するキャビティと、
前記キャビティの内部容積の変化に応じて前記キャビティ内の液体を吐出するために設けられたノズルと、
を備えるヘッドユニットであって、
前記制御ユニットは、
当該駆動信号の元となる源信号をパルス変調した変調信号を生成する変調回路と、
少なくとも第1コンデンサーを用いて昇圧した電圧を出力する昇圧回路と、
前記昇圧回路により昇圧された電圧を電源とし、前記変調信号に基づいて制御信号を生成するゲートドライバーと、
前記制御信号に基づいて増幅変調信号を生成するトランジスター対と、
前記増幅変調信号を平滑化して駆動信号を生成するローパスフィルターと、
前記圧電素子の駆動信号が印加される電極と異なる電極にオフセット電圧を出力端子から印加する電圧生成回路と、
前記電圧生成回路の出力端子に一端が電気的に接続された第2コンデンサーと、
を有し、
少なくとも前記昇圧回路と前記電圧生成回路とは集積回路に集積され、
前記第1コンデンサーと前記集積回路との距離は、前記第2コンデンサーと前記集積回路との距離より短い
ことを特徴とするヘッドユニット。
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