JP6301663B2 - 電源制御装置、電源制御方法および情報処理装置 - Google Patents
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Description
図1は、本発明の第1の実施形態に係る電源制御装置100の構成の概要を示す図である。図1に示すように、電源制御装置100は、メインカード(第2の基板)110と、メインカード110に接続される拡張カード(第1の基板)140とを備える。メインカード110は、MOS−FET(metal−oxide−semiconductor field−effect transistor)スイッチ部120と、電源制御演算回路130とを備え、拡張カード140に対して電源供給を行う。
110 メインカード
120 MOS−FETスイッチ部
130 電源制御演算回路
135 電圧フィードバック線
136a、136b MOS−FET制御線
140 拡張カード
145 LSI
1501乃至150n オン/オフ閾値検出回路
1601乃至160n DC−DCコンバータ
Claims (3)
- 供給された電源電圧を所定の電圧に変換し、変換した電圧を負荷に投入する複数のコンバータと、
前記コンバータにそれぞれ接続され、供給された前記電源電圧が閾値に達したことを検出するのに応じて、前記接続されたコンバータを駆動する閾値検出回路と、
前記電源電圧と、前記コンバータからそれぞれ出力される電圧とをモニタして、1の前記コンバータの立ち上がりが完了する時間と、他の前記コンバータの立ち上がりが開始する時間を予測し、前記完了する時間よりも前記開始する時間が遅くなるように、前記他のコンバータに接続された前記閾値検出回路に対する前記電源電圧の供給を制限する演算回路と
を備えた電源制御装置。 - 複数のコンバータにより、供給された電源電圧を所定の電圧に変換し、変換した電圧を負荷に投入し、
閾値検出回路により、供給された前記電源電圧が閾値に達したことを検出するのに応じて、当該閾値検出回路に接続された前記コンバータを駆動し、
演算回路により、前記電源電圧と、前記コンバータからそれぞれ出力される電圧とをモニタして、1の前記コンバータの立ち上がりが完了する時間と、他の前記コンバータの立ち上がりが開始する時間を予測し、前記完了する時間よりも前記開始する時間が遅くなるように、前記他のコンバータに接続された前記閾値検出回路に対する前記電源電圧の供給を制限する
電源制御方法。 - 供給された電源電圧を所定の電圧に変換し、変換した電圧を負荷に投入する複数のコンバータと、前記コンバータにそれぞれ接続され、供給された前記電源電圧が閾値に達したことを検出するのに応じて、前記接続されたコンバータを駆動する閾値検出回路とを含む第1の基板と、
前記第1の基板に接続され、前記電源電圧と、前記コンバータからそれぞれ出力される電圧とをモニタして、1の前記コンバータの立ち上がりが完了する時間と、他の前記コンバータの立ち上がりが開始する時間を予測し、前記完了する時間よりも前記開始する時間が遅くなるように、前記他のコンバータに接続された前記閾値検出回路に対する前記電源電圧の供給を制限する演算回路を含む第2の基板とを備えた電源制御装置
を備えた情報処理装置。
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JP2014014350A JP6301663B2 (ja) | 2014-01-29 | 2014-01-29 | 電源制御装置、電源制御方法および情報処理装置 |
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