JP6173766B2 - 電子内視鏡用プロセッサ、電子内視鏡システムおよび画像処理装置 - Google Patents
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Description
100 電子スコープ
108 CCD
114 メモリ
120 スコープコントローラ
150 スコープ側I/F
200 電子内視鏡用プロセッサ
202 システムコントローラ
206 タイミングコントローラ
220 画像処理ユニット
250 プロセッサ側I/F
251 PLL
252 PLL制御部
253 シリアル/パラレル変換部
300 モニタ
Claims (10)
- 電子内視鏡からLVDS信号を受信するインタフェースを備える電子内視鏡用プロセッサであって、
前記インタフェースは、
前記LVDS信号と位相比較を行って、該LVDS信号にロックするPLLと、
前記PLLを制御するPLL制御部と、
前記LVDS信号をパラレル信号に変換するパラレル変換部と、を有し、
前記PLLは、前記LVDS信号に基づいてウインドウ信号を生成し、
前記PLL制御部は、前記ウインドウ信号のウインドウ位置における前記LVDS信号の立ち上がりのみに基づいて位相比較を行うよう前記PLLを制御するものであり、
前記ウインドウ位置は、前記ウインドウ信号がHighの領域であり、
前記PLL制御部は、前記ウインドウ位置を前記LVDS信号に含まれ得るジッタの影響が少ない位置に設定することを特徴とする、電子内視鏡用プロセッサ。 - 前記PLL制御部は、前記LVDS信号の立ち上がりと前記ウインドウ信号の立ち上がりまたは立下りが一致しないように、前記ウインドウ位置を設定する、請求項1に記載の電子内視鏡用プロセッサ。
- 前記PLL制御部は、前記PLLのロックが外れるまで、前記ウインドウ信号の位相をシフトして、該シフトの回数に基づいて前記ウインドウ位置を設定する、請求項1または2に記載の電子内視鏡用プロセッサ。
- 前記PLL制御部は、(前記シフトの回数×1/2)だけ前記ウインドウ信号の位相をシフトして、前記ウインドウ位置を設定する、請求項3に記載の電子内視鏡用プロセッサ。
- 前記PLL制御部は、前記PLLのロックが外れるまで、前記ウインドウ信号の位相をUP方向にシフトし、前記PLLのロックが外れると、前記ウインドウ信号の位相をDOWN方向にシフトし、再び前記PLLのロックが外れると、(前記DOWN方向へのシフトの回数×1/2)だけ前記ウインドウ信号の位相をUP方向へシフトして、前記ウインドウ位置を設定する、請求項1または2に記載の電子内視鏡用プロセッサ。
- 前記ウインドウ信号は、前記LVDS信号のクロックを異なるデューティー比に変更することによって生成される、請求項1から5のいずれか一項に記載の電子内視鏡用プロセッサ。
- 前記PLL制御部は、前記PLLのダイナミック位相シフトを用いて、前記ウインドウ信号の位相をシフトさせることを特徴とする、請求項2から6のいずれか一項に記載の電子内視鏡用プロセッサ。
- 前記インタフェースは、FPGAで構成されることを特徴とする、請求項1から7のいずれか一項に記載の電子内視鏡用プロセッサ。
- 前記LVDS信号を生成して送信するインタフェースを備える電子内視鏡と、
請求項1から8のいずれか一項に記載の電子内視鏡用プロセッサと、からなる電子内視鏡システム。 - LVDS信号を受信するインタフェースを備える画像処理装置であって、
前記インタフェースは、
前記LVDS信号と位相比較を行って、該LVDS信号にロックするPLLと、
前記PLLを制御するPLL制御部と、
前記LVDS信号をパラレル信号に変換するパラレル変換部と、を有し、
前記PLLは、前記LVDS信号に基づいてウインドウ信号を生成し、
前記PLL制御部は、前記ウインドウ信号のウインドウ位置における前記LVDS信号の立ち上がりのみに基づいて位相比較を行うよう前記PLLを制御するものであり、
前記ウインドウ位置は、前記ウインドウ信号がHighの領域であり、
前記PLL制御部は、前記ウインドウ位置を前記LVDS信号に含まれ得るジッタの影響が少ない位置に設定することを特徴とする、画像処理装置。
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