JP5578915B2 - 固体撮像装置及びその駆動方法 - Google Patents
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Description
図1(A)は、本発明の第1の実施形態に係る固体撮像装置の構成例を示すブロック図である。固体撮像素子1は、画素部11及び画素駆動部12L,12Rを有する。画素部11は、行と列の2次元行列状に配列された複数の画素で構成される。画素駆動部12L,12Rは、画素を駆動する信号、すなわちフォトダイオードに蓄積された電荷を転送するための転送信号や、行列の中から特定の行の画素を選択するための行選択信号などを奇数行と偶数行のそれぞれに対して生成する。画素部11は、各々が光電変換素子(フォトダイオード)の光電変換により画素信号を生成する複数の画素を含む。各画素は、例えば光電変換素子の他に光電変換素子で蓄積された電荷に基づく電圧信号を出力する増幅部を有する、増幅型の画素が考えられる。固体撮像素子1は、奇数行と偶数行の行選択信号を保持するための選択記憶部13L,13R、行カウント値S15に対応する1行を選択する行アドレスデコーダ14L,14R、行アドレス生成部15、タイミング生成部16、行カウンタ制御部18を有する。行アドレス生成部15は、読み出し行カウンタ151、リセット行カウンタA(152)、リセット行カウンタB(153)及びセレクタ150を有する。セレクタ150は、3つの行カウンタ151〜153が出力する行アドレスの内、1つを選択して行カウント値S15として出力する。読み出し行カウンタ151は、画素部11の読み出しの行アドレスを生成する。第1のリセット行カウンタA(152)は、画素部11の奇数フィールド(第1のフィールド)でリセットする行を示す行アドレスを生成する。第2のリセット行カウンタB(153)は、画素部11の偶数フィールド(第2のフィールド)でリセットする行を示す行アドレスを生成する。奇数フィールド及び偶数フィールドは1フレームを構成する。セレクタ150は、読み出し行カウンタ151、リセット行カウンタA(152)及びリセット行カウンタB(153)により生成される行アドレスのうちの1つの行アドレスを選択する。行カウンタ制御部18は、外部のCPUからの通信信号19、垂直同期信号20、水平同期信号21に基づき、3つの行カウンタ151〜153のそれぞれに対し、カウンタスタートパルス等のカウンタ制御信号S1811〜S1813を出力する。行カウンタ制御部18は、行カウンタ151〜153を制御する。行アドレスデコーダ14L,14Rは、セレクタ150によって選択された行アドレスをデコードする。選択記憶部13L,13Rは、行アドレスデコーダ14L,14Rの出力ビットを入力してその状態を記憶する。画素駆動部12L,12Rは、選択記憶部13L,13Rに記憶された出力ビットに対応する行選択信号を出力する。タイミング生成部16は、外部のCPUからの通信信号19、垂直同期信号20、水平同期信号21に基づき、3つの行カウンタ151〜153のうちの1つを選択する行アドレス生成部選択信号S1610を生成する。さらに、タイミング生成部16は、選択記憶部13L,13Rを制御する奇数行と偶数行共通の記憶部制御信号S162と、画素駆動部12L,12Rを制御する画素駆動信号S163L,S163Rを生成する。第1の画素駆動部12Lは、セレクタ150により選択された行アドレスに対応する画素部11の奇数行を選択する。第2の画素駆動部12Rは、セレクタ150により選択された行アドレスに対応する画素部11の偶数行を選択する。第1及び第2の画素駆動部12L、12Rは、対応する選択記憶部13L、13Rの出力と、タイミング生成部16から供給される不図示の信号との論理和や論理積によって画素の動作を制御する構成になっている。固体撮像素子1、タイミング生成部16、行カウンタ制御部18は同一半導体上に集積されていても、されていなくてもかまわない。
次に、本発明の第2の実施形態の固体撮像装置について、第1の実施形態と異なる点を中心に説明する。図1(A)で示した固体撮像装置の構成は本実施形態においても同じであり、かつ行カウンタ制御部18以外の動作は同じである。
Claims (5)
- 光電変換により画素信号を生成する複数の画素が2次元行列状に配列された画素部と、
前記画素部の行を選択する画素駆動部と、を有し、
前記画素駆動部は、
第1のフィールドで読み出される前記画素部の行を走査して前記第1のフィールドで読み出される画素の画素信号を順次リセットし、その後、第2のフィールドで読み出される前記画素部の行を走査して前記第2のフィールドで読み出される画素の画素信号を順次リセットし、その後、前記第1のフィールドの画素の画素信号を順次読み出し、その後、前記第2のフィールドの画素の画素信号を順次読み出す第1の動作モードと、
前記第1のフィールドで読み出される前記画素部の行を走査して前記第1のフィールドで読み出される画素の画素信号を順次リセットし、その後、前記第1のフィールドの画素の画素信号を順次読み出し、その後、前記第2のフィールドで読み出される前記画素部の行を走査して前記第2のフィールドで読み出される画素の画素信号を順次リセットし、その後、前記第2のフィールドの画素の画素信号を順次読み出す第2の動作モードとを備え、
前記第2の動作モードに引き続き前記第1の動作モードが行われる際、前記第2の動作モードにおける前記第2のフィールドの画素の画素信号の読み出しの走査開始は、前記第1の動作モードにおける前記第1のフィールドの画素の画素信号のリセットの走査開始の後、かつ前記第1の動作モードにおける前記第2のフィールドの画素の画素信号のリセットの走査開始の前に行われることを特徴とする固体撮像装置。 - さらに、前記画素部の読み出しの行アドレスを生成する読み出し行カウンタと、
前記画素部の第1のフィールドのリセットの行アドレスを生成する第1のリセット行カウンタと、
前記画素部の前記第1のフィールドに引き続く第2のフィールドのリセットの行アドレスを生成する第2のリセット行カウンタと、
前記読み出し行カウンタ、前記第1のリセット行カウンタ及び前記第2のリセット行カウンタにより生成される行アドレスのうちの1つの行アドレスを選択するセレクタと、
前記読み出し行カウンタ、前記第1のリセット行カウンタ及び前記第2のリセット行カウンタを制御する行カウンタ制御部と、を有し、
前記行カウンタ制御部は、
前記読み出し行カウンタをカウントスタートさせるためのカウントスタートパルスを生成する第1のカウンタスタートパルス生成回路と、
垂直同期信号のタイミングでリセットし、水平同期信号のタイミングでカウントアップする水平同期信号カウンタと、
前記水平同期信号カウンタのカウンタ値に応じて、前記第1のリセット行カウンタをカウントスタートさせるためのカウントスタートパルスを生成する第2のカウンタスタートパルス生成回路と、
前記水平同期信号カウンタのカウンタ値に応じて、前記第2のリセット行カウンタをカウントスタートさせるためのカウントスタートパルスを生成する第3のカウンタスタートパルス生成回路とを有することを特徴とする請求項1記載の固体撮像装置。 - さらに、前記画素部の読み出しの行アドレスを生成する読み出し行カウンタと、
前記画素部の第1のフィールドのリセットの行アドレスを生成する第1のリセット行カウンタと、
前記画素部の前記第1のフィールドに引き続く第2のフィールドのリセットの行アドレスを生成する第2のリセット行カウンタと、
前記読み出し行カウンタ、前記第1のリセット行カウンタ及び前記第2のリセット行カウンタにより生成される行アドレスのうちの1つの行アドレスを選択するセレクタと、
前記読み出し行カウンタ、前記第1のリセット行カウンタ及び前記第2のリセット行カウンタを制御する行カウンタ制御部と、を有し、
前記行カウンタ制御部は、
前記読み出し行カウンタをカウントスタートさせるためのカウントスタートパルスを生成する第1のカウンタスタートパルス生成回路と、
2つの垂直同期信号のタイミング毎にリセットし、水平同期信号のタイミングでカウントアップする第1の水平同期信号カウンタと、
2つの垂直同期信号のタイミング毎かつ前記第1の水平同期信号カウンタに対して1つの垂直同期信号分ずれてリセットし、水平同期信号のタイミングでカウントアップする第2の水平同期信号カウンタと、
前記第1の水平同期信号カウンタのカウンタ値に応じて、前記第1のリセット行カウンタをカウントスタートさせるためのカウントスタートパルスを生成する第2のカウンタスタートパルス生成回路と、
前記第2の水平同期信号カウンタのカウンタ値に応じて、前記第2のリセット行カウンタをカウントスタートさせるためのカウントスタートパルスを生成する第3のカウンタスタートパルス生成回路とを有することを特徴とする請求項1記載の固体撮像装置。 - 1つの読み出し行カウンタと2つのリセット行カウンタを有する行アドレス生成部と、
前記読み出し行カウンタと前記リセット行カウンタを制御する行カウンタ制御部と、
前記行アドレス生成部で生成された行アドレスを選択するセレクタと、
前記セレクタによって選択された行アドレスをデコードする行アドレスデコーダと、
前記行アドレスデコーダの出力ビットを入力してその状態を記憶する記憶部と、
前記記憶部に記憶された出力ビットに対応する行選択信号を出力する画素駆動部とを有し、
前記読み出し行カウンタは、第1のフィールド及び第2のフィールドのインターレース読み出しの行アドレスを生成し、
前記2つのリセット行カウンタは、フィールド読み出し周期に対して短い蓄積時間と長い蓄積時間の2種類の蓄積動作の一方から他方へ切り替わる場合に、前記第1のフィールドと前記第2のフィールドが互いのフィールドの読み出し行を飛び越して行リセットするように行アドレスを生成することを特徴とする固体撮像装置。 - 光電変換により画素信号を生成する複数の画素が2次元行列状に配列された画素部と、
前記画素部の行を選択する画素駆動部と、を有する固体撮像装置の駆動方法であって、
前記画素駆動部は、
第1のフィールドで読み出される前記画素部の行を走査して前記第1のフィールドで読み出される画素の画素信号を順次リセットし、その後、第2のフィールドで読み出される前記画素部の行を走査して前記第2のフィールドで読み出される画素の画素信号を順次リセットし、その後、前記第1のフィールドの画素の画素信号を順次読み出し、その後、前記第2のフィールドの画素の画素信号を順次読み出す第1のステップと、
前記第1のフィールドで読み出される前記画素部の行を走査して前記第1のフィールドで読み出される画素の画素信号を順次リセットし、その後、前記第1のフィールドの画素の画素信号を順次読み出し、その後、前記第2のフィールドで読み出される前記画素部の行を走査して前記第2のフィールドで読み出される画素の画素信号を順次リセットし、その後、前記第2のフィールドの画素の画素信号を順次読み出す第2のステップとを備え、
前記第2のステップに引き続き前記第1のステップが行われる際、前記第2のステップにおける前記第2のフィールドの画素の画素信号の読み出しの走査開始は、前記第1のステップにおける前記第1のフィールドの画素の画素信号のリセットの走査開始の後、かつ前記第1のステップにおける前記第2のフィールドの画素の画素信号のリセットの走査開始の前に行われることを特徴とする固体撮像装置の駆動方法。
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