JP5342690B1 - クロック再生装置及び方法 - Google Patents
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Abstract
【解決手段】クロック生成装置において、クライアントクロックを固定分周した分周信号との位相差を比較する位相比較器(24)に対して、クライアントデータを蓄積するFIFOの使用量に応じてイネーブル信号の周期のイネーブル期間中のラインクロック信号を増減したクロックを分周した分周信号が入力されるようにして、クライアントクロック生成回路(20)が、FIFOの使用量が多いときには周波数の高いクライアントクロックを出力し、FIFOの使用量が少ないときには周波数の低いクライアントクロックを出力するようにした。
【選択図】図1
Description
12 イネーブル信号生成回路
14 分周クロック生成回路
15 デマッピングFIFO(メモリ)
16 ライトアドレスカウンタ
17 リードアドレスカウンタ
20 クライアントクロック生成回路
22 分周クロック生成回路(クライアントクロック分周回路)
24 位相比較回路
26 ローパスフィルタ(平滑回路)
30 FIFO偏り補正回路
40 クロック再生回路
50 クロック再生回路
Claims (4)
- データ量Lのラインデータ中に複数階層フレームで多段にフレーム化された形式で伝送されたデータ量Cのクライアントデータのクロックを生成するクロック再生装置であって、
前記クライアントデータを一時的に格納する格納手段と、
前記格納手段の格納領域における前記クライアントデータのライトアドレス及びリードアドレスを生成するアドレス生成手段と、
クライアントクロックを生成するクライアントクロック生成手段と、
前記クライアントクロックを固定分周数で分周した第1の分周クロックを出力する第1の分周クロック生成手段と、
ラインクロック信号、前記ラインデータの前記データ量L及び前記クライアントデータの前記データ量Cを入力として、ラインクロックのC/Lに相当するイネーブル信号を生成するイネーブル信号生成手段と、
前記ライトアドレス及び前記リードアドレスに基づいて前記格納領域の使用量を決定し、当該使用量に応じた値に相当するクロック分を前記イネーブル信号の周期のイネーブル期間中のラインクロック信号のクロック数に増減して出力する偏り補正手段と、
前記偏り補正手段から出力された信号を分周した第2の分周クロックを出力する第2の分周クロック生成手段と、
前記第1の分周クロックと前記第2の分周クロックとの位相差に応じた位相差信号を出力する位相比較手段と、
前記位相差信号を平滑化して前記クライアントクロック生成手段へ出力する平滑化手段と
を備えたことを特徴とするクロック再生装置。 - 前記偏り補正手段は、前記格納領域の使用量が多いとき程、前記イネーブル信号の周期のイネーブル期間中のラインクロック信号のクロック数に前記クロック分を増加し、前記格納領域の使用量が少ないとき程、前記イネーブル信号の周期のイネーブル期間中のラインクロック信号のクロック数から前記クロック分を減少することを特徴とする請求項1に記載のクロック再生装置。
- データ量Lのラインデータ中に複数階層フレームで多段にフレーム化された形式で伝送されたデータ量Cのクライアントデータのクロックを再生する方法であって、
前記クライアントデータを一時的に格納手段により格納することと、
アドレス生成手段により前記格納手段の格納領域における前記クライアントデータのライトアドレス及びリードアドレスを生成することと、
クライアントクロック生成手段により生成されたクライアントクロックを、第1の分周クロック生成手段により固定分周数で分周して第1の分周クロックを生成することと、
イネーブル信号生成手段により、ラインクロック信号、前記ラインデータの前記データ量L及び前記クライアントデータの前記データ量Cを入力として、生成されたラインクロックのC/Lに相当するイネーブル信号を生成することと、
偏り補正手段により前記ライトアドレス及び前記リードアドレスに基づいて前記格納領域の使用量を決定し、当該格納領域の使用量に応じた値に相当するクロック分を前記イネーブル信号の周期のイネーブル期間中のラインクロック信号のクロック数に増減して出力することと、
第2の分周クロック生成手段により前記偏り補正手段から出力された信号を分周した第2の分周クロックを生成することと、
位相比較手段により前記第1の分周クロックと前記第2の分周クロックとの位相差に応じた位相差信号を出力することと、
平滑化手段により前記位相差信号を平滑化して前記クライアントクロック生成手段へ出力することと
を備えることを特徴とする方法。 - 前記クロック分を前記イネーブル信号の周期のイネーブル期間中のラインクロック信号のクロック数に増減することは、前記格納領域の使用量が多いとき程、前記イネーブル信号の周期のイネーブル期間中のラインクロック信号のクロック数に前記クロック分を増加し、前記格納領域の使用量が少ないとき程、前記イネーブル信号の周期のイネーブル期間中のラインクロック信号のクロック数から前記クロック分を減少することを含むことを特徴とする請求項3に記載の方法。
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JP2008092414A (ja) * | 2006-10-04 | 2008-04-17 | Nippon Telegr & Teleph Corp <Ntt> | フレームマッピング方法および回路 |
JP2009130507A (ja) * | 2007-11-21 | 2009-06-11 | Hitachi Communication Technologies Ltd | 通信装置、及びそのシステムクロック制御方法 |
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