JP5266412B2 - マルチコアプロセッサを有する数値制御装置システム - Google Patents
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Description
請求項2に係る発明は、前記数値制御用プロセッサを前記マルチコアプロセッサのコアに割り当てることを特徴とする請求項1に記載の数値制御装置システムである。
請求項3に係る発明は、前記数値制御装置は、さらに、前記機械へのDI/DO信号を制御しまた前記数値制御部とデータのやり取りを行うプログラマブル・マシン・コントローラ用プロセッサを有し、そのプログラマブル・マシン・コントローラ用プロセッサを前記マルチコアプロセッサのコアに割り当てたことを特徴とする請求項1または2のいずれか一つに記載の数値制御装置システムである。
請求項5に係る発明は、前記モータ制御用プロセッサは、前記数値制御装置システムの制御軸数と1つのコアプロセッサが処理可能な軸数によって決まる最小の数量のコアプロセッサを有することを特徴とする請求項1乃至4のいずれか一つに記載の数値制御装置システムである。
請求項6に係る発明は、前記マルチコアプロセッサと前記アンプインタフェース部との接続がシリアル通信であることを特徴とする請求項1乃至5にいずれか一つに記載の数値制御装置システムである。
請求項7に係る発明は、前記シリアル通信がPCIExpress、HyperTransport、RapidIOのいずれか一つであることを特徴とする請求項6に記載の数値制御装置システムである。
数値制御装置1は工作機械や産業用機械などの機械に備わったモータ(図示せず)を制御する。数値制御装置1は、数値制御部10、PMC部20、アンプインタフェース部30、モータ制御部40、及びメモリ等部50を備える。数値制御部10、PMC部(プログラマブル・マシン・コントローラ部)20、アンプインタフェース部30、及びメモリ等部50はローカルバス60により相互に接続されている。なお、ここで、メモリ等部50とは、図1に示されるように、ROM、232Cインタフェース、DI/DO回路、その他のオプション回路を総称したものである。
なお、高速シリアル通信は、PCIExpress、HyperTransport、RapidIO というような規格のものを用いることができるが、これらの規格に限定されるものではない。
機械に備わったモータの数が少ない、つまり、制御軸数が少ない場合、制御軸数が少ない低価格の数値制御装置が用いられる。モータ制御に必要となるCPUの数が少ないため、数値制御部とPMC部とモータ制御部とをマルチコアCPUに統合することが可能となる。
プロセッサであるCPU111は、ROM112に格納されたシステムプログラムに従って数値制御装置1の全体を制御する。RAM113には各種のデータあるいは入出力信号が格納される。不揮発性メモリ114に格納された各種のデータは電源切断後もそのまま保存される。グラフィック制御回路115はデジタル信号を表示用の信号に変換して表示装置116に与える。キーボード117は、数値キー、文字キーなどを有する各種設定データを入力する手段である。
2 数値制御装置
10 数値制御部
11 CPU
12 DRAM
13 バスブリッジ
20 PMC部
21 CPU
22 DRAM
23 バスブリッジ
30 アンプインタフェース部
33 通信制御兼バスブリッジ
40 モータ制御部
41 マルチコアDSP
42 DRAM
43 FROM
50 メモリ等部
60 ローカルバス
70 インタフェース
90 数値制御部/モータ制御部/PMC部
91 マルチコアCPU
92 DRAM
93 FROM
100 モータ駆動用アンプ
Claims (7)
- 機械に備わったモータを駆動するモータ駆動用アンプとそのモータ駆動用アンプと通信で接続された数値制御装置とから構成される数値制御システムであって、
前記数値制御装置は、
移動指令を出力する数値制御用プロセッサと、
前記数値制御用プロセッサからの移動指令に基づいて前記モータを駆動する指令を出力するモータ制御用プロセッサと、
前記モータ制御用プロセッサからの指令に基づいて前記モータを駆動する前記モータ駆動用アンプの通信インタフェースと、
前記数値制御用プロセッサと前記モータ制御用プロセッサと接続するアンプインタフェース部とを備え、
前記モータ制御用プロセッサは、マルチコアプロセッサであることを特徴とする数値制御装置システム。 - 前記数値制御用プロセッサを前記マルチコアプロセッサのコアに割り当てることを特徴とする請求項1に記載の数値制御装置システム。
- 前記数値制御装置は、さらに、前記機械へのDI/DO信号を制御しまた前記数値制御部とデータのやり取りを行うプログラマブル・マシン・コントローラ用プロセッサを有し、
そのプログラマブル・マシン・コントローラ用プロセッサを前記マルチコアプロセッサのコアに割り当てたことを特徴とする請求項1または2のいずれか一つに記載の数値制御装置システム。 - 前記モータ制御用プロセッサであるマルチコアプロセッサの各コアに、制御する軸を割り当てたことを特徴とする請求項1乃至3のいずれか一つに記載の数値制御装置システム。
- 前記モータ制御用プロセッサは、前記数値制御装置システムの制御軸数と1つのコアプロセッサが処理可能な軸数によって決まる最小の数量のコアプロセッサを有することを特徴とする請求項1乃至4のいずれか一つに記載の数値制御装置システム。
- 前記マルチコアプロセッサと前記アンプインタフェース部との接続がシリアル通信であることを特徴とする請求項1乃至5にいずれか一つに記載の数値制御装置システム。
- 前記シリアル通信がPCIExpress、HyperTransport、RapidIOのいずれか一つであることを特徴とする請求項6に記載の数値制御装置システム。
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