JP5233300B2 - 放電装置 - Google Patents
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Description
図5は、従来の放電装置の装置構成を示した図である。
図5に示すように、従来の放電装置は、第1の半導体スイッチS1をスイッチ、第2の半導体スイッチS2をダイオードとして使用している。第1の半導体スイッチS1をオンにすると、入力電圧Vin→第1の半導体スイッチS1→コイルLのループ(第1のループ)で電流ILが流れる。
図6に示すように、コイルLの電流IL及び放電抵抗Rの電流Irの波形が検出されるとき、第1の半導体スイッチS1の両端にかかる電圧VS1は、第1の半導体スイッチS1がオンで、第2の半導体スイッチS2がオフの時にはVS1=0であり、第1の半導体スイッチS1がオフで、第2の半導体スイッチS2がオフの時にはVS1=Vin+Ir×Rとなっている。
少なくとも第1の半導体スイッチと、コイルと、電池又はキャパシタとからなる第1のループと、少なくとも第2の半導体スイッチと、前記コイルと、放電抵抗とからなる第2のループとにより構成される放電装置において、
前記第1の半導体スイッチ及び前記第2の半導体スイッチの両端電圧(V SW )を検出する電圧検出器と、
前記コイルを流れる電流(IL)を検出する電流検出器と、
前記電圧検出器で検出された前記両端電圧(V SW )と、前記電流検出器で検出された前記電流(IL)とに基づいて、前記第1の半導体スイッチの両端電圧が所定の設定値以下になるよう制御する放電制御手段とを備える
ことを特徴とする。
前記放電制御手段は、
前記コイルに流れる電流を一定に制御する電流制御手段と、
前記両端電圧(V SW )が設定値(V SET )より小さいときは出力は0であり、前記両端電圧(V SW )が前記設定値(V SET )より大きいときは、前記両端電圧(V SW )の増大に比例して出力も増大する出力特性の電圧垂下手段と、
PWM手段とを備え、
前記電圧垂下手段において検出された前記両端電圧(VSW)が前記設定値(V SET )より大きいとき、前記電流(IL)を減少させて前記第1の半導体スイッチの両端電圧が設定値以下となるように前記PWM手段によりPWMを行い、前記第1の半導体スイッチのゲートへ出力して、前記第1の半導体スイッチのオン/オフ比を制御する
ことを特徴とする。
前記放電制御手段は、
前記第1の半導体スイッチの両端電圧を一定に制御する電圧制御手段と、
前記電流(IL)が設定値(I SET )より小さいときは出力は0であり、前記電流(IL)が設定値(I SET )より大きいときは、前記電流(IL)の増大に比例して出力も増大する出力特性の電流垂下手段と、
PWM手段とを備え、
前記電流垂下手段において検出された前記電流(IL)が前記設定値(I SET )より大きいとき、前記両端電圧(V SW )を減少させて前記第1の半導体スイッチの両端電圧が設定値以下となるように前記PWM手段によりPWMを行い、第1の半導体スイッチのゲートへ出力して、第1の半導体スイッチのオン/オフ比を制御する
ことを特徴とする。
図1は、本実施例に係る放電装置における放電制御手段の制御ブロックを示した図である。
図1に示すように、本実施例に係る放電装置における放電制御手段は、電流ILを一定に制御する電流制御AMP(アンプ)10(電流制御手段)と、第1の半導体スイッチS1の両端電圧が設定値以上になると動作する電圧垂下AMP11(電圧垂下手段)とを備えている。
図2に示すように、本実施例に係る電圧垂下AMP11の出力特性は、電圧VSWが設定値Vsetより小さいときは出力は0であり、電圧VSWが設定値Vsetより大きいときは、電圧VSWの増大に比例して出力も増大するようになっている。
これにより、放電装置に耐圧の低い第1の半導体スイッチS1を用い、大きな抵抗値の放電抵抗Rを接続した場合であっても第1の半導体スイッチS1が破損することを防ぐことができる。
図3は、本実施例に係る放電装置における放電制御手段の制御ブロックを示した図である。
図3に示すように、本実施例に係る放電装置における放電制御手段は、第1の半導体スイッチS1の両端電圧を一定に制御する電圧制御AMP20(電圧制御手段)と、電流ILが設定値以上になると動作する電流垂下AMP21(電流垂下手段)とを備えている。
図4に示すように、本実施例に係る電流垂下AMP21の出力特性は、電流ILが設定値Isetより小さいときは出力は0であり、電流ILが設定値Isetより大きいときは、電流ILの増大に比例して出力も増大するようになっている。
これにより、放電装置に耐圧の低い第1の半導体スイッチS1を用い、大きな抵抗値の放電抵抗Rが接続されても第1の半導体スイッチS1が破損することを防ぐことができる。
11 電圧垂下AMP
12 PWM変調手段
13 ゲート
20 電圧制御AMP
21 電流垂下AMP
22 PWM変調手段
23 ゲート
Claims (3)
- 少なくとも第1の半導体スイッチと、コイルと、電池又はキャパシタとからなる第1のループと、少なくとも第2の半導体スイッチと、前記コイルと、放電抵抗とからなる第2のループとにより構成される放電装置において、
前記第1の半導体スイッチ及び前記第2の半導体スイッチの両端電圧(V SW )を検出する電圧検出器と、
前記コイルを流れる電流(IL)を検出する電流検出器と、
前記電圧検出器で検出された前記両端電圧(V SW )と、前記電流検出器で検出された前記電流(IL)とに基づいて、前記第1の半導体スイッチの両端電圧が所定の設定値以下になるよう制御する放電制御手段とを備える
ことを特徴とする放電装置。 - 前記放電制御手段は、
前記コイルに流れる電流を一定に制御する電流制御手段と、
前記両端電圧(V SW )が設定値(V SET )より小さいときは出力は0であり、前記両端電圧(V SW )が前記設定値(V SET )より大きいときは、前記両端電圧(V SW )の増大に比例して出力も増大する出力特性の電圧垂下手段と、
PWM手段とを備え、
前記電圧垂下手段において検出された前記両端電圧(VSW)が前記設定値(V SET )より大きいとき、前記電流(IL)を減少させて前記第1の半導体スイッチの両端電圧が設定値以下となるように前記PWM手段によりPWMを行い、前記第1の半導体スイッチのゲートへ出力して、前記第1の半導体スイッチのオン/オフ比を制御する
ことを特徴とする請求項1に記載の放電装置。 - 前記放電制御手段は、
前記第1の半導体スイッチの両端電圧を一定に制御する電圧制御手段と、
前記電流(IL)が設定値(I SET )より小さいときは出力は0であり、前記電流(IL)が設定値(I SET )より大きいときは、前記電流(IL)の増大に比例して出力も増大する出力特性の電流垂下手段と、
PWM手段とを備え、
前記電流垂下手段において検出された前記電流(IL)が前記設定値(I SET )より大きいとき、前記両端電圧(V SW )を減少させて前記第1の半導体スイッチの両端電圧が設定値以下となるように前記PWM手段によりPWMを行い、第1の半導体スイッチのゲートへ出力して、第1の半導体スイッチのオン/オフ比を制御する
ことを特徴とする請求項1に記載の放電装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2008025869A JP5233300B2 (ja) | 2008-02-06 | 2008-02-06 | 放電装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2008025869A JP5233300B2 (ja) | 2008-02-06 | 2008-02-06 | 放電装置 |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2009189142A JP2009189142A (ja) | 2009-08-20 |
JP5233300B2 true JP5233300B2 (ja) | 2013-07-10 |
Family
ID=41071827
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2008025869A Active JP5233300B2 (ja) | 2008-02-06 | 2008-02-06 | 放電装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP5233300B2 (ja) |
Family Cites Families (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH03120686U (ja) * | 1990-03-20 | 1991-12-11 | ||
JPH05211764A (ja) * | 1991-06-12 | 1993-08-20 | Toshiba Corp | チョッパ回路 |
-
2008
- 2008-02-06 JP JP2008025869A patent/JP5233300B2/ja active Active
Also Published As
Publication number | Publication date |
---|---|
JP2009189142A (ja) | 2009-08-20 |
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