JP5201741B2 - 汎用ブロックと専用リソースブロックを備えるテストモジュール - Google Patents
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Description
201 被試験装置(DUT)
202 集中制御装置
203 テストデバイス
204 制御インタフェース
205 被試験装置インタフェース
206、210 テストモジュール(デジタル波形生成モジュール)
211 テストモジュール(アナログ波形生成モジュール)
212 テストモジュール(電力供給モジュール)
213 汎用セクション
214 専用セクション
Claims (21)
- 被試験装置(201)をテストする試験装置(200)のためのテストモジュール(206)であって、前記テストモジュール(206)は特定のテストファンクションを実行するように構成され、
前記テストモジュール(206)の前記テストファンクションに限定されないテストリソースを提供するように構成され、前記試験装置(200)の集中制御装置(202)に接続されるように構成された制御インタフェース(204)を備える汎用セクション(213)であって、
前記被試験装置(201)のテストにおいて少なくとも1つのテストパターンを記憶するように構成された第1の記憶部(300)と、
前記被試験装置(201)への刺激信号の印加に応じて前記被試験装置(201)により生成される応答信号に比較される一組の予測値を記憶するように構成された第2の記憶部(303)と、
前記被試験装置(201)への刺激信号の印加に応じて前記被試験装置(201)により生成される応答信号と一組の予測値との比較がもたらす一組の結果値を記憶するように構成された第3の記憶部(304)と、
を備える、汎用セクション(213)と、
前記汎用セクション(213)に結合され且つ前記テストモジュール(206)の前記テストファンクションに限定されたテストリソースを提供するように構成された専用セクション(214)であって、
前記被試験装置(201)に接続されるように構成された被試験装置インタフェース(205)と、
前記専用セクション(214)と前記汎用セクション(213)との間を移動する信号を変換するように構成された変換部(401)と、
を備える、専用セクション(214)と、
を備えることを特徴とするテストモジュール(206)。 - 前記第1の記憶部(300)、前記第2の記憶部(303)、及び前記第3の記憶部(304)は、論理的には別々のメモリ部分であり、物理的には単一の共有の記憶装置として実装されること、を特徴とする請求項1に記載のテストモジュール(206)。
- 前記汎用セクション(213)は、前記専用セクション(214)を制御するように構成されたプロセッサユニット(305)を備えること、を特徴とする請求項1に記載のテストモジュール(206)。
- テストデバイス(203)の収容部のスロットに着脱可能な状態で挿入されるカートリッジとして構成されること、を特徴とする上記の請求項のいずれか一項に記載のテストモジュール(206)。
- 前記汎用セクション(213)と前記専用セクション(214)は、2つの別々の筐体内に収容される2つの物理的に別々のコンポーネントと、共通の筐体内に収容される1つの物理的に共通のコンポーネントと、2つの別々のソフトウェアコンポーネントとからなる群の1つであること、
を特徴とする上記の請求項のいずれか一項に記載のテストモジュール(206)。 - 前記変換部(401)は汎用信号と専用信号とを変換するように構成されること、を特徴とする上記の請求項のいずれか一項に記載のテストモジュール(206)。
- 前記変換部(401)はプログラマブルロジックユニットを備えること、を特徴とする上記の請求項のいずれか一項に記載のテストモジュール(206)。
- 前記変換部(401)はフィールドプログラマブルゲートアレイと、プログラマブルロジックデバイスと、特定用途向けの集積回路とからなる群の少なくとも1つを備えること、を特徴とする上記の請求項のいずれか一項に記載のテストモジュール(206)。
- 記憶装置、DRAM記憶装置、論理回路、電気回路、集積回路、プロセッサ、システムオンチップ、スマートカード、トランスポンダ、及びハイブリッド回路とからなる群の被試験装置(201)をテストするように構成されること、
を特徴とする上記の請求項のいずれか一項に記載のテストモジュール(206)。 - デジタル波形生成モジュール(206乃至210)、アナログ波形生成モジュール(211)、電力供給モジュール(212)、無線周波テスト信号生成モジュール、及び直流テスト信号生成モジュールからなる群の1つとして構成されること、
を特徴とする上記の請求項のいずれか一項に記載のテストモジュール(206)。 - 被試験装置(201)をテストする試験装置(200)のためのテストデバイス(203)であって、前記テストデバイス(203)は、
複数のテストモジュール(206乃至212)を収容するように構成された収容部と、
前記収容部に収容される上記の請求項のいずれか一項に記載の複数のテストモジュール(206乃至212)とを備えること、
を特徴とするテストデバイス(203)。 - 前記汎用セクション(213)は前記複数のテストモジュール(206乃至212)の各々につき同じであること、を特徴とする請求項11に記載のテストデバイス(203)。
- 前記汎用セクション(213)は前記複数のテストモジュール(206乃至212)の各々につき同様にプログラムされる、または同様にプログラム可能であること、
を特徴とする請求項11または12に記載のテストデバイス(203)。 - 前記専用セクション(214乃至220)は前記複数のテストモジュール(206乃至212)の少なくとも一部で異なること、を特徴とする請求項11から13のいずれか一項に記載のテストデバイス(203)。
- 前記専用セクション(214乃至220)は前記複数のテストモジュール(206乃至212)の各々につき各様にプログラムされる、または各様にプログラム可能であること、
を特徴とする請求項11から14のいずれか一項に記載のテストデバイス(203)。 - 被試験装置(201)をテストする試験装置(200)であって、
前記試験装置(200)は、
前記被試験装置(201)のテストにおいて実行すべきテストを集中的に制御する集中制御装置(202)と、
請求項11から15のいずれか一項に記載のテストデバイス(203)とを備え、
前記テストデバイス(203)の前記収容部に収容される前記複数のテストモジュール(206乃至212)の前記制御インタフェース(204)は、前記集中制御装置(202)に接続されること、
を特徴とする試験装置(200)。 - 被試験装置(201)をテストする試験装置(200)のためのテストデバイス(203)を構成する方法であって、
前記方法は、
請求項1から10のいずれか一項に記載の複数のテストモジュール(206乃至212)を前記テストデバイス(203)の収容部に挿入することと、
前記被試験装置(201)をテストする特定のテストに従い前記複数のテストモジュール(206乃至212)の少なくとも2つの前記汎用セクション(213)を少なくとも部分的に同時に構成することを備えること、
を特徴とする方法。 - 前記被試験装置(201)をテストする前記特定のテストに従い前記複数のテストモジュール(206乃至212)の少なくとも2つの前記専用セクション(214乃至220)を順次構成することをさらに備えること、
を特徴とする請求項17に記載の方法。 - 前記少なくとも2つの前記汎用セクション(213)を少なくとも部分的に同時に構成することが、特定のテストルーチンを指定することを含むこと、
を特徴とする請求項17または18に記載の方法。 - 前記少なくとも2つの前記汎用セクション(213)を構成することが、少なくとも2つの前記汎用セクション(213)で特定のテストルーチンのためのパラメータ値を順次指定することを含むこと、
を特徴とする請求項17から19のいずれか一項に記載の方法。 - 前記複数のテストモジュール(206乃至212)の少なくとも2つの前記汎用セクション(213)を少なくとも部分的に同時に構成することが、前記複数のテストモジュール(206乃至212)の内、少なくとも2つのテストモジュールの実行を同期することを含むこと、
を特徴とする請求項17から20のいずれか一項に記載の方法。
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