JP5165729B2 - 半導体装置のチップスケールパッケージおよびその製造方法 - Google Patents
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Description
11 基板
12 チップ
13 金属リード線
14 封止用樹脂体
15 接着剤
111 絶縁層
112 ボンディングパッド
113 コンタクト
114 導電体
20 半導体装置のチップスケールパッケージ
21 絶縁基板
22 チップ
23 第1の金属層
24 第2の金属層
25 絶縁層
25’ 絶縁層
26 導電部
27 端部電極
211 貫通開口
2111 第1の開口部
2112 第2の開口部
212 第1の面
213 第2の面
221 第1の電極
222 第2の電極
Claims (22)
- 半導体装置のチップスケールパッケージであって、当該チップスケールパッケージが、
第1の面と、第2の面と、前記第1の面および前記第2の面を貫通する貫通開口とを有し、前記貫通開口が第1の開口部と、第2の開口部とを有する絶縁基板と、
前記絶縁基板の前記第1の面および前記貫通開口の前記第1の開口部上に設けられている第1の金属層と、
第1の電極と、第2の電極とを備え、前記貫通開口内に設けられており、前記第1の電極が前記第1の金属層に電気的に接続されているチップと、
前記絶縁基板の前記第2の面を被覆するとともに、前記貫通開口の前記第2の開口部上を囲むように設けられている絶縁層と、
前記絶縁層および前記第2の開口部上に設けられるとともに、前記第2の電極に電気的に接続されている第2の金属層とを有してなり、
前記絶縁基板における対向する両側辺の一方に、少なくとも1つの第1の導電部と第1の端部電極とを順に積層し、他方に、少なくとも1つの第2の導電部と第2の端部電極とを順に積層したものをさらに備え、
前記第1の導電部が、前記第1の金属層の側面だけでなく、前記第1の金属層の上面にも電気的に接続され、前記第1の端部電極が、前記第1の金属層の側面には直接接続されず、前記第1の金属層の上面に電気的に接続され、
前記第2の導電部が、前記第2の金属層の側面だけでなく、前記第2の金属層の上面にも電気的に接続され、前記第2の端部電極が、前記第2の金属層の側面には直接接続されず、前記第2の金属層の上面に電気的に接続されることを特徴とする半導体装置のチップスケールパッケージ。 - 前記第1の電極と前記第1の金属層との中間に設けられている導電性接着剤をさらに備えたことを特徴とする請求項1に記載の半導体装置のチップスケールパッケージ。
- 前記導電性接着剤が銀ペーストであることを特徴とする請求項2に記載の半導体装置のチップスケールパッケージ。
- 前記絶縁基板の材質が、FR−4基板、酸化アルミニウムセラミックス(Al2O3)、窒化アルミニウム(AlN)、ガラス(Glass)または石英(Quartz)であることを特徴とする請求項1に記載の半導体装置のチップスケールパッケージ。
- 前記第1の金属層の材質が、銀(Ag)、パラジウム(Pd)、アルミニウム(Al)、クロム(Cr)、ニッケル(Ni)、チタン(Ti)、金(Au)、銅(Cu)または白金(Pt)であることを特徴とする請求項1に記載の半導体装置のチップスケールパッケージ。
- 前記第2の金属層の材質が、銀(Ag)、パラジウム(Pd)、アルミニウム(Al)、クロム(Cr)、ニッケル(Ni)、チタン(Ti)、金(Au)、銅(Cu)または白金(Pt)であることを特徴とする請求項1に記載の半導体装置のチップスケールパッケージ。
- 前記絶縁層の材質が、ポリイミド(polyimide)、エポキシ樹脂(epoxy resin)、ベンゾシクロブテン(BCB)または高分子重合体(polymer)であることを特徴とする請求項1に記載の半導体装置のチップスケールパッケージ。
- 前記絶縁層が前記貫通開口内に充填されていることを特徴とする請求項1に記載の半導体装置のチップスケールパッケージ。
- 前記第1及び第2の導電部の材質が銀または銅であることを特徴とする請求項1に記載の半導体装置のチップスケールパッケージ。
- 前記第1及び第2の端部電極の材質がニッケル−スズ合金であることを特徴とする請求項1に記載の半導体装置のチップスケールパッケージ。
- 半導体装置のチップスケールパッケージの製造方法であって、
第1の開口部と第2の開口部とを有する貫通開口を備えた第1の面および第2の面を有する絶縁基板と、第1の電極と第2の電極とを有するチップと、を提供する工程と、
前記絶縁基板の第1の面および前記貫通開口の第1の開口部上に第1の金属層を形成する工程と、
前記チップを前記貫通開口内に配置するとともに、前記第1の電極を前記第1の金属層に電気的に接続する工程と、
絶縁層で前記絶縁基板の第2の面を被覆する工程と、
前記絶縁層および前記第2の開口部上に第2の金属層を形成するとともに、前記第2の金属層を前記第2の電極に電気的に接続する工程と、
前記絶縁基板において対向する両側辺の一方に第1の導電部および第1の端部電極を、他方に第2の導電部および第2の端部電極を、順にそれぞれ形成する工程であって、
前記第1の導電部が、前記第1の金属層の側面だけでなく、前記第1の金属層の上面にも電気的に接続され、前記第1の端部電極が、前記第1の金属層の側面には直接接続されず、前記第1の金属層の上面に電気的に接続され、
前記第2の導電部が、前記第2の金属層の側面だけでなく、前記第2の金属層の上面にも電気的に接続され、前記第2の端部電極が、前記第2の金属層の側面には直接接続されず、前記第2の金属層の上面に電気的に接続されることを特徴とする半導体装置のチップスケールパッケージの製造方法。 - 前記第2の電極が露出するまで前記絶縁層の上層部分を除去する工程をさらに含むことを特徴とする請求項11に記載の半導体装置のチップスケールパッケージの製造方法。
- 前記絶縁層を除去する工程に、ラッピング(Lapping)、ドライエッチング(Dry Etching)またはウエットエッチング(Wet Etching)の工程を採用することを特徴とする請求項12に記載の半導体装置のチップスケールパッケージの製造方法。
- 前記第1及び第2の導電部が、銀または銅を浸着させる工程により形成されることを特徴とする請求項11に記載の半導体装置のチップスケールパッケージの製造方法。
- 前記第1及び第2の端部電極が、ニッケルまたはスズをめっきする工程により形成されることを特徴とする請求項11に記載の半導体装置のチップスケールパッケージの製造方法。
- 前記第1の金属層上に導電性接着剤を塗布して前記第1の電極を接合する工程をさらに含むことを特徴とする請求項11に記載の半導体装置のチップスケールパッケージの製造方法。
- 前記導電性接着剤が銀ペーストであることを特徴とする請求項16に記載の半導体装置のチップスケールパッケージの製造方法。
- 前記絶縁基板の材質が、FR−4基板、酸化アルミニウムセラミックス(Al2O3)、窒化アルミニウム(AlN)、ガラス(Glass)または石英(Quartz)であることを特徴とする請求項11に記載の半導体装置のチップスケールパッケージの製造方法。
- 前記第1の金属層の材質が、銀(Ag)、パラジウム(Pd)、アルミニウム(Al)、クロム(Cr)、ニッケル(Ni)、チタン(Ti)、金(Au)、銅(Cu)または白金(Pt)であることを特徴とする請求項11に記載の半導体装置のチップスケールパッケージの製造方法。
- 前記第2の金属層の材質が、銀(Ag)、パラジウム(Pd)、アルミニウム(Al)、クロム(Cr)、ニッケル(Ni)、チタン(Ti)、金(Au)、銅(Cu)または白金(Pt)であることを特徴とする請求項11に記載の半導体装置のチップスケールパッケージの製造方法。
- 前記絶縁層の材質が、ポリイミド(polyimide)、エポキシ樹脂(epoxy resin)、ベンゾシクロブテン(BCB)または高分子重合体(polymer)であることを特徴とする請求項11に記載の半導体装置のチップスケールパッケージの製造方法。
- 前記絶縁層が前記貫通開口内に充填されていることを特徴とする請求項11に記載の半導体装置のチップスケールパッケージの製造方法。
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