JP5039689B2 - A/d変換装置 - Google Patents
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信号を入力するための入力端子(10a)と、
複数のA/D変換器(12)と、
前記入力端子からの入力信号を前記A/D変換器にそれぞれ入力する信号分配器(11)と、
前記各A/D変換器に対し、サンプリングのための所定周期のクロックを、前記A/D変換器数で前記所定周期を割って得られる時間にほぼ等しい時間差で所定順に且つ循環的に与えるサンプリング制御部(21)と、
前記複数のA/D変換器の1つを基準とし、前記入力端子から前記各A/D変換器の出力端子までのそれぞれの周波数特性と前記入力端子から前記基準のA/D変換器の出力端子までの周波数特性との差の特性を満たすインパルス応答を有するフィルタの係数を予め記憶しているAD特性テーブル(25)と、
前記A/D変換器毎にそれぞれ設けられ、前記複数のA/D変換器によって変換出力されるサンプル値および前記AD特性テーブルに記憶されている係数に基づいて、前記クロックを受けたA/D変換器がサンプル値を更新するタイミングに他のA/D変換器が変換処理をおこなったと仮定して得られるサンプル値をそれぞれ推定する複数の第1の推定手段(22)と、
前記基準のA/D変換器と各A/D変換器の周波数特性の差をそれぞれ相殺する周波数特性を満たすインパルス応答を有するフィルタの係数を予め記憶しているイコライザ係数テーブル(27)と、
前記各第1の推定手段にそれぞれ対応して設けられ、各第1の推定手段の出力値に対して、前記イコライザ係数テーブルに記憶されている係数に基づくフィルタリングをそれぞれ行って、誤差補正された値をそれぞれ出力する複数の第1のイコライザ(23)と、
前記複数の第1のイコライザの出力値を受け、前記各A/D変換器が前記クロックによってサンプリングする順に前記複数の第1のイコライザの出力値を選択して出力する第1の信号切換器(24)と、
前記各第1のイコライザに対応して設けられ、前記AD特性テーブルに記憶されている係数に基づいて、前記第1の信号切換器から出力された信号に対して前記対応する各イコライザと逆の周波数補正処理を行うとともに、該補正処理で得られたデータのうち、前記対応するA/D変換器のサンプリングタイミングのデータを元のサンプル値に入れ換えて出力する複数の第2の推定手段(30)と、
前記各第2の推定手段の出力値に対し、前記入力端子から前記各A/D変換器までの信号経路の周波数特性の差異を補正するための処理を前記イコライザ係数テーブルに記憶された係数に基づいて行う複数の第2のイコライザ(31)と、
前記各第2のイコライザの出力値を受け、前記各A/D変換器が前記クロックによってサンプリングする順に前記複数の第2のイコライザの出力値を選択して出力する第2の信号選択手段(32)とを備えている。
始めに、前記したN個のA/D変換器12のうちの任意のものを基準A/D変換器と定め、各A/D変換器毎に、入力端子からA/D変換器までの入力特性や変換特性およびサンプリング系の位相誤差特性をまとめて周波数特性を算出し、その各周波数特性と基準のA/D変換器についての周波数特性との差を求めて、これをミスマッチ特性と定義する。
hi,u=F−1{Hi *(ω)} ……(2)
gi,k=F−1{Gi *(ω)} ……(3)
ただし、i=0,1,…,N
記号F−1は、離散フーリエ逆変換演算を示す
ただし、i=0,1,…,N−1
記号uΣは、u=−(U−1)〜(U−1)までの総和を示す
記号uΣは、u=−(U−1)〜(U−1)までの総和を示す
J(n)=n−P mod(N)
と表す。
ただし、Kはイコライザのインパルス列の長さを示し、記号kΣは、k=−(K−1)〜K−1までの総和を示す
xJ(n−r),n−r−k
ただし、r≠q×N(q:0,±1,±2,…)
の場合について考察する。
=kΣxJ(n−r),n−r−k・gJ(n−r),k ……(7)
ただし、記号kΣは、k=−(K−1)〜K−1までの総和を示す
ただし、記号uΣは、u=−(U−1)〜U−1までの総和を示す
図2は、上記前提技術に基づく実施形態のインタリーブ方式のA/D変換装置20の構成を示している。
c=a−2 mod(N) ……(11b)
Wi,n=xb,n ……(12a)
とする。
+xa,n・(hi,0/ha,0)
・{(hi,−1/hi,0)−(hb,−1/hb,0)}
+xc,n・(hi,0/hc,0)
・{(hi,1/hi,0)−(hb,1/hb,0)}
……(12b)
e=a−E−a0 mod(N)
の計算により求め、指定信号ADNUMで指定された値aに対してe番目のイコライザ23eの出力結果ye,nを選択して、最終のAD変換結果Y(n)として出力する。
ただし、Hi *(ω)≠0
X1,P=X1,P−1、X2,P=X2,P−1、…、
XN−1,P=XN−1,P−1
となる。
Claims (1)
- 信号を入力するための入力端子(10a)と、
複数のA/D変換器(12)と、
前記入力端子からの入力信号を前記A/D変換器にそれぞれ入力する信号分配器(11)と、
前記各A/D変換器に対し、サンプリングのための所定周期のクロックを、前記A/D変換器数で前記所定周期を割って得られる時間にほぼ等しい時間差で所定順に且つ循環的に与えるサンプリング制御部(21)と、
前記複数のA/D変換器の1つを基準とし、前記入力端子から前記各A/D変換器の出力端子までのそれぞれの周波数特性と前記入力端子から前記基準のA/D変換器の出力端子までの周波数特性との差の特性を満たすインパルス応答を有するフィルタの係数を予め記憶しているAD特性テーブル(25)と、
前記A/D変換器毎にそれぞれ設けられ、前記複数のA/D変換器によって変換出力されるサンプル値および前記AD特性テーブルに記憶されている係数に基づいて、前記クロックを受けたA/D変換器がサンプル値を更新するタイミングに他のA/D変換器が変換処理をおこなったと仮定して得られるサンプル値をそれぞれ推定する複数の第1の推定手段(22)と、
前記基準のA/D変換器と各A/D変換器の周波数特性の差をそれぞれ相殺する周波数特性を満たすインパルス応答を有するフィルタの係数を予め記憶しているイコライザ係数テーブル(27)と、
前記各第1の推定手段にそれぞれ対応して設けられ、各第1の推定手段の出力値に対して、前記イコライザ係数テーブルに記憶されている係数に基づくフィルタリングをそれぞれ行って、誤差補正された値をそれぞれ出力する複数の第1のイコライザ(23)と、
前記複数の第1のイコライザの出力値を受け、前記各A/D変換器が前記クロックによってサンプリングする順に前記複数の第1のイコライザの出力値を選択して出力する第1の信号切換器(24)と、
前記各第1のイコライザに対応して設けられ、前記AD特性テーブルに記憶されている係数に基づいて、前記第1の信号切換器から出力された信号に対して前記対応する各イコライザと逆の周波数補正処理を行うとともに、該補正処理で得られたデータのうち、前記対応するA/D変換器のサンプリングタイミングのデータを元のサンプル値に入れ換えて出力する複数の第2の推定手段(30)と、
前記各第2の推定手段の出力値に対し、前記入力端子から前記各A/D変換器までの信号経路の周波数特性の差異を補正するための処理を前記イコライザ係数テーブルに記憶された係数に基づいて行う複数の第2のイコライザ(31)と、
前記各第2のイコライザの出力値を受け、前記各A/D変換器が前記クロックによってサンプリングする順に前記複数の第2のイコライザの出力値を選択して出力する第2の信号選択手段(32)とを備えたA/D変換装置。
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JP2008317311A JP5039689B2 (ja) | 2008-12-12 | 2008-12-12 | A/d変換装置 |
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JP2008317311A JP5039689B2 (ja) | 2008-12-12 | 2008-12-12 | A/d変換装置 |
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JP6694728B2 (ja) * | 2016-02-18 | 2020-05-20 | 日本電波工業株式会社 | 信号処理装置 |
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2008
- 2008-12-12 JP JP2008317311A patent/JP5039689B2/ja not_active Expired - Fee Related
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