JP4993856B2 - 画像変換装置、画像変換のための直接メモリアクセス装置および画像変換を支援するカメラインターフェース - Google Patents
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Description
図9はX軸ミラー画像を直すための画像変換(X軸ミラー化)でのアドレス変化を図示する。図示したように、X軸ミラー化のためにはワード順序およびワード内のピクセル順序は元の画像と同一に維持され、フレーム開始アドレスおよびライン開始アドレスは変更されなければならないことが分かる。すなわち、アドレス発生手段はフレームの開始が一画像フレームの最後のラインから開始し、一ラインが終われば(一ラインの最後を知らせるEOL信号が発生すれば)フレームの上方に一ラインずつ上がるようにアドレスを発生させなければならない。したがって、X軸ミラー画像の場合、まずアドレス発生手段は画像一フレームの全体アドレス空間で水平一ラインに該当するアドレスを減算してフレーム開始アドレスを設定する。既に処理された一ラインに対するアドレスを勘案して、新しいラインに対する伝送を開始する前に、水平一ラインに対する処理が終わった時点の現在アドレスで水平二ラインに該当するアドレスを減算して新しいライン開始アドレスを設定する。
図10はY軸ミラー画像を直すための画像変換(Y軸ミラー化)でのアドレス変化を図示する。図示したように、Y軸ミラー化のためには一ラインの最後から前方へデータが書き込まれるようにDMAアドレスが設定されなければならない。また。伝送単位、すなわち、バースト伝送長さ内でワード順序およびワード内のピクセル手順が元の画像から逆順にならなければならない。図11はY軸ミラー化において、バースト伝送長さ16での16個のワード順序および各ワード内のピクセル順序変更を概略的に図示する。ワード順序W1〜W16がワード順序W16〜W1にリバースしなければならず、各ワード内でのピクセル順序もリバースしなければならない(例えば、一番目のワードW1内でピクセル順序0〜3がピクセル順序3〜0に変更されなければならない)。
図13はXY軸ミラー画像を直すための画像変換(XY軸ミラー化)でのアドレス変化を図示する。図示したように、XY軸ミラー化のためには一ラインの最後から前方にデータが書き込まれるように、そして画像フレームの最後のラインから上方ラインに行きながらデータが書き込まれるようにDMAアドレスが設定されなければならない。また、伝送単位、すなわち、バースト伝送長さ内でワード順序およびワード内のピクセル手順が元の画像から逆順にならなければならない。
119a,119b DMA装置
201a,201b フェッチ有限状態機械
203a,203b DMA有限状態機械
207a,207b 内部バッファメモリ
209a,209b プロトコル信号発生器
211a,211b アドレス発生手段
213a,213b データ選択手段
223 特殊機能レジスタ(SFR)
Claims (19)
- DMAにバーストアクセスされる画像データを貯蔵するバッファメモリと、
前記バッファメモリに貯蔵された画像データのワード順序および一ワード内のピクセル順序を変更して出力することができるデータ選択手段と、
前記データ選択手段から出力される画像データのためのフレーム開始アドレス、ライン開始アドレス、バースト伝送開始アドレスを発生させるアドレス発生手段とを含み、
前記バッファメモリに貯蔵された画像データは、前記データ選択手段と前記アドレス発生手段とによるアドレス制御によって画像変換され、
Y軸ミラー画像モードの場合、
前記データ選択手段は前記バッファメモリに貯蔵された画像のワード順序およびワード内のピクセル手順をリバースして出力し、
前記アドレス発生手段は、
前記画像データの水平一ラインに該当するアドレス空間でバースト伝送に対応するアドレス空間を加算して前記フレーム開始アドレスを設定し、
バースト伝送を開始する前に現在アドレスから前記バースト伝送および現在実行するバースト伝送の和に対応するアドレス空間を減算して前記バースト伝送開始アドレスを設定し、
前記画像データの水平一ラインに対する処理が終わった時点での現在アドレスで水平二ラインに該当するアドレス空間を加算し、前記画像データの水平一ラインの最後の二度のバースト伝送差に対応するアドレス空間を加算して前記ライン開始アドレスを設定することを特徴とする画像変換装置。 - DMAにバーストアクセスされる画像データを貯蔵するバッファメモリと、
前記バッファメモリに貯蔵された画像データのワード順序および一ワード内のピクセル順序を変更して出力することができるデータ選択手段と、
前記データ選択手段から出力される画像データのためのフレーム開始アドレス、ライン開始アドレス、バースト伝送開始アドレスを発生させるアドレス発生手段とを含み、
前記バッファメモリに貯蔵された画像データは、前記データ選択手段と前記アドレス発生手段とによるアドレス制御によって画像変換され、
XY軸ミラー画像モードの場合、
前記データ選択手段は前記バッファメモリに貯蔵されたワード順序およびワード内のピクセル手順をリバースして出力し、
前記アドレス発生手段は、
前記画像データの一フレームの全体アドレス空間でバースト伝送に対応するアドレス空間を加算して前記フレーム開始アドレスを設定し、
バースト伝送をする前に現在アドレスから前記バースト伝送および現在実行するバースト伝送の和に対応するアドレス空間を減算して前記バースト伝送開始アドレスを設定し、
水平一ラインに対する処理が終わった時点での現在アドレスで一ラインの最後の二度のバースト伝送差に対応するアドレス空間を加算して前記ライン開始アドレスを設定することを特徴とする請求項1に記載の画像変換装置。 - X軸ミラー画像モードの場合、
前記データ選択手段は前記バッファメモリに貯蔵された画像のワード順序およびワード内のピクセル手順を維持して出力し、
前記アドレス発生手段は、
前記画像データの一フレームの全体アドレス空間で水平一ラインに該当するアドレスを減算して前記フレーム開始アドレスを設定し、
前記水平一ラインに対する処理が終わった時点の現在アドレスで水平二ラインに該当するアドレスを減算して新しいライン開始アドレスを設定することを特徴とする請求項1または2に記載の画像変換装置。 - 水平一ラインのピクセル個数が前記バースト伝送長さに該当するピクセル個数の倍数ではない時、前記バースト伝送はメインバースト伝送および残余バースト伝送で分けられて実行され、前記残余バースト伝送は水平一ラインの最後のバースト伝送であることを特徴とする請求項1または2に記載の画像変換装置。
- 前記データ選択手段は、
前記バッファメモリに貯蔵されたワードおよび前記ワードを構成するピクセル手順がリバースされたワードを入力とし、前記バースト伝送長さに対応する個数のピクセル順序変更マルチプレクサと、
前記ピクセル順序変更マルチプレクサの出力ワードを入力として入力された手順、または逆順にワードを出力するワード順序変更マルチプレクサとを含むことを特徴とする請求項1または2に記載の画像変換装置。 - 前記ピクセル順序変更マルチプレクサはモード選択信号に従って前記ワードおよびピクセル手順がリバースされたワードを選択して出力し、
前記ワード順序変更マルチプレクサは0および(前記バースト伝送長さ−1)の間を増加、または減少しながらカウントするカウンタ出力に従って入力ワードを選択して出力することを特徴とする請求項5に記載の画像変換装置。 - DMAにバーストアクセスされる画像データを貯蔵するバッファメモリと、
前記バッファメモリに対するバーストDMAアクセスを制御するDMA制御手段と、
前記DMA制御手段状態を見ながら、前記バッファメモリに貯蔵された画像のワード順序およびワード内のピクセル手順を変更して出力するデータ選択手段と、
前記DMA制御手段状態を見ながら前記データ選択手段の出力画像データのためのフレーム開始アドレス、ライン開始アドレス、バースト伝送開始アドレスを発生させるアドレス発生手段と、
前記DMA制御手段状態およびバス状態を見ながらバス信号を発生させるバスプロトコル信号発生手段とを含み、
前記バッファメモリに貯蔵された画像データは、前記データ選択手段と前記アドレス発生手段とによるアドレス制御によって画像変換され、
Y軸ミラー画像モードの場合、前記アドレス発生手段は前記画像データの水平一ラインに該当するアドレス空間でバースト伝送に対応するアドレス空間を加算して前記フレーム開始アドレスを設定し、バースト伝送を開始する前に現在アドレスから前記バースト伝送および現在実行するバースト伝送の和に対応するアドレス空間を減算して前記バースト伝送開始アドレスを設定し、水平一ラインに対する処理が終わった時点での現在アドレスで水平二ラインに該当するアドレス空間を加算し、水平一ラインの最後の二度のバースト伝送差に対応するアドレス空間を加算して前記ライン開始アドレスを設定することを特徴とする画像変換のためのDMA装置。 - DMAにバーストアクセスされる画像データを貯蔵するバッファメモリと、
前記バッファメモリに対するバーストDMAアクセスを制御するDMA制御手段と、
前記DMA制御手段状態を見ながら、前記バッファメモリに貯蔵された画像のワード順序およびワード内のピクセル手順を変更して出力するデータ選択手段と、
前記DMA制御手段状態を見ながら前記データ選択手段の出力画像データのためのフレーム開始アドレス、ライン開始アドレス、バースト伝送開始アドレスを発生させるアドレス発生手段と、
前記DMA制御手段状態およびバス状態を見ながらバス信号を発生させるバスプロトコル信号発生手段とを含み、
前記バッファメモリに貯蔵された画像データは、前記データ選択手段と前記アドレス発生手段とによるアドレス制御によって画像変換され、
XY軸ミラー画像モードの場合、前記アドレス発生手段は前記画像データの一フレームの全体アドレス空間でバースト伝送に対応するアドレス空間を加算して前記フレーム開始アドレスを設定し、バースト伝送をする前に現在アドレスから前記バースト伝送および現在実行するバースト伝送の和に対応するアドレス空間を減算して前記バースト伝送開始アドレスを設定し、水平一ラインに対する処理が終わった時点での現在アドレスで一ラインの最後の二度のバースト伝送差に該当するアドレス空間を加算して前記ライン開始アドレスを設定することを特徴とする画像変換のためのDMA装置。 - X軸ミラー画像モードの場合、前記アドレス発生手段は前記画像データの一フレームの全体アドレス空間で水平一ラインに該当するアドレス空間を減算して前記フレーム開始アドレスを設定し、水平一ラインに対する処理が終わった時点の現在アドレスで水平二ラインに該当するアドレス空間を減算して新しいライン開始アドレスを設定することを特徴とする請求項7または8に記載の画像変換のためのDMA装置。
- 前記DMA制御手段はDMA伝送状態を表示するDMA有限状態機械と、
色成分に対するDMAアクセス優先権を管掌するチャンネルアービタと、
前記DMA有限状態機械の状態およびチャンネルアービタの状態に従って外部FIFOメモリからデータを持ってくるか否かを制御するフェッチ有限状態機械とを含むことを特徴とする請求項7または8に記載の画像変換のためのDMA装置。 - 前記データ選択手段は、
前記バッファメモリに貯蔵されたワードおよび前記ワードを構成するピクセル手順がリバースされたワードを入力とし、前記バースト伝送長さに対応する個数のピクセル順序変更マルチプレクサと、
前記ピクセル順序変更マルチプレクサの出力ワードを入力として入力された手順または逆順にワードを出力するワード順序変更マルチプレクサとを含み、
前記ピクセル順序変更マルチプレクサはモード選択信号に従って前記ワードおよびピクセル手順がリバースされたワードを選択して出力し、
前記ワード順序変更マルチプレクサは0および(前記バースト伝送長さ−1)の間を増加、または減少しながら、カウントするカウンタ出力に従って入力ワードを選択して出力することを特徴とする請求項7または8に記載の画像変換装置。 - Y軸ミラー画像モード、またはXY軸ミラー画像モードの場合、前記データ選択手段は前記バッファメモリに貯蔵された画像のワード順序およびワード内のピクセル手順をリバースして出力し、
X軸ミラー画像モード、または正常画像モードの場合、前記データ選択手段は前記バッファメモリに貯蔵された画像のワード順序およびワード内のピクセル手順を維持して出力することを特徴とする請求項11に記載の画像変換のためのDMA装置。 - カメラモジュールから受けた画像データをシステムバスにロードして外部フレームメモリに伝達するカメラインターフェースにおいて、
前記カメラモジュールから受けた画像データの前処理を担当する前処理部と、
前記前処理部が出力する画像データのピクセル個数を変更してFIFOメモリに貯蔵する色スケーリング部と、
前記FIFOメモリに貯蔵された画像データを前記システムバスにロードし、画像変換を可能にするDMA装置とを含み、
前記DMA装置は、
前記FIFOメモリから提供された画像データを貯蔵するバッファメモリと、
前記バッファメモリから前記システムバスへのDMAバースト伝送を制御するDMA制御手段と、
前記DMA制御手段状態を見ながら前記バッファメモリに貯蔵された画像データのワード順序およびワード内のピクセル順序を変更して出力するデータ選択手段と、
前記DMA制御手段状態を見ながら前記バッファメモリに貯蔵された画像データを前記外部フレームメモリに貯蔵するためのフレーム開始アドレス、ライン開始アドレス、バースト伝送開始アドレスを変更することができるアドレス発生手段と、
前記DMA制御手段状態および前記システムバス状態を見ながら、バス信号を発生させるバスプロトコル信号発生手段とを含み、
前記バッファメモリに貯蔵された画像データは、前記データ選択手段と前記アドレス発生手段とによるアドレス制御によって画像変換され、
Y軸ミラー画像モードの場合、
前記データ選択手段は前記バッファメモリに貯蔵された画像のワード順序およびワード内のピクセル手順をリバースして出力し、
前記アドレス発生手段は、
前記画像データの水平一ラインに該当するアドレス空間でバースト伝送に対応するアドレス空間を加算して前記フレーム開始アドレスを設定し、
バースト伝送をする前に現在アドレスから前記バースト伝送および現在実行するバースト伝送の和に対応するアドレス空間を減算して前記バースト伝送開始アドレスを設定し、
水平一ラインに対する処理が終わった時点での現在アドレスで水平二ラインに該当するアドレス空間を加算し、一ラインの最後の二度のバースト伝送差に対応するアドレス空間を加算して前記ライン開始アドレスを設定することを特徴とする画像変換を支援するカメラインターフェース。 - カメラモジュールから受けた画像データをシステムバスにロードして外部フレームメモリに伝達するカメラインターフェースにおいて、
前記カメラモジュールから受けた画像データの前処理を担当する前処理部と、
前記前処理部が出力する画像データのピクセル個数を変更してFIFOメモリに貯蔵する色スケーリング部と、
前記FIFOメモリに貯蔵された画像データを前記システムバスにロードし、画像変換を可能にするDMA装置とを含み、
前記DMA装置は、
前記FIFOメモリから提供された画像データを貯蔵するバッファメモリと、
前記バッファメモリから前記システムバスへのDMAバースト伝送を制御するDMA制御手段と、
前記DMA制御手段状態を見ながら前記バッファメモリに貯蔵された画像データのワード順序およびワード内のピクセル順序を変更して出力するデータ選択手段と、
前記DMA制御手段状態を見ながら前記バッファメモリに貯蔵された画像データを前記外部フレームメモリに貯蔵するためのフレーム開始アドレス、ライン開始アドレス、バースト伝送開始アドレスを変更することができるアドレス発生手段と、
前記DMA制御手段状態および前記システムバス状態を見ながら、バス信号を発生させるバスプロトコル信号発生手段とを含み、
前記バッファメモリに貯蔵された画像データは、前記データ選択手段と前記アドレス発生手段とによるアドレス制御によって画像変換され、
XY軸ミラー画像モードの場合、
前記データ選択手段は前記バッファメモリに貯蔵された画像のワード順序およびワード内のピクセル手順をリバースして出力し、
前記アドレス発生手段は、
前記画像データの一フレームの全体アドレス空間でバースト伝送に対応するアドレス空間を加算して前記フレーム開始アドレスを設定し、
バースト伝送をする前に現在アドレスから前記バースト伝送および現在実行するバースト伝送の和に対応するアドレス空間を減算して前記バースト伝送開始アドレスを設定し、
水平一ラインに対する処理が終わった時点での現在アドレスで一ラインの最後の二度のバースト伝送差に対応するアドレス空間を加算して前記ライン開始アドレスを設定することを特徴とする画像変換を支援するカメラインターフェース。 - X軸ミラー画像モードの場合、
前記データ選択手段は前記バッファメモリに貯蔵されたワード順序およびワード内のピクセル手順を維持したまま出力し、
前記アドレス発生手段は、
前記画像データの一フレームの全体アドレス空間で水平一ラインに該当するアドレス空間を減算して前記フレーム開始アドレスを設定し、
水平一ラインに対する処理が終わった時点の現在アドレスで水平二ラインに該当するアドレス空間を減算して新しいライン開始アドレスを設定することを特徴とする請求項13または14に記載の画像変換を支援するカメラインターフェース。 - 前記データ選択手段は、
前記バッファメモリに貯蔵されたワードおよび前記ワードを構成するピクセル手順がリバースされたワードを入力とし、前記バースト伝送長さに対応する個数のピクセル順序変更マルチプレクサと、
前記ピクセル順序変更マルチプレクサの出力ワードを入力として入力された手順、または逆順にワードを出力するワード順序変更マルチプレクサとを含み、
前記ピクセル順序変更マルチプレクサはモード選択信号に従って前記ワードおよびピクセル手順がリバースされたワードを選択して出力し、
前記ワード順序変更マルチプレクサは0および(前記バースト伝送長さ−1)の間を増加、または減少しながらカウントするカウンタ出力に従って入力ワードを選択して出力することを特徴とする請求項13または14に記載の画像変換を支援するカメラインターフェース。 - 前記DMA制御手段はDMA伝送状態を表示するDMA有限状態機械と、
前記DMA有限状態機械の状態を見て前記外部メモリからデータを持ってくるか否かを制御するフェッチ有限状態機械とを含むことを特徴とする請求項16に記載の画像変換を支援するカメラインターフェース。 - 前記DMA制御手段はDMA伝送状態を表示するDMA有限状態機械と、
色成分に対するDMAアクセス優先権を管掌するチャンネルアービタと、
前記DMA有限状態機械の状態およびチャンネルアービタの状態を見て前記外部メモリからデータを持ってくるか否かを制御するフェッチ有限状態機械とを含むことを特徴とする請求項16に記載の画像変換を支援するカメラインターフェース。 - 前記水平一ラインのピクセル個数が前記バースト伝送長さに該当するピクセル個数の倍数ではない時、前記バースト伝送はメインバースト伝送および残余バースト伝送で構成され、前記残余バースト伝送は水平一ラインの最後のバースト伝送であることを特徴とする請求項13または14に記載のカメラインターフェース。
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