JP4802781B2 - 強誘電体メモリ装置の製造方法 - Google Patents
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Description
従来、コンタクトホール内にCVD等によりコンタクトプラグを形成した場合、コンタクトプラグは結晶性の膜として成膜され、CMP等による研磨後も、そのコンタクトプラグ上面は結晶粒毎にそれぞれの面方位に依存した凹凸を有していた。そのため、コンタクトプラグの上方に形成する第1電極の配向性が低下する場合があった。しかしながら、本発明では、コンタクトプラグを形成するコンタクトホールの内面に単一配向性を有する窒化チタン層を形成したため、コンタクトプラグの結晶粒がきめ細かになり、研磨後の当該コンタクトプラグの上面を平坦にすることが可能となったのである。
例えば、窒化チタン層を(100)の面方位に配向制御すると、この表面構造を反映して、コンタクトプラグはエピライクに(100)配向する。この面方位で成長したコンタクトプラグの結晶構造は不明瞭となる。これは、結晶粒がきめ細かになった結果と考えられ、これによりコンタクトプラグ上面の平坦性が増すこととなるのである。
また、強誘電体層としては、例えばチタン酸ジルコン酸鉛(Pb(Zr,Ti)O3、以下PZTと略記)をはじめとするペロブスカイト型酸化物や、SrBi2Ta2O9等のビスマス層状化合物を採用することができる。
図1は、本発明の製造方法を用いて製造された強誘電体メモリ装置100の一実施の形態を模式的に示す断面図である。図1に示すように、強誘電体メモリ装置100は、半導体基板10の上方に、強誘電体キャパシタ30と、プラグ20と、強誘電体キャパシタ30のスイッチングトランジスタ18とを含んで構成されている。なお、本実施形態においては、1T/1C型のメモリセルについて説明するが、本発明が適用されるのは1T/1C型のメモリセルに限定されない。
また、成膜時に、バリア層14の結晶配向を反映した結晶配向を有する第1電極32をバリア層14の上方に形成するためには、バリア層14の膜厚は20nm〜200nmであることが好ましく、さらには50nm〜100nmであることがより好ましい。
なかでも、強誘電体層34の材料としてはPZTが好ましく、この場合、素子の信頼性の観点から、第1電極32はイリジウムであるのがより好ましい。
また、図3に示すように、開口部24の内面にチタン層25を形成し、当該チタン層25の内面に窒化チタン層23を形成するものとしてもよい。これにより、窒化チタン層23の単一配向性を高めることが可能となる。
次に、図1に示した強誘電体メモリ装置100の製造方法の一例について、図面を参照して説明する。図4(a)〜図4(d)、図5(a)〜図5(c)、および図6(a)〜図6(c)は、それぞれ図1の強誘電体メモリ装置100の一製造工程を模式的に示す断面図である。なお、図4〜図6においては、図1の強誘電体メモリ装置100のうち一部構成を省略する場合があり、省略した構成の詳細は図1を参照するものとする。
まず、強誘電体キャパシタ30とトランジスタ18とを接続するコンタクトプラグ20を形成するのに先立って、コンタクトホール24内に単一配向性を具備した窒化チタン層23を形成したため、当該プラグ20の結晶成長モードが変化し、よりきめ細かな結晶粒を得ることができ、ひいては研磨後の当該プラグ20の上面を平坦にすることが可能となった。このようにプラグ20上面の平坦性が増すと、プラグ20の上方に形成される第1電極32の配向性を高めることが可能となり、ひいては強誘電体層34の配向性を高めることが可能となった。その結果、本態様の製造方法により強誘電体特性に優れた強誘電体メモリ装置100を製造することが可能となる。
例えば、図3に示したように開口部24の内面にチタン層25を形成した後、窒化チタン層23を形成するものとしても良い。この場合、チタンは自己配向性に優れ、形成されるチタン層25は(001)面方位に配向性を示し、当該配向したチタン層25の内面に形成される窒化チタン層23は、その結晶構造を反映して(111)面方位に配向することとなる。このような窒化チタン層23の内側にプラグ20を形成した場合も、上記と同様に、当該プラグ20の結晶成長モードが変化し、よりきめ細かな結晶粒を得ることができ、ひいては研磨後の当該プラグ20の上面を平坦にすることが可能となる。
Claims (5)
- 基板に能動素子を形成する工程と、
前記基板上に層間絶縁膜を形成する工程と、
前記層間絶縁膜にコンタクトホールを形成する工程と、
前記コンタクトホールの内側に、前記層間絶縁膜に接するように(100)面方位に単一配向した窒化チタン層を形成する工程と、
前記窒化チタン層の内側に、前記能動素子と電気的に導通するコンタクトプラグを形成する工程と、
前記コンタクトプラグの表面を研磨する工程と、
前記コンタクトプラグの上方に、当該コンタクトプラグと電気的に導通する第1電極を形成する工程と、
前記第1電極上に強誘電体層を形成する工程と、
前記強誘電体層上に第2電極を形成する工程と、
を含むことを特徴とする強誘電体メモリ装置の製造方法。 - 前記コンタクトプラグの表面を研磨した後、当該コンタクトプラグ上にチタン層を形成する工程を含み、当該チタン層の上方に前記第1電極を形成することを特徴とする請求項1に記載の強誘電体メモリ装置の製造方法。
- 前記窒化チタン層を形成する前に、前記コンタクトホールの内面に対してアンモニアプラズマ処理を施すことを特徴とする請求項1又は2に記載の強誘電体メモリ装置の製造方法。
- 前記窒化チタン層を形成する工程において、当該窒化チタン層をロングスロースパッタ法により成膜することを特徴とする請求項1ないし3のいずれか1項に記載の強誘電体メモリ装置の製造方法。
- 前記コンタクトプラグを形成する工程において、当該コンタクトプラグが単一配向性を有して形成されることを特徴とする請求項1ないし4のいずれか1項に記載の強誘電体メモリ装置の製造方法。
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