JP4741886B2 - レギュレータ回路 - Google Patents
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Description
図1は、本発明の第1の実施形態に係るレギュレータ回路の構成を示す回路図である。本発明の第1の実施形態に係るレギュレータ回路は、外部から供給される正の電源電圧VDDを参照電圧VREFに基づいて安定化し、安定化された電源電圧VREGを出力端子から負荷に供給する。
VREG=VREF・(R1+R2)/R2
図2は、本発明の第2の実施形態に係るレギュレータ回路の構成を示す回路図である。本実施形態に係るレギュレータ回路は、外部から供給される負の電源電圧VSSを参照電圧VREFに基づいて安定化し、安定化された電源電圧VREGを出力端子から負荷に供給する。
VREG=−VREF・(R1+R2)/R2
Claims (4)
- 外部から供給される電源電圧を参照電圧に基づいて安定化し、安定化された電源電圧を出力端子から負荷に供給するレギュレータ回路であって、
参照電圧と帰還電圧との間の誤差を増幅する差動増幅手段と、
前記差動増幅手段の出力電圧に従って電流を生成する電流生成手段と、
前記電流生成手段によって生成される電流に従って前記出力端子に電流を供給する第1の出力手段と、
前記電流生成手段によって生成される電流の大きさに従って2つの端子間のインピーダンスが変化する可変インピーダンス手段と、
前記可変インピーダンス手段の1つの端子に接続された入力端子を有し、前記電流生成手段によって生成される電流が増加して前記可変インピーダンス手段の2つの端子間に発生する電圧が所定の値を超えたときに、前記出力端子に電流を供給する第2の出力手段と、
前記出力端子に発生する電圧に基づいて帰還電圧を生成し、該帰還電圧を前記差動増幅手段に入力する帰還手段と、
を具備するレギュレータ回路。 - 前記出力端子から負荷に供給される電流の絶対値が所定の値よりも小さいときに、前記第1の出力手段から供給される電流の絶対値が前記第2の出力手段から供給される電流の絶対値よりも大きく、前記出力端子から負荷に供給される電流の絶対値が所定の値よりも大きいときに、前記第2の出力手段から供給される電流の絶対値が前記第1の出力手段から供給される電流の絶対値よりも大きい、請求項1記載のレギュレータ回路。
- 前記電流生成手段が、ゲートに供給される前記差動増幅手段の出力電圧に従ってドレイン電流を生成する第1のトランジスタを含み、
前記第1の出力手段が、前記第1のトランジスタのドレイン電流がドレイン・ソース間を通過する飽和接続された第2のトランジスタと、前記第2のトランジスタのゲート電位がゲートに供給されることにより前記出力端子にドレイン電流を供給する第3のトランジスタとを含み、
前記可変インピーダンス手段が、一定の電圧がゲート・ソース間に印加され、前記第2のトランジスタを介して前記第1のトランジスタにドレイン電流を供給すると共に、前記第3のトランジスタのドレイン電流の大きさに従ってドレイン・ソース間のインピーダンスが変化する第4のトランジスタを含む、
請求項1又は2記載のレギュレータ回路。 - 前記第2の出力手段が、前記可変インピーダンス手段の2つの端子間に発生する電圧がゲート・ソース間に印加されることによって前記出力端子にドレイン電流を供給するトランジスタを含む、請求項1〜3のいずれか1項記載のレギュレータ回路。
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