JP4720155B2 - 水平同期再生方法および装置 - Google Patents
水平同期再生方法および装置 Download PDFInfo
- Publication number
- JP4720155B2 JP4720155B2 JP2004337019A JP2004337019A JP4720155B2 JP 4720155 B2 JP4720155 B2 JP 4720155B2 JP 2004337019 A JP2004337019 A JP 2004337019A JP 2004337019 A JP2004337019 A JP 2004337019A JP 4720155 B2 JP4720155 B2 JP 4720155B2
- Authority
- JP
- Japan
- Prior art keywords
- circuit
- signal
- sampling
- horizontal
- pulse
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Fee Related
Links
Images
Landscapes
- Synchronizing For Television (AREA)
- Synchronisation In Digital Transmission Systems (AREA)
Description
前記アナログ映像入力を所定のスライスレベルでスライスして、水平同期信号を分離出力し、
前記水平同期信号の立下りに対応する第1サンプリングパルスを生成し、
積分回路に前記水平同期信号を通し、その水平同期信号の立下りに対応する第2サンプリングパルスを生成し、
前記PLL回路の台形波を前記第1サンプリングパルスでサンプルホールドし、
該サンプルホールドされた信号を前記第2サンプリングパルスでリサンプリングし、
前記リサンプリングした信号を前記PLL回路のループフィルタに入力することを特徴とする水平同期再生方法。
前記アナログ映像入力を所定のスライスレベルでスライスして、水平同期信号を分離する同期分離回路と、
第1パルス発生回路及び第2パルス発生回路を有するサンプリング回路と、
台形波発生回路、第1及び第2サンプルホールド回路、及び電圧制御発振器を有するPLL回路とを備え、
前記第1パルス発生回路は、前記水平同期信号の立下りに対応した第1サンプリングパルスを生成し、
前記第2パルス発生回路は、積分回路を有し、当該積分回路に水平同期信号を通した後、その水平同期信号の立下りに対応した第2サンプリングパルスを生成し、
前記第1サンプルホールド回路は、前記第1サンプリングパルスに基づいて前記台形波発生回路が生成した台形波をサンプリングして第1サンプリングホールド信号を生成し、
前記第2サンプルホールド回路は、前記第1サンプリングホールド信号を、前記第2サンプリングパルスでリサンプリングして第2サンプリングホールド信号を生成し、
前記電圧制御発振器は、前記第2サンプリングホールド信号からクロック信号を生成する水平同期再生装置。
該同期分離回路の出力によりそれぞれ第1および第2サンプリングパルスを出力する第1および第2パルス発生回路と、
縦続接続されそれぞれ前記第1および第2サンプリングパルスでサンプリングされる第1および第2サンプルホールド回路と、
該第2サンプルホールド回路の出力および前記第1サンプルホールド回路の入力間に縦続接続されたループフィルタ、電圧制御発振器、同期再生回路および台形波発生回路を含むPLL回路とを備え、
前記同期分離回路は、前記アナログ映像入力を所定のスライスレベルでスライスして、水平同期信号を分離し、
前記第1パルス発生回路は、前記水平同期信号の立下りに対応した第1サンプリングパルスを生成し、
前記第2パルス発生回路は、積分回路を有し、当該積分回路に前記水平同期信号を通した後、その水平同期信号の立下りに対応した第2サンプリングパルスを生成し、
前記第1サンプルホールド回路は、前記第1サンプリングパルスに基づいて前記台形波発生回路が生成した台形波をサンプリングして第1サンプリングホールド信号を生成し、
前記第2サンプルホールド回路は、前記第1サンプリングホールド信号を、前記第2サンプリングパルスでリサンプリングして第2サンプリングホールド信号を生成し、
前記電圧制御発振器は、前記第2サンプリングホールド信号からクロック信号を生成し、
前記同期再生回路から前記アナログ映像入力の水平同期信号に同期した出力信号を得ることを特徴とする水平同期再生装置。
11 同期分離回路
12 第1パルス発生回路
13 第2パルス発生回路
14 台形波発生回路
15 第1サンプルホールド回路
16 第2サンプルホールド回路
17 ループフィルタ
18 VCO
19 同期再生回路
Claims (8)
- アナログ映像入力から同期分離回路により分離された水平同期信号の複数倍に対応する周波数のクロック信号をPLL(Phase Locked Loop)回路を使用して発生する水平同期再生方法において、
前記アナログ映像入力を所定のスライスレベルでスライスして、水平同期信号を分離出力し、
前記水平同期信号の立下りに対応する第1サンプリングパルスを生成し、
積分回路に前記水平同期信号を通し、その水平同期信号の立下りに対応する第2サンプリングパルスを生成し、
前記PLL回路の台形波を前記第1サンプリングパルスでサンプルホールドし、
該サンプルホールドされた信号を前記第2サンプリングパルスでリサンプリングし、
前記リサンプリングした信号を前記PLL回路のループフィルタに入力することを特徴とする水平同期再生方法。 - 前記第2サンプリングパルスは、前記第1サンプリングパルスに対して所定時間遅延させて、前記サンプルホールドされた信号の安定した箇所をリサンプリングすることを特徴とする請求項1に記載の水平同期再生方法。
- 前記第1サンプリングパルスは、前記アナログ映像入力を所定のスライスレベルでスライスして得ることを特徴とする請求項1又は2に記載の水平同期再生方法。
- アナログ映像入力から分離した水平同期信号の複数倍の周波数のクロック信号を発生する同期再生装置において、
前記アナログ映像入力を所定のスライスレベルでスライスして、水平同期信号を分離する同期分離回路と、
第1パルス発生回路及び第2パルス発生回路を有するサンプリング回路と、
台形波発生回路、第1及び第2サンプルホールド回路、及び電圧制御発振器を有するPLL回路とを備え、
前記第1パルス発生回路は、前記水平同期信号の立下りに対応した第1サンプリングパルスを生成し、
前記第2パルス発生回路は、積分回路を有し、当該積分回路に水平同期信号を通した後、その水平同期信号の立下りに対応した第2サンプリングパルスを生成し、
前記第1サンプルホールド回路は、前記第1サンプリングパルスに基づいて前記台形波発生回路が生成した台形波をサンプリングして第1サンプリングホールド信号を生成し、
前記第2サンプルホールド回路は、前記第1サンプリングホールド信号を、前記第2サンプリングパルスでリサンプリングして第2サンプリングホールド信号を生成し、
前記電圧制御発振器は、前記第2サンプリングホールド信号からクロック信号を生成する水平同期再生装置。 - 前記リサンプリングは、前記第1サンプリングパルスより所定時間遅延した前記第2サンプリングパルスにて行なうことを特徴とする請求項4に記載の水平同期再生装置。
- 前記第2サンプリングパルスは、前記積分回路でノイズを低減したパルスであることを特徴とする請求項5に記載の水平同期再生装置。
- 前記第2サンプリングパルスは、アップダウンカウンタを使用して発生することを特徴とする請求項5に記載の水平同期再生装置。
- アナログ映像入力が入力される同期分離回路と、
該同期分離回路の出力によりそれぞれ第1および第2サンプリングパルスを出力する第1および第2パルス発生回路と、
縦続接続されそれぞれ前記第1および第2サンプリングパルスでサンプリングされる第1および第2サンプルホールド回路と、
該第2サンプルホールド回路の出力および前記第1サンプルホールド回路の入力間に縦続接続されたループフィルタ、電圧制御発振器、同期再生回路および台形波発生回路を含むPLL回路とを備え、
前記第1パルス発生回路は、前記水平同期信号の立下りに対応した第1サンプリングパルスを生成し、
前記第2パルス発生回路は、積分回路を有し、当該積分回路に水平同期信号を通した後、その水平同期信号の立下りに対応した第2サンプリングパルスを生成し、
前記第1サンプルホールド回路は、前記第1サンプリングパルスに基づいて前記台形波発生回路が生成した台形波をサンプリングして第1サンプリングホールド信号を生成し、
前記第2サンプルホールド回路は、前記第1サンプリングホールド信号を、前記第2サンプリングパルスでリサンプリングして第2サンプリングホールド信号を生成し、
前記電圧制御発振器は、前記第2サンプリングホールド信号からクロック信号を生成し、
前記同期再生回路から前記アナログ映像入力の水平同期信号に同期した出力信号を得ることを特徴とする水平同期再生装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2004337019A JP4720155B2 (ja) | 2004-11-22 | 2004-11-22 | 水平同期再生方法および装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2004337019A JP4720155B2 (ja) | 2004-11-22 | 2004-11-22 | 水平同期再生方法および装置 |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2006148623A JP2006148623A (ja) | 2006-06-08 |
JP4720155B2 true JP4720155B2 (ja) | 2011-07-13 |
Family
ID=36627782
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2004337019A Expired - Fee Related JP4720155B2 (ja) | 2004-11-22 | 2004-11-22 | 水平同期再生方法および装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP4720155B2 (ja) |
Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS63187874A (ja) * | 1987-01-30 | 1988-08-03 | Nec Corp | 同期結合回路 |
JPH01115275A (ja) * | 1987-10-29 | 1989-05-08 | Sony Corp | 同期回路 |
Family Cites Families (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH01286524A (ja) * | 1988-05-11 | 1989-11-17 | Nec Corp | Pll保護回路 |
-
2004
- 2004-11-22 JP JP2004337019A patent/JP4720155B2/ja not_active Expired - Fee Related
Patent Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS63187874A (ja) * | 1987-01-30 | 1988-08-03 | Nec Corp | 同期結合回路 |
JPH01115275A (ja) * | 1987-10-29 | 1989-05-08 | Sony Corp | 同期回路 |
Also Published As
Publication number | Publication date |
---|---|
JP2006148623A (ja) | 2006-06-08 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
US4791488A (en) | Line-locked clock signal generation system | |
JPH09507015A (ja) | 時間基準補正を用いるテレビジョンデジタル信号処理装置 | |
EP1414248A2 (en) | NCO based timebase recovery system and method for A/V decoder | |
US8233092B2 (en) | Video signal processing device | |
JPH03238973A (ja) | 映像重合せ制御回路 | |
JPH11331639A (ja) | 放送スタジオの同期分配システム及び方法 | |
JP4720155B2 (ja) | 水平同期再生方法および装置 | |
JP2974301B2 (ja) | トリガ生成回路及び波形表示装置 | |
US8368812B2 (en) | PLL loop able to recover a synchronisation clock rhythm comprising a temporal discontinuity | |
EP2186344B1 (en) | Method and device for automatically compensating a phase shift on a synchronisation signal received by an item of remote equipment | |
JPS633577A (ja) | 映像信号処理装置 | |
JP2005080026A (ja) | サンプリングクロック生成回路 | |
JP2529288B2 (ja) | 映像信号サンプリングクロック発生装置 | |
KR100317289B1 (ko) | 디지털 티브이의 동기신호 보정장치 | |
JPH09215005A (ja) | 標本化信号処理装置 | |
JP2002300425A (ja) | デジタル・ビデオ処理回路および方法 | |
JPH0628382B2 (ja) | 垂直同期信号作成回路 | |
JPS625515B2 (ja) | ||
JP2508863B2 (ja) | ペデスタルクランプ回路 | |
JPH10290378A (ja) | クロック発生装置 | |
JP2006211013A (ja) | 同期分離装置 | |
JPH06245219A (ja) | バースト信号処理回路 | |
JPH0379189A (ja) | Hクリアパルス発生装置 | |
JPH08223602A (ja) | 倍速デジタルテレビジョン映像信号処理回路 | |
JPS6229286A (ja) | 走査線位置制御装置 |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A621 | Written request for application examination |
Free format text: JAPANESE INTERMEDIATE CODE: A621 Effective date: 20070911 |
|
RD02 | Notification of acceptance of power of attorney |
Free format text: JAPANESE INTERMEDIATE CODE: A7422 Effective date: 20080219 |
|
RD02 | Notification of acceptance of power of attorney |
Free format text: JAPANESE INTERMEDIATE CODE: A7422 Effective date: 20091211 |
|
RD04 | Notification of resignation of power of attorney |
Free format text: JAPANESE INTERMEDIATE CODE: A7424 Effective date: 20091214 |
|
A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20101221 |
|
A521 | Written amendment |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20110221 |
|
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20110308 |
|
A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20110321 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20140415 Year of fee payment: 3 |
|
R150 | Certificate of patent or registration of utility model |
Free format text: JAPANESE INTERMEDIATE CODE: R150 |
|
LAPS | Cancellation because of no payment of annual fees |