JP4624415B2 - 電子装置 - Google Patents
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Description
ここで、fは周波数、Iはハーネスを流れる電流の絶対値、rはアンテナからの距離をそれぞれ表す。
例えば、配線間隔(d)が1mmのハーネス22に(1)デファレンシャルモード電流および(2)コモンモード電流が同じ量流れていた場合、90MHz(FMバンド)では、Ecomm/Ediff=1.06×103となり、(2)コモンモード電流の方が、約1000倍(60dB)放射効率が良いことがわかる。
C10=C12×1/10(F) ……(4)
C20=C12×1/10(F) ……(5)
G=1.0×108(Ω) ……(6)
Lx=μ×lx/ly(H) ……(7)
Ly=μ×lx/ly(H) ……(8)
K=0.593(for d=1.6mm) ……(9)
Rx=1.0×10−3×lx(Ω) ……(10)
Ry=1.0×10−3×ly(Ω) ……(11)
ここで、εr,ε,μ,dはそれぞれ比誘電率、真空中の誘電率、透磁率、層間距離を表す。また、C12は両プレーン間の容量であり、C10,C20はそれぞれ上層、下層と絶対GNDとの容量を表す。今回の評価では、誘電損失Gおよび抵抗Rは一定の値を用いている。本来、抵抗は表皮効果により周波数に応じて変化する。しかし、問題となる周波数領域(FMバンド)ではインダクタンスLによるリアクタンス成分が抵抗に比べて大きいため、表皮効果を考慮しなくても問題にはないらいと考える。更に、今回のモデルでは、各層のCapacitive Cellと絶対GNDとの容量(C10,C20)も考慮している。この値は、層間容量C12の1/10とした。今回のモデル化の概念図を図13(PEEC法におけるプリント回路基板モデル化の概念図)に示す。また、コモンモード電流の評価には、回路解析ソフトSPICEを用いた。
(1)電流駆動型コモンモード電流
評価に用いたプリント回路基板モデル及びハーネスモデルを図14((a)は第1層の電源配線,(b)は第2層のGND配線,(c)はモデル全体像)に示す。
(2)電圧駆動型コモンモード電流
図22((a)は第1層の電源層,(b)は第2のGND層,(c)はモデル全体像)に、電圧駆動型のコモンモード電流発生メカニズムの検討に用いた評価モデルを示す。本モデルも、実際の車載電子機器を想定し、10cm×10cmの範囲内に収まるモデルとし、層間距離は1.6mmとなっている。また、Unit Cellのサイズは、4.0cm×4.0cmとした。プリント回路基板の第1層は電源層(電源配線26)とし、第2層をGND層とした。GND層29は10cm×10cmのプレーン構造になっており、第1層の一部に、発振回路30の配線を模擬したパターン(発振回路パターン31)を置いた。また、プリント回路基板上のコネクタ25近傍にバイパスコンデンサ(コンデンサC)を実装している。この発振回路パターン31の一部を電圧源32で励振したときのコモンモード電流発生の様子を解析により評価した。本評価モデルの近似的な等価回路を図23(電圧駆動型コモンモード電流評価の近似的な等価回路を示す図)に示す。
〔1〕;電流駆動型コモンモード電流の測定結果
ここでは、電流駆動型で発生するコモンモード電流の測定結果を示す。評価条件であるが、図26に示す評価基板20aにおいて、コネクタ25近傍にコンデンサCを実装し、インダクタ実装パッドは短絡する。このとき、(1)電源配線のみアンバランスパターンを追加、(2)GND配線のみアンバランスパターンを追加、(3)電源及びGND配線にアンバランスパターンを追加したときのコモンモード電流を測定し、電源/GND配線の何れにもアンバランスパターンを追加しなかった場合の測定結果と比較した。
〔2〕;電圧駆動型コモンモード電流の測定結果
ここでは、電圧駆動型で発生するコモンモード電流の測定結果を示す。マイコン搭載基板では、マイコンの動作クロックを生成するため水晶発振子33が実装される。この水晶発振子33では、特定の周波数において絶えず電位変動しており、ここと他の配線パターン(電源/GND配線など)との電界結合により不用意な電位変動が誘起され、この結果、コモンモード電流が発生することが考えられる。
第1及び第2の電源端子を有し、前記第1の電源端子が前記第1の電源配線に接続され、前記第2の電源端子が前記第2の電源配線に接続されたマイクロコンピュータと、
前記第1及び第2の電源配線に接続されたコネクタと、
を有する電子装置であって、
前記第1及び第2の電源配線のうちの何れか一方の電源配線に、前記マイクロコンピュータにおけるインピーダンス誤差を含めて前記第1及び第2の配線のインピーダンス誤差を補正するためのインダクタ素子が直列に接続されている。
〔1〕;バイパスコンデンサ実装法について
ここでは、バイパスコンデンサ実装によるマイコン搭載電子機器のコモンモード電流低減方法について説明する。前述の電流駆動型コモンモード電流発生メカニズム検討において、コモンモード電流はプリント回路基板における電源/GND配線のインピーダンスアンバランスにより発生することがわかった。そこで、ノイズ源であるマイコンから見て、インピーダンスアンバランスの前方若しくは後方の、何れにコンデンサを実装した場合がコモンモード電流発生を低減できるか解析及び実測で検討した。
〔2〕;チップインダクタ実装による配線インピーダンスアンバランス補正法について
ここでは、電源/GND配線にチップインダクタ実装することにより、マイコン搭載電子機器のコモンモード電流発生量を低減する方法について説明する。電流駆動型のコモンモードノイズ発生源であるプリント回路基板配線のインピーダンスアンバランスを、チップインダクタを実装することで補正可能であるから解析及び実測して検討した。
これより、バランスインダクタ実装により、Lvを大きくするとLtotalもこれに比例して増加することがわかる。この結果として、実装するバランスインダクタによりノイズ電流が変化することになる。一方、図39(b)より、電圧駆動型コモンモード電流では、電源とGND配線を電流が互いに同方向に流れる伝送モードでノイズが伝播している。この伝送モードにおけるインピーダンスは、次式となる。
この式より、バランスインダクタ実装で、Lvを大きくした場合(Lv>>Lgの極限でも)、全体のインピーダンスはLgとなり、電圧駆動型の電流伝送モードのインピーダンスは、さほど変化しない。この結果として、バランスインダクタを実装してもノイズ電流はほとんど変化しないことになる。
Claims (9)
- 第1の電源電位が印加される第1の電源配線と、前記第1の電源電位よりも低い第2の電源電位が印加される第2の電源配線とを有する配線基板と、
第1及び第2の電源端子を有し、前記第1の電源端子が前記第1の電源配線に接続され、前記第2の電源端子が前記第2の電源配線に接続されたマイクロコンピュータと、
前記第1及び第2の電源配線に接続されたコネクタと、
第1及び第2の電極を有し、前記第1の電極が前記第1の電源配線と電気的に接続され、前記第2の電極が前記第2の電源配線と電気的に接続されたバイパスコンデンサと、
を含む電子装置であって、
前記マイクロコンピュータの前記第1の電源端子から前記コネクタまでの配線長は、前記マイクロコンピュータの前記第2の電源端子から前記コネクタまでの配線長と異なり、
前記第1及び第2の電源配線のうち、前記マイクロコンピュータの電源端子から前記コネクタまでの配線長が短い方の電源配線に、インダクタ素子が直列に接続され、
前記インダクタ素子は、前記マイクロコンピュータの電源端子と前記バイパスコンデンサとの間において接続され、
前記マイクロコンピュータの電源端子と前記インダクタ素子との間には、ノイズを抑制するためのバイパスコンデンサが、前記第1及び第2の電源配線に並列に接続されていないことを特徴とする電子装置。 - 請求項1に記載の電子装置において、
前記インダクタ素子は、前記第1及び第2の電源配線のうち、前記マイクロコンピュータの電源端子から前記バイパスコンデンサまでの配線長が短い方の電源配線に接続されていることを特徴とする電子装置。 - 請求項1に記載の電子装置において、
前記インダクタ素子は、前記第1及び第2の電源配線のうち、前記マイクロコンピュータの電源端子から前記コネクタまでの配線長が短い方の電源配線に複数接続されていることを特徴とする電子装置。 - 請求項3に記載の電子装置において、
前記インダクタ素子は、前記第1及び第2の電源配線のうち、前記マイクロコンピュータの電源端子から前記バイパスコンデンサまでの配線長が短い方の電源配線に複数接続されていることを特徴とする電子装置。 - 請求項1に記載の電子装置において、
前記第1の電源配線は、前記マイクロコンピュータの電源端子から前記コネクタまでの配線長が第2の電源配線よりも短くなっており、
前記インダクタ素子は、前記第1の電源配線に接続されていることを特徴とする電子装置。 - 請求項1に記載の電子装置において、
前記第1及び第2の電源配線は、前記配線基板の異なる層に形成されていることを特徴とする電子装置。 - 請求項1に記載の電子装置において、
前記第1及び第2の電源配線は、前記配線基板の同一層に形成されていることを特徴とする電子装置。 - 第1の電源電位が印加される第1の電源配線と、前記第1の電源電位よりも低い第2の電源電位が印加される第2の電源配線とを有する配線基板と、
第1及び第2の電源端子を有し、前記第1の電源端子が前記第1の電源配線に接続され、前記第2の電源端子が前記第2の電源配線に接続されたマイクロコンピュータと、
前記第1及び第2の電源配線に接続されたコネクタと、
第1及び第2の電極を有し、前記第1の電極が前記第1の電源配線と電気的に接続され、前記第2の電極が前記第2の電源配線と電気的に接続されたバイパスコンデンサと、
を含む電子装置であって、
前記マイクロコンピュータの前記第1の電源端子から前記コネクタまでの配線長は、前記マイクロコンピュータの前記第2の電源端子から前記コネクタまでの配線長と異なり、
前記第1及び第2の電源配線のうち、前記マイクロコンピュータの電源端子から前記コネクタまでの配線長が短い方の電源配線に、電源配線の一部を蛇行させて形成したインダクタが設けられ、
前記インダクタは、前記マイクロコンピュータの電源端子と前記バイパスコンデンサとの間において設けられ、
前記マイクロコンピュータの電源端子と前記インダクタとの間には、ノイズを抑制するためのバイパスコンデンサが、前記第1及び第2の電源配線に並列に接続されていないことを特徴とする電子装置。 - 第1の電源電位が印加される第1の電源配線と、前記第1の電源電位よりも低い第2の電源電位が印加される第2の電源配線とを有する配線基板と、
第1及び第2の電源端子を有し、前記第1の電源端子が前記第1の電源配線に接続され、前記第2の電源端子が前記第2の電源配線に接続されたマイクロコンピュータと、
前記第1及び第2の電源配線に接続されたコネクタと、
第1及び第2の電極を有し、前記第1の電極が前記第1の電源配線と電気的に接続され、前記第2の電極が前記第2の電源配線と電気的に接続されたバイパスコンデンサと、
を含む電子装置であって、
前記マイクロコンピュータの前記第1の電源端子から前記コネクタまでの配線長は、前記マイクロコンピュータの前記第2の電源端子から前記コネクタまでの配線長と異なり、
前記第1及び第2の電源配線のうち、前記マイクロコンピュータの電源端子から前記コネクタまでの配線の面積が小さい方の電源配線に、インダクタ素子が直列に接続され、
前記インダクタ素子は、前記マイクロコンピュータの電源端子と前記バイパスコンデンサとの間において設けられ、
前記マイクロコンピュータの電源端子と前記インダクタ素子との間には、ノイズを抑制するためのバイパスコンデンサが、前記第1及び第2の電源配線に並列に接続されていないことを特徴とする電子装置。
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