JP4554582B2 - 並列プロセッサ - Google Patents
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さらに、この発明は、前記グローバル制御信号は、ICレイアウトを実現する配線プロセスにおいて、上層配線メタルを使用して配線され、上記任意の単位の複数のプロセッサエレメントのグループ内のバッファ手段に、グローバル制御信号が入力され、このバッファ手段にて生成されるローカル制御信号で任意単位のプロセッサエレメントの機能手段の動作を制御するように構成することができる。
3 プロセッサエレメントブロック
3a プロセッサエレメント
31 レジスタファイル
50 ローカル信号発生部
Claims (2)
- プログラムを解読しプロセッサ全体を制御するプロセッサと、データを処理するプロセッサエレメントを複数個備えて構成されるプロセッサエレメントブロックと、を有する並列プロセッサにおいて、
各プロセッサエレメントは、演算部、レジスタ部を少なくとも備える複数の機能手段を含み、
前記機能手段は、内部バスに接続され、
各機能手段の動作は、前記プロセッサで発生した制御信号の論理により制御され、
前記複数のプロセッサエレメントは、一次元に配列され、制御信号線に沿って任意の単位に分割されるとともに、任意単位のプロセッサエレメントのグループ内それぞれに、前記制御信号のバッファ手段が設けられ、
上記制御信号は、前記バッファ手段に入力され、このバッファ手段にてローカル制御信号が生成され、
生成されたローカル制御信号は、任意単位のプロセッサエレメントのグループに供給され、グループ単位で終端され、
前記制御信号は、全グループのバッファ手段に対して供給されることを特徴とする並列プロセッサ。 - プログラムを解読しプロセッサ全体を制御するプロセッサと、データを処理するプロセッサエレメントを複数個備えて構成されるプロセッサエレメントブロックと、を有し、各プロセッサエレメントは、演算部、レジスタ部を少なくとも備える複数の機能手段を含み、前記機能手段は、内部バスに接続され、各機能手段の動作は、前記プロセッサで発生した制御信号の論理により制御され、前記複数のプロセッサエレメントは、一次元に配列され、制御信号線に沿って任意の単位に分割されるとともに、任意単位のプロセッサエレメントのグループ内それぞれに、前記制御信号のバッファ手段が設けられた並列プロセッサにおけるデータ処理方法であって、
前記制御信号を全グループのバッファ手段に供給する工程と、
該各バッファ手段が入力された前記制御信号に基づいてローカル制御信号を生成する工程と、
前記各バッファ手段が生成したローカル制御信号をグループ内の任意単位のプロセッサエレメントのみに供給する工程と、を含むことを特徴とするデータ処理方法。
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