JP4419675B2 - 固体撮像装置および固体撮像装置の駆動方法 - Google Patents
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Description
図1は、本発明の第1実施形態に係るMOS型固体撮像装置、例えばCMOSイメージセンサの構成を示すブロック図である。図1に示すように、第1実施形態に係るCMOSイメージセンサ10Aは、画素アレイ部11、垂直駆動回路12、カラム信号処理回路13、記憶手段であるフレームメモリ14、デジタルアンプ15、タイミングジェネレータ16、DSP(Digital Signal Processor;デジタル信号処理)回路17および動きベクトル検出手段としての例えば加速度センサー18を有する構成となっている。
垂直駆動回路12による垂直走査により、画素111が1行ずつ、あるいは複数行同時に選択され、選択行の各画素111から信号(リセットレベルおよび信号レベル)が、最終出力段のデータレートよりも高速に、即ち当該データレートで決まるフレームレートよりも速いフレームレートで読み出される。この読み出された各画素111の信号は、カラム信号処理回路13において列ごとに、CDS回路131でCDS処理が行われ、ADC回路132でデジタル信号に変換された後、1フレーム目の各画素の信号についてはアドレス補正回路133および加算・平均化回路134を経由してフレームメモリ14に順次記憶される。
図9は、本発明の第2実施形態に係るMOS型固体撮像装置、例えばCMOSイメージセンサの構成を示すブロック図である。図9に示すように、第2実施形態に係るCMOSイメージセンサ10Cは、画素アレイ部21、垂直駆動回路22、カラム信号処理回路23、水平駆動回路24、水平信号線25、アナログアンプ26、タイミングジェネレータ27、ADC回路28、アドレス補正回路29、加算・平均化回路30、フレームメモリ31、DSP回路32および加速度センサー33を有する構成となっている。
Claims (7)
- 光電変換素子を含む画素が行列状に2次元配置されてなる画素アレイ部と、
前記画素アレイ部の各画素の信号を行単位で並列に読み出す駆動手段と、
前記駆動手段によって前記画素アレイ部の各画素から読み出される信号に基づく時間的に前の画像に対する後の画像の動きベクトルを検出する検出手段と、
前記画素アレイ部と同一の基板上に設けられ、前記画素アレイ部の各画素の信号を格納する単一のフレームメモリと、
前記検出手段の検出結果に基づいて前記後の画像に関する各画素の信号の前記フレームメモリ上の格納アドレスを行単位で並列に補正する補正手段と、
前記フレームメモリに格納されている各画素の信号と前記補正手段によってアドレス補正された各画素の信号とを行単位で並列に加算または平均化して前記フレームメモリの補正後の格納アドレスに格納する演算手段と
を備えた固体撮像装置。 - 前記駆動手段は、前記フレームメモリに格納された各画素の信号を順に前記基板外へ出力する最終出力段のデータレートよりも高速に前記画素アレイ部の各画素の信号を読み出す
請求項1記載の固体撮像装置。 - 前記補正手段は、前記駆動手段によって前記画素アレイ部の各画素から読み出される信号に基づく複数フレームの画像に対して順に前記格納アドレスの補正を行う
請求項2記載の固体撮像装置。 - 前記検出手段は、前記画素アレイ部と同一の基板上に設けられている
請求項1記載の固体撮像装置。 - 前記画素アレイ部の各画素ごとにカラーフィルタを有しており、
前記補正手段は、前記カラーフィルタのカラーコーディングにおける単位パターンの繰り返し画素数の整数倍でアドレス補正を行う
請求項1記載の固体撮像装置。 - 前記画素アレイ部の各画素ごとにカラーフィルタを有しており、
前記フレームメモリは、1つの画素の格納アドレスに前記カラーフィルタの色ごとの記憶領域を持っている
請求項1記載の固体撮像装置。 - 光電変換素子を含む画素が行列状に2次元配置されてなる画素アレイ部と、
前記画素アレイ部の各画素の信号を行単位で並列に読み出す駆動手段と、
前記駆動手段によって前記画素アレイ部の各画素から読み出される信号に基づく時間的に前の画像に対する後の画像の動きベクトルを検出する検出手段と、
前記画素アレイ部と同一の基板上に設けられ、前記画素アレイ部の各画素の信号を格納する単一のフレームメモリとを備えた固体撮像装置の駆動に当たって、
前記検出手段の検出結果に基づいて前記後の画像に関する各画素の信号の前記フレームメモリ上の格納アドレスを行単位で並列に補正し、
しかる後、前記フレームメモリに格納されている各画素の信号とアドレス補正後の各画素の信号とを行単位で並列に加算または平均化して前記フレームメモリの補正後の格納アドレスに格納する
固体撮像装置の駆動方法。
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