JP3813045B2 - Ｈブリッジドライバ - Google Patents
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Description
【０００１】
【発明の属する技術分野】
本発明は、負荷をその両端から相補的に駆動するためのＨブリッジを駆動する信号として方形波状の信号を生成する駆動信号生成回路を有するＨブリッジドライバに関するものである。
【０００２】
【従来の技術】
従来、負荷としてトランスの１次側コイルを駆動するようなＨブリッジドライバでは、図４に示すように、例えば、ソースが電源電圧ＶCCに接続されたｐチャネルのＭＯＳ型ＦＥＴ（以下、「ｐＭＯＳ」と言う）３０１とソースがグランドＧＮＤに接続されたｎチャネルのＭＯＳ型ＦＥＴ（以下、「ｎＭＯＳ」と言う）３０２とのドレイン同士が接続されて成る２つの相補接続回路３００−１、３００−２から成るＨブリッジ４００を駆動する場合、ロジック回路１００’から出力される信号Ｐ１をバッファアンプ２００−１’を介してそのまま相補接続回路３００−１のｐＭＯＳ３０１及びｎＭＯＳ３０２のゲートに、ロジック回路１００’から出力される、信号Ｐ１を反転させた信号Ｐ２をバッファアンプ２００−２’を介してそのまま相補接続回路３００−２のｐＭＯＳ３０１及びｎＭＯＳ３０２のゲートにそれぞれ与えていた。
【０００３】
以上の構成により、ｐチャネルのＭＯＳ型ＦＥＴがＯＮする閾値をＶthp、ｎチャネルのＭＯＳ型ＦＥＴがＯＮする閾値をＶthnとすると、パルス信号Ｐ１及びＰ２のハイレベルでの電圧値をＶCC−Ｖthpよりも高く、また、ローレベルでの電圧値をＶthnよりも低くしておけば、パルス信号Ｐ１がローレベルでパルス信号Ｐ２がハイレベルであるときには、相補接続回路３００−１においてはｐＭＯＳ３０１がＯＮ、ｎＭＯＳ３０２がＯＦＦとなり、一方、相補接続回路３００−２においてはｐＭＯＳ３０１がＯＦＦ、ｎＭＯＳ３０２がＯＮとなるので、電源電圧ＶCC→相補接続回路３００−１のｐＭＯＳ３０１→負荷５００→相補接続回路３００−２のｎＭＯＳ３０２→グランドＧＮＤの経路で電流が流れ、一方、パルス信号Ｐ１がハイレベルでパルス信号Ｐ２がローレベルであるときには、相補接続回路３００−１においてはｐＭＯＳ３０１がＯＦＦ、ｎＭＯＳ３０２がＯＮとなり、一方、相補接続回路３００−２においてはｐＭＯＳ３０１がＯＮ、ｎＭＯＳ３０２がＯＦＦとなるので、電源電圧ＶCC→相補接続回路３００−２のｐＭＯＳ３０１→負荷５００→相補接続回路３００−１のｎＭＯＳ３０２→グランドＧＮＤの経路で電流が流れ、負荷５００がその両端から相補的に駆動される。
【０００４】
【発明が解決しようとする課題】
しかしながら、従来のＨブリッジドライバでは、ロジック回路１００から出力される方形波状のパルス信号（すなわち、高周波成分が含まれる信号）でそのままＨブリッジ４００を駆動していたので、負荷５００のインダクタンス成分に起因して数１０[mV]の高周波ノイズが発生するという問題があり、このため、オーディオ、映像等の分野に使用することができなかった。
【０００５】
そこで、本発明は、Ｈブリッジの駆動信号として方形波状の信号を生成する駆動信号生成回路を備えたＨブリッジドライバであって、Ｈブリッジの負荷のインダクタンス成分に起因して発生する高周波ノイズを大幅に抑制することができるようにしたＨブリッジドライバを提供することを目的とする。
【０００６】
【課題を解決するための手段】
上記の目的を達成するため、本発明では、Ｈブリッジの駆動信号として方形波状の信号を生成する駆動信号生成回路を備えたＨブリッジドライバにおいて、前記駆動信号生成回路で生成されたＨブリッジの駆動信号の波形をなまらせた整形信号を出力する波形整形回路と、Ｈブリッジの出力側の電圧が前記整形信号の電圧と等しくなるように制御する制御回路と、を設け、前記波形整形回路は、コンデンサを有して該コンデンサに生じる電圧に応じた信号を前記整形信号として出力するものであり、前記駆動信号の電圧のレベルが変化する期間において、電流値が前半側で徐々に増大し且つ後半側で徐々に減少する電流を前記コンデンサに流すことによって、前記整形信号を生成する。
そして、例えば、前記波形整形回路は、前記駆動信号の電圧がローレベルからハイレベルに変化する期間において、電流値が前半側でゼロから徐々に増大し且つ後半側でゼロまで徐々に減少する第１方向の電流を前記コンデンサに流す一方、前記駆動信号の電圧がハイレベルからローレベルに変化する期間において、電流値が前半側でゼロから徐々に増大し且つ後半側でゼロまで徐々に減少する前記第１方向とは逆の第２方向の電流を前記コンデンサに流すことによって、前記整形信号を生成する。
また、例えば、前記整形信号として第１整形信号と第２整形信号とが存在し、 前記波形整形回路は、前記コンデンサに生じる電圧信号及び該電圧信号を反転した信号を、夫々、第１整形信号及び第２整形信号として出力し、前記制御回路は、Ｈブリッジの一方の出力側の電圧が前記第１整形信号の電圧と等しくなるように、且つ他方の出力側の電圧が前記第２整形信号の電圧と等しくなるように制御する。
更に例えば、前記駆動信号のローレベルの電圧及びハイレベルの電圧を夫々ＶＬ及びＶＨとし、ＶＬとＶＨの間の一定の電圧をＶＡ及びＶＢとし（但し、ＶＡ＜ＶＢ）、更に前記駆動信号の電圧をＰＶとした場合、前記波形整形回路は、前記駆動信号の電圧がローレベルからハイレベルに変化する期間において、ＰＶ＜ＶＡの時に電流値がＰＶに比例し且つＰＶ＞ＶＡの時に電流値がＶＡに比例する第１電流を生成する第１電流生成回路と、前記駆動信号の電圧がローレベルからハイレベルに変化する期間において、ＰＶ＜ＶＢの時に電流値が一定に維持され且つＰＶ＞ＶＢの時に電流値がＰＶの増加に従って増加する第２電流を生成する第２電流生成回路と、前記駆動信号の電圧がハイレベルからローレベルに変化する期間において、ＰＶ＞ＶＢの時に電流値がＰＶの減少に従って減少し且つＰＶ＜ＶＢの時に電流値が一定に維持される第３電流を生成する第３電流生成回路と、前記駆動信号の電圧がハイレベルからローレベルに変化する期間において、ＰＶ＞ＶＡの時に電流値がＶＡに比例し且つＰＶ＜ＶＡの時に電流値がＰＶに比例する第４電流を生成する第４電流生成回路と、を備え、前記駆動信号の電圧がローレベルからハイレベルに変化する期間において、前記第１電流から前記第２電流を差し引いた電流を第１方向に前記コンデンサに流す一方、前記駆動信号の電圧がハイレベルからローレベルに変化する期間において、前記第４電流から前記第３電流を差し引いた電流を第１方向とは逆の第２方向に前記コンデンサに流すことによって、前記整形信号を生成する。
【０００７】
【発明の実施の形態】
以下に、本発明の実施形態を図面を参照しながら説明する。図１は本発明の一実施形態であるＨブリッジドライバの構成を示す図である。１００はＨブリッジの駆動信号として方形波状のパルス信号Ｐを出力するロジック回路である。２００−１、２００−２は演算増幅器である。６００はロジック回路１から出力されるパルス信号の波形をなまらせた信号Ｐ１’と、この信号Ｐ１’を反転させた信号Ｐ２’とを出力する波形整形回路である。そして、ロジック回路１００、演算増幅器２００−１及び２００−２、波形整形回路６００、並びに、これらを接続する配線がまとまって１つの半導体装置となっている。
【０００８】
波形整形回路６００の回路構成例を図２に示す。切り換えスイッチ１はＡ、Ｂ、Ｃの３つの端子を有しており、端子ＡＢ間または端子ＡＣ間のどちらか一方がＯＮする構成となっているが、不図示の回路により、図３に示すように、ロジック回路１００から出力されたパルス信号ＰがハイレベルＶHになったときには端子ＡＣ間がＯＮし、また、同電圧がローレベルＶLになったときには端子ＡＢ間がＯＮするようになっている。切り替えスイッチ１の端子Ａにロジック回路１００から出力されたパルス信号Ｐが入力される。
【０００９】
演算増幅器２は、第１の非反転入力端子が切り換えスイッチ１の端子Ｂに接続されており、第２の非反転入力端子には基準電圧ＶAが印加されている。尚、演算増幅器２では、第１の非反転入力端子の電圧が第２の非反転入力端子の電圧よりも低いときには、第１の非反転入力端子の電圧と反転入力端子の電圧との電圧差を増幅して出力し、一方、第１の非反転入力端子の電圧が第２の非反転入力端子の電圧以上であるときには、第２の非反転入力端子の電圧と反転入力端子の電圧との電圧差を増幅して出力する。
【００１０】
ＮＰＮ型のトランジスタ３は、ベースが演算増幅器２の出力側に接続されており、エミッタが抵抗４を介して接地されているとともに演算増幅器２の反転入力端子に接続されており、コレクタがＰＮＰ型のトランジスタ５のコレクタに接続されている。トランジスタ５はダイオード接続されているとともに、そのベースにはＰＮＰ型のトランジスタ６のベースが接続されており、トランジスタ５及び６でカレントミラー回路を構成している。トランジスタ５及び６のエミッタには電源電圧ＶCCが印加されている。
【００１１】
演算増幅器７は、非反転入力端子が抵抗８を介して切り換えスイッチ１の端子Ｂに接続されており、反転入力端子には基準電圧ＶBが印加されている。尚、基準電圧ＶA及びＶB、並びに、ロジック回路１００が出力するパルス信号Ｐのハイレベルの電圧ＶH及びローレベルの電圧ＶLの関係は、ＶL＝０、ＶL＜ＶA＜ＶB＜ＶH、かつ、ＶA＋ＶB＝ＶHになっている。
【００１２】
ＰＮＰ型のトランジスタ９は、ベースが演算増幅器７の出力側に接続されており、エミッタが演算増幅器７の非反転入力端子に接続されており、コレクタがＮＰＮ型のトランジスタ１０のコレクタに接続されている。トランジスタ１０はダイオード接続されているとともに、そのベースにはＮＰＮ型のトランジスタ１１のベースが接続されており、トランジスタ１０及び１１でカレントミラー回路を構成している。トランジスタ１０及び１１のエミッタは接地されている。
【００１３】
演算増幅器１２は、非反転入力端子が抵抗１３を介して切り換えスイッチ１の端子Ｃに接続されており、反転入力端子には基準電圧ＶBが印加されている。ＰＮＰ型のトランジスタ１４は、ベースが演算増幅器１２の出力側に接続されており、エミッタが演算増幅器１２の非反転入力端子に接続されており、コレクタがＮＰＮ型のトランジスタ１５のコレクタに接続されている。
【００１４】
トランジスタ１５はダイオード接続されているとともに、そのベースにはＮＰＮ型のトランジスタ１６のベースが接続されており、トランジスタ１５及び１６でカレントミラー回路を構成している。トランジスタ１５及び１６のエミッタは接地されている。
【００１５】
ＰＮＰ型のトランジスタ１７はダイオード接続されており、そのコレクタはトランジスタ１６のコレクタに接続されている。ＰＮＰ型のトランジスタ１８のベースはトランジスタ１７のベースに接続されており、トランジスタ１７及び１８でカレントミラー回路を構成している。トランジスタ１７及び１８のエミッタには電源電圧ＶCCが印加されている。
【００１６】
演算増幅器１９は、第１の非反転入力端子が切り換えスイッチ１の端子Ｃに接続されており、第２の非反転入力端子には基準電圧ＶAが印加されている。尚、演算増幅器１９では、第１の非反転入力端子の電圧が第２の非反転入力端子の電圧よりも低いときには、第１の非反転入力端子の電圧と反転入力端子の電圧との電圧差を増幅して出力し、一方、第１の非反転入力端子の電圧が第２の非反転入力端子の電圧以上であるときには、第２の非反転入力端子の電圧と反転入力端子の電圧との電圧差を増幅して出力する。
【００１７】
ＮＰＮ型のトランジスタ２０は、ベースが演算増幅器１９の出力側に接続されており、エミッタが抵抗２１を介して接地されているとともに演算増幅器１９の反転入力端子に接続されており、コレクタがＰＮＰ型のトランジスタ２２のコレクタに接続されている。
【００１８】
トランジスタ２２はダイオード接続されているとともに、そのベースにはトランジスタ２３のベースが接続されており、トランジスタ２２及び２３でカレントミラー回路を構成している。トランジスタ２２及び２３のエミッタには電源電圧ＶCCが印加されている。
【００１９】
ＮＰＮ型のトランジスタ２４はダイオード接続されており、そのコレクタはトランジスタ２３のコレクタに接続されている。ＮＰＮ型のトランジスタ２５のベースはトランジスタ２４のベースに接続されており、トランジスタ２４及び２５でカレントミラー回路を構成している。トランジスタ２４及び２５のエミッタは接地されている。
【００２０】
トランジスタ６、１１、１８、及び、２５のコレクタは、一端が接地されたコンデンサ２６の他端に共通に接続されている。反転回路２７はコンデンサ２６に生じる電圧信号を反転させて出力する。そして、コンデンサ２６に生じる電圧信号Ｐ１’、及び、反転回路２７の出力信号Ｐ２’が波形整形から６００から出力される。
【００２１】
以上の構成により、波形整形回路６００においては、図３に示すように、ロジック回路１００から出力されたパルス信号Ｐの値ＰVがローレベルＶLからハイレベルＶHに立ち上がる際には、トランジスタ６のコレクタ電流Ｉ1は、抵抗４、８、１３、２１の各抵抗値をそれぞれＲとすれば、ＰV＜ＶAであればＩ1＝ＰV／Ｒ、ＶA≦ＰVであればＩ1＝ＶA／Ｒであり、また、トランジスタ１１のコレクタ電流Ｉ2は、ＰV≦ＶBであればＩ2＝０、ＶB＜ＰVであればＩ2＝（ＰV−ＶB）／Ｒであり、また、トランジスタ１８のコレクタ電流Ｉ3、及び、トランジスタ２５のコレクタ電流Ｉ4は、Ｉ3＝Ｉ4＝０であるので、コンデンサ２６に流れ込む電流ＩCは、ＰV＜ＶAである間はＩC＝ＰV／ＲとなってＰVの上昇に伴って増加し、ＰV＝ＶAとなった時点でＩC＝ＶA／Ｒとなって一定となり、さらに、ＰVが上昇してＶB＜ＰVとなるとＩC＝ＶA／Ｒ−（ＰV−ＶB）／ＲとなってＰVの上昇に伴って減少し、ＰVがハイレベルＶHになったときにはＩC＝０となる。
【００２２】
また、ロジック回路１００から出力されたパルス信号Ｐの電圧ＰVがハイレベルＶHからローレベルＶLに立ち下がる際には、Ｉ1＝Ｉ2＝０であり、また、ＶB＜ＰVであればＩ3＝（ＰV−ＶB）／Ｒ、ＰV≦ＶBであればＩ3＝０であり、また、ＶA≦ＰVであればＩ4＝ＶA／Ｒ、ＰV＜ＶAであればＩ4＝ＰV／Ｒであるので、コンデンサ２６に流れ込む電流ＩCは、ＶB＜ＰVである間はＩC＝（ＰV−ＶB）／Ｒ−ＶA／ＲとなってＰVの下降に伴って減少し、ＰV＝ＶBとなった時点でＩC＝−ＶA／Ｒとなって一定となり、さらに、ＰVが下降してＰV＜ＶAとなるとＩC＝−ＰV／ＲとなってＰVの下降に伴って増加し、ＰVがローレベルＶLになったときにはＩC＝０となる。
【００２３】
したがって、コンデンサ２６に生じる電圧信号Ｐ１’はコンデンサ２６に流れ込む電流ＩCを積分したものとなることから、その信号波形は図３に示すように、ロジック回路１００から出力されたパルス信号Ｐの波形をなまらせたものとなる。このようにして、波形整形回路６００からはロジック回路１００から出力されたパルス信号Ｐの波形をなまらせた信号Ｐ１’、及び、この信号Ｐ１’を反転させた信号Ｐ２’が出力される。
【００２４】
そして、波形整形回路６００から出力される信号Ｐ１’、Ｐ２’はそれぞれ演算増幅器２００−１、２００−２の反転入力端子（−）に入力される。演算増幅器２００−１、２００−２の非反転入力端子（＋）はそれぞれ相補接続回路３００−１、３００−２の出力側（ｐＭＯＳ３０１とｎＭＯＳ３０２とのドレイン同士の接続点）に接続されている。
【００２５】
したがって、演算増幅器２００−１、相補接続回路３００−１、及び、これらの接続関係から成る負帰還制御回路７００−１の働きにより、相補接続回路３００−１の出力側の電圧が波形整形回路６００から出力される信号Ｐ１’の電圧と等しくなるように制御され、また、演算増幅器２００−２、相補接続回路３００−２、及び、これらの接続関係から成る負帰還制御回路７００−２の働きにより、相補接続回路３００−２の出力側の電圧が波形整形回路６００から出力される信号Ｐ２’の電圧と等しくなるように制御される。
【００２６】
まとめると、相補接続回路３００−１の出力側にはロジック回路１００から出力されたパルス信号Ｐの波形をなまらせた信号（すなわち、パルス信号Ｐから高周波成分を取り除いた信号）Ｐ１’が現れ、一方、相補接続回路３００−２の出力側にはロジック回路１００から出力されたパルス信号Ｐの波形をなまらせた信号（すなわち、パルス信号Ｐから高周波成分を取り除いた信号）を反転させた信号Ｐ２’が現れるので、負荷５００のインダクタンス成分に起因して発生する高周波ノイズを大幅に抑制することができるようになる。また、これにより、オーディオ、映像等の分野に使用することができるようになる。
【００２７】
尚、演算増幅器の出力を相補型出力回路のゲートに共通に印加している例についてのみ説明したが、演算増幅器を異なる２つのスレッショルド電圧またはタイミングで出力が切り換わるようにして、異なる電圧でｐＭＯＳとｎＭＯＳを切り換えるようにすれば、駆動回路での貫通電流を減らすことができるようになり、更に良い。
【００２８】
【発明の効果】
以上説明したように、本発明のＨブリッジドライバによれば、Ｈブリッジの出力側にはＨブリッジの駆動信号の波形をなまらせた信号が現れるので、Ｈブリッジの駆動信号として方形波状の信号が生成される場合であっても、Ｈブリッジの負荷のインダクタンス成分に起因して発生する高周波ノイズを大幅に抑制することができるようになる。また、これにより、オーディオ、映像等の分野に使用することができるようになる。
【図面の簡単な説明】
【図１】 本発明の一実施形態であるＨブリッジドライバの構成を示す図である。
【図２】 波形整形回路の一回路構成例を示す図である。
【図３】 図１に示すＨブリッジドライバの各部の信号の波形図である。
【図４】 従来例のＨブリッジドライバの構成を示す図である。
【符号の説明】
１ 切り替えスイッチ
２ 演算増幅器
３ ＮＰＮ型のトランジスタ
４ 抵抗
５、６ ＰＮＰ型のトランジスタ
７ 演算増幅器
８ 抵抗
９ ＰＮＰ型のトランジスタ
１０、１１ ＮＰＮ型のトランジスタ
１２ 演算増幅器
１３ 抵抗
１４ ＰＮＰ型のトランジスタ
１５、１６ ＮＰＮ型のトランジスタ
１７、１８ ＰＮＰ型のトランジスタ
１９ 演算増幅器
２０ ＮＰＮ型のトランジスタ
２１ 抵抗
２２、２３ ＰＮＰ型のトランジスタ
２４、２５ ＮＰＮ型のトランジスタ
２６ コンデンサ
２７ 反転回路
１００ ロジック回路
２００−１、２００−２ 演算増幅器
３００−１、３００−２ 相補接続回路
３０１ ｐチャネルのＭＯＳ型ＦＥＴ
３０２ ｎチャネルのＭＯＳ型ＦＥＴ
４００ Ｈブリッジ
５００ 負荷
６００ 波形整形回路
７００−１、７００−２ 負帰還制御回路
【発明の属する技術分野】
本発明は、負荷をその両端から相補的に駆動するためのＨブリッジを駆動する信号として方形波状の信号を生成する駆動信号生成回路を有するＨブリッジドライバに関するものである。
【０００２】
【従来の技術】
従来、負荷としてトランスの１次側コイルを駆動するようなＨブリッジドライバでは、図４に示すように、例えば、ソースが電源電圧ＶCCに接続されたｐチャネルのＭＯＳ型ＦＥＴ（以下、「ｐＭＯＳ」と言う）３０１とソースがグランドＧＮＤに接続されたｎチャネルのＭＯＳ型ＦＥＴ（以下、「ｎＭＯＳ」と言う）３０２とのドレイン同士が接続されて成る２つの相補接続回路３００−１、３００−２から成るＨブリッジ４００を駆動する場合、ロジック回路１００’から出力される信号Ｐ１をバッファアンプ２００−１’を介してそのまま相補接続回路３００−１のｐＭＯＳ３０１及びｎＭＯＳ３０２のゲートに、ロジック回路１００’から出力される、信号Ｐ１を反転させた信号Ｐ２をバッファアンプ２００−２’を介してそのまま相補接続回路３００−２のｐＭＯＳ３０１及びｎＭＯＳ３０２のゲートにそれぞれ与えていた。
【０００３】
以上の構成により、ｐチャネルのＭＯＳ型ＦＥＴがＯＮする閾値をＶthp、ｎチャネルのＭＯＳ型ＦＥＴがＯＮする閾値をＶthnとすると、パルス信号Ｐ１及びＰ２のハイレベルでの電圧値をＶCC−Ｖthpよりも高く、また、ローレベルでの電圧値をＶthnよりも低くしておけば、パルス信号Ｐ１がローレベルでパルス信号Ｐ２がハイレベルであるときには、相補接続回路３００−１においてはｐＭＯＳ３０１がＯＮ、ｎＭＯＳ３０２がＯＦＦとなり、一方、相補接続回路３００−２においてはｐＭＯＳ３０１がＯＦＦ、ｎＭＯＳ３０２がＯＮとなるので、電源電圧ＶCC→相補接続回路３００−１のｐＭＯＳ３０１→負荷５００→相補接続回路３００−２のｎＭＯＳ３０２→グランドＧＮＤの経路で電流が流れ、一方、パルス信号Ｐ１がハイレベルでパルス信号Ｐ２がローレベルであるときには、相補接続回路３００−１においてはｐＭＯＳ３０１がＯＦＦ、ｎＭＯＳ３０２がＯＮとなり、一方、相補接続回路３００−２においてはｐＭＯＳ３０１がＯＮ、ｎＭＯＳ３０２がＯＦＦとなるので、電源電圧ＶCC→相補接続回路３００−２のｐＭＯＳ３０１→負荷５００→相補接続回路３００−１のｎＭＯＳ３０２→グランドＧＮＤの経路で電流が流れ、負荷５００がその両端から相補的に駆動される。
【０００４】
【発明が解決しようとする課題】
しかしながら、従来のＨブリッジドライバでは、ロジック回路１００から出力される方形波状のパルス信号（すなわち、高周波成分が含まれる信号）でそのままＨブリッジ４００を駆動していたので、負荷５００のインダクタンス成分に起因して数１０[mV]の高周波ノイズが発生するという問題があり、このため、オーディオ、映像等の分野に使用することができなかった。
【０００５】
そこで、本発明は、Ｈブリッジの駆動信号として方形波状の信号を生成する駆動信号生成回路を備えたＨブリッジドライバであって、Ｈブリッジの負荷のインダクタンス成分に起因して発生する高周波ノイズを大幅に抑制することができるようにしたＨブリッジドライバを提供することを目的とする。
【０００６】
【課題を解決するための手段】
上記の目的を達成するため、本発明では、Ｈブリッジの駆動信号として方形波状の信号を生成する駆動信号生成回路を備えたＨブリッジドライバにおいて、前記駆動信号生成回路で生成されたＨブリッジの駆動信号の波形をなまらせた整形信号を出力する波形整形回路と、Ｈブリッジの出力側の電圧が前記整形信号の電圧と等しくなるように制御する制御回路と、を設け、前記波形整形回路は、コンデンサを有して該コンデンサに生じる電圧に応じた信号を前記整形信号として出力するものであり、前記駆動信号の電圧のレベルが変化する期間において、電流値が前半側で徐々に増大し且つ後半側で徐々に減少する電流を前記コンデンサに流すことによって、前記整形信号を生成する。
そして、例えば、前記波形整形回路は、前記駆動信号の電圧がローレベルからハイレベルに変化する期間において、電流値が前半側でゼロから徐々に増大し且つ後半側でゼロまで徐々に減少する第１方向の電流を前記コンデンサに流す一方、前記駆動信号の電圧がハイレベルからローレベルに変化する期間において、電流値が前半側でゼロから徐々に増大し且つ後半側でゼロまで徐々に減少する前記第１方向とは逆の第２方向の電流を前記コンデンサに流すことによって、前記整形信号を生成する。
また、例えば、前記整形信号として第１整形信号と第２整形信号とが存在し、 前記波形整形回路は、前記コンデンサに生じる電圧信号及び該電圧信号を反転した信号を、夫々、第１整形信号及び第２整形信号として出力し、前記制御回路は、Ｈブリッジの一方の出力側の電圧が前記第１整形信号の電圧と等しくなるように、且つ他方の出力側の電圧が前記第２整形信号の電圧と等しくなるように制御する。
更に例えば、前記駆動信号のローレベルの電圧及びハイレベルの電圧を夫々ＶＬ及びＶＨとし、ＶＬとＶＨの間の一定の電圧をＶＡ及びＶＢとし（但し、ＶＡ＜ＶＢ）、更に前記駆動信号の電圧をＰＶとした場合、前記波形整形回路は、前記駆動信号の電圧がローレベルからハイレベルに変化する期間において、ＰＶ＜ＶＡの時に電流値がＰＶに比例し且つＰＶ＞ＶＡの時に電流値がＶＡに比例する第１電流を生成する第１電流生成回路と、前記駆動信号の電圧がローレベルからハイレベルに変化する期間において、ＰＶ＜ＶＢの時に電流値が一定に維持され且つＰＶ＞ＶＢの時に電流値がＰＶの増加に従って増加する第２電流を生成する第２電流生成回路と、前記駆動信号の電圧がハイレベルからローレベルに変化する期間において、ＰＶ＞ＶＢの時に電流値がＰＶの減少に従って減少し且つＰＶ＜ＶＢの時に電流値が一定に維持される第３電流を生成する第３電流生成回路と、前記駆動信号の電圧がハイレベルからローレベルに変化する期間において、ＰＶ＞ＶＡの時に電流値がＶＡに比例し且つＰＶ＜ＶＡの時に電流値がＰＶに比例する第４電流を生成する第４電流生成回路と、を備え、前記駆動信号の電圧がローレベルからハイレベルに変化する期間において、前記第１電流から前記第２電流を差し引いた電流を第１方向に前記コンデンサに流す一方、前記駆動信号の電圧がハイレベルからローレベルに変化する期間において、前記第４電流から前記第３電流を差し引いた電流を第１方向とは逆の第２方向に前記コンデンサに流すことによって、前記整形信号を生成する。
【０００７】
【発明の実施の形態】
以下に、本発明の実施形態を図面を参照しながら説明する。図１は本発明の一実施形態であるＨブリッジドライバの構成を示す図である。１００はＨブリッジの駆動信号として方形波状のパルス信号Ｐを出力するロジック回路である。２００−１、２００−２は演算増幅器である。６００はロジック回路１から出力されるパルス信号の波形をなまらせた信号Ｐ１’と、この信号Ｐ１’を反転させた信号Ｐ２’とを出力する波形整形回路である。そして、ロジック回路１００、演算増幅器２００−１及び２００−２、波形整形回路６００、並びに、これらを接続する配線がまとまって１つの半導体装置となっている。
【０００８】
波形整形回路６００の回路構成例を図２に示す。切り換えスイッチ１はＡ、Ｂ、Ｃの３つの端子を有しており、端子ＡＢ間または端子ＡＣ間のどちらか一方がＯＮする構成となっているが、不図示の回路により、図３に示すように、ロジック回路１００から出力されたパルス信号ＰがハイレベルＶHになったときには端子ＡＣ間がＯＮし、また、同電圧がローレベルＶLになったときには端子ＡＢ間がＯＮするようになっている。切り替えスイッチ１の端子Ａにロジック回路１００から出力されたパルス信号Ｐが入力される。
【０００９】
演算増幅器２は、第１の非反転入力端子が切り換えスイッチ１の端子Ｂに接続されており、第２の非反転入力端子には基準電圧ＶAが印加されている。尚、演算増幅器２では、第１の非反転入力端子の電圧が第２の非反転入力端子の電圧よりも低いときには、第１の非反転入力端子の電圧と反転入力端子の電圧との電圧差を増幅して出力し、一方、第１の非反転入力端子の電圧が第２の非反転入力端子の電圧以上であるときには、第２の非反転入力端子の電圧と反転入力端子の電圧との電圧差を増幅して出力する。
【００１０】
ＮＰＮ型のトランジスタ３は、ベースが演算増幅器２の出力側に接続されており、エミッタが抵抗４を介して接地されているとともに演算増幅器２の反転入力端子に接続されており、コレクタがＰＮＰ型のトランジスタ５のコレクタに接続されている。トランジスタ５はダイオード接続されているとともに、そのベースにはＰＮＰ型のトランジスタ６のベースが接続されており、トランジスタ５及び６でカレントミラー回路を構成している。トランジスタ５及び６のエミッタには電源電圧ＶCCが印加されている。
【００１１】
演算増幅器７は、非反転入力端子が抵抗８を介して切り換えスイッチ１の端子Ｂに接続されており、反転入力端子には基準電圧ＶBが印加されている。尚、基準電圧ＶA及びＶB、並びに、ロジック回路１００が出力するパルス信号Ｐのハイレベルの電圧ＶH及びローレベルの電圧ＶLの関係は、ＶL＝０、ＶL＜ＶA＜ＶB＜ＶH、かつ、ＶA＋ＶB＝ＶHになっている。
【００１２】
ＰＮＰ型のトランジスタ９は、ベースが演算増幅器７の出力側に接続されており、エミッタが演算増幅器７の非反転入力端子に接続されており、コレクタがＮＰＮ型のトランジスタ１０のコレクタに接続されている。トランジスタ１０はダイオード接続されているとともに、そのベースにはＮＰＮ型のトランジスタ１１のベースが接続されており、トランジスタ１０及び１１でカレントミラー回路を構成している。トランジスタ１０及び１１のエミッタは接地されている。
【００１３】
演算増幅器１２は、非反転入力端子が抵抗１３を介して切り換えスイッチ１の端子Ｃに接続されており、反転入力端子には基準電圧ＶBが印加されている。ＰＮＰ型のトランジスタ１４は、ベースが演算増幅器１２の出力側に接続されており、エミッタが演算増幅器１２の非反転入力端子に接続されており、コレクタがＮＰＮ型のトランジスタ１５のコレクタに接続されている。
【００１４】
トランジスタ１５はダイオード接続されているとともに、そのベースにはＮＰＮ型のトランジスタ１６のベースが接続されており、トランジスタ１５及び１６でカレントミラー回路を構成している。トランジスタ１５及び１６のエミッタは接地されている。
【００１５】
ＰＮＰ型のトランジスタ１７はダイオード接続されており、そのコレクタはトランジスタ１６のコレクタに接続されている。ＰＮＰ型のトランジスタ１８のベースはトランジスタ１７のベースに接続されており、トランジスタ１７及び１８でカレントミラー回路を構成している。トランジスタ１７及び１８のエミッタには電源電圧ＶCCが印加されている。
【００１６】
演算増幅器１９は、第１の非反転入力端子が切り換えスイッチ１の端子Ｃに接続されており、第２の非反転入力端子には基準電圧ＶAが印加されている。尚、演算増幅器１９では、第１の非反転入力端子の電圧が第２の非反転入力端子の電圧よりも低いときには、第１の非反転入力端子の電圧と反転入力端子の電圧との電圧差を増幅して出力し、一方、第１の非反転入力端子の電圧が第２の非反転入力端子の電圧以上であるときには、第２の非反転入力端子の電圧と反転入力端子の電圧との電圧差を増幅して出力する。
【００１７】
ＮＰＮ型のトランジスタ２０は、ベースが演算増幅器１９の出力側に接続されており、エミッタが抵抗２１を介して接地されているとともに演算増幅器１９の反転入力端子に接続されており、コレクタがＰＮＰ型のトランジスタ２２のコレクタに接続されている。
【００１８】
トランジスタ２２はダイオード接続されているとともに、そのベースにはトランジスタ２３のベースが接続されており、トランジスタ２２及び２３でカレントミラー回路を構成している。トランジスタ２２及び２３のエミッタには電源電圧ＶCCが印加されている。
【００１９】
ＮＰＮ型のトランジスタ２４はダイオード接続されており、そのコレクタはトランジスタ２３のコレクタに接続されている。ＮＰＮ型のトランジスタ２５のベースはトランジスタ２４のベースに接続されており、トランジスタ２４及び２５でカレントミラー回路を構成している。トランジスタ２４及び２５のエミッタは接地されている。
【００２０】
トランジスタ６、１１、１８、及び、２５のコレクタは、一端が接地されたコンデンサ２６の他端に共通に接続されている。反転回路２７はコンデンサ２６に生じる電圧信号を反転させて出力する。そして、コンデンサ２６に生じる電圧信号Ｐ１’、及び、反転回路２７の出力信号Ｐ２’が波形整形から６００から出力される。
【００２１】
以上の構成により、波形整形回路６００においては、図３に示すように、ロジック回路１００から出力されたパルス信号Ｐの値ＰVがローレベルＶLからハイレベルＶHに立ち上がる際には、トランジスタ６のコレクタ電流Ｉ1は、抵抗４、８、１３、２１の各抵抗値をそれぞれＲとすれば、ＰV＜ＶAであればＩ1＝ＰV／Ｒ、ＶA≦ＰVであればＩ1＝ＶA／Ｒであり、また、トランジスタ１１のコレクタ電流Ｉ2は、ＰV≦ＶBであればＩ2＝０、ＶB＜ＰVであればＩ2＝（ＰV−ＶB）／Ｒであり、また、トランジスタ１８のコレクタ電流Ｉ3、及び、トランジスタ２５のコレクタ電流Ｉ4は、Ｉ3＝Ｉ4＝０であるので、コンデンサ２６に流れ込む電流ＩCは、ＰV＜ＶAである間はＩC＝ＰV／ＲとなってＰVの上昇に伴って増加し、ＰV＝ＶAとなった時点でＩC＝ＶA／Ｒとなって一定となり、さらに、ＰVが上昇してＶB＜ＰVとなるとＩC＝ＶA／Ｒ−（ＰV−ＶB）／ＲとなってＰVの上昇に伴って減少し、ＰVがハイレベルＶHになったときにはＩC＝０となる。
【００２２】
また、ロジック回路１００から出力されたパルス信号Ｐの電圧ＰVがハイレベルＶHからローレベルＶLに立ち下がる際には、Ｉ1＝Ｉ2＝０であり、また、ＶB＜ＰVであればＩ3＝（ＰV−ＶB）／Ｒ、ＰV≦ＶBであればＩ3＝０であり、また、ＶA≦ＰVであればＩ4＝ＶA／Ｒ、ＰV＜ＶAであればＩ4＝ＰV／Ｒであるので、コンデンサ２６に流れ込む電流ＩCは、ＶB＜ＰVである間はＩC＝（ＰV−ＶB）／Ｒ−ＶA／ＲとなってＰVの下降に伴って減少し、ＰV＝ＶBとなった時点でＩC＝−ＶA／Ｒとなって一定となり、さらに、ＰVが下降してＰV＜ＶAとなるとＩC＝−ＰV／ＲとなってＰVの下降に伴って増加し、ＰVがローレベルＶLになったときにはＩC＝０となる。
【００２３】
したがって、コンデンサ２６に生じる電圧信号Ｐ１’はコンデンサ２６に流れ込む電流ＩCを積分したものとなることから、その信号波形は図３に示すように、ロジック回路１００から出力されたパルス信号Ｐの波形をなまらせたものとなる。このようにして、波形整形回路６００からはロジック回路１００から出力されたパルス信号Ｐの波形をなまらせた信号Ｐ１’、及び、この信号Ｐ１’を反転させた信号Ｐ２’が出力される。
【００２４】
そして、波形整形回路６００から出力される信号Ｐ１’、Ｐ２’はそれぞれ演算増幅器２００−１、２００−２の反転入力端子（−）に入力される。演算増幅器２００−１、２００−２の非反転入力端子（＋）はそれぞれ相補接続回路３００−１、３００−２の出力側（ｐＭＯＳ３０１とｎＭＯＳ３０２とのドレイン同士の接続点）に接続されている。
【００２５】
したがって、演算増幅器２００−１、相補接続回路３００−１、及び、これらの接続関係から成る負帰還制御回路７００−１の働きにより、相補接続回路３００−１の出力側の電圧が波形整形回路６００から出力される信号Ｐ１’の電圧と等しくなるように制御され、また、演算増幅器２００−２、相補接続回路３００−２、及び、これらの接続関係から成る負帰還制御回路７００−２の働きにより、相補接続回路３００−２の出力側の電圧が波形整形回路６００から出力される信号Ｐ２’の電圧と等しくなるように制御される。
【００２６】
まとめると、相補接続回路３００−１の出力側にはロジック回路１００から出力されたパルス信号Ｐの波形をなまらせた信号（すなわち、パルス信号Ｐから高周波成分を取り除いた信号）Ｐ１’が現れ、一方、相補接続回路３００−２の出力側にはロジック回路１００から出力されたパルス信号Ｐの波形をなまらせた信号（すなわち、パルス信号Ｐから高周波成分を取り除いた信号）を反転させた信号Ｐ２’が現れるので、負荷５００のインダクタンス成分に起因して発生する高周波ノイズを大幅に抑制することができるようになる。また、これにより、オーディオ、映像等の分野に使用することができるようになる。
【００２７】
尚、演算増幅器の出力を相補型出力回路のゲートに共通に印加している例についてのみ説明したが、演算増幅器を異なる２つのスレッショルド電圧またはタイミングで出力が切り換わるようにして、異なる電圧でｐＭＯＳとｎＭＯＳを切り換えるようにすれば、駆動回路での貫通電流を減らすことができるようになり、更に良い。
【００２８】
【発明の効果】
以上説明したように、本発明のＨブリッジドライバによれば、Ｈブリッジの出力側にはＨブリッジの駆動信号の波形をなまらせた信号が現れるので、Ｈブリッジの駆動信号として方形波状の信号が生成される場合であっても、Ｈブリッジの負荷のインダクタンス成分に起因して発生する高周波ノイズを大幅に抑制することができるようになる。また、これにより、オーディオ、映像等の分野に使用することができるようになる。
【図面の簡単な説明】
【図１】 本発明の一実施形態であるＨブリッジドライバの構成を示す図である。
【図２】 波形整形回路の一回路構成例を示す図である。
【図３】 図１に示すＨブリッジドライバの各部の信号の波形図である。
【図４】 従来例のＨブリッジドライバの構成を示す図である。
【符号の説明】
１ 切り替えスイッチ
２ 演算増幅器
３ ＮＰＮ型のトランジスタ
４ 抵抗
５、６ ＰＮＰ型のトランジスタ
７ 演算増幅器
８ 抵抗
９ ＰＮＰ型のトランジスタ
１０、１１ ＮＰＮ型のトランジスタ
１２ 演算増幅器
１３ 抵抗
１４ ＰＮＰ型のトランジスタ
１５、１６ ＮＰＮ型のトランジスタ
１７、１８ ＰＮＰ型のトランジスタ
１９ 演算増幅器
２０ ＮＰＮ型のトランジスタ
２１ 抵抗
２２、２３ ＰＮＰ型のトランジスタ
２４、２５ ＮＰＮ型のトランジスタ
２６ コンデンサ
２７ 反転回路
１００ ロジック回路
２００−１、２００−２ 演算増幅器
３００−１、３００−２ 相補接続回路
３０１ ｐチャネルのＭＯＳ型ＦＥＴ
３０２ ｎチャネルのＭＯＳ型ＦＥＴ
４００ Ｈブリッジ
５００ 負荷
６００ 波形整形回路
７００−１、７００−２ 負帰還制御回路
Claims (4)
- Ｈブリッジの駆動信号として方形波状の信号を生成する駆動信号生成回路を備えたＨブリッジドライバにおいて、
前記駆動信号生成回路で生成されたＨブリッジの駆動信号の波形をなまらせた整形信号を出力する波形整形回路と、
Ｈブリッジの出力側の電圧が前記整形信号の電圧と等しくなるように制御する制御回路と、を設け、
前記波形整形回路は、コンデンサを有して該コンデンサに生じる電圧に応じた信号を前記整形信号として出力するものであり、前記駆動信号の電圧のレベルが変化する期間において、電流値が前半側で徐々に増大し且つ後半側で徐々に減少する電流を前記コンデンサに流すことによって、前記整形信号を生成する
ことを特徴とするＨブリッジドライバ。 - 前記波形整形回路は、前記駆動信号の電圧がローレベルからハイレベルに変化する期間において、電流値が前半側でゼロから徐々に増大し且つ後半側でゼロまで徐々に減少する第１方向の電流を前記コンデンサに流す一方、前記駆動信号の電圧がハイレベルからローレベルに変化する期間において、電流値が前半側でゼロから徐々に増大し且つ後半側でゼロまで徐々に減少する前記第１方向とは逆の第２方向の電流を前記コンデンサに流すことによって、前記整形信号を生成する
ことを特徴とする請求項１に記載のＨブリッジドライバ。 - 前記整形信号として第１整形信号と第２整形信号とが存在し、
前記波形整形回路は、前記コンデンサに生じる電圧信号及び該電圧信号を反転した信号を、夫々、第１整形信号及び第２整形信号として出力し、
前記制御回路は、Ｈブリッジの一方の出力側の電圧が前記第１整形信号の電圧と等しくなるように、且つ他方の出力側の電圧が前記第２整形信号の電圧と等しくなるように制御する
ことを特徴とする請求項１または請求項２に記載のＨブリッジドライバ。 - 前記駆動信号のローレベルの電圧及びハイレベルの電圧を夫々ＶＬ及びＶＨとし、ＶＬとＶＨの間の一定の電圧をＶＡ及びＶＢとし（但し、ＶＡ＜ＶＢ）、更に前記駆動信号の電圧をＰＶとした場合、
前記波形整形回路は、
前記駆動信号の電圧がローレベルからハイレベルに変化する期間において、ＰＶ＜ＶＡの時に電流値がＰＶに比例し且つＰＶ＞ＶＡの時に電流値がＶＡに比例する第１電流を生成する第１電流生成回路と、
前記駆動信号の電圧がローレベルからハイレベルに変化する期間において、ＰＶ＜ＶＢの時に電流値が一定に維持され且つＰＶ＞ＶＢの時に電流値がＰＶの増加に従って増加する第２電流を生成する第２電流生成回路と、
前記駆動信号の電圧がハイレベルからローレベルに変化する期間において、ＰＶ＞ＶＢの時に電流値がＰＶの減少に従って減少し且つＰＶ＜ＶＢの時に電流値が一定に維持される第３電流を生成する第３電流生成回路と、
前記駆動信号の電圧がハイレベルからローレベルに変化する期間において、ＰＶ＞ＶＡの時に電流値がＶＡに比例し且つＰＶ＜ＶＡの時に電流値がＰＶに比例する第４電流を生成する第４電流生成回路と、を備え、
前記駆動信号の電圧がローレベルからハイレベルに変化する期間において、前記第１電流から前記第２電流を差し引いた電流を第１方向に前記コンデンサに流す一方、前記駆動信号の電圧がハイレベルからローレベルに変化する期間において、前記第４電流から前記第３電流を差し引いた電流を第１方向とは逆の第２方向に前記コンデンサに流すことによって、前記整形信号を生成する
ことを特徴とする請求項１〜請求項３の何れかに記載のＨブリッジドライバ。
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