JP3796529B2 - 低インダクタンスの回路装置 - Google Patents
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Description
【発明の属する技術分野】
本発明は、請求項1の前提部分に記載した、特にパワークラスの変換器の形式における回路装置に関し、この回路装置はその実施において圧力接触構造体にも適している。パワークラスの変換器のためには、迅速で且つ低損失でスイッチングする半導体スイッチが有利とされている。それにより、MOSFET、または絶縁ゲートバイポーラトランジスタ(IGBT)及びそれに対して逆並列に接続されるフリーホイーリングダイオードを有する回路装置が特に適している。この種の回路装置及びそれにより構成されている変換器は、特にターンオフ過程における電圧のスパイクの発生を回避するために低誘導性で設計される必要がある。このことは、回路装置の中間回路、回路装置の接続導体、並びに回路装置の基板表面における漏れインダクタンスが小さくなくてはならないことを意味する。20nHの領域の漏れインダクタンスは低電圧MOSFETにおいて電圧のスパイクを導き、この電圧のスパイクは半導体スイッチを破壊し得る。
【0002】
【従来の技術】
従来技術には、寄生インダクタンスを減少するために個々の構成上の措置を有する個別スイッチ及びパワー半導体モジュールが含まれ、これらは、例えば、EPO特許出願公開第0277546号公報(EP0277546A1)、ドイツ特許出願公開第3937045号公報(DE3937045A1)、またはEPO特許出願公開第0609528号公報(EP0609528A1)から知られている。
【0003】
EPO特許出願公開第0277546号公報(EP0277546A1)では、個別スイッチのために、直流リードにおける寄生インダクタンスを低減するための方法が記載されている。ここでは、両方の直流リードが狭い間隔で隣り合っていて、少なくとも部分的に互いに平行に配設されている。これは、狭い間隔で隣り合って配設されているリードの領域において電流の流れで取り囲まれる面を小さくし、それによりこのリード部分のインダクタンスを少なくするというものである。
【0004】
ドイツ特許出願公開第3937045号公報(DE3937045A1)では、ハーフブリッジのために、直流リードにおける寄生インダクタンスを低減するための方法が記載されている。ここでは、プラスリードとマイナスリードとの間に交流リードを有し、両方の直流リードが狭い間隔で隣り合っていて、少なくとも部分的に互いに平行に配設されている。これは、同様に、狭い間隔で隣り合って配設されているリードの領域において電流の流れで取り囲まれる面を小さくし、それによりこのリード部分のインダクタンスを比較的少なくするというものである。
【0005】
EPO特許出願公開第0609528号公報(EP0609528A1)では、同様に、個別スイッチのために、平行に且つ狭い間隔で隣り合う直流リードにおける寄生インダクタンスを低減するための方法が記載されている。ここでは追加的に半導体デバイスが基板上にて対称に配設されている。
【0006】
また、従来技術には、例えばドイツ特許出願公開第19630173号公報(DE19630173A1)並びにドイツ特許出願公開第59306387号公報(DE59306387A1)に記載されているように、圧力接触技術(プレッシャーコンタクト技術)を用いたパワー半導体モジュールが含まれる。この種のパワー半導体モジュールはセラミック基板を有し、このセラミック基板上には接触面が設けられていて、この接触面上に半導体デバイスが配設されている。これらの半導体デバイスは、ロウ付けにより接触面と接合されていて、他の半導体デバイスへのボンディング接続部、または、第1接触面に対して絶縁されていて基板上に設けられている他の第2接触面へのボンディング接続部を有する。ここで圧力接触とは、2つの異なる種類の接触に関連している。一方では、対応する基板の接触面に対する接続導体の電気的な接触であり、他方では、冷却体に対する基板ないしは全モジュールの熱的な接触である。この種の接触では、例えば、圧力を伝達し且つプラスチック等の合成物質から成る要素が使用され、これらの要素は、電気的並びに熱的に確実な接触を形成するために、外部からモジュールに作用する圧力を接続要素及び/又は基板に加える。
【0007】
低誘導性の回路装置の従来技術に分類し得るこれらの全ての発明は、全システムの部分領域、即ち中間回路−インバータの部分領域においてのみ寄生インダクタンスをある程度減少させるという点で共通している。それによりこの全システムの全インダクタンスのために達成可能な値は現在では良くても20nH以上である。
【0008】
EPO特許出願公開第0277546号公報(EP0277546A1)では、個別スイッチを形成するトランジスタが狭い間隔で互いに隣り合っているが、電流は、異なる経路、中でも異なる長さの経路で回路装置を通じて流れている。その結果、電流の流れにより取り囲まれる異なる面、並びに様々なパワー経路のために異なるインダクタンスが得られることになる。この種の個別スイッチを用いたハーフブリッジの構成では、そのために必要不可欠な外部の回路が原因で決して低誘導性とは成り得ない。これは、特性の総和として、全システムの寄生インダクタンス、即ち中間回路−インバータの寄生インダクタンスをある程度は低減させるが、それにより寄生インダクタンスの最小化に対する全ての要求が満たされることはない。
【0009】
ドイツ特許出願公開第3937045号公報(DE3937045A1)では、寄生インダクタンスを最小にするという目的が2つの根本的な原因により達成されない。第1に、ここでは交流接続導体が両方の直流接続導体の間に配設されているので、直流接続導体が最小の間隔で互いに配設されているわけではない。それにより、直流接続導体の領域にて電流の流れで取り囲まれる面は最小ではなく、従ってこの領域のためのインダクタンスも最小ではない。第2に、第1及び第2パワースイッチのパワートランジスタが相対的に互いに離れて配設されていて、これは同様に寄生インダクタンスを高めてしまう。
【0010】
【発明が解決しようとする課題】
本発明の基礎を成す課題は、回路装置の寄生インダクタンスを、接続ラインの領域においても、電気的に絶縁されている基板上に構成されている半導体デバイスの領域においても、この装置の全インダクタンスが1nHの大きさ、または、それよりも小さい、即ち、少なくとも従来技術における大きさよりも小さくなるように最適化することである。
【0011】
【課題を解決するための手段】
前記課題は、中間回路のプラス接続部からマイナス接続部までにおいて、全回路装置における電流の流れで取り囲まれる面が、回路装置の全体として以下の措置により最小限に抑えられることにより解決される:
・ 第1及び第2パワースイッチが基板上にて狭い間隔で隣り合って配設されている。
・ 第1及び第2パワースイッチが一列に設けられていて、それにより出来る限り短く互いに接続されている。
・ 第1及び第2パワースイッチを形成するパワートランジスタ、並びに場合により必要とされるフリーホイーリングダイオードが同様に狭い間隔で隣り合って直列に設けられている。
・ プラス接続部及びマイナス接続部の接続ラインがバンド(ストラップ)として実施されている。
・ プラス接続部及びマイナス接続部の接続ラインが基板の近くまでのそれらの経過にて平行に配設されている。
・ プラス接続部及びマイナス接続部の接続ラインが絶縁層によってのみ離されて狭い間隔で隣り合っている。
・ 両方の直流接続部の少なくとも1つの直流接続部の接続バンドの部分が基板の近くで基板に対して平行に配設されていて、出来るだけ小さな間隔でパワートランジスタの上方に設けられている。
・ 少なくとも1つの直流接続部において基板に対して平行に設けられたそれぞれの部分にバーが設けられている。これらのバーが、パワースイッチのパワートランジスタ間の領域にて下方へとベースプレート上にまで達し、このベースプレートから絶縁のために必要不可欠な層によってのみ離されている。
・ これらのバーが、記載の装置により、冷却体上における基板の圧力接触部としても用いられる。それにより、これらのバーが少なくとも部分的に従来技術の圧力要素を補うことが可能である。
【0012】
これらの措置により、基板平面においても、基板に対して垂直であり接続ラインによって定義される全ての平面においても、インダクタンスが最低限に抑えられる。
【0013】
【発明の実施の形態】
次に、図1〜7に関する実施形態に基づいて本発明を更に詳細に説明する。特別な構成が図1〜7に示されている。
【0014】
図1にはハーフブリッジが図示されている。従来技術によるこの典型的な構成は、プラス接続部(2)とマイナス接続部(3)を有するコンデンサ(1)を用いた中間回路、並びにパワースイッチ(4)から成る。これらのパワースイッチはMOSFETまたはIGBTとして実現され得る。IGBTを用いて実現化する場合には追加的にフリーホイーリングダイオード(5)が必要不可欠である。交流接続部は符号(6)で示されている。矢印(7)は転流過程中におけるプラスからマイナスへの電流の流れを表し、線影の付けられた領域は、その際に電流の流れで取り囲まれる面(8)を示している。電流の流れで取り囲まれた面の大きさは、発生する寄生インダクタンスのための直接的な尺度であり、この大きさは具体的には1つの巻線を有する1つのコイルの横断面を形成する。
【0015】
図2には図1による回路装置の現実的なケースが示されていて、ここでは第1及び第2パワースイッチが並列に接続されている複数のパワートランジスタによってそれぞれ実現されている。この場合、線影の付けられた領域(8)は、電流の流れにより取り囲まれる最大の面を表している。ここでは、それらの面が異なり、それにより、対応するインダクタンスがそれぞれのパワートランジスタのために異なっていることが見て取れる。
【0016】
図3ではハーフブリッジの基板の実現化の従来技術が示されている。ここでは図面の見易さのために、ゲートエミッタ、ベースエミッタ、または補助エミッタのような補助接続部は考慮されていない。セラミック基板(9)上には、プラス接続部(11)、マイナス接続部(10)、並びに交流接続部(12)のために銅コーティングされている面が配設されている。この場合、プラス面上には、第1パワースイッチを実現する第1パワートランジスタ(13)、並びにフリーホイーリングダイオード(14)が設けられている。パワートランジスタ(13)のエミッタは、ボンディングワイヤ(15)を用いて、銅コーティングされている交流接続部の面(12)と接続されている。この面上には、第2パワートランジスタ、並びに同様にフリーホイーリングダイオードが配設されている。これらの第2パワートランジスタ(19)は、ボンディングワイヤを用いて、銅コーティングされているマイナス接続部の面(10)と接続されている。中間回路に通じるプラス接続導体(17)、マイナス接続導体(16)、並びに交流接続導体(18)は、同様にそれらの極性に対応して銅コーティングされている面上に配設されている。従来技術によるこの種の装置における典型的なこととして、プラス接続導体及びマイナス接続導体が基板の上方にて少なくとも僅かな間隔に至るまで狭い間隔で隣り合って配置されていることが挙げられる。ここで矢印(7)は同様に電流の流れにより取り囲まれる最大の面を特徴付けている。この面はこの回路装置の寄生インダクタンスを決定する。この種の回路装置では基板の平面に関して典型的なインダクタンスは20nH〜50nHの領域に達する。
【0017】
図4には回路装置における本発明の解決策の一部分が示されていて、ここで接続導体は、基板の領域にて最小のインダクタンスを達成するために統合された装置の構成要素である。ここでは図面を見易さのために同様に必要不可欠な補助接続部が省略されている。基板(9)上には、従来技術に従い、プラス接続部(12)、マイナス接続部(10)並びに交流接続部(11)のために銅コーティングされている面が配設されている。本発明の思想は、2つの特徴の組み合わせにある。
【0018】
第1に、最小の寄生インダクタンスのために、第1パワートランジスタ(13)(例えばMOSFET)が第2パワートランジスタ(19)に出来るだけ狭い間隔で隣り合うように配設されていて、これらの第1及び第2パワートランジスタが直列に配設されている必要がある。
【0019】
第2に、プラス接続ライン(20)及びマイナス接続ライン(21)がバンド状(帯状)に実施されていて電流ガイドに取り入れられている。説明のためにこれらの2つの接続ラインを(図6に示されているように)以下に記す複数の部分に分割する。
【0020】
部分「A」は中間回路接続部から基板表面の近くまで達している。部分「B」は基板表面に対して平行に延びている。部分「C」は、前記の平行に延びる領域に接続し、基板表面の銅コーティングされている対応面への典型的には垂直な接触部を示している。両方の直流接続ラインのうちの少なくとも1つは前記のように実施されている。部分Bは、基板表面に対して平行にバンド(ストラップ)として配設されているだけではなく、直列に配設されている第1及び第2パワートランジスタ間の各領域にてこれらの第1及び第2パワートランジスタに対して平行に延びる少なくとも1つのバーを有することによって、この部分Bは本発明の思想にとって決定的な特徴を有する。これらのバーは下方へと基板表面上にまで達し、銅コーティングされている他のそれぞれのパワータイプの面から薄い絶縁層によってのみ離されている。
【0021】
プラス接続ライン(20)は部分「A」内でマイナス接続ライン(21)に対して平行に配設されていて、この領域にてマイナス接続ライン(21)から絶縁層によってのみ離されている。部分「B」からはバー(23)だけが示されていて、バーの上方に延びてバーを接続するバンド状の部分は示されていない。これらの平行のバーは、線影の領域にて、基板の表面から、並びに、基板に位置付けられている銅コーティングされたマイナス面(10)及び交流面(11)から、薄い絶縁層により離されている。塗り潰されて平面的に示されている領域においてバーは材料結合または材料拘束されて銅コーティングと接合されている。このことは、対応して交流接続ラインにも適用されている。ここで矢印(7)は同様に電流の流れにより取り囲まれる最大の面を表している。基板の平面に関して電流の流れで取り囲まれる面は、この装置により最小限に抑えられている。更に、全パワートランジスタのためのこの装置の対称性により、均等な電流負荷と同じ寄生インダクタンスが得られる。
【0022】
この種の回路装置により、基板の平面に関してインダクタンスは1nH以下の大きさに達する。
【0023】
同様に交流接続ライン(22)は、プラス接続ライン(20)のように、即ちバンド状でバーを用いて下方へとDCBセラミック上にまで達するように実現されている。
【0024】
図5には、従来技術に従い、基板(9)に対して垂直であり接続ラインによって定義されている平面が示されている。この基板(9)上には、プラス接続部(12)、マイナス接続部(10)、並びに交流接続部(11)のために銅コーティングされている面が配設されている。ここでプラス面(12)上には第1パワートランジスタ(13)が設けられている。第2パワートランジスタ(19)は交流面(11)上に設けられている。第1パワートランジスタ(13)のエミッタは、ボンディングワイヤ(15)を用いて、銅コーティングされている交流接続部の面(11)と接続されている。第2パワートランジスタ(19)のエミッタは、同様にボンディングワイヤ(15)を用いて、銅コーティングされているマイナス接続部の面(10)と接続されている。この平面内において電流の流れにより取り囲まれる面(24)は、プラス接続導体の下方にて基板の表面にまで、ないしは、ボンディング接続部の領域にてこれらのボンディング接続部にまで延びている。
【0025】
図6には、本発明による思想が、同様に、基板(9)に対して垂直であり接続ラインによって定義されている平面で示されている。ここで、接続ラインの3つの部分「A」「B」「C」が同様に示されている。下方へと基板の表面にまで達する本発明のバー(23)により、プラス接続導体のバンド状部分の下方にて、この領域は電流の流れにより取り囲まれないことになる。銅コーティングされている面(12)への電流の流れは、基板の上方にて直接的に起こり、マイナス接続導体への他の電流の流れは、基板にて、即ちボンディング接続部を有する部分にて、これらのボンディング接続部により起こる。それにより、電流の流れで取り囲まれる3つの有意な面が得られる。即ち、マイナス接続ラインとプラス接続ラインとの間の領域(26)、並びに、上方に向かってはボンディングワイヤにより画成されていて且つ下方に向かっては本発明のバー(23)の下側により画成されている領域(25)である。図5と比較すると、電流の流れで取り囲まれる面が低減され、それにより本発明の回路装置の寄生インダクタンスが低減されていることが明白である。完全に低誘導性の回路装置を達成するためには、中間回路コンデンサが直流リードに直接的に配設される必要がある。
【0026】
図7には、本発明の思想の部分図が3次元的に示されている。ここでは第1パワートランジスタ(13)並びに第2パワートランジスタ(19)がそれぞれ示されている。この部分図でも全ての補助接続部、並びに接続ラインの閉じたバンド状部分は示されていない。接続ラインの閉じたバンド状部分は、基板の上方にてバー上に設けられていて、補助接続部のために接続ラインを貫通して案内するために必要な場合には中断され得る。プラス接続導体(12)、マイナス接続導体(10)、並びに交流接続導体(11)のバー(23)は、接続ライン内のインダクタンスを最小に保持するというそれらの課題に加えて追加的に、圧力接触される構造体のために圧力を伝達する要素として用いられ得る。記述した接続導体のそれぞれは、バーを介して、この接続導体に割り当てられていて銅コーティングされている面に対して直接的に接触し、圧力接触構造体において接続部自体の電気的な圧力接触のためにも冷却体に対する基板の熱的な圧力接触のためにも用いられる。接続導体の各バーは、熱的な圧力接触の目的を、銅コーティングされている面であるがこの接続導体に割り当てられていない面に同様に施すことはなく、それは、接続導体が前記の面から絶縁層、典型的にはプラスチックフォイル等の合成物質フォイルによってのみ離されているからである。
【図面の簡単な説明】
【図1】従来技術に対応するハーフブリッジ並びに電流の流れで取り囲まれているハーフブリッジの領域を示す図である。
【図2】図1によるハーフブリッジを、複数のパワートランジスタ並びに電流の流れで取り囲まれるこの装置の最大の領域を有する場合で示す図である。
【図3】従来技術による基板並びにハーフブリッジのパワースイッチの構成、並びにこの装置内における電流の流れで取り囲まれる最大の領域を示す図である。
【図4】本発明による回路装置の一部分を示す図である。
【図5】従来技術による接続ラインにおいて電流の流れで取り囲まれる領域を示す図である。
【図6】接続ラインの本発明による装置において電流の流れで取り囲まれる領域を示す図である。
【図7】本発明による回路装置の部分図を3次元的に示す図である。
【符号の説明】
1 コンデンサ
2 プラス接続部
3 マイナス接続部
4 パワースイッチ
5 フリーホイーリングダイオード
6 交流接続部
7 電流の流れ
8 電流の流れで取り囲まれる面
9 セラミック基板
10 マイナス接続部
11 プラス接続部(図4以降:交流接続部)
12 交流接続部(図4以降:プラス接続部)
13 第1パワートランジスタ
14 フリーホイーリングダイオード
15 ボンディングワイヤ
16 マイナス接続導体
17 プラス接続導体
18 交流接続導体
19 第2パワートランジスタ
20 プラス接続ライン
21 マイナス接続ライン
22 交流接続ライン
23 バー
24 電流の流れで取り囲まれる面
25 上方に向かってはボンディングワイヤにより画成されていて且つ下方に向かってはバーの下側により画成されている領域
26 マイナス接続ラインとプラス接続ラインとの間の領域
A 接続ラインの一部分
B 接続ラインの一部分
C 接続ラインの一部分
Claims (5)
- 電気的に絶縁性の基板(9)を有する、寄生インダクタンスの小さい回路装置であって、基板(9)上に設けられていて互いに絶縁されている金属性の接続経路と、並列に接続されている複数の第1パワートランジスタ(13)及び第2パワートランジスタ(19)からそれぞれ構成されていて金属性の接続経路上に設けられ直列に接続されている第1及び第2パワースイッチと、直流接続導体(20、21)及び交流接続導体(22)とを有する前記回路装置において、
それぞれの第1パワートランジスタ(13)及び第2パワートランジスタ(19)が、狭い間隔で隣り合って且つ一列に配設されていて、
一方の直流接続導体(20)が、第1の部分にて他方の直流接続導体(21)に対しバンド状で狭い間隔で隣り合って平行に配設され、基板(9)上の金属性の接続経路の近くまで延在し、他方の直流接続導体(21)が基板(9)上の金属性の接続経路に接触するように配設されていて、
一方の直流接続導体(20)が、基板(9)の表面に対して平行であり第1の部分に接続されている第2のバンド状の部分を有し、この第2の部分にはバー(23)が接続されていて、これらのバー(23)が、部分的には絶縁層によってのみ基板(9)上の金属性の接続経路から離されているが、基板(9)上の少なくとも1つの金属性の接続経路と接触することを特徴とする回路装置。 - バー(23)が、パワートランジスタ(13、19)の間に配設されていて、少なくとも1つの直流接続導体(20)が、モジュールの圧力接触構造体において接続部自体の電気的な圧力接触のため並びに冷却体に対する基板(9)の熱的な圧力接触のための圧力伝達要素として形成されていることを特徴とする、請求項1に記載の回路装置。
- 第1及び第2パワースイッチが、2列のパワートランジスタにより基板(9)上で対称に位置付けられていることを特徴とする、請求項1に記載の回路装置。
- パワートランジスタが、IGBTまたはMOSFETであることを特徴とする、請求項1〜3のいずれか一項に記載の回路装置。
- トランジスタの他に、1つの又は複数のフリーホイーリングダイオードもパワースイッチを形成し、それぞれに付設されているパワートランジスタと一列に配設されていることを特徴とする、請求項1〜4のいずれか一項に記載の回路装置。
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DE102004037078A1 (de) * | 2004-07-30 | 2006-03-23 | Siemens Ag | Planare Verbindungstechnik für Stromführung im Fehlerfall |
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DE102004059313B3 (de) * | 2004-12-09 | 2006-05-04 | Semikron Elektronik Gmbh & Co. Kg | Leistungshalbleitermodul mit verringerten parasitären Induktivitäten |
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JP2725952B2 (ja) * | 1992-06-30 | 1998-03-11 | 三菱電機株式会社 | 半導体パワーモジュール |
DE59304797D1 (de) * | 1992-08-26 | 1997-01-30 | Eupec Gmbh & Co Kg | Leistungshalbleiter-Modul |
EP0609528A1 (en) * | 1993-02-01 | 1994-08-10 | Motorola, Inc. | Low inductance semiconductor package |
DE4421319A1 (de) * | 1994-06-17 | 1995-12-21 | Abb Management Ag | Niederinduktives Leistungshalbleitermodul |
US5550436A (en) * | 1994-09-01 | 1996-08-27 | International Rectifier Corporation | MOS gate driver integrated circuit for ballast circuits |
DE59509057D1 (de) * | 1994-11-07 | 2001-04-05 | Eupec Gmbh & Co Kg | Brücken-Modul |
US5773320A (en) * | 1995-11-13 | 1998-06-30 | Asea Brown Boveri Ag | Method for producing a power semiconductor module |
US5705848A (en) * | 1995-11-24 | 1998-01-06 | Asea Brown Boveri Ag | Power semiconductor module having a plurality of submodules |
WO1998004029A1 (en) * | 1996-07-22 | 1998-01-29 | Hydro-Quebec | Low stray interconnection inductance power converting module for converting a dc voltage into an ac voltage, and a method therefor |
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DE19826731C2 (de) * | 1998-06-16 | 2000-10-26 | Gruendl & Hoffmann | Halbbrückenbaugruppe |
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