JP3541391B2 - 映像処理装置 - Google Patents
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Description
【産業上の利用分野】
本発明は、映像信号を動画としてデジタル圧縮した後、映像デ−タをCPUまたは記憶媒体に送り、また、CPUあるいは記憶媒体からの圧縮された映像デ−タをデジタル伸長させ、同時にモニタ−画面の任意位置および任意サイズで拡大、縮小させた動画表示を実現させる映像処理装置に関する。
【0002】
【従来の技術】
従来例を図2を用いて説明する。映像信号20を映像デコ−ダ部21に送り、カラ−信号・輝度信号・同期信号に分離する。カラ−信号・輝度信号はADコンバ−タ22(以降、ADCと略称)によりデジタル化し、映像符合圧縮回路部27で符合圧縮された映像デ−タはCPU16とバスライン29によりCPU16または記憶媒体15に送られる。CPU16または記憶媒体15から圧縮された映像デ−タはCPUバスライン29を通じ、映像符合伸長回路部28に送られてデ−タ伸長される。伸長されたデ−タは映像メモリ23に書き込まれ、DAコンバ−タ24(以降、DACと略称)でアナログ信号化させ、ビデオスイッチ25に送られ、ビデオスイッチ25によりDAC24からの信号とコンピュ−タ映像信号26を切り替える。そこからの映像信号をモニタ−部31に送られて表示される。そこで、映像信号20をモニタ−部31に出力させながらCPUバスライン29に映像信号を符合圧縮させ、CPU16または記憶媒体15に送ろうとした場合、映像信号20を映像デコ−ダ21、ADC22からデジタル化された映像デ−タを映像符合圧縮回路部27により符合圧縮させ、CPUバスライン29を経由し、CPUまたは記憶媒体に送られる。映像デコ−ダ部21の信号を受けて圧縮伸長制御回路部30は映像符合圧縮回路部27と映像符合伸長回路部28を制御している。
【0003】
次に、先に書き込まれた映像デ−タをCPUまたは記憶媒体からCPUバスライン29を通じ映像符合伸長回路部28により符合伸長させ、映像メモリ23を更新させ、モニタ−部31に動画として表示される。
【0004】
【発明が解決しようとする課題】
しかし、従来例で映像信号20をフレ−ム単位またはフィ−ルド単位でCPUまたは記憶媒体に書き込み作業後、映像メモリ23を更新するため、映像信号のフレーム単位のあるいはフィールド単位の少なくとも1/2以下の速度での書き込みとなり、ここで仮に、フレーム単位あるいはフィールド単位の両者をまとめて「作業単位」と表現したとすると、映像信号をモニタ−部31に表示する場合も作業単位の1/2以下の速度での表示となってしまう。
【0006】
【課題を解決するための手段】
本発明の映像処理装置は、表示装置に表示するためのデータを記憶する映像メモリ部と、映像処理部と、バスとを備えた映像処理装置であって、
該バスを介して映像メモリ部に供給されるデータは該バスを介して該映像処理部にも供給されるように該映像メモリ部および該映像処理部とが該バスに並列に連結されてなり、
前記映像処理部は、該バスを介して供給されるデータを圧縮して記憶媒体に格納する映像符号圧縮回路部と、前記映像符号圧縮回路部によるデータの圧縮および格納と並行して前記映像メモリ部から映像を読み出して任意の表示サイズおよび表示位置で前記表示装置に表示する制御を行う表示拡大縮小回路部と、を備える。
【0008】
【実施例】
図1は、本発明の全体回路ブロック図であり、かかる処理回路については、同一出願人による特開平02−298176号公報に詳述され、特に、表示拡大縮小回路部についてはこの公報の第14図に示されている。
【0009】
図1において、映像信号1を映像デコ−ダ部2により色成分{R色・G色・B色またはY(輝度)・U/V(色相)}と、水平同期信号・垂直同期信号を得る。得られた色成分はADコンバ−タ3へ送られデジタル信号化される。映像デコ−ダ部2の信号を受けて圧縮伸長制御回路部19は映像符合圧縮回路部10と映像符合伸長回路部11を制御している。デジタル化された映像信号は、短絡状態(ON)となった絶縁回路部4を介して映像メモリ部5と映像符合圧縮回路部10の双方に送られており、これらのADコンバ−タ3と映像メモリ部5と映像符合圧縮回路部10はバスライン18を介して互いに連結されている。その際、バスライン18を介して連結されている映像メモリ部と映像符合伸長回路部11間は、絶縁回路部12により絶縁状態(OFF)となる。そこで、映像メモリ部5とDAコンバ−タ6とビデオスイッチ7は表示拡大縮小回路部14により制御され、モニタ−部8内に任意の表示サイズの表示位置で表示され、コンピュ−タ映像信号9とス−パ−インポ−ズされる。それと同時に、映像符合圧縮回路部10は絶縁回路部4からの映像信号を符合圧縮し、CPUバスライン17を通じてCPU16または記憶媒体15に書き込まれる。その結果、CPU16は専らデータの取り込みに専念できるという大きな特徴をもつことになる。
【0010】
再生時においては、通信回線などCPU16を介した信号または記憶媒体15からの圧縮符合化された映像デ−タを、映像符合伸長回路部11により映像信号の符合伸長して、短絡状態(ON)となった絶縁回路部12を通り、映像メモリ部5へ送られる。そこで、映像が送られた映像メモリ部5から表示拡大縮小回路部14で制御された映像メモリ部5,DAコンバ−タ6,ビデオスイッチ7を通り、任意の表示サイズおよび表示位置でモニタ−部8に表示される。その際、ADコンバ−タ3の経路は絶縁回路部4により絶縁状態(OFF)となる。この再生時に他のCPUをさらに付加して再生専用に動作させることもできるが、本発明は絶縁回路部4と12の存在によりそのような必要がない。
【0011】
【発明の効果】
本発明により、映像データをモニター部に表示させたまま、同時に映像データを圧縮することができ、記憶媒体に書込むことができる。従って映像データはフィールドまたはフレーム単位で途切れることなく信号処理される。
【0012】
また、CPUまたは記憶媒体から読みだされたデータは、指定サイズの映像デ−タを表示拡大縮小回路部14により、指定サイズに拘らず任意の表示サイズおよび表示位置でモニタ−部8に表示させられ、今後、マルチメディアに対応した映像処理分野ではなくてはならない効果が得られる発明である。
【図面の簡単な説明】
【図1】本発明の回路ブロック図。
【図2】従来の回路ブロック図。
【符号の説明】
1:映像信号
2:映像デコ−ダ部
3:ADコンバ−タ部
4:絶縁回路部
5:映像メモリ部
6:DAコンバ−タ部
7:ビデオスイッチ部
8:モニタ−部
9:コンピュ−タ映像信号
10:映像符合圧縮回路部
11:映像符合伸長回路部
12:絶縁回路部
13:デジタイズ制御回路部
14:表示拡大縮小回路部
15:記憶媒体
16:CPU
17:CPUバスライン
20:映像信号
21:映像デコ−ダ部
22:ADコンバ−タ
23:映像メモリ部
24:DAコンバ−タ
25:ビデオスイッチ部
26:コンピュ−タ映像信号
27:映像符合圧縮回路部
28:映像符合伸長回路部
29:CPUバスライン
30:圧縮伸長制御回路部
31:モニタ−部
Claims (1)
- 表示装置に表示するためのデータを記憶する映像メモリ部と、映像処理部と、バスとを備えた映像処理装置であって、
該バスを介して映像メモリ部に供給されるデータは該バスを介して該映像処理部にも供給されるように該映像メモリ部および該映像処理部とが該バスに並列に連結されてなり、
前記映像処理部は、該バスを介して供給されるデータを圧縮して記憶媒体に格納する映像符号圧縮回路部と、前記映像符号圧縮回路部によるデータの圧縮および格納と並行して前記映像メモリ部から映像を読み出して任意の表示サイズおよび表示位置で前記表示装置に表示する制御を行う表示拡大縮小回路部と、を備えることを特徴とする映像処理装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP07174391A JP3541391B2 (ja) | 1991-04-04 | 1991-04-04 | 映像処理装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP07174391A JP3541391B2 (ja) | 1991-04-04 | 1991-04-04 | 映像処理装置 |
Related Child Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2003433326A Division JP3636196B2 (ja) | 2003-12-26 | 2003-12-26 | 映像処理装置 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH04307876A JPH04307876A (ja) | 1992-10-30 |
JP3541391B2 true JP3541391B2 (ja) | 2004-07-07 |
Family
ID=13469314
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP07174391A Expired - Lifetime JP3541391B2 (ja) | 1991-04-04 | 1991-04-04 | 映像処理装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP3541391B2 (ja) |
Families Citing this family (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0832962A (ja) * | 1994-07-20 | 1996-02-02 | Seiko Epson Corp | 動画映像信号の圧縮/伸長装置 |
-
1991
- 1991-04-04 JP JP07174391A patent/JP3541391B2/ja not_active Expired - Lifetime
Also Published As
Publication number | Publication date |
---|---|
JPH04307876A (ja) | 1992-10-30 |
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