JP3440314B2 - ２スイッチ付きバック・ブースト変換器 - Google Patents
２スイッチ付きバック・ブースト変換器Info
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- G05F—SYSTEMS FOR REGULATING ELECTRIC OR MAGNETIC VARIABLES
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- G05F1/10—Regulating voltage or current
- G05F1/46—Regulating voltage or current wherein the variable actually regulated by the final control device is dc
- G05F1/62—Regulating voltage or current wherein the variable actually regulated by the final control device is dc using bucking or boosting dc sources
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- H—ELECTRICITY
- H02—GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
- H02M—APPARATUS FOR CONVERSION BETWEEN AC AND AC, BETWEEN AC AND DC, OR BETWEEN DC AND DC, AND FOR USE WITH MAINS OR SIMILAR POWER SUPPLY SYSTEMS; CONVERSION OF DC OR AC INPUT POWER INTO SURGE OUTPUT POWER; CONTROL OR REGULATION THEREOF
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- H02M3/02—Conversion of dc power input into dc power output without intermediate conversion into ac
- H02M3/04—Conversion of dc power input into dc power output without intermediate conversion into ac by static converters
- H02M3/10—Conversion of dc power input into dc power output without intermediate conversion into ac by static converters using discharge tubes with control electrode or semiconductor devices with control electrode
- H02M3/145—Conversion of dc power input into dc power output without intermediate conversion into ac by static converters using discharge tubes with control electrode or semiconductor devices with control electrode using devices of a triode or transistor type requiring continuous application of a control signal
- H02M3/155—Conversion of dc power input into dc power output without intermediate conversion into ac by static converters using discharge tubes with control electrode or semiconductor devices with control electrode using devices of a triode or transistor type requiring continuous application of a control signal using semiconductor devices only
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- H02M3/158—Conversion of dc power input into dc power output without intermediate conversion into ac by static converters using discharge tubes with control electrode or semiconductor devices with control electrode using devices of a triode or transistor type requiring continuous application of a control signal using semiconductor devices only with automatic control of output voltage or current, e.g. switching regulators including plural semiconductor devices as final control devices for a single load
- H02M3/1582—Buck-boost converters
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Description
【０００１】
【産業上の利用分野】本発明は、一般に、ＤＣ／ＤＣ変
換器に関し、特に、２スイッチ付きバック・ブースト変
換器に関する。
換器に関し、特に、２スイッチ付きバック・ブースト変
換器に関する。
【０００２】
【従来の技術】２スイッチ付きバック・ブースト変換器
は、所望のＤＣ出力電圧を創出するようにＤＣ入力電圧
を必要に応じて「バック・ダウン」又は「ブースト・ア
ップ」することができるように構成された非絶縁型ＤＣ
／ＤＣ変換器に用いられる周知の電気的トポロジ（接続
形態）である。典型的な従来技術の２スイッチ付きバッ
ク・ブースト変換器は、図１に例示されている。この回
路の主たる目的は、どの電力変換トポロジにおいても同
じであるが、変換器内での電力損失が最少限になるよう
にして電力を入力から出力に変換することである。換言
すれば、電力切換効率を高くすることが望ましいという
ことである。バック・ブースト変換器を制御する最も直
載的な技法は、その２つのスイッチの両方を同時に切り
換えること（２スイッチ同時制御）による方法である
が、この制御方法は、電力切換効率を不必要に劣化させ
るという欠点がある。なぜなら、制御する必要のない方
のスイッチを含めて両方のスイッチを同時に制御するか
らである。理論的には、変換器の調整は、その変換器へ
の入力電圧に対して出力電圧を低下させるべきか、上昇
させるべきかに応じて１回に１つのスイッチだけを能動
的に切り換えることによって行えばよい。変換器の１つ
のスイッチを１つの状態から他の状態に切り換える過程
で電力の損失を生じるので、後者の技法（即ち、制御す
る必要のない方のスイッチを含めて両方のスイッチを同
時に制御するのではなく、必要の都度、１回に１つのス
イッチの制御だけを行う方法）の方が望ましい。
は、所望のＤＣ出力電圧を創出するようにＤＣ入力電圧
を必要に応じて「バック・ダウン」又は「ブースト・ア
ップ」することができるように構成された非絶縁型ＤＣ
／ＤＣ変換器に用いられる周知の電気的トポロジ（接続
形態）である。典型的な従来技術の２スイッチ付きバッ
ク・ブースト変換器は、図１に例示されている。この回
路の主たる目的は、どの電力変換トポロジにおいても同
じであるが、変換器内での電力損失が最少限になるよう
にして電力を入力から出力に変換することである。換言
すれば、電力切換効率を高くすることが望ましいという
ことである。バック・ブースト変換器を制御する最も直
載的な技法は、その２つのスイッチの両方を同時に切り
換えること（２スイッチ同時制御）による方法である
が、この制御方法は、電力切換効率を不必要に劣化させ
るという欠点がある。なぜなら、制御する必要のない方
のスイッチを含めて両方のスイッチを同時に制御するか
らである。理論的には、変換器の調整は、その変換器へ
の入力電圧に対して出力電圧を低下させるべきか、上昇
させるべきかに応じて１回に１つのスイッチだけを能動
的に切り換えることによって行えばよい。変換器の１つ
のスイッチを１つの状態から他の状態に切り換える過程
で電力の損失を生じるので、後者の技法（即ち、制御す
る必要のない方のスイッチを含めて両方のスイッチを同
時に制御するのではなく、必要の都度、１回に１つのス
イッチの制御だけを行う方法）の方が望ましい。
【０００３】作動において、図１に示された従来のバッ
ク・ブースト変換器は、極性が正の端子Ｑと極性が負の
端子Ｒの間で単極性の入力電圧を印加する。この変換器
の出力電圧は、極性が正の端子Ｓと極性が負の端子Ｔの
間で創出される。端子ＲとＴは電気的に接続されてお
り、ゼロ基準電位即ち接地側である。端子Ｅ及びＦは、
それぞれ、半導体スイッチデバイスＳ1 ，Ｓ2 への制御
用入力端子である。半導体デバイス（「半導体デバイ
ス」又は単に「デバイス」とも称する）Ｓ1 ，Ｓ2は、
この変換器ではそれぞれ「ブーストスイッチ」、「バッ
クスイッチ」と称されるものであり、図示のように、例
えばＭＯＳＦＥＴ（金属酸化膜半導体電界効果トランジ
スタ）である。デバイスＳ1 とＳ2 を同時に調整すれ
ば、使用される回路構成部品の制約の範囲内で任意の正
の出力電圧を得ることができる。しかしながら、デバイ
スＳ1 ，Ｓ2 のこのような慣用の同時スイッチング（切
換）は、不必要な電力損失をもたらす。
ク・ブースト変換器は、極性が正の端子Ｑと極性が負の
端子Ｒの間で単極性の入力電圧を印加する。この変換器
の出力電圧は、極性が正の端子Ｓと極性が負の端子Ｔの
間で創出される。端子ＲとＴは電気的に接続されてお
り、ゼロ基準電位即ち接地側である。端子Ｅ及びＦは、
それぞれ、半導体スイッチデバイスＳ1 ，Ｓ2 への制御
用入力端子である。半導体デバイス（「半導体デバイ
ス」又は単に「デバイス」とも称する）Ｓ1 ，Ｓ2は、
この変換器ではそれぞれ「ブーストスイッチ」、「バッ
クスイッチ」と称されるものであり、図示のように、例
えばＭＯＳＦＥＴ（金属酸化膜半導体電界効果トランジ
スタ）である。デバイスＳ1 とＳ2 を同時に調整すれ
ば、使用される回路構成部品の制約の範囲内で任意の正
の出力電圧を得ることができる。しかしながら、デバイ
スＳ1 ，Ｓ2 のこのような慣用の同時スイッチング（切
換）は、不必要な電力損失をもたらす。
【０００４】デバイスＳ2 をＯＦＦに保持したままでデ
バイスＳ1 を調整させれば、出力電圧を、（入力電圧−
回路内での電圧損失分）（即ち、入力電圧から回路内で
の電圧損失分を差し引いた電圧）を最大限とする範囲内
で任意の正電位に調整することができる。この動作モー
ドは、変換器のバック動作モードと称される。反対に、
デバイスＳ1 をＯＮに保持したままでデバイスＳ2 を調
整すれば、出力電圧を、（入力電圧−回路内での電圧損
失分）未満の任意の正電位に調整することができる。こ
の動作モードは、変換器のブースト動作モードと称され
る。図１の従来のバック・ブースト変換器のこれらの２
つの動作モードは、２つのスイッチの同時調整操作より
は高い電力変換効率が得られる１回１スイッチ制御によ
る方法である。
バイスＳ1 を調整させれば、出力電圧を、（入力電圧−
回路内での電圧損失分）（即ち、入力電圧から回路内で
の電圧損失分を差し引いた電圧）を最大限とする範囲内
で任意の正電位に調整することができる。この動作モー
ドは、変換器のバック動作モードと称される。反対に、
デバイスＳ1 をＯＮに保持したままでデバイスＳ2 を調
整すれば、出力電圧を、（入力電圧−回路内での電圧損
失分）未満の任意の正電位に調整することができる。こ
の動作モードは、変換器のブースト動作モードと称され
る。図１の従来のバック・ブースト変換器のこれらの２
つの動作モードは、２つのスイッチの同時調整操作より
は高い電力変換効率が得られる１回１スイッチ制御によ
る方法である。
【０００５】近年、日本の富士電機（株）は、１回１ス
イッチ制御法を首尾よく実施するバック・ブースト制御
器集積回路（部品Ｎｏ．ＦＡ７６１８）を発売した。こ
のバック・ブースト制御器の回路の関連部分が図２に示
されている。このバック・ブーストトポロジに特有の一
番の特徴は、１回１スイッチ制御法の良好な実施を可能
にしたことにある。即ち、入力電圧を一定とした場合、
１００％のデューティ比率（動作比率）で動作するバッ
ク動作モードにおける変換器の出力電圧は、０％のデュ
ーティ比率で動作するブースト動作モードにおける変換
器の出力電圧と同じである。「デューティ比率」とは、
斯界において周知のように、スイッチのＯＮ時間とＯＦ
Ｆ時間の全サイクルを完了するのに必要とされる時間に
対するスイッチのＯＮ時間の比率のことである。従っ
て、この従来技術の制御回路を開発する上での難題は、
バックスイッチのデューティ比率を制御する信号が１０
０％に近づくいたとき、その同じ信号が、又、０％のデ
ューティ比率から出発しているブーストスイッチを調整
させ始める働きをするように構成しなければならないと
いう要件であった。
イッチ制御法を首尾よく実施するバック・ブースト制御
器集積回路（部品Ｎｏ．ＦＡ７６１８）を発売した。こ
のバック・ブースト制御器の回路の関連部分が図２に示
されている。このバック・ブーストトポロジに特有の一
番の特徴は、１回１スイッチ制御法の良好な実施を可能
にしたことにある。即ち、入力電圧を一定とした場合、
１００％のデューティ比率（動作比率）で動作するバッ
ク動作モードにおける変換器の出力電圧は、０％のデュ
ーティ比率で動作するブースト動作モードにおける変換
器の出力電圧と同じである。「デューティ比率」とは、
斯界において周知のように、スイッチのＯＮ時間とＯＦ
Ｆ時間の全サイクルを完了するのに必要とされる時間に
対するスイッチのＯＮ時間の比率のことである。従っ
て、この従来技術の制御回路を開発する上での難題は、
バックスイッチのデューティ比率を制御する信号が１０
０％に近づくいたとき、その同じ信号が、又、０％のデ
ューティ比率から出発しているブーストスイッチを調整
させ始める働きをするように構成しなければならないと
いう要件であった。
【０００６】スイッチの駆動デューティ比率の固定周波
数・パルス幅変調制御を実施するための慣用の技法は、
制御信号（エラー信号）を固定振幅及び周波数の三角波
形又は鋸歯波形によって表されるタイミングランプ信号
に対して比較するために１つの比較器を用いる方法であ
る。上記従来技術のＦＡ７６１８制御器に使用されてい
る実施方法は、１つの比較器を上述した標準的態様で使
用して、一方の駆動信号を制御し、かつ、他方の駆動信
号を制御するためにタイミングランプ信号の大きさに等
しい量だけもう１つの比較器の一方の入力のレベルをシ
フトする方法である。適正に構成すれば、この構成によ
ってバック・ブースト変換器の両方のスイッチのための
所望の駆動信号を与えることができる。上述したレベル
シフトの大きさをランプ信号即ちランプ波（以下、単に
「ランプ」とも称する）の大きさに等しい大きさに設定
することによってバック動作モードとブースト動作モー
ドとの間の移行を、動作基点の変更を必要とすることな
く実施することができる。周知のように、動作基点の変
更は、その際に出力の乱れを生じするので望ましくな
い。
数・パルス幅変調制御を実施するための慣用の技法は、
制御信号（エラー信号）を固定振幅及び周波数の三角波
形又は鋸歯波形によって表されるタイミングランプ信号
に対して比較するために１つの比較器を用いる方法であ
る。上記従来技術のＦＡ７６１８制御器に使用されてい
る実施方法は、１つの比較器を上述した標準的態様で使
用して、一方の駆動信号を制御し、かつ、他方の駆動信
号を制御するためにタイミングランプ信号の大きさに等
しい量だけもう１つの比較器の一方の入力のレベルをシ
フトする方法である。適正に構成すれば、この構成によ
ってバック・ブースト変換器の両方のスイッチのための
所望の駆動信号を与えることができる。上述したレベル
シフトの大きさをランプ信号即ちランプ波（以下、単に
「ランプ」とも称する）の大きさに等しい大きさに設定
することによってバック動作モードとブースト動作モー
ドとの間の移行を、動作基点の変更を必要とすることな
く実施することができる。周知のように、動作基点の変
更は、その際に出力の乱れを生じするので望ましくな
い。
【０００７】上記従来技術のＦＡ７６１８制御器の作動
は、図２の回路図及び図３の波形図を参照することによ
って理解することができよう。三角波形発振器ＯＳＣ
は、端子ＢとＣの間に印加される２つの電位の間で一定
周波数のランプ信号を出力し、端子Ｇで取り出すことが
できるタイミングランプを供給する。エラー信号は、端
子Ａに印加される。出力端子Ｆを有する比較器は、発振
器ＯＳＣの電位を該エラー信号の電位に対して比較す
る。この比較器の２つの入力極性は、エラー信号の電位
が発振器の電位を越えると、出力が高くなり、反対にエ
ラー信号の電位が発振器の電位より低いと、出力が低く
なるように構成されている。出力端子Ｆは、図１のバッ
クスイッチＳ1 のための制御端子として機能する。出力
端子Ｅを有するもう１つの比較器は、発振器ＯＳＣの電
位を上記エラー信号の電位から量ＶLSだけ差し引いた値
に等しい電位に対して比較する。量ＶLSは、端子ＢとＣ
の間の電位差の大きさに等しくするのが理想的である。
端子ＢとＣの間の電位差は、発振器ＯＳＣの電圧変動の
大きさに等しい。端子Ｅは、図１のブーストスイッチＳ
2 のための制御端子として機能する。
は、図２の回路図及び図３の波形図を参照することによ
って理解することができよう。三角波形発振器ＯＳＣ
は、端子ＢとＣの間に印加される２つの電位の間で一定
周波数のランプ信号を出力し、端子Ｇで取り出すことが
できるタイミングランプを供給する。エラー信号は、端
子Ａに印加される。出力端子Ｆを有する比較器は、発振
器ＯＳＣの電位を該エラー信号の電位に対して比較す
る。この比較器の２つの入力極性は、エラー信号の電位
が発振器の電位を越えると、出力が高くなり、反対にエ
ラー信号の電位が発振器の電位より低いと、出力が低く
なるように構成されている。出力端子Ｆは、図１のバッ
クスイッチＳ1 のための制御端子として機能する。出力
端子Ｅを有するもう１つの比較器は、発振器ＯＳＣの電
位を上記エラー信号の電位から量ＶLSだけ差し引いた値
に等しい電位に対して比較する。量ＶLSは、端子ＢとＣ
の間の電位差の大きさに等しくするのが理想的である。
端子ＢとＣの間の電位差は、発振器ＯＳＣの電圧変動の
大きさに等しい。端子Ｅは、図１のブーストスイッチＳ
2 のための制御端子として機能する。
【０００８】従来技術のＦＡ７６１８制御器の構成の１
つの欠点は、レベルシフト回路を用いたことである。バ
ック動作モードとブースト動作モードとをオーバーラン
させることなく両者間の最適な移行を実施するための鍵
は、レベルシフトの大きさをタイミングランプの大きさ
をもって正確に追跡することにある。従って、レベルシ
フトの大きさ及びタイミングランプの大きさの制御は臨
界的な重要性を有しており、前者の方が正確に制御する
のは、前者の方が後者より困難である。
つの欠点は、レベルシフト回路を用いたことである。バ
ック動作モードとブースト動作モードとをオーバーラン
させることなく両者間の最適な移行を実施するための鍵
は、レベルシフトの大きさをタイミングランプの大きさ
をもって正確に追跡することにある。従って、レベルシ
フトの大きさ及びタイミングランプの大きさの制御は臨
界的な重要性を有しており、前者の方が正確に制御する
のは、前者の方が後者より困難である。
【０００９】
【発明が解決しようとする課題】従って、本発明の目的
は、タイミングランプ信号の電圧変動限度に等しい大き
さの電圧に対して、一方の駆動出力を制御するためにア
ナログエラー信号を使用し、それと同時併行的に、該ア
ナログエラー信号のアナログ反転信号を使用することに
よって１回に１つのスイッチ制御を行う２スイッチ付き
バック・ブースト変換器のための制御器を提供すること
である。
は、タイミングランプ信号の電圧変動限度に等しい大き
さの電圧に対して、一方の駆動出力を制御するためにア
ナログエラー信号を使用し、それと同時併行的に、該ア
ナログエラー信号のアナログ反転信号を使用することに
よって１回に１つのスイッチ制御を行う２スイッチ付き
バック・ブースト変換器のための制御器を提供すること
である。
【００１０】本発明の他の目的は、１つの比較器を使用
してアナログエラー信号をタイミングランプ信号の所定
の電圧変動限度に対して比較し、それによって、２つの
駆動出力のどちらを変調制御可能状態にするべきである
かを決定する機能と、該比較器によって比較された該タ
イミングランプ信号の電圧変動限度が２つの異なる電圧
変動限度の間でスイッチされるように該タイミングラン
プ信号の電圧変動限度を変更する機能とを果たすことに
よって１回に１つのスイッチ制御を行う２スイッチ付き
バック・ブースト変換器のための制御器を提供すること
である。
してアナログエラー信号をタイミングランプ信号の所定
の電圧変動限度に対して比較し、それによって、２つの
駆動出力のどちらを変調制御可能状態にするべきである
かを決定する機能と、該比較器によって比較された該タ
イミングランプ信号の電圧変動限度が２つの異なる電圧
変動限度の間でスイッチされるように該タイミングラン
プ信号の電圧変動限度を変更する機能とを果たすことに
よって１回に１つのスイッチ制御を行う２スイッチ付き
バック・ブースト変換器のための制御器を提供すること
である。
【００１１】
【課題を解決するための手段】上記課題が解決するため
に、本発明は、その一側面によれば、２スイッチ付きバ
ック・ブースト変換器に使用するための制御器であっ
て、高入力電圧と低入力電圧を受け取り、該高入力電圧
及び低入力電圧に等しい変動電圧限度を有するタイミン
グランプ信号を発生するための発振器と、エラー信号を
受け取るための反転用入力端と、前記高入力電圧を受け
取るための非反転用入力端を有する演算増幅器と、前記
エラー信号を受け取るための入力端及び前記タイミング
ランプ信号を受け取るための入力端と、前記２スイッチ
付きバック・ブースト変換器のバックスイッチを制御す
るための出力端を有する第１比較器と、前記タイミング
ランプ信号を受け取るための入力端及び前記演算増幅器
の出力を受け取るための入力端と、前記２スイッチ付き
バック・ブースト変換器のブーストスイッチを制御する
ための出力端を有する第２比較器と、から成る制御器を
提供する。
に、本発明は、その一側面によれば、２スイッチ付きバ
ック・ブースト変換器に使用するための制御器であっ
て、高入力電圧と低入力電圧を受け取り、該高入力電圧
及び低入力電圧に等しい変動電圧限度を有するタイミン
グランプ信号を発生するための発振器と、エラー信号を
受け取るための反転用入力端と、前記高入力電圧を受け
取るための非反転用入力端を有する演算増幅器と、前記
エラー信号を受け取るための入力端及び前記タイミング
ランプ信号を受け取るための入力端と、前記２スイッチ
付きバック・ブースト変換器のバックスイッチを制御す
るための出力端を有する第１比較器と、前記タイミング
ランプ信号を受け取るための入力端及び前記演算増幅器
の出力を受け取るための入力端と、前記２スイッチ付き
バック・ブースト変換器のブーストスイッチを制御する
ための出力端を有する第２比較器と、から成る制御器を
提供する。
【００１２】本発明の他の側面によれば、２スイッチ付
きバック・ブースト変換器に使用するための制御器であ
って、高入力電圧と、中間入力電圧と、低入力電圧を受
け取り、該中間入力電圧と低入力電圧との間、及び該中
間入力電圧と低入力電圧との間の選択自在の変動電圧限
度を有するタイミングランプ信号を発生するための発振
器と、エラー信号を受け取るための入力端及び前記中間
入力電圧を受け取るための入力端と、前記発振器に接続
されており、前記タイミングランプ信号の前記変動電圧
限度を選択するための出力端を有する第１比較器と、前
記タイミングランプ信号を受け取るための入力端及び前
記エラー信号を受け取るための入力端を有する第２比較
器と、前記タイミングランプ信号を受け取るための入力
端及び前記エラー信号を受け取るための入力端を有する
第３比較器と、前記第１比較器の出力と、前記第２比較
器の出力を受け取るように結合されており、前記２スイ
ッチ付きバック・ブースト変換器のブーストスイッチを
制御するためのＯＲゲートと、前記第１比較器の出力
と、前記第２比較器の出力を受け取るように結合されて
おり、前記２スイッチ付きバック・ブースト変換器のバ
ックスイッチを制御するためのＡＮＤゲートと、から成
る制御器が提供される。
きバック・ブースト変換器に使用するための制御器であ
って、高入力電圧と、中間入力電圧と、低入力電圧を受
け取り、該中間入力電圧と低入力電圧との間、及び該中
間入力電圧と低入力電圧との間の選択自在の変動電圧限
度を有するタイミングランプ信号を発生するための発振
器と、エラー信号を受け取るための入力端及び前記中間
入力電圧を受け取るための入力端と、前記発振器に接続
されており、前記タイミングランプ信号の前記変動電圧
限度を選択するための出力端を有する第１比較器と、前
記タイミングランプ信号を受け取るための入力端及び前
記エラー信号を受け取るための入力端を有する第２比較
器と、前記タイミングランプ信号を受け取るための入力
端及び前記エラー信号を受け取るための入力端を有する
第３比較器と、前記第１比較器の出力と、前記第２比較
器の出力を受け取るように結合されており、前記２スイ
ッチ付きバック・ブースト変換器のブーストスイッチを
制御するためのＯＲゲートと、前記第１比較器の出力
と、前記第２比較器の出力を受け取るように結合されて
おり、前記２スイッチ付きバック・ブースト変換器のバ
ックスイッチを制御するためのＡＮＤゲートと、から成
る制御器が提供される。
【００１３】本発明は、又、２スイッチ付きバック・ブ
ースト変換器のバックスイッチ及びブーストスイッチを
制御するための制御方法であって、変動電圧上限と変動
電圧下限を有するタイミングランプ信号を発生し、アナ
ログエラー信号を前記タイミングランプ信号の前記変動
電圧上限と比較し、前記タイミングランプ信号の前記変
動電圧上限に対して前記アナログエラー信号のアナログ
反転信号を創生し、該創生されたアナログ反転信号を前
記タイミングランプ信号と比較し、前記アナログエラー
信号が前記タイミングランプ信号の前記変動電圧上限を
越えているときは前記バックスイッチをＯＮにし、前記
エラー信号の前記アナログ反転信号が前記タイミングラ
ンプ信号の前記変動電圧上限を越えているときは前記ブ
ーストスイッチをＯＮにすることから成る制御方法を提
供する。
ースト変換器のバックスイッチ及びブーストスイッチを
制御するための制御方法であって、変動電圧上限と変動
電圧下限を有するタイミングランプ信号を発生し、アナ
ログエラー信号を前記タイミングランプ信号の前記変動
電圧上限と比較し、前記タイミングランプ信号の前記変
動電圧上限に対して前記アナログエラー信号のアナログ
反転信号を創生し、該創生されたアナログ反転信号を前
記タイミングランプ信号と比較し、前記アナログエラー
信号が前記タイミングランプ信号の前記変動電圧上限を
越えているときは前記バックスイッチをＯＮにし、前記
エラー信号の前記アナログ反転信号が前記タイミングラ
ンプ信号の前記変動電圧上限を越えているときは前記ブ
ーストスイッチをＯＮにすることから成る制御方法を提
供する。
【００１４】更に、本発明は、２スイッチ付きバック・
ブースト変換器のバックスイッチ及びブーストスイッチ
を制御するための制御方法であって、変動電圧の中間限
度と下限との間、及び変動電圧の上限と下限との間の選
択自在の変動電圧限度を有するタイミングランプ信号を
発生し、アナログエラー信号を前記タイミングランプ信
号の変動電圧の中間限と比較し、前記タイミングランプ
信号と前記アナログエラー信号を比較し、前記アナログ
エラー信号の電圧が前記タイミングランプ信号の変動電
圧の前記中間限度を越えているときは前記バックスイッ
チをＯＮにし、前記タイミングランプ信号の変動電圧の
前記中間限度が前記アナログエラー信号の電圧を越えて
いるときは前記ブーストスイッチをＯＮにすることから
成る制御方法を提供する。
ブースト変換器のバックスイッチ及びブーストスイッチ
を制御するための制御方法であって、変動電圧の中間限
度と下限との間、及び変動電圧の上限と下限との間の選
択自在の変動電圧限度を有するタイミングランプ信号を
発生し、アナログエラー信号を前記タイミングランプ信
号の変動電圧の中間限と比較し、前記タイミングランプ
信号と前記アナログエラー信号を比較し、前記アナログ
エラー信号の電圧が前記タイミングランプ信号の変動電
圧の前記中間限度を越えているときは前記バックスイッ
チをＯＮにし、前記タイミングランプ信号の変動電圧の
前記中間限度が前記アナログエラー信号の電圧を越えて
いるときは前記ブーストスイッチをＯＮにすることから
成る制御方法を提供する。
【００１５】
【実施例】図４及び５を参照すると、本発明の第１実施
例によるバック・ブースト制御器及びその電圧波形図が
示されている。このバック・ブースト制御器の三角波発
振器１０は、入力端子ＢとＣに印加される２つの電圧の
間で一定周波数の電圧ランプ信号を（端子Ｇ）から発出
する。発振器１０によって創出される電圧ランプ信号
は、タイミングランプ信号とも称することができる。
例によるバック・ブースト制御器及びその電圧波形図が
示されている。このバック・ブースト制御器の三角波発
振器１０は、入力端子ＢとＣに印加される２つの電圧の
間で一定周波数の電圧ランプ信号を（端子Ｇ）から発出
する。発振器１０によって創出される電圧ランプ信号
は、タイミングランプ信号とも称することができる。
【００１６】エラー信号は、端子Ａに印加される。出力
端子Ｆを有する第１比較器１２は、発振器１０によって
創出された電圧ランプ信号をエラー信号に対して比較す
る。第１比較器１２の２つの入力極性は、エラー信号の
電圧が発振器の電圧ランプ信号のそれを越えると、該比
較器の出力が高くなり、反対にエラー信号の電圧が該電
圧ランプ信号のそれより低いと、該比較器の出力が低く
なるように規定されている。第１比較器１２の出力端子
Ｆは、図１に示されるような在来のバック・ブースト変
換器のバックスイッチＳ1 のための制御端子として機能
する。
端子Ｆを有する第１比較器１２は、発振器１０によって
創出された電圧ランプ信号をエラー信号に対して比較す
る。第１比較器１２の２つの入力極性は、エラー信号の
電圧が発振器の電圧ランプ信号のそれを越えると、該比
較器の出力が高くなり、反対にエラー信号の電圧が該電
圧ランプ信号のそれより低いと、該比較器の出力が低く
なるように規定されている。第１比較器１２の出力端子
Ｆは、図１に示されるような在来のバック・ブースト変
換器のバックスイッチＳ1 のための制御端子として機能
する。
【００１７】出力端子Ｅを有する第２比較器１４は、発
振器１０によって創出された電圧ランプ信号を演算増幅
器１６の主力に対して比較する。演算増幅器１６は、端
子Ａに印加されたエラー信号の負の１ゲインを得るよう
に構成されている。演算増幅器１６の正の入力は、発振
器１０によって創出された電圧ランプ信号のピーク電圧
（端子Ｂに印加された電圧）を制御するのと同じ基準に
よって制御される。
振器１０によって創出された電圧ランプ信号を演算増幅
器１６の主力に対して比較する。演算増幅器１６は、端
子Ａに印加されたエラー信号の負の１ゲインを得るよう
に構成されている。演算増幅器１６の正の入力は、発振
器１０によって創出された電圧ランプ信号のピーク電圧
（端子Ｂに印加された電圧）を制御するのと同じ基準に
よって制御される。
【００１８】図２の従来技術の回路によっても、上述し
た本発明の回路によっても１回に１つのバック・ブース
ト駆動信号が発出されるが、両者の重要な相違は、ブー
スト駆動信号と電圧ランプ信号との関係にある。電圧ラ
ンプ信号に対するバック駆動信号及びブースト駆動信号
のタイミング関係は、それらの駆動信号は、いずれも、
電圧ランプ信号の谷において０％のデューティサイクル
（動作サイクル）で開始するという点でどちらの回路に
おいても同じである。しかしながら、本発明の回路では
バック駆動信号は、電圧ランプ信号（Ｇ）の谷において
０％のデューティサイクルで開始するが、ブースト駆動
信号は、電圧ランプ信号（Ｇ）の谷ではなくピークにお
いて０％のデューティサイクルで開始する。上述した本
発明のバック・ブースト制御器の利点は、レベルシフト
回路を省除し、レベルシフトの大きさをタイミングラン
プの大きさでもって正確に追跡する必要性を排除するこ
とである。
た本発明の回路によっても１回に１つのバック・ブース
ト駆動信号が発出されるが、両者の重要な相違は、ブー
スト駆動信号と電圧ランプ信号との関係にある。電圧ラ
ンプ信号に対するバック駆動信号及びブースト駆動信号
のタイミング関係は、それらの駆動信号は、いずれも、
電圧ランプ信号の谷において０％のデューティサイクル
（動作サイクル）で開始するという点でどちらの回路に
おいても同じである。しかしながら、本発明の回路では
バック駆動信号は、電圧ランプ信号（Ｇ）の谷において
０％のデューティサイクルで開始するが、ブースト駆動
信号は、電圧ランプ信号（Ｇ）の谷ではなくピークにお
いて０％のデューティサイクルで開始する。上述した本
発明のバック・ブースト制御器の利点は、レベルシフト
回路を省除し、レベルシフトの大きさをタイミングラン
プの大きさでもって正確に追跡する必要性を排除するこ
とである。
【００１９】図６及び７を参照すると、本発明の第２実
施例による単一チャンネル型バック・ブースト制御器及
びその電圧波形図が示されている。このバック・ブース
ト制御器の三角波発振器５０は、入力端子ＢとＣとＤに
印加される３つの電圧の間で一定周波数の電圧ランプ信
号を（端子Ｇ）から発出する。
施例による単一チャンネル型バック・ブースト制御器及
びその電圧波形図が示されている。このバック・ブース
ト制御器の三角波発振器５０は、入力端子ＢとＣとＤに
印加される３つの電圧の間で一定周波数の電圧ランプ信
号を（端子Ｇ）から発出する。
【００２０】エラー信号は、端子Ａに印加される。出力
端子Ｈを有する第１比較器５２は、エラー信号を端子Ｃ
に印加された電圧に対して比較する。エラー信号の電圧
が端子Ｃに印加された電圧より低いと、第１比較器５２
の出力は低くなり、反対にエラー信号の電圧が端子Ｃに
印加された電圧より高いと、第１比較器５２の出力は高
くなる。第１比較器５２の出力は、発振器５０へ入力と
して機能し、その入力が低いときは、発振器５０は、端
子Ｄに印加される電圧と端子Ｃに印加される電圧との間
でランプする電圧ランプ信号を端子Ｇに創出する。反対
に、発振器５０への入力が高いときは、発振器５０は、
端子Ｃに印加される電圧と端子Ｄに印加される電圧との
間でランプする電圧ランプ信号を端子Ｇに創出する。端
子Ｄ，Ｃ及びＢの電圧は、図６に示されるようにその順
に高く、それらの電圧の差は等差である。
端子Ｈを有する第１比較器５２は、エラー信号を端子Ｃ
に印加された電圧に対して比較する。エラー信号の電圧
が端子Ｃに印加された電圧より低いと、第１比較器５２
の出力は低くなり、反対にエラー信号の電圧が端子Ｃに
印加された電圧より高いと、第１比較器５２の出力は高
くなる。第１比較器５２の出力は、発振器５０へ入力と
して機能し、その入力が低いときは、発振器５０は、端
子Ｄに印加される電圧と端子Ｃに印加される電圧との間
でランプする電圧ランプ信号を端子Ｇに創出する。反対
に、発振器５０への入力が高いときは、発振器５０は、
端子Ｃに印加される電圧と端子Ｄに印加される電圧との
間でランプする電圧ランプ信号を端子Ｇに創出する。端
子Ｄ，Ｃ及びＢの電圧は、図６に示されるようにその順
に高く、それらの電圧の差は等差である。
【００２１】出力端子Ｆを有する第２比較器５４は、発
振器５０によって創出された電圧ランプ信号を上記エラ
ー信号に対して比較する。第２比較器５４の入力極性
は、エラー信号の電圧が発振器５０の電圧ランプ信号の
それを越えると、比較器５４の出力が高くなり、反対に
エラー信号の電圧が該電圧ランプ信号のそれより低い
と、比較器５４の出力が低くなるように規定されてい
る。出力端子Ｆは、図１に示されるような在来のバック
・ブースト変換器のバックスイッチＳ1 のための制御端
子として機能する。第２比較器５４の出力は、ＯＲゲー
ト５６への第２入力として印加される。この信号は、エ
ラー信号の電圧が端子Ｃに印加された電圧を越えている
ときは常に、バックスイッチＳ1 をＯＮに維持する働き
をする。
振器５０によって創出された電圧ランプ信号を上記エラ
ー信号に対して比較する。第２比較器５４の入力極性
は、エラー信号の電圧が発振器５０の電圧ランプ信号の
それを越えると、比較器５４の出力が高くなり、反対に
エラー信号の電圧が該電圧ランプ信号のそれより低い
と、比較器５４の出力が低くなるように規定されてい
る。出力端子Ｆは、図１に示されるような在来のバック
・ブースト変換器のバックスイッチＳ1 のための制御端
子として機能する。第２比較器５４の出力は、ＯＲゲー
ト５６への第２入力として印加される。この信号は、エ
ラー信号の電圧が端子Ｃに印加された電圧を越えている
ときは常に、バックスイッチＳ1 をＯＮに維持する働き
をする。
【００２２】出力端子Ｆを有する第３比較器５８は、発
振器５０によって創出された電圧ランプ信号を上記エラ
ー信号に対して比較し、その出力をＡＮＤゲート６０へ
の入力として供給する。ＡＮＤゲート６０は、出力端子
Ｅを有している。第３比較器５８の入力極性は、エラー
信号の電圧が発振器５０の電圧ランプ信号のそれを越え
ると、比較器５８の出力が高くなり、反対にエラー信号
の電圧が該電圧ランプ信号のそれより低いと、比較器５
８の出力が低くなるように規定されている。出力端子Ｅ
は、図１に示されるような在来のバック・ブースト変換
器のブーストスイッチＳ2 のための制御端子として機能
する。第３比較器５８の出力は、ＡＮＤゲート５６への
第２入力として印加され、端子Ｃに印加された電圧がエ
ラー信号の電圧を越えているときは常に、ブーストスイ
ッチＳ2 をＯＦＦに維持する働きをする。
振器５０によって創出された電圧ランプ信号を上記エラ
ー信号に対して比較し、その出力をＡＮＤゲート６０へ
の入力として供給する。ＡＮＤゲート６０は、出力端子
Ｅを有している。第３比較器５８の入力極性は、エラー
信号の電圧が発振器５０の電圧ランプ信号のそれを越え
ると、比較器５８の出力が高くなり、反対にエラー信号
の電圧が該電圧ランプ信号のそれより低いと、比較器５
８の出力が低くなるように規定されている。出力端子Ｅ
は、図１に示されるような在来のバック・ブースト変換
器のブーストスイッチＳ2 のための制御端子として機能
する。第３比較器５８の出力は、ＡＮＤゲート５６への
第２入力として印加され、端子Ｃに印加された電圧がエ
ラー信号の電圧を越えているときは常に、ブーストスイ
ッチＳ2 をＯＦＦに維持する働きをする。
【００２３】
【発明の効果】本発明の第１実施例によるバック・ブー
スト制御器の利点は、上述したように、レベルシフト回
路を省除し、レベルシフトの大きさをタイミングランプ
の大きさでもって正確に追跡する必要性を排除すること
である。本発明の第２実施例によるバック・ブースト制
御器も、第１実施例野物と同様に、従来技術のバック・
ブースト制御器に使用されて板複雑なレベルシフト回路
を不要にする。
スト制御器の利点は、上述したように、レベルシフト回
路を省除し、レベルシフトの大きさをタイミングランプ
の大きさでもって正確に追跡する必要性を排除すること
である。本発明の第２実施例によるバック・ブースト制
御器も、第１実施例野物と同様に、従来技術のバック・
ブースト制御器に使用されて板複雑なレベルシフト回路
を不要にする。
【図１】図１は、従来技術の２スイッチ付きバック・ブ
ースト変換器の概略図である。
ースト変換器の概略図である。
【図２】図２は、図１の従来の２スイッチ付きバック・
ブースト変換器を制御するのに用いることができる従来
のＦＡ７６１８バック・ブースト制御器の機能ブロック
図である。
ブースト変換器を制御するのに用いることができる従来
のＦＡ７６１８バック・ブースト制御器の機能ブロック
図である。
【図３】図３は、図２の従来技術のバック・ブースト制
御器の動作に随伴するいろいろな電圧波形を示す波形図
である。
御器の動作に随伴するいろいろな電圧波形を示す波形図
である。
【図４】図４は、本発明の第１実施例によるバック・ブ
ースト制御器の機能ブロック図である。
ースト制御器の機能ブロック図である。
【図５】図５は、図４のバック・ブースト制御器の動作
に随伴するいろいろな電圧波形を示す波形図である。
に随伴するいろいろな電圧波形を示す波形図である。
【図６】図６は、本発明の第２実施例によるバック・ブ
ースト制御器の機能ブロック図である。
ースト制御器の機能ブロック図である。
【図７】図７は、図６のバック・ブースト制御器の動作
に随伴するいろいろな電圧波形を示す波形図である。
に随伴するいろいろな電圧波形を示す波形図である。
１０：三角波発振器
１２：第１比較器
１４：第２比較器
１６：演算増幅器
５０：三角波発振器
５２：第１比較器
５４：第２比較器
５６：ＯＲゲート
５８：第３比較器
６０：ＡＮＤゲート
─────────────────────────────────────────────────────
フロントページの続き
(56)参考文献 特開 平３−251074（ＪＰ，Ａ)
特開 平３−169255（ＪＰ，Ａ)
特開 平３−278208（ＪＰ，Ａ)
米国特許4549254（ＵＳ，Ａ)
(58)調査した分野(Int.Cl.7，ＤＢ名)
H02M 3/155
Claims (9)
- 【請求項１】 ２スイッチ付きバック・ブースト変換器
に使用するための制御器であって、 高入力電圧と低入力電圧を受け取り、該高入力電圧及び
低入力電圧に等しい変動電圧限度を有するタイミングラ
ンプ信号を発生するための発振器手段と、 エラー信号を受け取るための反転用入力と、前記高入力
電圧と低入力電圧のうちの選択された一つを受け取るた
めの非反転用入力を有し、前記エラー信号と前記高入力
電圧と低入力電圧のうちの選択された一つに応答して反
転したエラー信号を発生するために動作する増幅器回路
構成と、 前記エラー信号を前記タイミングランプ信号と比較し、
前記エラー信号を前記タイミングランプ信号と比較した
結果としての第１パルス幅変調信号を発生し、前記第１
パルス幅変調信号を前記２スイッチ付きバック・ブース
ト変換器の第１スイッチに結合するための第１比較器回
路構成と、 前記反転したエラー信号を前記タイミングランプ信号と
比較し、第２パルス幅変調信号を発生し、前記第２パル
ス幅変調信号を前記２スイッチ付きバック・ブースト変
換器の第２スイッチに結合するための第２比較器回路構
成とから成ることを特徴とする制御器。 - 【請求項２】 ２スイッチ付きバック・ブースト変換器
に使用するための制御器であって、 高入力電圧と、中間入力電圧と、低入力電圧を受け取
り、該中間入力電圧と低入力電圧との間、及び該中間入
力電圧と高入力電圧との間の選択自在の変動電圧限度を
有するタイミングランプ信号を発生するための発振器回
路構成と、 エラー信号を前記タイミングランプ信号と比較し、パル
ス幅変調信号を発生する第１比較器回路構成と、 前記エラー信号を前記中間入力電圧と比較し、２状態選
択信号を発生する第２比較器回路構成と、 前記選択信号に応答して、前記選択信号が第１状態にあ
るときは前記タイミングランプ信号の前記変動電圧限度
の一組を選択し、前記選択信号が第２状態にあるときは
前記タイミングランプ信号の前記変動電圧限度の他の組
を選択する選択回路構成と、 前記パルス幅変調信号と前記選択信号とをゲートし、前
記選択信号が前記第１状態にあるときは前記パルス幅変
調信号を前記２スイッチ付きバック・ブースト変換器の
第１スイッチに印加し、前記選択信号が前記第２状態に
あるときは前記第１スイッチをオン状態に維持し、更
に、前記選択信号が前記第２状態にあるときは前記パル
ス幅変調信号を前記２スイッチ付きバック・ブースト変
換器の第２スイッチに印加し、前記選択信号が前記第１
状態にあるときは前記第２スイッチをオフ状態に維持す
るために動作する論理回路構成とから成ることを特徴と
する制御器。 - 【請求項３】 前記第１及び第２スイッチのうちの一つ
のみを前記タイミングランプ信号の一フルサイクルの間
変調させることができるラッチ回路構成を更に含む請求
項１記載の制御器。 - 【請求項４】 前記タイミングランプ信号が前記変動電
圧限度のいずれかにほぼ等しいときを除き、前記選択信
号をラッチして前記選択信号の状態変化を妨げるラッチ
回路構成を更に含む請求項２記載の制御器。 - 【請求項５】 前記タイミングランプ信号は、ほぼ三角
形の波形を含み、 前記増幅回路構成は、前記非反転用入力に関して前記反
転用入力のほぼ均一な利得の反転を行うように構成さ
れ、 前記エラー信号は、前記２スイッチ付きバック・ブース
ト変換器の出力電圧に関して反転極性を有する増幅され
た濾過信号を含み、 前記増幅器回路構成の前記非反転用入力は、前記高入力
電圧を受け取り、 前記第１スイッチは、前記２スイッチ付きバック・ブー
スト変換器のバック・スイッチを含み、 前記第２スイッチは、前記２スイッチ付きバック・ブー
スト変換器のブースト・スイッチを含み、 前記第１比較器回路構成は、前記第１パルス幅変調信号
を、前記エラー信号の電圧が前記タイミングランプ信号
の電圧より大きいときは前記バック・スイッチをオンに
し、前記エラー信号の電圧が前記タイミングランプ信号
の電圧より小さいときは前記バック・スイッチをオフに
するように選択された極性構成を有し、前記第２比較器
回路構成は、前記第１パルス幅変調信号を、前記反転エ
ラー信号の電圧が前記タイミングランプ信号の電圧より
小さいときは前記ブースト・スイッチをオンにし、前記
エラー信号の電圧が前記タイミングランプ信号の電圧よ
り大きいときは前記ブースト・スイッチをオフにするよ
うに選択された極性構成を有する請求項１記載の制御
器。 - 【請求項６】 前記タイミングランプ信号は、前記選択
可能な電圧限度の間のほぼ固定した変動レートを有する
電圧波形を含み、 前記エラー信号は、前記２スイッチ付きバック・ブース
ト変換器の出力電圧に関して反転極性を有する増幅され
た濾過信号を含み、 前記選択信号の前記第１状態は、前記エラー信号の電圧
が前記中間入力電圧より小さいときは前記第２比較器回
路構成による比較に起因し、前記選択信号の前記第２状
態は、前記エラー信号の電圧が前記中間入力電圧より大
きいときは前記第２比較器回路構成による比較に起因
し、 前記選択回路構成は、前記選択信号が前記第１状態にあ
るときは前記中間電圧と低変動電圧限度を選択し、前記
選択信号が前記第２状態にあるときは前記中間電圧と高
変動電圧限度を選択し、 前記論理回路構成は、前記選択信号が前記第１状態にあ
るときは前記パルス幅変調信号を前記２スイッチ付きバ
ック・ブースト変換器のバック・スイッチに印加し、前
記選択信号が前記第１状態にあるときは前記２スイッチ
付きバック・ブースト変換器のブースト・スイッチをオ
フ状態に維持するように構成され、 前記論理回路構成は、前記選択信号が前記第２状態にあ
るときは前記パルス幅変調信号を前記ブースト・スイッ
チに印加し、前記選択信号が前記第２状態にあるときは
前記バック・スイッチをオン状態に維持するように更に
構成された請求項２記載の制御器。 - 【請求項７】 ２スイッチ付きバック・ブースト変換器
に使用するための制御器であって、 高入力電圧と、中間入力電圧と、低入力電圧を受け取
り、該中間入力電圧と低入力電圧との間、及び該中間入
力電圧と高入力電圧との間の選択自在の変動電圧限度を
有するタイミングランプ信号を発生するための発振器回
路構成と、 エラー信号を前記タイミングランプ信号と比較し、パル
ス幅変調信号を発生しかつ前記エラー信号を前記中間入
力電圧と比較し、２状態選択信号を発生する比較器回路
構成と、 前記選択信号に応答して、前記選択信号が第１状態にあ
るときは前記タイミングランプ信号の前記変動電圧限度
の一組を選択し、前記選択信号が第２状態にあるときは
前記タイミングランプ信号の前記変動電圧限度の他の組
を選択する選択回路構成と、 前記パルス幅変調信号と前記選択信号とをゲートし、前
記選択信号が前記第１状態にあるときは前記パルス幅変
調信号を前記２スイッチ付きバック・ブースト変換器の
第１スイッチに印加し、前記選択信号が前記第２状態に
あるときは前記第１スイッチをオン状態に維持し、更
に、前記選択信号が前記第２状態にあるときは前記パル
ス幅変調信号を前記２スイッチ付きバック・ブースト変
換器の第２スイッチに印加し、前記選択信号が前記第１
状態にあるときは前記第２スイッチをオフ状態に維持す
るために動作する論理回路構成とから成ることを特徴と
する制御器。 - 【請求項８】 ２スイッチ付きバック・ブースト変換器
のバックスイッチ及びブーストスイッチを制御するため
の制御方法であって、 高入力電圧と低入力電圧を受け取り、 高変動電圧限度と低変動電圧限度を有するタイミングラ
ンプ信号をそれぞれ前記高入力電圧と低入力電圧に等し
く発生し、 エラー信号を前記高入力電圧と低入力電圧の選択された
一つと比較して第１パルス幅変調信号を発生し、 前記第１パルス幅変調信号を前記２スイッチ付きバック
・ブースト変換器の第１スイッチに結合し、 前記エラー信号及び前記高入力電圧と低入力電圧の前記
選択された一つの機能として反転エラー信号を形成し、 前記反転エラー信号を前記タイミングランプ信号と比較
して第２パルス幅変調信号を発生し、 前記第２パルス幅変調信号を前記２スイッチ付きバック
・ブースト変換器の第２スイッチに結合することから成
ることを特徴とする制御方法。 - 【請求項９】 ２スイッチ付きバック・ブースト変換器
のバックスイッチ及びブーストスイッチを制御するため
の制御方法であって、 高入力電圧と、中間入力電圧と、低入力電圧を受け取
り、 該中間入力電圧と低入力電圧の組み合わせ、及び該中間
入力電圧と高入力電圧の組み合わせとの間の選択自在の
変動電圧限度を有するタイミングランプ信号を発生し、 エラー信号を前記タイミングランプ信号と比較してパル
ス幅変調信号を発生し、 前記エラー信号を前記中間入力電圧と比較して２状態選
択信号を発生し、 前記選択信号が第１状態にあるときは前記タイミングラ
ンプ信号の前記変動電圧限度の一方の組み合わせを選択
し、 前記選択信号が第２状態にあるときは前記タイミングラ
ンプ信号の前記変動電圧限度の他方の組み合わせを選択
し、 前記選択信号が前記第１状態にあるときは前記パルス幅
変調信号を前記２スイッチ付きバック・ブースト変換器
の第１スイッチに印加し、 前記選択信号が第２状態にあるときは前記第１スイッチ
をオン状態に維持し、 前記選択信号が前記第２状態にあるときは前記パルス幅
変調信号を前記２スイッチ付きバック・ブースト変換器
の第２スイッチに印加し、 前記選択信号が前記第１状態にあるときは前記第２スイ
ッチをオフ状態に維持することから成ることを特徴とす
る制御方法。
Applications Claiming Priority (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| US08/062,309 US5402060A (en) | 1993-05-13 | 1993-05-13 | Controller for two-switch buck-boost converter |
| US08/062,309 | 1993-05-13 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH07143742A JPH07143742A (ja) | 1995-06-02 |
| JP3440314B2 true JP3440314B2 (ja) | 2003-08-25 |
Family
ID=22041649
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP12199094A Expired - Lifetime JP3440314B2 (ja) | 1993-05-13 | 1994-05-11 | ２スイッチ付きバック・ブースト変換器 |
Country Status (2)
| Country | Link |
|---|---|
| US (1) | US5402060A (ja) |
| JP (1) | JP3440314B2 (ja) |
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| US9048729B2 (en) | 2010-01-28 | 2015-06-02 | Mitsumi Electric Co., Ltd. | Step-up/down DC-DC converter and switching control circuit |
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