JP3402184B2 - サンプリングクロック発生装置 - Google Patents
サンプリングクロック発生装置Info
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- JP3402184B2 JP3402184B2 JP03100498A JP3100498A JP3402184B2 JP 3402184 B2 JP3402184 B2 JP 3402184B2 JP 03100498 A JP03100498 A JP 03100498A JP 3100498 A JP3100498 A JP 3100498A JP 3402184 B2 JP3402184 B2 JP 3402184B2
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Description
り正確に有効領域を検出し、最適なサンプリングクロッ
クを発生するサンプリングクロック発生装置に関するも
のである。
平、垂直の有効画素数が同じで、帰線期間領域や同期信
号タイミングの異なる映像信号をディスプレイ装置に表
示する場合、それぞれの映像信号に合わせて表示領域を
手動で調整していた。さらに、液晶ディスプレイなどマ
トリクス型表示装置では、内部で映像信号出力の再生ク
ロックと同じクロックで映像信号をサンプリングするた
め、1水平走査期間のブランキング期間も含めた総画素
数を検出し、水平同期信号を総画素数倍したクロックを
発生する必要があった。
ては、例えば特開平2−130593号公報がある。こ
の従来例では、映像信号の変化点でサンプリングクロッ
クをサンプリングし、映像信号とサンプリングクロック
の位相関係を監視することでPLL回路の分周比を決定
していた。
うな構成では、入力映像信号の変化が少ない信号(例え
ば全画面が白色のような場合)は、映像信号とサンプリ
ングクロックの位相関係を正確に検出できず、正確な分
周比を求めることができないという課題を有していた。
より有効領域を検出し、最適なサンプリングクロックを
発生するサンプリングクロック発生装置を提供すること
を目的とする。
を二値化する二値化回路と、同期信号の付加された映像
信号入力または水平同期信号、垂直同期信号より各種パ
ルスを発生するパルス発生回路と、前記パルス発生回路
の出力とマイコンの出力するデータに基づきクロックを
発生するPLL回路と、前記PLL回路の出力するクロ
ックの位相を制御し出力する位相制御回路と、前記パル
ス発生回路の出力と前記位相制御回路の出力するクロッ
クで水平有効領域内の画素数をカウントするカウンター
回路と、前記二値化回路の出力および前記カウンター回
路の出力より、映像信号の水平有効領域の開始画素位置
を検出する有効領域開始位置検出回路と、前記二値化回
路の出力および前記カウンター回路の出力より、映像信
号の水平有効領域の終了画素位置を検出する有効領域終
了位置検出回路と、前記有効領域開始位置検出回路の出
力より最小値を検出しマイコンに伝送する最小値検出回
路と、前記有効領域終了位置検出回路の出力より最大値
を検出しマイコンに伝送する最大値検出回路と、前記最
小値検出回路と前記最大値検出回路の出力値より、水平
有効領域内の画素数を算出し、水平同期信号、垂直同期
信号から設定される水平有効画素数と比較することで、
前記PLL回路の分周比を決定するマイコンを具備する
ことを特徴とするサンプリングクロック発生装置であ
る。
換器により実現することを特徴とするサンプリングクロ
ック発生装置である。
レータにより実現することを特徴とするサンプリングク
ロック発生装置である。
部または一部を実現するためのプログラムを格納したこ
とを特徴とする媒体である。
発生装置を内蔵することを特徴とするマトリクス型表示
装置である。
おけるサンプリングクロック発生装置のブロック図であ
る。図1において、1は映像信号入力を二値化し、ディ
ジタル信号の1(ハイ)、0(ロー)信号を出力する二
値化回路である。2は同期信号の付加された映像信号入
力より水平、垂直同期信号を分離し、水平、垂直周期の
各種パルスを発生する。また、外部から別系統で水平同
期信号、垂直同期信号が入力される場合は、これら同期
信号より水平、垂直周期の各種パルスを発生することも
可能である。
期周期のパルスに同期したクロックを発生するPLL回
路であり、分周比はマイコン10により制御される。9
は位相制御回路であり、PLL回路3の出力するクロッ
クをマイコン10の指示に従って、位相制御し出力す
る。4はパルス発生回路2の出力する水平同期周期のパ
ルスでリセットをかけ、位相制御回路9の出力するクロ
ックで、前記の水平同期周期のパルス位置を基準とし
た、水平走査線上の画素番号をカウントするカウンター
回路である。この画素番号は位相制御回路9の出力する
クロック周波数によって変化する。5は、二値化回路2
の出力信号の最初の変化点における、カウンター回路4
の出力する画素番号を検出する有効領域開始位置検出回
路である。
化点における、カウンター回路4の出力する画素番号を
検出する有効領域終了位置検出回路である。
位置検出回路5の出力する水平有効領域の開始位置よ
り、1垂直期間の最小値を検出し、マイコン10に伝送
する。8は最大値検出回路であり、有効領域終了位置検
出回路6の出力する水平有効領域の終了位置より、1垂
直期間の最大値を検出し、マイコン10に伝送する。マ
イコン10は、最小値検出回路7および最大値検出回路
8の出力値より水平有効領域内のクロック数を算出し、
その値により分周比を決定し、PLL回路3に伝送す
る。また、位相制御回路9もマイコン10により最適な
クロック位相に制御される。
ンプリングクロック発生装置において、以下その動作を
説明する。
ある値以上の部分は1(ハイ)、それ以外は0(ロー)
に変換されて出力される。二値化回路1の動作例を図2
に示す。この例では、映像信号の最大振幅を0.7V、
またハイ、ローを区別する電圧を0.35Vに設定し
た。
れた映像信号入力より水平、垂直同期信号を分離し、水
平、垂直周期の各種パルスを発生する。また、外部から
別系統で水平同期信号、垂直同期信号が入力される場合
は、これら同期信号より水平、垂直周期の各種パルスを
発生することも可能である。これらのパルスは、PLL
回路3、カウンター回路4、有効領域開始位置検出回路
5、有効領域終了位置検出回路6、最小値検出回路7、
最大値検出回路8のリセット、ロードなどのタイミング
信号として使用される。
力する水平同期周期のパルスに同期したクロックを発生
する。分周比はマイコン10により制御される。PLL
回路3の出力するクロック信号は、位相制御回路9に入
力され、その位相はマイコン10の指示により最適な位
置に制御される。
る。カウンター回路4の出力値は10進数で示した。カ
ウンター回路4は、パルス発生回路2の出力する水平同
期周期のパルスでリセットをかけられ、位相制御回路9
の出力するクロックで前記のパルス位置を基準とした、
水平走査線上の画素数をカウントする。この動作によ
り、水平帰線期間を含むすべての画素に現在のクロック
周波数での画素番号、すなわち個々の画素が前記のパル
ス位置から何番目にあるかが決められる。例えば、図4
の映像信号上のaの画素は、現在のクロック周波数で水
平同期周期のパルス位置から65番目の画素ということ
になる。
効領域終了位置検出回路6の動作例を示した図である。
路2の出力信号の最初の変化点における、カウンター回
路4の出力する画素番号を水平走査線毎に検出し出力す
る。図4の例では、この走査線における二値化回路2の
出力信号の最初の変化点は、カウンター回路4の出力値
が22の時であるので、有効領域開始位置検出回路5
は、22をこの走査線の有効領域開始位置として出力す
る。
路2の出力信号の最後の変化点における、カウンター回
路4の出力する画素番号を水平走査線毎に検出し出力す
る。図4の例では、この走査線における二値化回路2の
出力信号の最後の変化点は、カウンター回路4の出力値
が192の時であるので、有効領域終了位置検出回路6
は、192をこの走査線の有効領域終了位置として出力
する。
出回路5の出力する各走査線の有効領域の開始位置から
1垂直期間内の最小値を検出し、その検出値を水平有効
領域の開始位置として、マイコン10に伝送する。
出回路6の出力する各走査線の有効領域の終了位置から
1垂直期間内の最大値を検出し、その検出値を水平有効
領域の終了位置として、マイコン10に伝送する。
するプログラムを実行する。まず映像信号が入力される
と、11のブロックで水平同期信号の周波数と垂直同期
信号の周波数の関係から、映像信号入力の垂直帰線期間
を含めた総走査線数aを求め、総走査線数aより有効走
査線数bを推定する。次に、12のブロックでは、推定
された有効走査線数bより水平有効画素数dを設定す
る。近年パソコンなどの映像信号出力の有効表示領域
は、帰線期間が未知であっても、例えば有効走査線が6
00本ならば水平の有効画素は800画素というよう
に、水平および垂直の画素数(有効走査線数)の規格
化、すなわち画像モードの規格化が進んでいる。そのた
め、有効走査線数より水平の有効画素数を求めることが
できる。
設定された水平有効画素数dに応じて、デフォルトの分
周比eをPLL回路3に伝送し、クロックを発生する。
と最大値検出回路8から水平有効領域開始位置fと水平
有効領域終了位置gを受け取り、水平有効領域終了位置
から水平有効領域開始位置を減算することで、現在のク
ロック周波数での水平有効領域内の画素数(クロック
数)hを計算する。15のブロックでは水平同期信号の
周波数と垂直同期信号の周波数の関係から得られた水平
有効領域の画素数dと、現在のクロック周波数での水平
有効領域内の画素数(クロック数)hを比較する。d=
hの場合は、処理を終了する。d>hの場合は、分周比
を1あげてブロック14に戻る。d<hの場合は、分周
比を1さげてブロック14に戻る。
増減し、最終的な分周比をを決定する。
ルトの分周比で発生するクロックで水平有効領域開始位
置と水平有効領域終了位置を検出し、減算することで得
た水平有効領域内の画素数と、水平同期信号の周波数と
垂直同期信号の周波数の関係から得られた実際の水平の
有効画素数とを比較し、これらの値が一致ようPLL回
路の分周比を決定することにより、最適なサンプリング
クロックを発生できるすることができる。
て、分周比の変化量を1としたが、その他の変化量を用
いても良いことは言うまでもない。
た機能を、その他の手段、例えばマイコンなどで実現し
ても良いことは言うまでもない。
第1の実施例のサンプリングクロック発生装置を内蔵す
ることを特徴とするマトリクス型表示装置の構成図であ
る。20はレンズ群、21は反射鏡、22はマトリクス
表示パネル、23は光源、24は電源、25は前記のサ
ンプリングクロック発生装置である。
に電力を供給する。サンプリングクロック発生装置25
は、映像信号源の有効表示領域を検出して、最適なサン
プリングクロックを発生する。マトリクス型表示パネル
22は、外部の映像信号源から入力される映像信号を、
サンプリングクロック発生装置25の発生するクロック
でサンプリングし、先に同装置25で検出した有効表示
領域に従って、パネル上の適切な位置に画像を表示す
る。光源23は、マトリクス型表示パネル22に表示さ
れる画像を反射鏡21に投射する。反射鏡21は、光源
23により投射されるマトリクス型表示パネル22の画
像を反射し、レンズ群20を通して映像信号源の画像を
スクリーンなどに投射する。
表示装置によれば、映像信号源から入力される映像信号
から、有効表示領域を検出し、適切なクロックで映像信
号をサンプリングできるので、どのような入力信号に切
り替えても自動で画像表示設定を行い、最適な画像を表
示できる。
フォルトの分周比で発生するクロックで水平有効領域開
始位置と水平有効領域終了位置を検出し、減算すること
で得た水平有効領域内の画素数と、水平同期信号の周波
数と垂直同期信号の周波数の関係から得られた実際の水
平の有効画素数とを比較し、これらの値が一致ようPL
L回路の分周比を決定することにより、最適なサンプリ
ングクロックを発生できるサンプリングクロック発生装
置を実現でき、その実用的効果は大きい。
マトリクス型表示装置によれば、映像信号源から入力さ
れる映像信号から、有効表示領域を検出し、適切なクロ
ックで映像信号をサンプリングできるので、どのような
入力信号に切り替えても自動で画像表示設定を行い、最
適な画像を表示でき、その実用的効果は大きい。
ロック発生装置のブロック図
領域終了位置検出回路6の動作例を示した図
の流れ図
クロック発生装置を内蔵したマトリクス型表示装置の構
成図
Claims (5)
- 【請求項1】映像信号入力を二値化する二値化回路と、
同期信号の付加された映像信号入力または水平同期信
号、垂直同期信号より各種パルスを発生するパルス発生
回路と、前記パルス発生回路の出力とマイコンの出力す
るデータに基づきクロックを発生するPLL回路と、前記P
LL回路の出力するクロックの位相を制御し出力する位相
制御回路と、前記パルス発生回路の出力と前記位相制御
回路の出力するクロックで水平有効領域内の画素数をカ
ウントするカウンター回路と、前記二値化回路の出力お
よび前記カウンター回路の出力より、映像信号の水平有
効領域の開始画素位置を検出する有効領域開始位置検出
回路と、前記二値化回路の出力および前記カウンター回
路の出力より、映像信号の水平有効領域の終了画素位置
を検出する有効領域終了位置検出回路と、前記有効領域
開始位置検出回路の出力より1垂直期間内における最小
値を検出しマイコンに伝送する最小値検出回路と、前記
有効領域終了位置検出回路の出力より1垂直期間内にお
ける最大値を検出しマイコンに伝送する最大値検出回路
と、前記最小値検出回路と前記最大値検出回路の出力値
より、水平有効領域内の画素数を算出し、水平同期信
号、垂直同期信号から設定される水平有効画素数と比較
し、前記最小値検出回路と前記最大値検出回路の出力値
から算出した前記水平領域内の画素数と、前記水平同期
信号、垂直同期信号から設定される水平有効画素数とが
同じ画素数となるまで前記PLL回路の分周比を増減し、
最終的な分周比を決定するマイコンとを具備することを
特徴とするサンプリングクロック発生装置。 - 【請求項2】 二値化回路を、AD変換器により実現す
ることを特徴とする請求項1記載のサンプリングクロッ
ク発生装置。 - 【請求項3】 二値化回路を、コンパレータにより実現
することを特徴とする請求項1記載のサンプリングクロ
ック発生装置。 - 【請求項4】請求項1記載の各手段、又は機能の全部ま
たは一部を実現するためのプログラムを格納したことを
特徴とするコンピュータ読み取り可能な記録媒体。 - 【請求項5】 請求項1記載のサンプリングクロック発
生装置を内蔵することを特徴とするマトリクス型表示装
置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP03100498A JP3402184B2 (ja) | 1998-02-13 | 1998-02-13 | サンプリングクロック発生装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP03100498A JP3402184B2 (ja) | 1998-02-13 | 1998-02-13 | サンプリングクロック発生装置 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH11231857A JPH11231857A (ja) | 1999-08-27 |
JP3402184B2 true JP3402184B2 (ja) | 2003-04-28 |
Family
ID=12319432
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP03100498A Expired - Lifetime JP3402184B2 (ja) | 1998-02-13 | 1998-02-13 | サンプリングクロック発生装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP3402184B2 (ja) |
Families Citing this family (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR100433526B1 (ko) * | 2001-09-28 | 2004-05-31 | 삼성전자주식회사 | 영상 처리를 위한 코스트 신호 발생 방법 및 장치 |
-
1998
- 1998-02-13 JP JP03100498A patent/JP3402184B2/ja not_active Expired - Lifetime
Also Published As
Publication number | Publication date |
---|---|
JPH11231857A (ja) | 1999-08-27 |
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Legal Events
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