JP3399554B2 - 画像読み取り装置 - Google Patents
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- JP3399554B2 JP3399554B2 JP05185192A JP5185192A JP3399554B2 JP 3399554 B2 JP3399554 B2 JP 3399554B2 JP 05185192 A JP05185192 A JP 05185192A JP 5185192 A JP5185192 A JP 5185192A JP 3399554 B2 JP3399554 B2 JP 3399554B2
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Description
【０００１】
【産業上の利用分野】本発明は、デジタル複写機やファ
クシミリ装置に好適な画像読み取り装置に関する。
クシミリ装置に好適な画像読み取り装置に関する。
【０００２】
【従来の技術】従来の画像読み取り装置としては例えば
特開昭６１−２３４１６６号公報に示すように、複数の
一次元撮像素子（ＣＣＤラインセンサ）を千鳥状に配列
したものや、２列に配列したものや、ＲＧＢのフィルタ
を備えたラインセンサを副走査方向に配列したものが知
られている。
特開昭６１−２３４１６６号公報に示すように、複数の
一次元撮像素子（ＣＣＤラインセンサ）を千鳥状に配列
したものや、２列に配列したものや、ＲＧＢのフィルタ
を備えたラインセンサを副走査方向に配列したものが知
られている。
【０００３】これらのセンサは、いずれも間隔が１ライ
ンの幅の整数倍になるように配列されているので、その
差を補正するために等倍の読み取り時には、読み取り信
号をＡ／Ｄ変換した後、そのデータをＲＡＭなどの記憶
素子に蓄積して上記間隔に応じたライン分を遅延するよ
うに構成されている。また、変倍の読み取り時にはスキ
ャン速度が異なるので、読み取りの際のライン間隔が異
なる。例えば等倍時の間隔が５ラインの場合には、２倍
（２００％）の拡大時には間隔が１０ラインになり、１
／２（５０％）の縮小時には２．５ラインになる。した
がって、ライン間隔が整数倍の場合には等倍時と同様に
補正することができるが、２．５ラインのように小数を
含む場合には補正することができない。
ンの幅の整数倍になるように配列されているので、その
差を補正するために等倍の読み取り時には、読み取り信
号をＡ／Ｄ変換した後、そのデータをＲＡＭなどの記憶
素子に蓄積して上記間隔に応じたライン分を遅延するよ
うに構成されている。また、変倍の読み取り時にはスキ
ャン速度が異なるので、読み取りの際のライン間隔が異
なる。例えば等倍時の間隔が５ラインの場合には、２倍
（２００％）の拡大時には間隔が１０ラインになり、１
／２（５０％）の縮小時には２．５ラインになる。した
がって、ライン間隔が整数倍の場合には等倍時と同様に
補正することができるが、２．５ラインのように小数を
含む場合には補正することができない。
【０００４】このように小数を含む場合には、特開昭６
１−２３４１６６号公報に示すように各センサのサンプ
リングパルスの位相をずらして露光タイミングを変える
ことにより補正することが開示されている。例えば基準
となるセンサに対して１／２ずらした場合、スキャナが
移動して読み取る場合に読み取り位置が１／２ラインず
れたことになり、１／２ラインのずれを補正することが
できる。
１−２３４１６６号公報に示すように各センサのサンプ
リングパルスの位相をずらして露光タイミングを変える
ことにより補正することが開示されている。例えば基準
となるセンサに対して１／２ずらした場合、スキャナが
移動して読み取る場合に読み取り位置が１／２ラインず
れたことになり、１／２ラインのずれを補正することが
できる。
【０００５】また、上記小数分は変倍率に応じた種々の
値となる。例えば等倍時の間隔が５ラインの場合、７５
％の縮小時には３．７５ラインとなり、１２５％の拡大
時には６．２５ラインとなるので、上記小数分はそれぞ
れ０．７５ライン、０．２５ラインとなるが、上記位相
のずれ量を調整することによりライン間隔のずれを補正
することができる。
値となる。例えば等倍時の間隔が５ラインの場合、７５
％の縮小時には３．７５ラインとなり、１２５％の拡大
時には６．２５ラインとなるので、上記小数分はそれぞ
れ０．７５ライン、０．２５ラインとなるが、上記位相
のずれ量を調整することによりライン間隔のずれを補正
することができる。
【０００６】
【発明が解決しようとする課題】ここで、ＣＣＤライン
イメージセンサを用いた画像読み取り装置では、ランプ
をスキャンさせて所定のタイミング毎にＣＣＤラインイ
メージセンサの信号が読み出されるが、１つの原稿当た
りの読み取り速度を早くするためには、ランプのスキャ
ン速度とＣＣＤラインイメージセンサの読み出しタイミ
ングを早くしなければならない。したがって、１つの原
稿当たりの読み取り速度を早くするためには回路の電気
信号の処理速度を早くしなければならないので、回路が
複雑かつ高価になるという問題点がある。特に、読み取
られた画像を処理する回路系は、比較的大規模な電子回
路であるので、回路全体の処理速度を早くすると、コス
ト的にも信頼性の点でも多くの問題が発生する。
イメージセンサを用いた画像読み取り装置では、ランプ
をスキャンさせて所定のタイミング毎にＣＣＤラインイ
メージセンサの信号が読み出されるが、１つの原稿当た
りの読み取り速度を早くするためには、ランプのスキャ
ン速度とＣＣＤラインイメージセンサの読み出しタイミ
ングを早くしなければならない。したがって、１つの原
稿当たりの読み取り速度を早くするためには回路の電気
信号の処理速度を早くしなければならないので、回路が
複雑かつ高価になるという問題点がある。特に、読み取
られた画像を処理する回路系は、比較的大規模な電子回
路であるので、回路全体の処理速度を早くすると、コス
ト的にも信頼性の点でも多くの問題が発生する。
【０００７】そこで、複数のラインセンサが配列された
ＣＣＤセンサを用いて読み取り速度を向上させる方法が
考えられている。しかしながら、このような装置では、
光学系によりスキャンしながら読み取るので、見かけの
アパーチャが実際の読み取り密度よりも大きく、また、
複数のラインセンサにより同一の画素をオーバラップし
ながら読み取るので、十分な解像度を実現することがで
きないという問題点がある。
ＣＣＤセンサを用いて読み取り速度を向上させる方法が
考えられている。しかしながら、このような装置では、
光学系によりスキャンしながら読み取るので、見かけの
アパーチャが実際の読み取り密度よりも大きく、また、
複数のラインセンサにより同一の画素をオーバラップし
ながら読み取るので、十分な解像度を実現することがで
きないという問題点がある。
【０００８】本発明は上記従来の問題点に鑑み、解像度
の向上を図ることができる画像読み取り装置を提供する
ことを目的とする。本発明はまた、複数のラインセンサ
により読み取る場合の補正回路を安価かつ簡単に構成す
ることができる画像読み取り装置を提供することを目的
とする。
の向上を図ることができる画像読み取り装置を提供する
ことを目的とする。本発明はまた、複数のラインセンサ
により読み取る場合の補正回路を安価かつ簡単に構成す
ることができる画像読み取り装置を提供することを目的
とする。
【０００９】
【課題を解決するための手段】第１の手段は上記目的を
達成するために、副走査方向にＭライン分だけ離間して
配列され、Ｍライン離れた先の位置、後の位置をそれぞ
れ同時に読み取る第１及び第２のラインセンサと、前記
第１及び第２のラインセンサの間のライン数Ｍと変倍率
Ｘに基づいて、前記第１のラインセンサの読み取り信号
をＭ×Ｘ−１／２ライン分だけ遅延する手段と、前記遅
延された第１のラインセンサの信号の各画素と前記第２
のラインセンサの読み取り信号の各画素を１ラインに合
成する手段とを備えたことを特徴とする。
達成するために、副走査方向にＭライン分だけ離間して
配列され、Ｍライン離れた先の位置、後の位置をそれぞ
れ同時に読み取る第１及び第２のラインセンサと、前記
第１及び第２のラインセンサの間のライン数Ｍと変倍率
Ｘに基づいて、前記第１のラインセンサの読み取り信号
をＭ×Ｘ−１／２ライン分だけ遅延する手段と、前記遅
延された第１のラインセンサの信号の各画素と前記第２
のラインセンサの読み取り信号の各画素を１ラインに合
成する手段とを備えたことを特徴とする。
【００１０】第２の手段は、副走査方向にＭライン分だ
け離間して配列され、Ｍライン離れた先の位置、後の位
置をそれぞれ同時に読み取る第１及び第２のラインセン
サと、前記第１及び第２のラインセンサの間のライン数
Ｍと変倍率Ｘに基づいて、前記第１のラインセンサの読
み取り信号がＭ×Ｘ−１／２ライン分だけ遅延するよう
に前記第１及び第２のラインセンサの各光蓄積タイミン
グを制御する制御回路と、前記制御回路により制御され
た前記第１及び第２のラインセンサの各信号の各画素を
１ラインに合成する手段とを備えたことを特徴とする。
け離間して配列され、Ｍライン離れた先の位置、後の位
置をそれぞれ同時に読み取る第１及び第２のラインセン
サと、前記第１及び第２のラインセンサの間のライン数
Ｍと変倍率Ｘに基づいて、前記第１のラインセンサの読
み取り信号がＭ×Ｘ−１／２ライン分だけ遅延するよう
に前記第１及び第２のラインセンサの各光蓄積タイミン
グを制御する制御回路と、前記制御回路により制御され
た前記第１及び第２のラインセンサの各信号の各画素を
１ラインに合成する手段とを備えたことを特徴とする。
【００１１】第３の手段は、第２の手段の制御回路が、
前記第１及び第２のラインセンサの各光蓄積タイミング
をずらすことを特徴とする。
前記第１及び第２のラインセンサの各光蓄積タイミング
をずらすことを特徴とする。
【００１２】第４の手段は、第２の手段の制御回路が、
前記ラインセンサの各光蓄積タイミングを各ラインセン
サのシフトゲート信号により制御することを特徴とす
る。
前記ラインセンサの各光蓄積タイミングを各ラインセン
サのシフトゲート信号により制御することを特徴とす
る。
【００１３】第５の手段は、副走査方向にＭライン分だ
け離間して配列され、Ｍライン離れた先の位置、後の位
置を同時にそれぞれのシャッタを介して読み取る第１及
び第２のラインセンサと、前記第１及び第２のラインセ
ンサの間のライン数Ｍと変倍率Ｘに基づいて、前記第１
のラインセンサの読み取り信号がＭ×Ｘ−１／２ライン
分だけ遅延するように前記シャッタの開閉タイミングを
制御する制御回路と、前記制御回路により制御された前
記第１及び第２のラインセンサの各信号の各画素を１ラ
インに合成する手段とを備えたことを特徴とする。
け離間して配列され、Ｍライン離れた先の位置、後の位
置を同時にそれぞれのシャッタを介して読み取る第１及
び第２のラインセンサと、前記第１及び第２のラインセ
ンサの間のライン数Ｍと変倍率Ｘに基づいて、前記第１
のラインセンサの読み取り信号がＭ×Ｘ−１／２ライン
分だけ遅延するように前記シャッタの開閉タイミングを
制御する制御回路と、前記制御回路により制御された前
記第１及び第２のラインセンサの各信号の各画素を１ラ
インに合成する手段とを備えたことを特徴とする。
【００１４】
【作用】第１の手段では上記構成により、Ｍライン離れ
た先の位置、後の位置をそれぞれ同時に読み取る第１及
び第２のラインセンサの間のライン数Ｍと変倍率Ｘに基
づいて、第１のラインセンサの読み取り信号をＭ×Ｘ−
１／２ライン分だけ遅延して１ラインに合成するので、
複数のラインセンサが同一の画素をオーバラップして読
み取ることを防止することができ、したがって、解像度
を向上させることができる。
た先の位置、後の位置をそれぞれ同時に読み取る第１及
び第２のラインセンサの間のライン数Ｍと変倍率Ｘに基
づいて、第１のラインセンサの読み取り信号をＭ×Ｘ−
１／２ライン分だけ遅延して１ラインに合成するので、
複数のラインセンサが同一の画素をオーバラップして読
み取ることを防止することができ、したがって、解像度
を向上させることができる。
【００１５】第２の手段では、Ｍライン離れた先の位
置、後の位置をそれぞれ同時に読み取る第１及び第２の
ラインセンサの間のライン数Ｍと変倍率Ｘに基づいて、
第１のラインセンサの読み取り信号がＭ×Ｘ−１／２ラ
イン分だけ遅延するように第１及び第２のラインセンサ
の各光蓄積タイミングを制御して１ラインに合成するの
で、複数のラインセンサが同一の画素をオーバラップし
て読み取ることを防止することができ、したがって、解
像度を向上させることができる。
置、後の位置をそれぞれ同時に読み取る第１及び第２の
ラインセンサの間のライン数Ｍと変倍率Ｘに基づいて、
第１のラインセンサの読み取り信号がＭ×Ｘ−１／２ラ
イン分だけ遅延するように第１及び第２のラインセンサ
の各光蓄積タイミングを制御して１ラインに合成するの
で、複数のラインセンサが同一の画素をオーバラップし
て読み取ることを防止することができ、したがって、解
像度を向上させることができる。
【００１６】第３の手段では、第１及び第２のラインセ
ンサの各光蓄積タイミングをずらすので、複数のライン
センサが同一の画素をオーバラップして読み取ることを
防止することができ、したがって、解像度を向上させる
ことができる。
ンサの各光蓄積タイミングをずらすので、複数のライン
センサが同一の画素をオーバラップして読み取ることを
防止することができ、したがって、解像度を向上させる
ことができる。
【００１７】第４の手段では、ラインセンサの各光蓄積
タイミングがシフトゲート信号により制御されるので、
解像度を向上させることができるとともに、複数のライ
ンセンサ間の距離を補正する回路を安価かつ簡単に構成
することができる。
タイミングがシフトゲート信号により制御されるので、
解像度を向上させることができるとともに、複数のライ
ンセンサ間の距離を補正する回路を安価かつ簡単に構成
することができる。
【００１８】第５の手段では、Ｍライン離れた先の位
置、後の位置をそれぞれ同時に読み取る第１及び第２の
ラインセンサの間のライン数Ｍと変倍率Ｘに基づいて、
第１のラインセンサの読み取り信号がＭ×Ｘ−１／２ラ
イン分だけ遅延するようにシャッタの開閉タイミングを
制御して１ラインに合成するので、複数のラインセンサ
が同一の画素をオーバラップして読み取ることを防止す
ることができ、したがって、解像度を向上させることが
できる。
置、後の位置をそれぞれ同時に読み取る第１及び第２の
ラインセンサの間のライン数Ｍと変倍率Ｘに基づいて、
第１のラインセンサの読み取り信号がＭ×Ｘ−１／２ラ
イン分だけ遅延するようにシャッタの開閉タイミングを
制御して１ラインに合成するので、複数のラインセンサ
が同一の画素をオーバラップして読み取ることを防止す
ることができ、したがって、解像度を向上させることが
できる。
【００１９】
【実施例】以下、図面を参照して本発明の実施例を説明
する。図１は本発明に係る画像読み取り装置の一実施例
を示すブロック図、図２は図１の画像読み取り装置の光
学系を示す構成図、図３は図１および図２のＣＣＤセン
サの主要信号を示すタイミングチャートである。
する。図１は本発明に係る画像読み取り装置の一実施例
を示すブロック図、図２は図１の画像読み取り装置の光
学系を示す構成図、図３は図１および図２のＣＣＤセン
サの主要信号を示すタイミングチャートである。
【００２０】ＣＣＤセンサ１０は図１に示すように、一
例として２本のラインセンサ１０ａ，１０ｂにより構成
され、このラインセンサ１０ａ，１０ｂの間隔は読み取
り位置が副走査方向にＭライン分だけずれるように構成
されている（Ｍは正の整数）。なお、ラインセンサ１０
ａ（図示ライン１）がラインセンサ１０ｂ（ライン２）
より先の位置を読み取るものとして説明する。
例として２本のラインセンサ１０ａ，１０ｂにより構成
され、このラインセンサ１０ａ，１０ｂの間隔は読み取
り位置が副走査方向にＭライン分だけずれるように構成
されている（Ｍは正の整数）。なお、ラインセンサ１０
ａ（図示ライン１）がラインセンサ１０ｂ（ライン２）
より先の位置を読み取るものとして説明する。
【００２１】まず、図２を参照してこのＣＣＤセンサ１
０を用いた読み取り光学系を説明すると、コンタクトガ
ラス１上の原稿（図示省略）は、光源である蛍光灯２お
よび蛍光灯ヒータ３により照明され、その反射光すなわ
ち原稿像が第１ミラー４、第２ミラー５、第３ミラー６
により順次反射され、レンズ７によりＣＣＤセンサ１０
の受光面に結像され、したがって、原稿画像がＣＣＤセ
ンサ１０により読み取られる。なお、光源２，３と第１
ミラー４は変倍率に応じた速度で副走査方向（図示左右
方向）に移動し、第２ミラー５と第３ミラー６は光源
２，３と第１ミラー４の１／２の速度で副走査方向に移
動する。
０を用いた読み取り光学系を説明すると、コンタクトガ
ラス１上の原稿（図示省略）は、光源である蛍光灯２お
よび蛍光灯ヒータ３により照明され、その反射光すなわ
ち原稿像が第１ミラー４、第２ミラー５、第３ミラー６
により順次反射され、レンズ７によりＣＣＤセンサ１０
の受光面に結像され、したがって、原稿画像がＣＣＤセ
ンサ１０により読み取られる。なお、光源２，３と第１
ミラー４は変倍率に応じた速度で副走査方向（図示左右
方向）に移動し、第２ミラー５と第３ミラー６は光源
２，３と第１ミラー４の１／２の速度で副走査方向に移
動する。
【００２２】図１において、このようなＣＣＤセンサ１
０の各ラインセンサ１０ａ，１０ｂはタイミング発生回
路１５により図３に示すように駆動され、アナログ画像
信号で原稿画像を読み取る。なお、図３においてシフト
ゲート信号ＳＧは、各ラインセンサ１０ａ，１０ｂの光
信号蓄積時間Ｔint を決定するための信号である。この
各アナログ画像信号はそれぞれ信号処理回路１１ａ，１
１ｂにより振幅が補正等された後、Ａ／Ｄ変換器１２
ａ，１２ｂによりデジタル信号に変換され、後述するよ
うにライン間補正回路１３によりラインセンサ１０ａ，
１０ｂの読み取り位置のずれが１／２ラインになるよう
に補正され、ついで１ライン化処理回路１４により１ラ
イン分の画像に合成される。
０の各ラインセンサ１０ａ，１０ｂはタイミング発生回
路１５により図３に示すように駆動され、アナログ画像
信号で原稿画像を読み取る。なお、図３においてシフト
ゲート信号ＳＧは、各ラインセンサ１０ａ，１０ｂの光
信号蓄積時間Ｔint を決定するための信号である。この
各アナログ画像信号はそれぞれ信号処理回路１１ａ，１
１ｂにより振幅が補正等された後、Ａ／Ｄ変換器１２
ａ，１２ｂによりデジタル信号に変換され、後述するよ
うにライン間補正回路１３によりラインセンサ１０ａ，
１０ｂの読み取り位置のずれが１／２ラインになるよう
に補正され、ついで１ライン化処理回路１４により１ラ
イン分の画像に合成される。
【００２３】ここで、ラインセンサ１０ａ，１０ｂの読
み取り位置に対して１／２ライン分のずれを発生させる
場合、データを演算する第１の方法と、ライン間の物理
的な距離が１ライン幅の整数倍でないセンサを用いる第
２の方法と、ラインセンサ１０ａ，１０ｂの各ラインの
光蓄積タイミングを変更する第３の方法が考えられる
が、第１の実施例では第１の方法が用いられている。
み取り位置に対して１／２ライン分のずれを発生させる
場合、データを演算する第１の方法と、ライン間の物理
的な距離が１ライン幅の整数倍でないセンサを用いる第
２の方法と、ラインセンサ１０ａ，１０ｂの各ラインの
光蓄積タイミングを変更する第３の方法が考えられる
が、第１の実施例では第１の方法が用いられている。
【００２４】第１の実施例では、例えば特開昭６１−２
３４１６６号公報に示すようにカラー用の３ラインＣＣ
Ｄセンサに適用された技術により容易に実現することが
できる。すなわち、ライン間補正回路１３は、例えば各
ラインセンサ１０ａ，１０ｂの物理的な距離がＭライン
であって変倍率がＸ倍の場合、ラインセンサ１０ａの読
み取り信号がＭ＊Ｘ−１／２ライン分だけ遅延するよう
に構成されている。
３４１６６号公報に示すようにカラー用の３ラインＣＣ
Ｄセンサに適用された技術により容易に実現することが
できる。すなわち、ライン間補正回路１３は、例えば各
ラインセンサ１０ａ，１０ｂの物理的な距離がＭライン
であって変倍率がＸ倍の場合、ラインセンサ１０ａの読
み取り信号がＭ＊Ｘ−１／２ライン分だけ遅延するよう
に構成されている。
【００２５】第２〜第４の実施例では上記第３の方法が
用いられ、この第３の方法では、次の３通りの方法が考
えられる。第１に図４や図５に示すように、ＣＣＤセン
サの各ライン毎にシフトゲート信号ＳＧの発生タイミン
グを変更する方法であり、第２に図６〜図８に示すよう
に光蓄積タイミングを外部からの電気信号により１ライ
ンの読み取り周期内の任意の位置に設定可能なＣＣＤセ
ンサを用いる方法であり、第３に図９〜図１１に示すよ
うにＣＣＤセンサと光源の間にＣＣＤセンサの各ライン
毎に制御可能なシャッタを設ける方法である。
用いられ、この第３の方法では、次の３通りの方法が考
えられる。第１に図４や図５に示すように、ＣＣＤセン
サの各ライン毎にシフトゲート信号ＳＧの発生タイミン
グを変更する方法であり、第２に図６〜図８に示すよう
に光蓄積タイミングを外部からの電気信号により１ライ
ンの読み取り周期内の任意の位置に設定可能なＣＣＤセ
ンサを用いる方法であり、第３に図９〜図１１に示すよ
うにＣＣＤセンサと光源の間にＣＣＤセンサの各ライン
毎に制御可能なシャッタを設ける方法である。
【００２６】つぎに、第２の実施例を説明する。図４は
ＣＣＤセンサの各ライン毎にシフトゲート信号ＳＧ１，
ＳＧ２の発生タイミング（蓄積時間）Ｔint1，Ｔint2を
変更する場合を示すタイミングチャートである。この実
施例では、ラインセンサ１０ａ，１０ｂの物理的な距離
がラインセンサ１０ａ，１０ｂの物理的な距離がＭライ
ンであるので、タイミング発生回路１５は図４に示すよ
うに、発生タイミングＴint1, Ｔint2の位相差Ｔｄを
（Ｔint1／２）に設定することにより、１／２ラインの
読み取り位置のずれを発生することができる。
ＣＣＤセンサの各ライン毎にシフトゲート信号ＳＧ１，
ＳＧ２の発生タイミング（蓄積時間）Ｔint1，Ｔint2を
変更する場合を示すタイミングチャートである。この実
施例では、ラインセンサ１０ａ，１０ｂの物理的な距離
がラインセンサ１０ａ，１０ｂの物理的な距離がＭライ
ンであるので、タイミング発生回路１５は図４に示すよ
うに、発生タイミングＴint1, Ｔint2の位相差Ｔｄを
（Ｔint1／２）に設定することにより、１／２ラインの
読み取り位置のずれを発生することができる。
【００２７】また、少なくとも光蓄積時間をシフトゲー
ト信号ＳＧ１, ＳＧ２に同期して制御可能なＣＣＤセン
サを用いて光蓄積時間を短くすると、各ライン間の光蓄
積時間の重畳部分を無くすことができ、また、副走査方
向のアパーチャが小さくなるので、副走査方向のＭＴＦ
を向上することができる。
ト信号ＳＧ１, ＳＧ２に同期して制御可能なＣＣＤセン
サを用いて光蓄積時間を短くすると、各ライン間の光蓄
積時間の重畳部分を無くすことができ、また、副走査方
向のアパーチャが小さくなるので、副走査方向のＭＴＦ
を向上することができる。
【００２８】図５は他の例として、蓄積時間Ｔint1, Ｔ
int2の１／２の周期の信号ＷＧ１，ＷＧ２により蓄積時
間Ｔint1，Ｔint2が交互になるように制御する場合を示
す。ここで、蓄積時間Ｔint1，Ｔint2を短くし過ぎる
と、出力信号のレベルが小さくなり、Ｓ／Ｎ比が悪くな
るが、ラインセンサ１０ａ，１０ｂの感度は一般に同等
であるので、蓄積時間Ｔint1，Ｔint2を同じに設定する
ことができる。そして、上記の条件を考慮して、各ライ
ンの蓄積時間Ｔint1，Ｔint2を一般的に同一に設定し、
かつ各ラインの蓄積タイミングが重ならないように最長
の蓄積時間Ｔint1，Ｔint2が得られるようにラインセン
サ１０ａ，１０ｂが制御される。
int2の１／２の周期の信号ＷＧ１，ＷＧ２により蓄積時
間Ｔint1，Ｔint2が交互になるように制御する場合を示
す。ここで、蓄積時間Ｔint1，Ｔint2を短くし過ぎる
と、出力信号のレベルが小さくなり、Ｓ／Ｎ比が悪くな
るが、ラインセンサ１０ａ，１０ｂの感度は一般に同等
であるので、蓄積時間Ｔint1，Ｔint2を同じに設定する
ことができる。そして、上記の条件を考慮して、各ライ
ンの蓄積時間Ｔint1，Ｔint2を一般的に同一に設定し、
かつ各ラインの蓄積タイミングが重ならないように最長
の蓄積時間Ｔint1，Ｔint2が得られるようにラインセン
サ１０ａ，１０ｂが制御される。
【００２９】つぎに、図６〜図８を参照して第３の実施
例を説明する。図６は従来のＣＣＤセンサを示す回路
図、図７は第３の実施例において光蓄積タイミングが外
部から設定可能なＣＣＤセンサを示す回路図、図８は図
７のＣＣＤセンサの駆動信号を示すタイミングチャート
である。
例を説明する。図６は従来のＣＣＤセンサを示す回路
図、図７は第３の実施例において光蓄積タイミングが外
部から設定可能なＣＣＤセンサを示す回路図、図８は図
７のＣＣＤセンサの駆動信号を示すタイミングチャート
である。
【００３０】図６に示す従来のＣＣＤセンサでは、１ラ
イン分の各画素のデータはシフトパルスＳＨによりスイ
ッチＳＷを介してＣＣＤアナログシフトレジスタに取り
込まれ、ついで転送パルスφ１，φ２により転送され
る。したがって、この回路では光蓄積タイミングを外部
からの電気信号により１ラインの読み取り周期内の任意
の位置に設定することができない。
イン分の各画素のデータはシフトパルスＳＨによりスイ
ッチＳＷを介してＣＣＤアナログシフトレジスタに取り
込まれ、ついで転送パルスφ１，φ２により転送され
る。したがって、この回路では光蓄積タイミングを外部
からの電気信号により１ラインの読み取り周期内の任意
の位置に設定することができない。
【００３１】そこで、図７および図８に示すように信号
ＷＧによりスイッチＳＷ１をオン、オフすることにより
光蓄積タイミングのみスイッチＳＷ１をコンデンサＣ側
に短絡して各画素の電荷をコンデンサＣに蓄積し、光蓄
積タイミング以外でスイッチＳＷ１を接地側に短絡して
画素のコンデンサＣに電荷が蓄積されないように制御す
ることにより、ＣＣＤセンサの各ラインセンサの光蓄積
タイミングを制御することができる。
ＷＧによりスイッチＳＷ１をオン、オフすることにより
光蓄積タイミングのみスイッチＳＷ１をコンデンサＣ側
に短絡して各画素の電荷をコンデンサＣに蓄積し、光蓄
積タイミング以外でスイッチＳＷ１を接地側に短絡して
画素のコンデンサＣに電荷が蓄積されないように制御す
ることにより、ＣＣＤセンサの各ラインセンサの光蓄積
タイミングを制御することができる。
【００３２】なお、この場合には図８に示すように、各
ラインのシフトゲート信号ＳＧ１，ＳＧ２のタイミング
は、同一になるように制御される。この場合にも同様
に、各ラインの蓄積時間Ｔint1，Ｔint2を一般的に同一
に設定し、かつ各ラインの蓄積タイミングが重ならない
ように最長の蓄積時間Ｔint1，Ｔint2が得られるように
ラインセンサ１０ａ，１０ｂが制御される。
ラインのシフトゲート信号ＳＧ１，ＳＧ２のタイミング
は、同一になるように制御される。この場合にも同様
に、各ラインの蓄積時間Ｔint1，Ｔint2を一般的に同一
に設定し、かつ各ラインの蓄積タイミングが重ならない
ように最長の蓄積時間Ｔint1，Ｔint2が得られるように
ラインセンサ１０ａ，１０ｂが制御される。
【００３３】つぎに、図９〜図１１を参照して第４の実
施例を説明する。図９は液晶シャッタを用いた画像読み
取り装置の光学系を示す構成図、図１０は図９に示す液
晶シャッタとＣＣＤラインセンサの関係を示す説明図、
図１１は液晶シャッタを用いた場合の駆動信号を示すタ
イミングチャートである。
施例を説明する。図９は液晶シャッタを用いた画像読み
取り装置の光学系を示す構成図、図１０は図９に示す液
晶シャッタとＣＣＤラインセンサの関係を示す説明図、
図１１は液晶シャッタを用いた場合の駆動信号を示すタ
イミングチャートである。
【００３４】この実施例では図９および図１０に示すよ
うに、レンズ７とＣＣＤセンサ１０の間に液晶シャッタ
９が配置されている。液晶シャッタ９は図１０に詳しく
示すように、２つのシャッタ９ａ，９ｂにより構成さ
れ、このシャッタ９ａ，９ｂはオン、オフにより他方の
ラインセンサ１０ａ，１０ｂの受光量に影響を与えない
ように配置される。
うに、レンズ７とＣＣＤセンサ１０の間に液晶シャッタ
９が配置されている。液晶シャッタ９は図１０に詳しく
示すように、２つのシャッタ９ａ，９ｂにより構成さ
れ、このシャッタ９ａ，９ｂはオン、オフにより他方の
ラインセンサ１０ａ，１０ｂの受光量に影響を与えない
ように配置される。
【００３５】そして、図１１に示すようにこのシャッタ
９ａ，９ｂはそれぞれ駆動信号ＴＧ１，ＴＧ２により交
互にオン、オフするように制御され、したがって、各ラ
インの受光タイミングを変更することができるので、光
蓄積時間Ｔl1，Ｔl2を変更することができる。なお、こ
の方法によれば、図６に示す場合と同様に、各ラインの
シフトゲート信号ＳＧ１，ＳＧ２のタイミングが同一に
なるように制御することができる。
９ａ，９ｂはそれぞれ駆動信号ＴＧ１，ＴＧ２により交
互にオン、オフするように制御され、したがって、各ラ
インの受光タイミングを変更することができるので、光
蓄積時間Ｔl1，Ｔl2を変更することができる。なお、こ
の方法によれば、図６に示す場合と同様に、各ラインの
シフトゲート信号ＳＧ１，ＳＧ２のタイミングが同一に
なるように制御することができる。
【００３６】なお、上記第２〜第４の実施例によれば、
光蓄積タイミングをずらすことにより１／２ラインのず
れを発生させることができるが、ライン間補正回路１３
は、ライン間の距離がＭライン、変倍率がＸ倍の場合、
ラインセンサ１０ａの信号を（Ｍ＋１／２）＊Ｘ−１／
２だけ遅延するように構成されている。
光蓄積タイミングをずらすことにより１／２ラインのず
れを発生させることができるが、ライン間補正回路１３
は、ライン間の距離がＭライン、変倍率がＸ倍の場合、
ラインセンサ１０ａの信号を（Ｍ＋１／２）＊Ｘ−１／
２だけ遅延するように構成されている。
【００３７】なお、３ライン以上のＣＣＤセンサを用い
た場合には、各ラインの間隔が同一でない場合もある
が、ライン間補正回路１３の構成を考慮すると、ライン
間隔は同一であるほうが各ライン毎に同一のハードウエ
アにより構成することができる。
た場合には、各ラインの間隔が同一でない場合もある
が、ライン間補正回路１３の構成を考慮すると、ライン
間隔は同一であるほうが各ライン毎に同一のハードウエ
アにより構成することができる。
【００３８】
【発明の効果】以上説明したように請求項１記載の発明
は、Ｍライン離れた先の位置、後の位置をそれぞれ同時
に読み取る第１及び第２のラインセンサの間のライン数
Ｍと変倍率Ｘに基づいて、第１のラインセンサの読み取
り信号をＭ×Ｘ−１／２ライン分だけ遅延して１ライン
に合成するので、複数のラインセンサが同一の画素をオ
ーバラップして読み取ることを防止することができ、し
たがって、解像度を向上させることができる。
は、Ｍライン離れた先の位置、後の位置をそれぞれ同時
に読み取る第１及び第２のラインセンサの間のライン数
Ｍと変倍率Ｘに基づいて、第１のラインセンサの読み取
り信号をＭ×Ｘ−１／２ライン分だけ遅延して１ライン
に合成するので、複数のラインセンサが同一の画素をオ
ーバラップして読み取ることを防止することができ、し
たがって、解像度を向上させることができる。
【００３９】請求項２記載の発明は、Ｍライン離れた先
の位置、後の位置をそれぞれ同時に読み取る第１及び第
２のラインセンサの間のライン数Ｍと変倍率Ｘに基づい
て、第１のラインセンサの読み取り信号がＭ×Ｘ−１／
２ライン分だけ遅延するように第１及び第２のラインセ
ンサの各光蓄積タイミングを制御して１ラインに合成す
るので、複数のラインセンサが同一の画素をオーバラッ
プして読み取ることを防止することができ、したがっ
て、解像度を向上させることができる。
の位置、後の位置をそれぞれ同時に読み取る第１及び第
２のラインセンサの間のライン数Ｍと変倍率Ｘに基づい
て、第１のラインセンサの読み取り信号がＭ×Ｘ−１／
２ライン分だけ遅延するように第１及び第２のラインセ
ンサの各光蓄積タイミングを制御して１ラインに合成す
るので、複数のラインセンサが同一の画素をオーバラッ
プして読み取ることを防止することができ、したがっ
て、解像度を向上させることができる。
【００４０】請求項３記載の発明は、第１及び第２のラ
インセンサの各光蓄積タイミングをずらすので、複数の
ラインセンサが同一の画素をオーバラップして読み取る
ことを防止することができ、したがって、解像度を向上
させることができる。
インセンサの各光蓄積タイミングをずらすので、複数の
ラインセンサが同一の画素をオーバラップして読み取る
ことを防止することができ、したがって、解像度を向上
させることができる。
【００４１】請求項４記載の発明は、請求項２記載の制
御回路が、前記ラインセンサの各光蓄積タイミングを各
ラインセンサのシフトゲート信号により制御するので、
解像度を向上させることができるとともに、複数のライ
ンセンサ間の距離を補正する回路を安価かつ簡単に構成
することができる。
御回路が、前記ラインセンサの各光蓄積タイミングを各
ラインセンサのシフトゲート信号により制御するので、
解像度を向上させることができるとともに、複数のライ
ンセンサ間の距離を補正する回路を安価かつ簡単に構成
することができる。
【００４２】請求項５記載の発明は、Ｍライン離れた先
の位置、後の位置をそれぞれ同時に読み取る第１及び第
２のラインセンサの間のライン数Ｍと変倍率Ｘに基づい
て、第１のラインセンサの読み取り信号がＭ×Ｘ−１／
２ライン分だけ遅延するようにシャッタの開閉タイミン
グを制御して１ラインに合成するので、複数のラインセ
ンサが同一の画素をオーバラップして読み取ることを防
止することができ、したがって、解像度を向上させるこ
とができる。
の位置、後の位置をそれぞれ同時に読み取る第１及び第
２のラインセンサの間のライン数Ｍと変倍率Ｘに基づい
て、第１のラインセンサの読み取り信号がＭ×Ｘ−１／
２ライン分だけ遅延するようにシャッタの開閉タイミン
グを制御して１ラインに合成するので、複数のラインセ
ンサが同一の画素をオーバラップして読み取ることを防
止することができ、したがって、解像度を向上させるこ
とができる。
【図１】本発明に係る画像読み取り装置の一実施例を示
すブロック図である。
すブロック図である。
【図２】図１の画像読み取り装置の光学系を示す構成図
である。
である。
【図３】図１および図２のＣＣＤセンサの主要信号を示
すタイミングチャートである。
すタイミングチャートである。
【図４】第２の実施例においてＣＣＤセンサの各ライン
毎にシフトゲート信号の発生タイミングを変更する場合
を示すタイミングチャートである。
毎にシフトゲート信号の発生タイミングを変更する場合
を示すタイミングチャートである。
【図５】図４の変形例を示すタイミングチャートであ
る。
る。
【図６】従来のＣＣＤセンサを示す回路図である。
【図７】第３の実施例において光蓄積タイミングが外部
から設定可能なＣＣＤセンサを示す回路図である。
から設定可能なＣＣＤセンサを示す回路図である。
【図８】図７のＣＣＤセンサの駆動信号を示すタイミン
グチャートである。
グチャートである。
【図９】第４の実施例において液晶シャッタを用いた画
像読み取り装置の光学系を示す構成図である。
像読み取り装置の光学系を示す構成図である。
【図１０】図９に示す液晶シャッタとＣＣＤラインセン
サの関係を示す説明図である。
サの関係を示す説明図である。
【図１１】液晶シャッタを用いた場合の駆動信号を示す
タイミングチャートである。
タイミングチャートである。
９ 液晶シャッタ
１０ ＣＣＤセンサ
１０ａ，１０ｂ ラインセンサ
１３ ライン間補正回路
１５ タイミング発生回路
─────────────────────────────────────────────────────
フロントページの続き
(72)発明者 武末 敏洋
東京都大田区中馬込１丁目３番６号 株
式会社リコー内
(56)参考文献 特開 昭62−163456（ＪＰ，Ａ)
特開 昭58−186254（ＪＰ，Ａ)
特開 昭54−159809（ＪＰ，Ａ)
特開 平５−260263（ＪＰ，Ａ)
特開 平４−35177（ＪＰ，Ａ)
(58)調査した分野(Int.Cl.7，ＤＢ名)
H04N 1/19
H04N 1/028
H04N 1/04
Claims (5)
- 【請求項１】 副走査方向にＭライン分だけ離間して配
列され、Ｍライン離れた先の位置、後の位置をそれぞれ
同時に読み取る第１及び第２のラインセンサと、 前記第１及び第２のラインセンサの間のライン数Ｍと変
倍率Ｘに基づいて、前記第１のラインセンサの読み取り
信号をＭ×Ｘ−１／２ライン分だけ遅延する手段と、 前記遅延された第１のラインセンサの信号の各画素と前
記第２のラインセンサの読み取り信号の各画素を１ライ
ンに合成 する手段と、 を備えた画像読み取り装置。 - 【請求項２】 副走査方向にＭライン分だけ離間して配
列され、Ｍライン離れた先の位置、後の位置をそれぞれ
同時に読み取る第１及び第２のラインセンサと、 前記第１及び第２のラインセンサの間のライン数Ｍと変
倍率Ｘに基づいて、前記第１のラインセンサの読み取り
信号がＭ×Ｘ−１／２ライン分だけ遅延するように前記
第１及び第２のラインセンサの各光蓄積タイミングを制
御する制御回路と、 前記制御回路により制御された前記第１及び第２のライ
ンセンサの各信号の各画素を１ラインに合成する手段と
を備えた画像読み取り装置。 - 【請求項３】 前記制御回路は、前記第１及び第２のラ
インセンサの各光蓄積タイミングをずらすことを特徴と
する請求項２記載の画像読み取り装置。 - 【請求項４】 前記制御回路は、前記ラインセンサの各
光蓄積タイミングを各ラインセンサのシフトゲート信号
により制御することを特徴とする請求項２記載の画像読
み取り装置。 - 【請求項５】 副走査方向にＭライン分だけ離間して配
列され、Ｍライン離れた先の位置、後の位置を同時にそ
れぞれのシャッタを介して読み取る第１及び第２のライ
ンセンサと、 前記第１及び第２のラインセンサの間のライン数Ｍと変
倍率Ｘに基づいて、前 記第１のラインセンサの読み取り
信号がＭ×Ｘ−１／２ライン分だけ遅延するように前記
シャッタの開閉タイミングを制御する制御回路と、 前記制御回路により制御された前記第１及び第２のライ
ンセンサの各信号の各画素を１ラインに合成する手段と
を備えた画像読み取り装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP05185192A JP3399554B2 (ja) | 1992-03-10 | 1992-03-10 | 画像読み取り装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP05185192A JP3399554B2 (ja) | 1992-03-10 | 1992-03-10 | 画像読み取り装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH05260261A JPH05260261A (ja) | 1993-10-08 |
| JP3399554B2 true JP3399554B2 (ja) | 2003-04-21 |
Family
ID=12898363
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP05185192A Expired - Fee Related JP3399554B2 (ja) | 1992-03-10 | 1992-03-10 | 画像読み取り装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3399554B2 (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP6238541B2 (ja) * | 2013-03-27 | 2017-11-29 | 東レエンジニアリング株式会社 | 高速撮像方法および高速撮像装置 |
-
1992
- 1992-03-10 JP JP05185192A patent/JP3399554B2/ja not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JPH05260261A (ja) | 1993-10-08 |
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Legal Events
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