JP3351801B2 - ゲッタリング方法 - Google Patents
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- 238000000034 method Methods 0.000 title claims description 29
- 238000005247 gettering Methods 0.000 title claims description 23
- 239000000758 substrate Substances 0.000 claims description 85
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 claims description 68
- 229910052710 silicon Inorganic materials 0.000 claims description 68
- 239000010703 silicon Substances 0.000 claims description 67
- 239000002184 metal Substances 0.000 claims description 60
- LEVVHYCKPQWKOP-UHFFFAOYSA-N [Si].[Ge] Chemical compound [Si].[Ge] LEVVHYCKPQWKOP-UHFFFAOYSA-N 0.000 claims description 38
- 230000008569 process Effects 0.000 claims description 12
- 238000010438 heat treatment Methods 0.000 claims description 6
- 229910021421 monocrystalline silicon Inorganic materials 0.000 claims 1
- GNPVGFCGXDBREM-UHFFFAOYSA-N germanium atom Chemical compound [Ge] GNPVGFCGXDBREM-UHFFFAOYSA-N 0.000 description 19
- 229910052732 germanium Inorganic materials 0.000 description 18
- 238000000151 deposition Methods 0.000 description 13
- 238000007789 sealing Methods 0.000 description 12
- 238000011109 contamination Methods 0.000 description 9
- 235000012431 wafers Nutrition 0.000 description 6
- 230000008901 benefit Effects 0.000 description 5
- 229910021420 polycrystalline silicon Inorganic materials 0.000 description 5
- 230000000694 effects Effects 0.000 description 4
- ATJFFYVFTNAWJD-UHFFFAOYSA-N Tin Chemical compound [Sn] ATJFFYVFTNAWJD-UHFFFAOYSA-N 0.000 description 3
- 238000005229 chemical vapour deposition Methods 0.000 description 3
- 150000001875 compounds Chemical class 0.000 description 3
- 230000008021 deposition Effects 0.000 description 3
- 238000004519 manufacturing process Methods 0.000 description 3
- 239000000203 mixture Substances 0.000 description 3
- UFHFLCQGNIYNRP-UHFFFAOYSA-N Hydrogen Chemical compound [H][H] UFHFLCQGNIYNRP-UHFFFAOYSA-N 0.000 description 2
- 229910000577 Silicon-germanium Inorganic materials 0.000 description 2
- OPTOQCQBJWTWPN-UHFFFAOYSA-N [Si].[Ge].[Si] Chemical compound [Si].[Ge].[Si] OPTOQCQBJWTWPN-UHFFFAOYSA-N 0.000 description 2
- 238000007796 conventional method Methods 0.000 description 2
- 239000007789 gas Substances 0.000 description 2
- 239000001257 hydrogen Substances 0.000 description 2
- 229910052739 hydrogen Inorganic materials 0.000 description 2
- 239000012535 impurity Substances 0.000 description 2
- 239000000463 material Substances 0.000 description 2
- 230000007246 mechanism Effects 0.000 description 2
- YTRCVQWXYYPLAA-UHFFFAOYSA-N [GeH3+]=O Chemical compound [GeH3+]=O YTRCVQWXYYPLAA-UHFFFAOYSA-N 0.000 description 1
- 230000015572 biosynthetic process Effects 0.000 description 1
- 239000000969 carrier Substances 0.000 description 1
- 239000007795 chemical reaction product Substances 0.000 description 1
- 239000002131 composite material Substances 0.000 description 1
- 238000005137 deposition process Methods 0.000 description 1
- 238000005538 encapsulation Methods 0.000 description 1
- 238000005516 engineering process Methods 0.000 description 1
- 238000009499 grossing Methods 0.000 description 1
- 238000004806 packaging method and process Methods 0.000 description 1
- JTJMJGYZQZDUJJ-UHFFFAOYSA-N phencyclidine Chemical compound C1CCCCN1C1(C=2C=CC=CC=2)CCCCC1 JTJMJGYZQZDUJJ-UHFFFAOYSA-N 0.000 description 1
- 238000005498 polishing Methods 0.000 description 1
- 229920005591 polysilicon Polymers 0.000 description 1
- 239000000047 product Substances 0.000 description 1
- 230000009467 reduction Effects 0.000 description 1
- 239000004065 semiconductor Substances 0.000 description 1
- 150000003376 silicon Chemical class 0.000 description 1
- 239000011856 silicon-based particle Substances 0.000 description 1
- 239000010409 thin film Substances 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
- H01L21/30—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
- H01L21/322—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to modify their internal properties, e.g. to produce internal imperfections
- H01L21/3221—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to modify their internal properties, e.g. to produce internal imperfections of silicon bodies, e.g. for gettering
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- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
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- Engineering & Computer Science (AREA)
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- Manufacturing & Machinery (AREA)
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- Microelectronics & Electronic Packaging (AREA)
- Power Engineering (AREA)
- Recrystallisation Techniques (AREA)
- Insulated Gate Type Field-Effect Transistor (AREA)
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Description
関し、特にシリコン基板上の能動素子からシリコン基板
中の金属原子を分離するためのゲッタリングに関する。
動素子からシリコン基板中の金属原子を分離する試みに
対して、これまでに幾つかの問題点が発生している。集
積回路の製造中において、電子部品が基板上に形成され
る時往々にして金属原子がシリコン基板中に移動する。
不幸にも、このような金属原子は製品の処理中に基板中
を移動し易い。もしかなりの量の金属原子が能動素子を
移動すれば集積回路の効率はかなり悪くなる。能動素子
中のこのような金属原子によって生ずる問題は、集積回
路の電気的短絡から少数キャリアの寿命の減少による不
適切な素子動作にまで及ぶ。
グ処理は幾つかあるうちの一つの方法によって能動素子
からこのような金属原子を分離即ちゲッタリングするた
めに使用されてきた。このような方法の一つには、シリ
コン基板の背面損傷がある。表面を損傷することによっ
て、基板の背面に格子転位が形成される。金属原子は移
動してこの格子転位に達し、ここで捕獲される。不幸に
も、背面損傷は一般には不均一であり、更に基板表面に
自由シリコン粒子が堆積することによって基板表面の汚
染を引き起こしやすい。
て、基板背面上に多結晶シリコン層を堆積する方法があ
る。シリコン表面に隣接して多結晶シリコン層を形成す
ることによって、各層の表面の界面に格子構造の転位が
形成され、シリコン基板中の金属分子がここに捕獲され
る。金属原子はまた多結晶シリコンの粒界にも捕獲され
る。このような堆積には、多結晶シリコン層の堆積過程
を必要とするため、コストがかかり、さらに時間を浪費
する。さらにこの多結晶シリコン層は簡単にエッチング
され、結局ゲッタリング素材を除去する結果となる。
ための製造工程に能動素子中へ移動する金属原子によっ
てもたらされる損害を防ぐために、より優れたゲッタリ
ング処理が必要とされる。さらに、シリコン基板の表面
を汚染することが無く、かつ基板中の金属原子を効果的
にゲッタリングするために均一に、堆積されるゲッタリ
ング処理が必要とされている。さらにその上、簡単に実
行し得てかつ経済的なゲッタリング技術が求められてい
る。
能動素子から基板中の金属原子を分離するためのゲッタ
リング機構にある。先ず最初に、犠牲層として作用する
ゲルマニウムシリコン層をシリコン基板上に堆積し、基
板上に連続層が形成されるようにする。基板の第1の面
を、ゲルマニウムシリコン層の堆積のための均一な接触
面を形成するように研磨することも可能である。しかし
ながら、これは必ずしも必要ではない。格子構造の不整
合による転位がゲルマニウムシリコン層とシリコン基板
との界面に沿って形成される。ゲルマニウムシリコンの
不整合層をシリコン基板上に堆積したのち、任意にシリ
コン層をゲルマニウム層上に堆積し、これによって基板
とシリコン層間にゲルマニウム層を封止する。このゲル
マニウムシリコン層の封止によって不整合転位の付加的
な層が形成され、これはゲッタリング機構を保証するた
めの犠牲層として作用し、集積回路の全製造過程を通し
て存続する。
積回路を形成するために電子部品が製造される。電子部
品が基板上に製造されると、金属原子はシリコン基板中
に移動する。この発明は、ゲルマニウムシリコン層(典
型的にはシリコン中に約0.1%から25%のゲルマニ
ウムを含み、さらに約0.1μmから25mmの厚さを有
する)をシリコン基板の背面に堆積することによって、
ウエファの背面上に不整合による転位を生成する方法か
らなる。シリコン層を任意にゲルマニウム/シリコン層
上に堆積してもよいが、しかしこれは必ずしも必要では
ない。シリコンウエファ上へ素子を形成する典型的な処
理では、約300℃から1400℃の温度を必要とす
る。この様な温度では金属原子はシリコンウエファ中で
移動しやすく、ゲルマニウムシリコンとシリコンの界面
の不整合転位に向かって移動し、ここで永久的に捕獲さ
れる。
原子をゲッタリングすると、ゲルマニウムシリコン層と
シリコン層は除去される。シリコン層とゲルマニウム層
の除去は任意であるが、しかし普通は特定の応用事例に
対するパッケージ上の必要性から除去するように要請さ
れる。
属原子をゲッタリングする従来の方法に比べて幾つかの
利点を有している。このような利点としては、処理過程
で形成される金属クラスターを効率的に減少させるこ
と、およびシリコン基板の表面における特殊な汚染を減
少させることを含んでいる。さらにその上、この発明
は、犠牲層を均一に堆積して基板全体の適正なゲッタリ
ングを確実に実行するという技術上の利点を有する。最
後に、この発明は従来技術よりも最終製品に関してより
経済的であり、さらにより実施し易い。
効果は、図面を参照しながら詳細な説明を熟考すること
によって認識される。
す図である。加工体10は好ましくはシリコンを材料と
し約550μmの厚さを有している。加工体10は背面
14と前面16を有している。前面16は先ずラッピン
グ工程を晒され表面のデコボコが除去される。このラッ
ピング工程が完了すると、表面16を研磨して次工程の
準備をする。
は、シリコン(ゲルマニウム2%)の化学的気相成長
(CVD)22が実行され、層20を均一に被覆する。
層20は約1から2μmの厚さを有するゲルマニウムシ
リコンの混合体であり、シリコンとシリコンゲルマニウ
ムとの格子定数の違いによって、シリコン/シリコンゲ
ルマニウムの界面に不整合による転位を生じるように機
能する。層20は約0.1μmから25μmの範囲で変
化する。この層20は面16における層12と20の界
面に格子構造の不整合転位を形成する。このような格子
構造の転位は、この発明によって後に基板12から金属
原子をゲッタリングするために利用される。
2%)はシリコンとスズの混合体に置き換えることがで
きる。ゲルマニウムとスズ原子はその界面で格子構造不
整合転位を生じるために用いられるもので、従って必要
な格子構造不整合転位を生じるなら、他のIV族の化合物
をゲルマニウムとスズの変わりに使用することが出来
る。
シリコン層20上には封止層24が堆積される。封止層
24は例えばCVD工程によって堆積される純粋シリコ
ンのようなシリコン組成を有していることが望ましい。
封止層24は後の工程でゲルマニウム原子が層20から
移動して基板12を汚染しないようにする目的で使用さ
れている。層24は約2μmから約5μmの厚さに堆積
されることが望ましい。この時点で、加工体10はその
後の処理のためにウエファ工程に送られ、あるいは素子
を製造するために処理設備の先端に送られる。
次の処理工程が理解される。処理中に、通常の方法によ
って前面14上に数個の電子部品26が形成される。部
品26が表面14上に形成されると、金属分子28は高
温においてシリコン基板12の格子構造を介して移動し
分散される傾向がある。金属原子がシリコン層12中を
移動する場合、この金属原子は温度がかなり上昇すると
処理中にクラスターを形成する傾向がある。金属原子2
8のこの様なクラスター化は後の処理工程において、例
えば集積回路の短絡、あるいは表面の汚染等の困難な状
況をつくり出す。能動素子中に位置する単一の金属原子
はまた少数キャリアの寿命を短くし、結果的に素子の効
率を落とす。
2から金属原子28をゲッタリングする方法が理解され
る。基板12が約300℃から1400℃間の典型的な
処理温度に熱せられると、金属原子はシリコン格子中を
ランダムに移動する。この移動中の金属原子がゲルマニ
ウムシリコン/シリコン界面の不整合転位に達すると、
この原子は永久的にこれに捕獲される。このような転位
への金属原子の捕獲によって、基板中に金属原子の濃度
勾配が生じ、その結果金属原子はゲルマニウムシリコン
/シリコン間の界面層16における不整合転位へ実質的
に流出しあるいは移動する。
選択位置に不整合転位を生じ、基板12が加熱されてい
る間に金属原子28をこの所定位置に移動させるため
に、堆積される。第5図に示すように、犠牲層20への
金属原子28の移動によって前面14に達する金属原子
の濃度が減少する。金属分子28の位置が前面14から
離れる事によって、前面14の基板12内での金属クラ
スター化の確率が減少する。このような金属クラスター
の減少によって集積回路の短絡と表面汚染の可能性が減
少する。前面付近のこのような金属原子の減少によって
少数のキャリアの寿命が長くなり結果的に素子効率が向
上する。
リング効果を達成することが困難性であった従来の技術
に対して、技術的な特徴を有している。基板12上への
ゲッタリング効果が均一でないと、高濃度の金属分子2
8が基板を貫通して表面に拡散し、その結果動作上の問
題を引き起こす可能性が生じる。
止層24が除去されていることが理解される。この層2
0と24の除去は任意であるが、これが一旦実行される
とパッケージ領域内でのスペースが増加する。基板12
の厚さを減少すること、および層20と24の除去によ
って、加工体10の性能が落ちる。一旦犠牲層20と封
止層24が加工体10から除去されると、金属分子28
もまた加工体10から除去され、その結果高温に晒され
る場合の将来的な金属分子クラスター化の可能性が取り
除かれる。
記載する例を参照する事によって、容易に理解される。
ピングし研磨することによって準備された。表面を平均
に滑らかにした後、背面を純粋シリコン原子源に晒し、
背面にゲルマニウム源を受容するための準備をした。シ
リコン(ゲルマニウム2%)気体を約200lの体積を
有する反応容器内で循環させた。この反応容器はアプラ
イドマテリアルテクノロジー(Applied Mat
erial Technology)社製のモデルAM
T−7810であった。この反応容器は水素源とシリコ
ン(ゲルマニウム2%)源と完全に混合するためのプレ
ミックス容器と共に供給された。
lであり、ゲルマニウム2%のシリコン(ゲルマニウム
2%)流は毎分約0.8lであった。容器の温度は約1
000℃、圧力は約1気圧であった。その結果シリコン
基板上に堆積されたゲルマニウムシリコン層の厚さは約
1.5μmであった。シリコン層はゲルマニウム層上に
平均に各4μmの厚さで堆積された。
故意に汚染した。背面に金属不純物を有する基板を約2
0秒間、約1000℃の炉の中に保持した。シリコンウ
エファの前面を観察したが、何の汚れも見られなかっ
た。この汚れが存在しないという事実は、金属分子がゲ
ルマニウムシリコン面に移動する事、およびシリコン基
板を加熱した後で前面に達する汚染が最小であることを
示している。
つの層の間に挟まれた犠牲層として作用するゲルマニウ
ムシリコン層を用いる事に特徴を有する、効果的なゲッ
タリング処理を開示している。この発明のゲッタリング
処理は、均一性、金属クラスターの減少、表面上の汚染
の減少、およびより均一なゲッタリングと言う点で大き
な効果を有している。
実施例とその効果について開示したが、この発明はこれ
らの限定されるものでは無く、請求の範囲に示した精神
および範囲にのみ限定されるものである。
る。
および上記基板上に堆積された犠牲層であって上記基板
から金属分子を該犠牲層の近辺に引きつけるための犠牲
層、からなるゲッタリング構造。
記犠牲層から上記基板への特定の汚染を減少させるため
の封止層を含む事を特徴とする、第1項に記載の装置。
ている事を特徴とする第1項に記載の装置。
からなることを特徴とする第1項に記載の装置。
子の引きつけは上記基板の温度を約300℃から約14
00℃の間に上げることによって開始されるものである
第1項に記載の装置。
いる事を特徴とする第2項に記載の装置。
徴とする第1項に記載の装置。
25μmの間である事を特徴とする第1項に記載の装
置。
範囲である事を特徴とする第2項に記載の装置。
ニウムシリコン層と、および上記ゲルマニウムシリコン
層を封止するために上記ゲルマニウムシリコン層上に堆
積されたシリコン層からなり、この基板と上記ゲルマニ
ウムシリコン層は格子構造不整合による転位を有しその
結果加熱により上記ゲルマニウムシリコン/シリコンの
界面において基板から不整合転位へ向かう金属原子の流
れが引き起こされることを特徴とする、シリコン基板か
ら金属原子をゲッタリングするための装置。
コン中に約0.1から約25%のゲルマニウムを含んで
いることを特徴とする第10項に記載の装置。
0.1から25μmの厚さを有している事を特徴とする
第10項に記載の装置。
0℃の間に加熱される事を特徴とする第10項に記載の
装置。
上に素子を形成しこの素子の処理過程からの金属原子を
上記基板中に移動させ、さらに上記基板からゲルマニウ
ム−シリコンとシリコン界面における不整合転位への金
属原子の移動を誘起するために上記基板を加熱する、各
ステップから構成されるゲッタリング方法。
ン層に封止層を堆積して上記ゲルマニウム/シリコン層
を上記基板と該封止層間に局限するステップを含む事を
特徴とする第14項に記載の方法。
ムシリコン/シリコン界面における上記不整合転位へ移
動したのち上記基板から上記ゲルマニウムシリコン−シ
リコン層と上記封止層を除去するステップを含むことを
特徴とする第15項に記載の方法。
基板の温度を約300℃と約1400℃の範囲内で上昇
させる事を特徴とする第14項に記載の方法。
記不整合転位層を形成するためのにゲルマニウムシリコ
ンを堆積するステップからなることを特徴とする第14
項に記載の方法。
プは上記犠牲層を形成するためにIV族化合物を堆積する
ステップからなる事を特徴とする第14項に記載の方
法。
コン層を堆積し、上記ゲルマニウムシリコン層上にシリ
コン層を堆積して上記ゲルマニウムシリコン層を該シリ
コン層と基板間に封止し、基板の第2面上に素子を形成
して通常の処理過程中に汚染を生じる基板を金属原子で
汚染させ、さらに基板から上記ゲルマニウムシリコン層
の近辺への金属分子の移動を誘起するために基板を加熱
し基板を実質的に金属分子の影響を受けない状態にす
る、各ステップからなる、汚染されたシリコン基板から
金属原子をゲッタリングする方法。
シリコン層と上記シリコン層を除去するステップを含む
ことを特徴とする第20項に記載の方法。
300℃と約1400℃の範囲で上昇させるものである
第20項に記載の方法。
加工体の拡大図。
層の形成を示すための、図1に示した加工体の拡大断面
図。
ン層を示すための、図2に示し加工体の拡大断面図。
3に示す加工体の拡大断面図。
ゲッタリングした金属分子を示すための、図4に示す加
工体の拡大断面図。
を除去した後の加工体を示すための、図5に示す加工体
の拡大断面図。
Claims (1)
- 【請求項1】 単結晶シリコン基板上全面にゲルマニウ
ム−シリコン犠牲層を均一に堆積して、その界面に不整
合転位を形成し、 上記基板の反対面に素子を形成し、この素子の前記形成
過程からの金属原子を上記基板中に移動させ、さらに 上記基板を加熱して、上記基板からゲルマニウム−シリ
コンとシリコン界面における不整合転位への金属原子の
移動を誘起する、 各ステップから構成されるゲッタリング方法。
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US07/457,441 US5229306A (en) | 1989-12-27 | 1989-12-27 | Backside gettering method employing a monocrystalline germanium-silicon layer |
US457441 | 1989-12-27 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH0437140A JPH0437140A (ja) | 1992-02-07 |
JP3351801B2 true JP3351801B2 (ja) | 2002-12-03 |
Family
ID=23816747
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP40831090A Expired - Fee Related JP3351801B2 (ja) | 1989-12-27 | 1990-12-27 | ゲッタリング方法 |
Country Status (4)
Country | Link |
---|---|
US (1) | US5229306A (ja) |
EP (1) | EP0434984A3 (ja) |
JP (1) | JP3351801B2 (ja) |
KR (1) | KR100257364B1 (ja) |
Families Citing this family (13)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5789284A (en) | 1994-09-29 | 1998-08-04 | Semiconductor Energy Laboratory Co., Ltd. | Method for fabricating semiconductor thin film |
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JP3295346B2 (ja) | 1997-07-14 | 2002-06-24 | 株式会社半導体エネルギー研究所 | 結晶性珪素膜の作製方法及びそれを用いた薄膜トランジスタ |
US6268641B1 (en) | 1998-03-30 | 2001-07-31 | Kabushiki Kaisha Toshiba | Semiconductor wafer having identification indication and method of manufacturing the same |
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-
1989
- 1989-12-27 US US07/457,441 patent/US5229306A/en not_active Expired - Lifetime
-
1990
- 1990-11-23 EP EP19900122377 patent/EP0434984A3/en not_active Ceased
- 1990-12-26 KR KR1019900021736A patent/KR100257364B1/ko not_active IP Right Cessation
- 1990-12-27 JP JP40831090A patent/JP3351801B2/ja not_active Expired - Fee Related
Also Published As
Publication number | Publication date |
---|---|
EP0434984A2 (en) | 1991-07-03 |
KR100257364B1 (ko) | 2000-05-15 |
EP0434984A3 (en) | 1993-03-03 |
JPH0437140A (ja) | 1992-02-07 |
KR910013448A (ko) | 1991-08-08 |
US5229306A (en) | 1993-07-20 |
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