CN108666259A - 贴合晶圆的制造方法以及贴合晶圆 - Google Patents
贴合晶圆的制造方法以及贴合晶圆 Download PDFInfo
- Publication number
- CN108666259A CN108666259A CN201810201351.7A CN201810201351A CN108666259A CN 108666259 A CN108666259 A CN 108666259A CN 201810201351 A CN201810201351 A CN 201810201351A CN 108666259 A CN108666259 A CN 108666259A
- Authority
- CN
- China
- Prior art keywords
- wafer
- fitting
- epitaxial
- ion
- substrate
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Withdrawn
Links
- 238000004519 manufacturing process Methods 0.000 title claims abstract description 39
- 235000012431 wafers Nutrition 0.000 claims abstract description 252
- 239000000758 substrate Substances 0.000 claims abstract description 66
- 238000004140 cleaning Methods 0.000 claims abstract description 44
- 238000000034 method Methods 0.000 claims abstract description 44
- 239000007789 gas Substances 0.000 claims abstract description 8
- GPRLSGONYQIRFK-UHFFFAOYSA-N hydron Chemical compound [H+] GPRLSGONYQIRFK-UHFFFAOYSA-N 0.000 claims abstract description 6
- 230000015572 biosynthetic process Effects 0.000 claims abstract description 5
- 230000007547 defect Effects 0.000 claims description 18
- 238000000407 epitaxy Methods 0.000 claims description 16
- 230000002093 peripheral effect Effects 0.000 claims description 8
- 238000002347 injection Methods 0.000 claims description 5
- 239000007924 injection Substances 0.000 claims description 5
- 229910052756 noble gas Inorganic materials 0.000 abstract description 5
- 239000010408 film Substances 0.000 description 46
- 150000002500 ions Chemical class 0.000 description 32
- 230000003647 oxidation Effects 0.000 description 18
- 238000007254 oxidation reaction Methods 0.000 description 18
- 238000010438 heat treatment Methods 0.000 description 11
- 230000000052 comparative effect Effects 0.000 description 5
- 239000013078 crystal Substances 0.000 description 5
- 238000005516 engineering process Methods 0.000 description 5
- 239000007788 liquid Substances 0.000 description 5
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 description 4
- 239000000463 material Substances 0.000 description 4
- 229910021421 monocrystalline silicon Inorganic materials 0.000 description 4
- 229910052710 silicon Inorganic materials 0.000 description 4
- 239000010703 silicon Substances 0.000 description 4
- 239000000243 solution Substances 0.000 description 4
- 238000005229 chemical vapour deposition Methods 0.000 description 3
- 230000000694 effects Effects 0.000 description 3
- 238000001000 micrograph Methods 0.000 description 3
- CBENFWSGALASAD-UHFFFAOYSA-N Ozone Chemical compound [O-][O+]=O CBENFWSGALASAD-UHFFFAOYSA-N 0.000 description 2
- 239000007864 aqueous solution Substances 0.000 description 2
- 238000011156 evaluation Methods 0.000 description 2
- 239000004065 semiconductor Substances 0.000 description 2
- 239000000126 substance Substances 0.000 description 2
- XLYOFNOQVPJJNP-UHFFFAOYSA-N water Substances O XLYOFNOQVPJJNP-UHFFFAOYSA-N 0.000 description 2
- VHUUQVKOLVNVRT-UHFFFAOYSA-N Ammonium hydroxide Chemical compound [NH4+].[OH-] VHUUQVKOLVNVRT-UHFFFAOYSA-N 0.000 description 1
- OAICVXFJPJFONN-UHFFFAOYSA-N Phosphorus Chemical compound [P] OAICVXFJPJFONN-UHFFFAOYSA-N 0.000 description 1
- 230000001133 acceleration Effects 0.000 description 1
- 150000001335 aliphatic alkanes Chemical class 0.000 description 1
- QVGXLLKOCUKJST-UHFFFAOYSA-N atomic oxygen Chemical compound [O] QVGXLLKOCUKJST-UHFFFAOYSA-N 0.000 description 1
- 239000002019 doping agent Substances 0.000 description 1
- 238000004299 exfoliation Methods 0.000 description 1
- 239000012535 impurity Substances 0.000 description 1
- 239000004615 ingredient Substances 0.000 description 1
- 238000007689 inspection Methods 0.000 description 1
- 238000009413 insulation Methods 0.000 description 1
- 239000002184 metal Substances 0.000 description 1
- 229910052760 oxygen Inorganic materials 0.000 description 1
- 239000001301 oxygen Substances 0.000 description 1
- 239000002245 particle Substances 0.000 description 1
- 229910052698 phosphorus Inorganic materials 0.000 description 1
- 239000011574 phosphorus Substances 0.000 description 1
- 238000009832 plasma treatment Methods 0.000 description 1
- 239000010409 thin film Substances 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/70—Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
- H01L21/71—Manufacture of specific parts of devices defined in group H01L21/70
- H01L21/76—Making of isolation regions between components
- H01L21/762—Dielectric regions, e.g. EPIC dielectric isolation, LOCOS; Trench refilling techniques, SOI technology, use of channel stoppers
- H01L21/7624—Dielectric regions, e.g. EPIC dielectric isolation, LOCOS; Trench refilling techniques, SOI technology, use of channel stoppers using semiconductor on insulator [SOI] technology
- H01L21/76251—Dielectric regions, e.g. EPIC dielectric isolation, LOCOS; Trench refilling techniques, SOI technology, use of channel stoppers using semiconductor on insulator [SOI] technology using bonding techniques
- H01L21/76254—Dielectric regions, e.g. EPIC dielectric isolation, LOCOS; Trench refilling techniques, SOI technology, use of channel stoppers using semiconductor on insulator [SOI] technology using bonding techniques with separation/delamination along an ion implanted layer, e.g. Smart-cut, Unibond
-
- B—PERFORMING OPERATIONS; TRANSPORTING
- B28—WORKING CEMENT, CLAY, OR STONE
- B28D—WORKING STONE OR STONE-LIKE MATERIALS
- B28D1/00—Working stone or stone-like materials, e.g. brick, concrete or glass, not provided for elsewhere; Machines, devices, tools therefor
- B28D1/005—Cutting sheet laminae in planes between faces
-
- B—PERFORMING OPERATIONS; TRANSPORTING
- B28—WORKING CEMENT, CLAY, OR STONE
- B28D—WORKING STONE OR STONE-LIKE MATERIALS
- B28D5/00—Fine working of gems, jewels, crystals, e.g. of semiconductor material; apparatus or devices therefor
- B28D5/0005—Fine working of gems, jewels, crystals, e.g. of semiconductor material; apparatus or devices therefor by breaking, e.g. dicing
- B28D5/0011—Fine working of gems, jewels, crystals, e.g. of semiconductor material; apparatus or devices therefor by breaking, e.g. dicing with preliminary treatment, e.g. weakening by scoring
-
- C—CHEMISTRY; METALLURGY
- C23—COATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; CHEMICAL SURFACE TREATMENT; DIFFUSION TREATMENT OF METALLIC MATERIAL; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL; INHIBITING CORROSION OF METALLIC MATERIAL OR INCRUSTATION IN GENERAL
- C23C—COATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; SURFACE TREATMENT OF METALLIC MATERIAL BY DIFFUSION INTO THE SURFACE, BY CHEMICAL CONVERSION OR SUBSTITUTION; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL
- C23C14/00—Coating by vacuum evaporation, by sputtering or by ion implantation of the coating forming material
- C23C14/02—Pretreatment of the material to be coated
- C23C14/021—Cleaning or etching treatments
-
- C—CHEMISTRY; METALLURGY
- C23—COATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; CHEMICAL SURFACE TREATMENT; DIFFUSION TREATMENT OF METALLIC MATERIAL; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL; INHIBITING CORROSION OF METALLIC MATERIAL OR INCRUSTATION IN GENERAL
- C23C—COATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; SURFACE TREATMENT OF METALLIC MATERIAL BY DIFFUSION INTO THE SURFACE, BY CHEMICAL CONVERSION OR SUBSTITUTION; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL
- C23C14/00—Coating by vacuum evaporation, by sputtering or by ion implantation of the coating forming material
- C23C14/02—Pretreatment of the material to be coated
- C23C14/021—Cleaning or etching treatments
- C23C14/022—Cleaning or etching treatments by means of bombardment with energetic particles or radiation
-
- G—PHYSICS
- G01—MEASURING; TESTING
- G01L—MEASURING FORCE, STRESS, TORQUE, WORK, MECHANICAL POWER, MECHANICAL EFFICIENCY, OR FLUID PRESSURE
- G01L9/00—Measuring steady of quasi-steady pressure of fluid or fluent solid material by electric or magnetic pressure-sensitive elements; Transmitting or indicating the displacement of mechanical pressure-sensitive elements, used to measure the steady or quasi-steady pressure of a fluid or fluent solid material, by electric or magnetic means
- G01L9/0041—Transmitting or indicating the displacement of flexible diaphragms
- G01L9/0042—Constructional details associated with semiconductive diaphragm sensors, e.g. etching, or constructional details of non-semiconductive diaphragms
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/02041—Cleaning
- H01L21/02043—Cleaning before device manufacture, i.e. Begin-Of-Line process
- H01L21/02052—Wet cleaning only
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/02104—Forming layers
- H01L21/02365—Forming inorganic semiconducting materials on a substrate
- H01L21/02612—Formation types
- H01L21/02617—Deposition types
- H01L21/02634—Homoepitaxy
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/02104—Forming layers
- H01L21/02365—Forming inorganic semiconducting materials on a substrate
- H01L21/02656—Special treatments
- H01L21/02658—Pretreatments
- H01L21/02661—In-situ cleaning
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
- H01L21/20—Deposition of semiconductor materials on a substrate, e.g. epitaxial growth solid phase epitaxy
- H01L21/2003—Deposition of semiconductor materials on a substrate, e.g. epitaxial growth solid phase epitaxy characterised by the substrate
- H01L21/2007—Bonding of semiconductor wafers to insulating substrates or to semiconducting substrates using an intermediate insulating layer
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
- H01L21/26—Bombardment with radiation
- H01L21/263—Bombardment with radiation with high-energy radiation
- H01L21/265—Bombardment with radiation with high-energy radiation producing ion implantation
- H01L21/26506—Bombardment with radiation with high-energy radiation producing ion implantation in group IV semiconductors
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
- H01L21/30—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
- H01L21/31—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to form insulating layers thereon, e.g. for masking or by using photolithographic techniques; After treatment of these layers; Selection of materials for these layers
- H01L21/3105—After-treatment
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/70—Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
- H01L21/71—Manufacture of specific parts of devices defined in group H01L21/70
- H01L21/76—Making of isolation regions between components
- H01L21/762—Dielectric regions, e.g. EPIC dielectric isolation, LOCOS; Trench refilling techniques, SOI technology, use of channel stoppers
- H01L21/7624—Dielectric regions, e.g. EPIC dielectric isolation, LOCOS; Trench refilling techniques, SOI technology, use of channel stoppers using semiconductor on insulator [SOI] technology
- H01L21/76243—Dielectric regions, e.g. EPIC dielectric isolation, LOCOS; Trench refilling techniques, SOI technology, use of channel stoppers using semiconductor on insulator [SOI] technology using silicon implanted buried insulating layers, e.g. oxide layers, i.e. SIMOX techniques
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L33/00—Semiconductor devices having potential barriers specially adapted for light emission; Processes or apparatus specially adapted for the manufacture or treatment thereof or of parts thereof; Details thereof
- H01L33/005—Processes
- H01L33/0093—Wafer bonding; Removal of the growth substrate
Landscapes
- Engineering & Computer Science (AREA)
- Physics & Mathematics (AREA)
- General Physics & Mathematics (AREA)
- Manufacturing & Machinery (AREA)
- Computer Hardware Design (AREA)
- Microelectronics & Electronic Packaging (AREA)
- Power Engineering (AREA)
- Condensed Matter Physics & Semiconductors (AREA)
- Chemical & Material Sciences (AREA)
- Mechanical Engineering (AREA)
- Chemical Kinetics & Catalysis (AREA)
- High Energy & Nuclear Physics (AREA)
- Materials Engineering (AREA)
- Metallurgy (AREA)
- Organic Chemistry (AREA)
- Analytical Chemistry (AREA)
- Mining & Mineral Resources (AREA)
- Toxicology (AREA)
- Health & Medical Sciences (AREA)
- Recrystallisation Techniques (AREA)
Abstract
技术问题:本发明提供一种贴合晶圆的制造方法,在将外延晶圆用于接合晶圆或者基底晶圆的情况下,能够制造平台宽度较小的贴合晶圆。解决手段:一种贴合晶圆的制造方法,该方法是从接合晶圆的表面离子注入氢离子、稀有气体离子的至少一种气体离子从而在晶圆内部形成离子注入层,直接或者隔着绝缘膜贴合所述接合晶圆的进行了离子注入的表面与基底晶圆的表面后,通过在所述离子注入层使接合晶圆剥离,从而来制造在所述基底晶圆上具有薄膜的贴合晶圆,其中,作为所述接合晶圆和所述基底晶圆的至少一方而使用外延晶圆,并通过单晶圆旋转清洗来进行该外延晶圆的形成外延层前的清洗。
Description
技术领域
本发明涉及一种贴合晶圆的制造方法以及贴合晶圆。
背景技术
作为SOI晶圆的制造方法,尤其是使尖端集成电路的高性能化成为可能的薄膜SOI晶圆的制造方法,将在贴合进行了离子注入的晶圆后进行剥离来制造SOI晶圆的方法(离子注入剥离法:也称为智能剥离法(注册商标)的技术)备受关注。该离子注入剥离法是如下所述的技术,即,在两张硅晶圆中的至少一方上形成绝缘膜(尤其是氧化膜),并且从一方的硅晶圆(接合晶圆)的上表面注入氢离子或者稀有气体离子等气体离子,使该晶圆内部形成微小气泡层(封入层)后,使注入了该离子的一方的面隔着绝缘膜(尤其是氧化膜)与另一方的硅晶圆(基底晶圆)紧贴(贴合),然后施加热处理(剥离热处理)而使微小气泡层作为劈开面呈薄膜状来剥离一方的晶圆(接合晶圆),再施加热处理(结合热处理)来牢固地结合从而做成SOI晶圆(参照专利文献1)。在该阶段中,劈开面(剥离面)成为SOI层的表面,比较容易获得SOI膜厚较薄且均匀性也较高的SOI晶圆。
以往,贴合SOI晶圆的基底晶圆是作为支承基板而用于支承SOI层的基板,但近年来,用沟槽等分离到埋入绝缘膜层(尤其是被称为BOX层的埋入氧化膜层)的基底并作为元器件结构一部分而使用的例子逐渐增加。作为形成这样的用作的元器件结构一部分的区域的方法之一,进行如下所述的SOI晶圆的制造,即,控制掺杂剂来制作形成了外延层的晶圆(外延晶圆),并将其作为基底晶圆使用。
另外,即使在不隔着绝缘膜而贴合晶圆彼此的直接接合晶圆中,也有使用外延晶圆作为贴合的材料晶圆(接合晶圆与基底晶圆的至少任意一方)的例子。
即使在隔着上述绝缘膜来对接合晶圆与基底晶圆进行接合的情况,和直接对接合晶圆与基底晶圆进行接合的情况中的任意一种情况下,在薄膜化后的贴合晶圆中也都存在被称为平台(terrace)部的区域。该平台部是在基底晶圆上不存在薄膜的区域。这是由于在所贴合之前的两张晶圆的周边部中存在厚度稍薄的被称为研磨塌边的部分、倒角部,该部分未通过贴合而结合,或者作为结合力较弱的未结合部分而残留。
现有技术文献
专利文献
专利文献1:日本专利公开平成5-211128号公报
专利文献2:日本专利公开2013-4760号公报
专利文献3:日本专利公开2006-270039号公报
发明内容
(一)要解决的技术问题
如上所述,在将外延晶圆作为材料晶圆使用的贴合晶圆中,存在如下问题:薄膜化后的平台部的宽度(平台宽度)在一部分的区域产生比其以外的区域的平台宽度更宽的部分。
本发明是为了解决上述问题而完成的,其目的在于,提供一种贴合晶圆的制造方法,其在将外延晶圆用于接合晶圆或者基底晶圆的情况下,能够制造平台宽度较小的贴合晶圆。
(二)技术方案
为了解决上述课题,本发明提供一种贴合晶圆的制造方法,该方法是从接合晶圆的表面离子注入氢离子、稀有气体离子的至少一种气体离子从而在晶圆内部形成离子注入层,直接或者隔着绝缘膜贴合所述接合晶圆的进行了离子注入的表面与基底晶圆的表面后,通过在所述离子注入层使接合晶圆剥离,从而来制造在所述基底晶圆上具有薄膜的贴合晶圆,其中,所述制造方法的特征在于,作为所述接合晶圆和所述基底晶圆的至少一方而使用外延晶圆,并通过单晶圆旋转清洗(日文:枚葉式スピン洗浄)来进行该外延晶圆的形成外延层前的清洗。
如果是这样的贴合晶圆的制造方法,则由于作为进行外延成长前的晶圆的清洗而进行单晶圆旋转清洗,因此当清洗时,能够使晶圆与晶圆支承工具的接触仅在不进行外延成长的区域。因此,即使在晶圆上进行外延成长,也能够避免微小的凸状缺陷向进行贴合的面的成长。其结果为,在贴合晶圆中,能够制造在整周上平台宽度较小的贴合晶圆。
此时,作为所述基底晶圆,可以使用所述外延晶圆。
这样,在作为基底晶圆而使用外延晶圆的情况下,能够特别适宜地使用本发明的贴合晶圆的制造方法。
另外,本发明提供一种贴合晶圆,其是直接或者隔着绝缘膜在基底晶圆上贴合有薄膜的贴合晶圆,其特征在于,所述基底晶圆是具有外延层的外延晶圆,在所述基底晶圆的外周部上表面中作为未形成有所述薄膜的部分的平台部,不存在作为所述外延层成长所引起的凸缺陷的外延缺陷。
如果是这样的贴合晶圆,则即使是将外延晶圆作为基底晶圆使用的贴合晶圆,也能够做成平台宽度较小的贴合晶圆。如果是这样的贴合晶圆,则有效面积较多,能够到外周附近都可用于元器件形成。
(三)有益效果
如果是本发明的贴合晶圆的制造方法,则即使在将外延晶圆用于接合晶圆和基底晶圆的任意一方的情况下,也能够制造平台宽度较小的贴合晶圆。另外,如果是本发明的贴合晶圆,则平台部不会在一部分区域变宽,能够做成平台宽度较小的贴合晶圆。如果是这样的贴合晶圆,则有效面积较多,能够到外周附近都可用于元器件形成。
附图说明
图1是表示本发明的贴合晶圆的制造方法一例的流程图。
图2是将通过分批式清洗进行了外延成长前的清洗的外延晶圆作为基底晶圆使用的贴合SOI晶圆(以往的贴合SOI晶圆)的外周部的显微镜照相。
具体实施方式
如上所述,正在寻求开发如下所述贴合晶圆的制造方法:即使在将外延晶圆用于材料晶圆(接合晶圆和基底晶圆的至少任意一方)的情况下,也能够制造平台宽度较小的贴合晶圆。
本发明人对上述课题进行了反复深入研究,结果得出了以下的见解。在外延晶圆的制造方法中,关于在即将形成外延层之前进行的清洗(也简称为“外延前清洗”),在通常情况下,主要使用将多个晶圆设置于晶圆载具上并浸渍于药液中的清洗(分批式清洗)。若在外延前清洗中使用分批式清洗,则会由于在晶圆外周部的与载具接触部分及其周边残存的接触痕迹、异物等原因,导致因外延成长而成长微小的凸状缺陷的情况。然而,由于其发生区域是距离晶圆外周端为0.5~2mm程度的区域,在通常情况下的外延晶圆检查工序中属于外周除外区域(不用于元器件制作的区域),不会导致不合格。然而,最新发现存在如下所述的问题:当将具有这样的微小凸状缺陷的晶圆作为用于制作基于离子注入剥离法的贴合晶圆的材料晶圆(接合晶圆和基底晶圆的至少任意一方)使用时,则会导致存在凸状缺陷的部分不能贴合、平台部形状比其他区域宽。换言之,若不将外延晶圆用于贴合晶圆的制造则没有问题,而一旦将外延晶圆用于贴合晶圆的制造则显然会产生问题。
图2是将通过分批式清洗进行了外延前清洗的外延晶圆作为基底晶圆使用的贴合SOI晶圆的外周部的显微镜照相。图2中的(a)是从SOI层侧拍摄贴合SOI晶圆的外周部的显微镜照相。在图2中的(a)中,基底晶圆表面作为平台部而存在,在多数的区域中,从外周端向内侧以大致一定的宽度形成有平台部。在平台部的内侧观察薄膜(SOI层)的表面。在图2中的(a)中所示的范围中,右侧存在判定为平台部中有不合格的区域。在该区域中,平台宽度比其他的区域宽(平台变形)。该平台部的不合格也被称为“孔隙缺陷”。在该不合格部分存在上述的微小的凸状缺陷。图2中的(b)是放大观察该微小的凸状缺陷的显微镜照相。在图2中的(b)中所观察到的那种扁平棱锥型的微小的凸状缺陷(也称为“外延缺陷”)存在于晶圆的边缘部附近,这成为平台变形的原因。
本发明人基于该见解进一步深入研究,发现在基于离子注入剥离法的贴合晶圆的制造方法中,即使在作为接合晶圆和基底晶圆的至少一方而使用外延晶圆的情况下,也能够通过利用单晶圆旋转清洗来进行该外延晶圆的形成外延层前的清洗,从而避免在外延晶圆上的贴合区域形成微小的凸状缺陷,其结果为,平台部不会在一部分的区域变宽,能够制造平台宽度较小的贴合晶圆,从而完成本发明。
以下,对本发明详细地进行说明,但本发明并不限定于此。
首先,准备接合晶圆和基底晶圆。在此,作为接合晶圆和基底晶圆的至少一方而准备外延晶圆。作为外延晶圆,例如可以使外延层在经过镜面研磨的单晶硅晶圆上成长。另外,即使对不进行外延成长的晶圆,也可适宜使用例如经过镜面研磨的单晶硅晶圆等。在本发明中,通过单晶圆旋转清洗来进行外延晶圆的形成外延层前的清洗(外延前清洗)。通过利用单晶圆旋转清洗来进行外延前清洗,能够使与晶圆支承工具的接触仅在不进行外延成长的区域,因此即使在清洗后的晶圆上进行外延成长,也能够避免微小的凸状缺陷向进行贴合的面成长。
单晶圆旋转清洗作为清洗半导体晶圆的方法之一而被公知,例如专利文献2所记载的那样,是一种通过进行至少具有一次以HF清洗、臭氧水清洗、HF清洗的顺序进行的清洗工序的清洗,而能够同时降低半导体晶圆表面上的金属杂质程度和微粒程度的清洗方法。但是,药液不限于该组合,可以根据目的而采用适当的成分。例如,也能够采用SC1清洗液(NH4OH与H2O2的混合水溶液)与SC2清洗液(HCl与H2O2的混合水溶液)的组合。
接着,作为任意的工序,在接合晶圆和基底晶圆的至少任意一方的表面形成绝缘膜。该绝缘膜的形成方法不特别限定,例如能够使用CVD(化学气相成长)法,在是氧化膜的情况下也能够使用热氧化法。在不形成绝缘膜而直接贴合接合晶圆与基底晶圆来制造贴合晶圆的情况下,不形成该绝缘膜。
接着,从接合晶圆的表面离子注入氢离子、稀有气体离子的至少一种气体离子从而在晶圆内部形成离子注入层。此时,为了能够获得期望膜厚的薄膜,而选择离子注入加速电压(加速能量)。
接着,直接或者隔着绝缘膜贴合接合晶圆的进行了离子注入的表面与基底晶圆的表面。贴合可以在室温下进行。
接着,通过在离子注入层使接合晶圆剥离,来制造在基底晶圆上具有薄膜的贴合晶圆。剥离时只要通过例如400~600℃程度的剥离热处理等公知的方法来进行剥离即可。另外,也可以通过在至少一方的贴合面上预先实施等离子处理,从而不施加热处理(或者施加了不会剥离程度的热处理后)而施加外力来进行剥离。
在本发明的贴合晶圆的制造方法中,既可以在外延前清洗中进行单晶圆旋转清洗,也可以包含上述以外的各种工序。例如,根据需要,既可以在贴合前进行清洗,也可以在剥离热处理后利用高温来进行提高贴合强度的结合热处理。
在本发明中,尤其可以使用外延晶圆作为基底晶圆。由此,能够适用于如上述所述那样近年来正在增加的、用沟槽等分离到SOI晶圆的埋入式绝缘膜层的基底并作为元器件结构的一部分使用的情况。
另外,在作为基底晶圆而使用外延晶圆的情况下,如果是本发明的贴合晶圆的制造方法,则能够做成外延晶圆,其是在基底晶圆上直接或者隔着绝缘膜贴合有薄膜的贴合晶圆,且基底晶圆具有外延层。在该贴合晶圆中,在基底晶圆的外周部上表面中作为未形成有薄膜的部分的平台部,能够不存在作为外延层的成长所引起的凸缺陷的外延缺陷。如果是这样的贴合晶圆,则即使在将外延晶圆作为基底晶圆使用的贴合晶圆中,也能够成为平台宽度较小的贴合晶圆。如果是这样的贴合晶圆,则有效面积较多,能够到外周附近都可用于元器件形成。
以下参照图1对本发明的贴合晶圆的制造方法更具体地进行说明。图1是表示本发明的贴合晶圆的制造方法一例的流程图,在该图中,示出了在接合晶圆上作为绝缘膜而形成氧化膜(贴合后,作为埋入式氧化膜(BOX)的氧化膜)来制造SOI晶圆的例子。另外,示出了仅使基底晶圆为外延晶圆的例子。
在图1的贴合晶圆的制造方法中,首先,如图1中的(a)所示,在接合晶圆的表面形成氧化膜作为绝缘膜(工序a)。该氧化膜是在贴合了接合晶圆与基底晶圆后作为埋入式氧化膜(BOX)的氧化膜。因此,该工序可以被称为“BOX氧化”。该氧化膜的形成方法如上述所述并未特别限定,可以使用热氧化法、CVD法等。
接着,如图1中的(b)所示,从在工序a中形成了氧化膜的接合晶圆的表面离子注入氢离子、稀有气体离子的至少一种气体离子,从而在晶圆内部形成离子注入层(工序b)。
与针对贴合前的接合晶圆的处理(工序a、b)不同,如下所述准备基底晶圆。
在基底晶圆上进行外延成长(工序d),但是在此之前,如图1中的(c)所示那样,进行清洗(外延前清洗、工序c)。在本发明中,通过单晶圆旋转清洗来进行该外延前清洗。如上所述,通过利用单晶圆旋转清洗来进行外延前清洗,能够使与晶圆支承工具的接触仅在不进行外延成长的区域,因此即使进行外延成长,也能够避免微小的凸状缺陷向进行贴合的面成长。
接着,如图1中的(d)所示,对进行了清洗的基底晶圆进行外延成长(外延成长、工序d)。
此外,工序a、b与工序c、d既可以某一方先进行,也可以平行进行。
接着,如图1中的(e)所示,隔着在接合晶圆上形成的氧化膜来贴合接合晶圆的进行了离子注入的表面与基底晶圆的表面(工序e)。在此,基底晶圆的进行贴合的表面是形成有外延层的面。
接着,如图1中的(f)所示,进行剥离热处理,并在离子注入层使接合晶圆剥离(工序f)。由此,能够制造在基底晶圆上具有埋入式氧化膜以及薄膜(SOI层)的贴合SOI晶圆。
最后,能够如图1中的(g)所示,观察所制造的贴合SOI晶圆的平台部,并评价贴合后的状态(工序g)。
此外,在专利文献3中,作为关联技术,记载了在进行了HF旋转清洗后进行外延成长的技术,但是,由于进行HF旋转清洗以及外延成长的对象是SOI晶圆本身,因此与本发明不同。
【实施例】
以下,使用实施例和比较例来具体地说明本发明,但本发明并不限定于这些实施例。
[实施例1]
根据图1记载的方法,制造了贴合晶圆。
首先,作为接合晶圆而准备了直径为300mm、面方位为(100)、导电型为p型、电阻率为10Ωcm的单晶硅晶圆。在该接合晶圆的表面,通过热氧化以200nm的厚度形成了作为埋入式氧化膜的氧化膜(BOX氧化、工序a)。接着,对该接合晶圆进行了离子注入。离子注入条件为:注入离子为H+离子,加速电压为48.7keV,剂量为7.5×1016/cm2。
接着,作为基底晶圆而如以下那样准备了外延晶圆。作为进行外延成长的成长用基板而准备了直径为300mm、面方位为(100)、导电型为n型、电阻率为10Ωcm的单晶硅晶圆。接着,对该成长用基板进行了单晶圆旋转清洗(工序c)。单晶圆旋转清洗按照(1)臭氧水清洗(10ppm、常温、15秒)、(2)HF水溶液清洗(1wt%、常温、15秒)重复了两次(即,(1)、(2)、(1)、(2))。
接着,使外延层在成长用基板上成长(工序d)。此时,作为原料气体而使用三氯硅烷,成长条件为:成长温度1100℃,膜厚3.5μm,导电型为n型(磷掺杂),电阻率为0.001Ωcm。这样,作为基底晶圆而准备了外延晶圆。
接着,贴合如上所述那样准备的接合晶圆与基底晶圆(工序e)。在贴合前清洗两晶圆,清洗后在室温下进行了贴合。
接着,通过剥离热处理在离子注入层将与基底晶圆为贴合状态的接合晶圆剥离(工序f)。剥离热处理的条件为500℃、30分钟、Ar气氛。
如以上那样制造了贴合SOI晶圆。作为该贴合SOI晶圆的评价,基于显微镜观察测量了平台宽度(工序g)。平台宽度沿着晶圆全周为1.7mm以下为合格。另外,在相同的条件下制造多个晶圆,并计算出了不合格率。将平台宽度不合格的贴合SOI晶圆的张数作为不合格张数,并根据与制造张数的比率来计算该不合格率。
[实施例2]
除了变更了外延前清洗的方法以外,与实施例1同样地进行了贴合SOI晶圆的制造。外延前清洗的清洗方法是单晶圆旋转清洗,这与实施例1相同,但是,将药液设置为SC1清洗(70℃、120秒)与SC2清洗(50℃、120秒)的组合。
[比较例]
除了变更了外延前清洗的方法以外,与实施例2同样地进行了贴合SOI晶圆的制造。外延前清洗的清洗方法为使用了晶圆载具的分批式清洗。在分批式清洗中使用的药液与实施例2相同,为SC1清洗(70℃、120秒)与SC2清洗(50℃、120秒)的组合。
实施例1、2、比较例的实施条件和评价结果在表1中汇总。
【表1】
不合格率=不合格张数/制造张数×100(%)
如表1所示,就在外延前清洗中使用了单晶圆旋转清洗的实施例1、2而言,不合格率分别是0.5%、1%,明显低于比较例,可获得本发明的效果。虽然比较例与实施例2的药液的组合相同,但是由于在外延前清洗中使用了分批式清洗而与实施例2相比不合格率较高。
此外,本发明并不限定于上述实施方式。上述实施方式仅是例示,具有与本发明的权利要求所记载的技术思想实质上相同的结构,并实现同样的作用效果的技术方案,均包含于本发明的技术范围内。
Claims (3)
1.一种贴合晶圆的制造方法,该方法是从接合晶圆的表面离子注入氢离子、稀有气体离子的至少一种气体离子并在晶圆内部形成离子注入层,直接或者隔着绝缘膜贴合所述接合晶圆的进行了离子注入的表面与基底晶圆的表面后,通过在所述离子注入层使接合晶圆剥离,从而来制造在所述基底晶圆上具有薄膜的贴合晶圆,其特征在于,
作为所述接合晶圆和所述基底晶圆的至少一方而使用外延晶圆,
并通过单晶圆旋转清洗来进行该外延晶圆的形成外延层前的清洗。
2.根据权利要求1所述的贴合晶圆的制造方法,其特征在于,
作为所述基底晶圆而使用所述外延晶圆。
3.一种贴合晶圆,其在基底晶圆上直接或者隔着绝缘膜贴合有薄膜,其特征在于,
所述基底晶圆是具有外延层的外延晶圆,
在所述基底晶圆的外周部上表面中作为未形成有所述薄膜的部分的平台部,不存在作为所述外延层的成长所引起的凸缺陷的外延缺陷。
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2017-060757 | 2017-03-27 | ||
JP2017060757A JP2018164006A (ja) | 2017-03-27 | 2017-03-27 | 貼り合わせウェーハの製造方法及び貼り合わせウェーハ |
Publications (1)
Publication Number | Publication Date |
---|---|
CN108666259A true CN108666259A (zh) | 2018-10-16 |
Family
ID=63582883
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
CN201810201351.7A Withdrawn CN108666259A (zh) | 2017-03-27 | 2018-03-12 | 贴合晶圆的制造方法以及贴合晶圆 |
Country Status (3)
Country | Link |
---|---|
US (1) | US20180277422A1 (zh) |
JP (1) | JP2018164006A (zh) |
CN (1) | CN108666259A (zh) |
Families Citing this family (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR20200134353A (ko) | 2019-05-21 | 2020-12-02 | 삼성전자주식회사 | 반도체 패키지의 검사방법 및 검사시스템, 및 이를 이용한 반도체 패키지의 제조방법 |
Family Cites Families (9)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP3319397B2 (ja) * | 1998-07-07 | 2002-08-26 | 信越半導体株式会社 | 半導体製造装置およびこれを用いたエピタキシャルウェーハの製造方法 |
US6534819B2 (en) * | 2000-08-30 | 2003-03-18 | Cornell Research Foundation, Inc. | Dense backplane cell for configurable logic |
JP2003204048A (ja) * | 2002-01-09 | 2003-07-18 | Shin Etsu Handotai Co Ltd | Soiウエーハの製造方法及びsoiウエーハ |
JP2004247609A (ja) * | 2003-02-14 | 2004-09-02 | Canon Inc | 基板の製造方法 |
US20070069335A1 (en) * | 2003-09-08 | 2007-03-29 | Akihiko Endo | Bonded wafer and its manufacturing method |
KR100753740B1 (ko) * | 2003-12-11 | 2007-08-31 | 가부시키가이샤 섬코 | 에피택셜 웨이퍼 및 그 제조 방법 |
US20080268617A1 (en) * | 2006-08-09 | 2008-10-30 | Applied Materials, Inc. | Methods for substrate surface cleaning suitable for fabricating silicon-on-insulator structures |
WO2010150547A1 (ja) * | 2009-06-26 | 2010-12-29 | 株式会社Sumco | シリコンウェーハの洗浄方法、およびその洗浄方法を用いたエピタキシャルウェーハの製造方法 |
JP6100200B2 (ja) * | 2014-04-24 | 2017-03-22 | 信越半導体株式会社 | 貼り合わせsoiウェーハの製造方法 |
-
2017
- 2017-03-27 JP JP2017060757A patent/JP2018164006A/ja active Pending
-
2018
- 2018-02-26 US US15/904,850 patent/US20180277422A1/en not_active Abandoned
- 2018-03-12 CN CN201810201351.7A patent/CN108666259A/zh not_active Withdrawn
Also Published As
Publication number | Publication date |
---|---|
JP2018164006A (ja) | 2018-10-18 |
US20180277422A1 (en) | 2018-09-27 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
EP3136420B1 (en) | Method for manufacturing bonded soi wafer | |
TWI310962B (zh) | ||
KR102312812B1 (ko) | 접합 soi 웨이퍼의 제조방법 | |
EP1883104B1 (en) | Method for manufacturing a bonded SOI wafer | |
US9824891B1 (en) | Method of manufacturing the thin film | |
EP2159826A1 (en) | Soi wafer manufacturing method | |
CN101960558B (zh) | 贴合晶片的制造方法 | |
KR101340002B1 (ko) | Soi웨이퍼의 제조방법 | |
KR20090081335A (ko) | 접합 웨이퍼의 제조 방법 | |
KR20180015634A (ko) | 접합 soi 웨이퍼의 제조방법 | |
JP2002184960A (ja) | Soiウェーハの製造方法及びsoiウェーハ | |
CN109075028B (zh) | 贴合式soi晶圆的制造方法 | |
CN108666259A (zh) | 贴合晶圆的制造方法以及贴合晶圆 | |
EP1965413B1 (en) | Method for manufacturing soi substrate | |
US8389382B2 (en) | Method for manufacturing bonded wafer | |
WO2019087517A1 (ja) | 薄膜soi層を有するsoiウェーハの製造方法 | |
US20120299156A1 (en) | Wafer processing method | |
JP2752371B2 (ja) | 半導体装置の製造方法 | |
KR101184380B1 (ko) | 에피택셜 웨이퍼 제조 방법, 이를 적용한 에피택셜 웨이퍼,및 반도체 소자 | |
US20040187769A1 (en) | Method of producing SOI wafer | |
JP2018137278A (ja) | 貼り合わせsoiウェーハの製造方法 | |
JP2019216222A (ja) | 貼り合わせsoiウェーハの製造方法及び貼り合わせsoiウェーハ | |
JPH0196923A (ja) | エピタキシャル成長方法 | |
JP2010040638A (ja) | Soi基板の製造方法 | |
CN110010445B (zh) | 键合晶片用支撑基板的制造方法和键合晶片的制造方法 |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
PB01 | Publication | ||
PB01 | Publication | ||
SE01 | Entry into force of request for substantive examination | ||
SE01 | Entry into force of request for substantive examination | ||
WW01 | Invention patent application withdrawn after publication | ||
WW01 | Invention patent application withdrawn after publication |
Application publication date: 20181016 |