JP3251042B2 - 高速撮影装置 - Google Patents
高速撮影装置Info
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- JP3251042B2 JP3251042B2 JP02974992A JP2974992A JP3251042B2 JP 3251042 B2 JP3251042 B2 JP 3251042B2 JP 02974992 A JP02974992 A JP 02974992A JP 2974992 A JP2974992 A JP 2974992A JP 3251042 B2 JP3251042 B2 JP 3251042B2
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Description
ビデオシステムに組み込まれる高速撮影装置に係り、特
に動画像を高速で撮影する高速撮影装置に関する。
には、動画像を高速度で撮影する高速撮影装置を組み込
んだものがある。この高速撮影装置は、動く物体の撮影
を行なう面撮像センサとして例えば固体撮像素子が用い
られ、この固体撮像素子は、撮影の最小単位である1フ
レーム分の静止画を順次連続させることにより動画像を
得るようになっている。
数の光電変換素子を二次元配列して撮像面を形成し、こ
の撮像面を形成した各光電変換素子を一定の走査方法で
順次走査してフレーム画像(静止画像)を得るようにな
っている。
(ピクセル)×横100画素(ピクセル)の光電変換素
子を二次元配列した場合、始めに縦方向一番目の行
(列)を横方向の走査ラインに沿って100画素分ライ
ン走査し、このライン走査が終了すると縦方向二番目の
行をライン走査し、以後このライン走査を順次行ない、
100番目の行のライン走査が完了すると1フレーム分
の撮像が完了したことになる。
ムのレートで撮影が行なわれるので、縦・横100画素
づつの光電変換素子を備えた固体撮像素子では1秒間に
3千回のライン走査が行なわれる。このライン走査によ
る出力信号はVTRや半導体メモリに一旦記録された後
に、受像CRTモニタで同じレートの走査が行なわれて
映像が再生表示される。
トで撮影し、通常のレートである毎秒30フレームで再
生すると、30フレーム/撮影レートの倍率で動体の動
きを低速化して見ることができる。この高速撮影は理工
学やスポーツの分野に応用され、様々な効果を発揮して
いる。
撮影する方法として、フレームの読出し周波数を高速に
したり、読み出す画素(ピクセル)数を少なくしたり、
あるいは二次元に配列された光電変換素子群(画素群)
を並列に読み出す方法がある。
して高速化を図る場合、光電変換素子群の全ラインを同
時に並列に読み出すことができれば、最も高速撮影が可
能になる。
二次元配列された光電変換素子群の並列ライン数が多く
なり、後段での信号処理量が多いため、信号処理上様々
な問題が新たに生じる。このため、並列読出しは、光電
変換素子群の素子数(画素数)が比較的少ない場合に限
り使用されている。
像センサが開発されている。
換素子群を複数列毎にブロック化し、各ブロックを1つ
のセンサとみなして各ブロックを並列にライン走査して
読み出すものである。
群を16のブロックB1〜B16に区画し、各ブロック
B1〜B16が16本の走査ラインで構成された面撮像
センサの例を示す。
より各ブロックB1〜B16の第1番目のラインを16
ライン並列に読み出し、この16ライン並列読出しが終
了すれば、走査ラインを第2番目、第3番目…と順次切
り換え、各ブロックB1〜B16の第16番目のライン
の並列読出しで1画面(1フレーム)分の走査が終了す
る。
B1〜B16に区画し、各ブロックB1〜B16を16
本のラインで構成したので、面撮像センサの全画面25
6ラインの読出しを16回の並列ライン走査で完了する
ので、全画面を1ラインずつ順次読み出す場合に比べ、
16倍のフレーム速度が得られ、高速化を図ることがで
きる。
を備えた高速撮影装置においては、面撮像センサの全画
面を高速に読み出すことで高速撮影を行なうことができ
るが、面撮像センサのセンサ画面を部分読出しする場合
にも、全画面走査と同様に16回の並列ライン走査を行
なう必要がある。このため、必要(有効)読出し画素数
(ピクセル数)が減少しても、減少分に応じて撮影速度
を高速化させることは困難であった。
素数を減少させ、例えば1ラインの画素数の1/2や1
/4を必要読出し画素数としても、各必要画素の読出し
にライン走査回数は固定であるため、必要読出し画素数
が少なくなっても、少ない画素数に比例して高速化を図
ることができない。
査位置の切換中は、映像信号を出さない無効時間となる
が、この無効時間が面撮像センサの全画面読出し時と部
分読出し時で同じ値となる。このため、部分読出し時に
おける無効時間の比率が全画面読出し時に比べて大きく
なり、読出し画素を減少させた効果が少なく、これは特
に部分読出し画素数が全画面読出し画素数に対し少なく
なるほど効果が少なくなる。
される高速撮影においては、画素数、並列ブロックやラ
イン数が異なる種々のタイプの固体撮像装置が個々に必
要になり、この固体撮影装置に対応して後段の信号処理
装置もそれぞれ必要となり、コスト増を招いている。
もので、動画像を高速撮影するとともに高速撮影しても
高画質の画像が得られ、かつ全画面読出しと部分(画
面)読出しで異なるフレーム速度が得られる高速撮影装
置を提供することを目的としている。
読出し時にブロックを構成するライン走査数を減少させ
てより一層の高速化を図った高速撮影装置を提供するこ
とにある。
置は、上述した課題を解決するために、請求項1に記載
したように多数の光電変換素子を二次元配列して面撮像
センサを構成し、この面撮像センサの光電変換素子群を
複数列毎にブロック化して複数のブロックに区画し、各
ブロックの光電変換素子列をライン走査してビデオ信号
を出力する高速撮影装置において、前記面撮像センサの
1/N(Nは2以上の整数)の選択対象領域をライン走
査する際、上記選択対象領域のブロックをそれぞれN個
ずつの小ブロックに区分けする一方、各小ブロック共通
番目の光電変換素子列のラインを選択して並列にライン
走査させる走査手段を設け、この走査手段をドライブさ
せる駆動回路を設けたものである。
発明に係る高速撮影装置は、請求項2に記載したよう
に、走査手段は、垂直走査回路と水平走査回路とからな
り、上記垂直走査回路および水平走査回路は各ブロック
あるいは各小ブロックの共通番目の光電変換素子列を選
択して並列にライン走査させ、かつ選択する走査ライン
を逐次切り換えるように設定したり、また、請求項3に
記載したように、走査手段は、各ブロックの光電変換素
子群の共通位置のラインを選択し、ラインの途中の予め
決められた位置からライン走査開始を可能に設定したも
のである。
の構成を変更させる一方、このブロックの構成の変更に
伴って読み出すライン数を変更させ、かつ部分読出し時
にも全画面読出し時と同じ並列ライン数で出力させるこ
とができるから、1種類の装置で異なるフレーム速度の
画像が得られる。また、部分画面読出し時には全ての出
力が有効映像信号となるので、動画像を効率的に高速撮
影することができ、高速撮影しても高画質の画像が得ら
れる。また、部分画面読出し時にも全画面読出し時と同
じ並列ライン数で出力され、かつ全ての出力が有効映像
信号であるから、後段側の信号処理装置は、全画面読出
しと部分読出しで区別する必要がなく、同じ形式のもの
を共用化することができる。
面読出しも部分画面読出しも、各ブロックの共通番目の
光電変換素子列ラインを選択して並列にライン走査され
るので、全体のアウトライン画像は1本あるいは少ない
並列ライン走査で得られ、一層高速化が図れる。
例について添付図面を参照して説明する。
デオシステムに適用した例を示す機能ブロック図であ
り、この高速ビデオシステムは動く物体を高速度で撮影
可能な撮影カメラ1を有する。この撮影カメラ1は、対
物光学系2を介して動く物体を撮影する面撮像センサ3
やこの面撮像センサ3からの出力ビデオ信号を増幅させ
る増幅器群4、面撮像センサ3の駆動回路5を内蔵して
いる。
グビデオ信号が増幅器群4で増幅されて出力されるよう
になっており、出力されたアナログビデオ信号はA/D
変換器6によりディジタルビデオ信号に変換されて画像
記録メモリ7に連続的に入力される。画像記録メモリ7
は、16チャンネルのデジタルビデオ信号を連続的に入
力して画像デジタルデータとして記憶される。
ルデータはフレームメモリ8に1画面のデータとして再
構成されて書き込まれ、このフレームメモリ8により時
系列的に読み出され、撮像時の速度より低速の連続画像
としてフレーム画像を再生する。このフレーム画像のデ
ィジタルデータ信号はD/A変換器9によりアナログデ
ータ信号に変換されて映像モニタ10に入力され、この
映像モニタ10で画像表示される。
の作動コントロールや細部の動作コントロールはマイコ
ンやCPU等のコントロール部11で行なわれる。この
コントロール部11には図示しない動作センサからのセ
ンサ信号が入力され、このセンサ信号を入力してコント
ロール部11はシステム全体の制御の他に撮影カメラ1
に内蔵された面撮像センサ3のブロック選択制御、画像
記録メモリ7を読み出しフレームメモリ8に再構築させ
る制御等を行なう。符号13はブロック選択アドレス発
生回路であり、このアドレス発生回路13で後述する出
力ブロックを選択するようになっている。
機能は、面撮像センサ3側に持たせることもできる。こ
の場合、動作センサは不要となる。また、面センサに代
えて2組以上のラインセンサを組み合せてもよい。
なデータを書き込む書き込みアドレス発生回路であり、
このアドレス発生回路14で画像記録メモリ7への書き
込みアドレスを高速で発生させるようになっている。な
お、画像記録メモリ7からの画像デジタルデータの読み
出しは比較的低速であり、また、読み出し順が一定では
ないので、前述したようにCPU等のコントロール部1
1が読み出しアドレスを発生させている。
センサ3は画像の蓄積や読出し可能な固体撮像素子16
からなり、この固体撮像素子16は駆動回路5からのド
ライブ信号により駆動され、読出しが開始される。駆動
回路5は例えば25MHz のクロック17からのクロック
パルスにより駆動される。
うにMOS型半導体素子からなるフォトダイオード等の
光電変換素子を多数二次元配列して構成される撮像面
(受光面)20と、光電変換素子群をライン走査させる
走査手段21と、この走査手段21をドライブさせる駆
動回路5と、撮像面20の走査により多チャンネルアナ
ログビデオ信号S1 〜S16を選択して出力する出力選択
回路22とを有する。また、走査手段21は垂直行ブロ
ック選択シフトレジスタを構成する第1の走査回路とし
ての垂直走査回路24と水平列ブロック選択シフトレジ
スタおよび列シフトレジスタを構成する第2の走査回路
としての水平走査回路25とを有し、さらに、垂直走査
回路24は面撮像センサ3の選択対象領域20aを効率
的に選択して走査させるために、図2において上部およ
び下部領域の第1の垂直走査回路26a,26bと中央
領域の第2の垂直走査回路27とに区画される。
ように、画素(ピクセル)を構成する光電変換素子30
を例えば266個の水平列R1 ,R2 …R266 と256
個の垂直行C1 ,C2 …C256 に二次元配列してフォー
マット化された撮像面20を形成する一方、撮像面20
は縦列方向に沿って例えば16のブロックB1 ,B2…
B16に区分される。
の水平方向に複数行、例えば16行の光電変換素子列が
形成され、各光電変換素子列により16本(16行)の
走査線(ライン)が各ブロックB1 〜B16毎に構成され
る。ブロックB1 ,B2 …B16の各共通番目の走査線は
垂直および水平走査回路24,25により並列にライン
走査されて読み出され、出力選択回路22から多チャン
ネル、16本のアナログビデオ信号S1 ,S2 …S16が
出力されるようになっている。
子16の第1回目の読出しは、ブロックB1 〜B16の各
第1番目のラインから同時に並列に16本ライン走査さ
れ、以後図4に示すように、第2番目、第3番目、…第
16番目のラインがライン走査により順次読み出され、
第16番目のラインのライン走査の完了により1フレー
ム分(1画面分)の全画面読出しが終了するようになっ
ている。
平方向の光電変換素子数が垂直方向の光電変換素子数よ
り10個程多いのは、ノイズに対する余裕度を持たせた
ためである。
にも図2に示すように例えば5つのライン走査開始点H
1 (第1画素)、H2 (第65画素)、H3 (第97画
素)、H4 (第129画素)、H5 (第193画素)を
有する。
回路25に入力される水平クロックパルスHC1 ,HC
2 は、水平方向の266個の光電変換素子30のある画
素を読み出すとき、1画素ずつ読み出すタイミングとし
て使われる。この水平クロックパルスHC1 ,HC2 は
水平シフトレジスタ同期パルスH1 ,H2 ,…H4 ,H
5 のいずれかにより水平方向の読出しが開始されたと
き、この開始時点からHC1 ,HC2 のクロックパルス
で画素の読出しが行なわれる。このクロックパルスHC
1 ,HC2 は各々例えば12.5MHz で180゜位相が
異なっており、水平走査速度は25MHz となる。
説明する。
カメラ1のカメラ操作により、カメラの対物光学系(レ
ンズ系)2を通して面撮像センサ3に被写体が結像され
る一方、対物光学系とは別系統の図示しないレンズを通
して同じ被写体が図示しない動作センサにも結像され
る。
ンサ信号としてCPU等のコントロール部11に出力す
る。コントロール部11はこのセンサ信号を解析し、面
撮像センサ3の選択すべきブロックと選択されたブロッ
ク読出し順、および切替タイミングを算出し、ブロック
選択アドレス発生回路13に指示する。
述する駆動回路5を介して面撮像センサ3が出力すべき
ブロックを次々に選択し、指示する。ブロック選択アド
レス発生回路13が駆動回路を兼ねるようにしてもよ
い。
ロックB1 〜B16の共通番目の光電変換素子列ラインが
走査手段21により選択され、選択された16本のライ
ンは並列に同時にライン走査される。
アナログビデオ信号は、各A/D変換器6によりデジタ
ルビデオ信号に変換される。このビデオ信号は画像記録
メモリ7に順次記録されるが、その記録場所はCPU等
のコントロール部11により制御される画像メモリ−書
き込みアドレス発生回路14で指定される。画像記録メ
モリ7は一部リセットしてから記録することができる
が、前画面の一部の記録を一部変更することもできる。
前画面の一部変更は、画像記録メモリ7にストアされた
静止状態の画像の一部だけを、撮影カメラ1から出力さ
れる画像変化が生じたブロック画像と置換させるもの
で、置換されたブロック画像以外は前画面の画像が採用
されて1つのフレーム画像が構成される。
ック画像であるので、画像再生時には、コントロール部
11からの指示によりフレーム画像となるような順序で
ブロック画像データをフレームメモリ8に転送する。再
生画像信号はD/A変換器9でアナログビデオ信号に変
換されて映像(デレビ)モニタ10に表示される。
子16の撮像面20に記録された画像の読出しについて
説明する。
全面走査する場合、図2に示すように、クロック17で
駆動される駆動回路5からのドライブ信号として垂直リ
セットパルスVRと垂直シフトレジスタクロックパルス
VCが垂直走査回路24に送られ、この垂直走査回路2
4を駆動させる。垂直走査回路24は垂直リセットパル
スVRによりリセットされ、垂直シフトレジスタクロッ
クパルスVCにより各ブロックB1 〜B16の共通番目の
ライン(第1番目のライン)Y1 ,Y17,Y33,Y49,
Y65,Y81,Y97,Y113 ,Y129 ,Y145 ,Y161 ,
Y177 ,Y193,Y209 ,Y225 ,Y241 を選択し、各
ブロックB1 〜B16の第1番目のラインの画像走査動作
を可能にする。
水平リセットパルスHRと水平シフトレジスタ同期パル
スH1 (第1画素スタート)が送られ、水平走査回路2
5が駆動される。水平走査回路25は水平リセットパル
スHRによりセットされ、水平シフトレジスタ同期パル
スH1 により第1画素R1から順次走査が開始される。
0に記録された画像は選択された第各ブロックB1 〜B
16の第1番目のラインの第1画素R1 から、16本
(行)の走査線に沿って並列に同時走査され、この並列
ライン走査により得られたアナログビデオ信号S1 ,S
2 …S16は出力選択回路22から出力される。
設けられており、256画素を水平走査した時点で水平
リセットパルスHRを水平走査回路25に送って水平走
査を一旦終了し、次に垂直シフトレジスタクロックパル
スVCを垂直走査回路24に送り、各ブロックB1 〜B
16の第1番目のラインの動作可能を終了して、垂直行方
向にスキップさせ、各ブロックB1 〜B16の第2番目の
ラインY2 ,Y18,Y34,Y50,Y66,Y82,Y98,Y
114 ,Y130 ,Y146 ,Y162 ,Y178 ,Y194 ,Y
210 ,Y226 ,Y242 を選択し、この第2番目のライン
の動作を可能とする。
に第1画素スタート用の水平シフトレジスタ同期パルス
H1 を送って各ブロックB1 〜B16の第2番目のライン
の読出しを開始する。
ロックのn番目のラインの読出しを次々と行なう。各ブ
ロックB1 〜B16の最終(第16番目の)ラインの読出
し終了後に駆動回路5から垂直リセットパルスVR、垂
直シフトレジスタクロックパルスVCを垂直走査回路2
1に送り、1フレームの動作が終了し、次の撮像面20
の画像処理のために、各ブロックB1 〜B16の第1番目
のラインが再び選択され、動作が可能となる。
動作可能な各ブロックB1 〜B16にそれぞれ対応した1
6本の走査線分のアナログビデオ信号S1 ,S2 …S16
をA/Dコンバータ6に同時に出力するようになってい
る。動作可能となっていない各ブロックB1 〜B16の非
選択ラインは、画像走査の影響を受けず、入射光に対応
して電荷を蓄積している。
撮像エリアである選択対象領域20aを選択して走査
(画像処理)する場合を説明する。
形部分(撮像面20の1/2の選択対象領域20a)を
読み出す場合を例にとる。
で駆動される駆動回路5から垂直走査回路24に垂直走
査選択回路VSを出力し、垂直走査回路24を選択し、
第1垂直走査回路26a,26bの走査を停止させる一
方、中央領域の第2垂直走査回路27のみを動作させ
る。
る固体撮像素子16の各ブロックB5 〜B12は、図5に
示すようにそれぞれ2つの小ブロックB5A,B5B〜B
12A,B12B に区画され、各ブロックを構成するライン
数を変更させている。
1/2を選択対象領域20aとして選択した部分読出し
の場合を示すが、撮像面20の1/N(但し、Nは2以
上の整数)を選択対象領域として選択した場合には、選
択された各ブロックをN個の小ブロックに区画すればよ
い。この場合には、ブロックを構成するライン数は1/
Nに減少する。例えば撮像面20全体の1/4を読み出
す場合は、各ブロックを4つの小ブロックに区分けし、
各小ブロックを構成するライン数を4本とすればよい。
においては、選択対象領域20aのブロックB5 〜B12
をそれぞれ2つの小ブロックB5A,B5B〜B12A ,B
12B に分けたので、選択対象領域20aの小ブロック数
は全画面読出し時の全体のブロック数を等しく、各小ブ
ロックB5A,B5B〜B12A ,B12B のライン走査回数を
全画面読出しの16回から8回に半減させることができ
る。
〜B12をそれぞれ2つの小ブロックB5A,B5B〜
B12A ,B12B に分けてブロックの構成を変更させたの
で、部分画面読出し時にも全画面読出し時と同じ並列ラ
イン数が得られ、読出しライン数を変えることなく出力
選択回路22から16本のアナログビデオ信号を出力さ
せることができる。
ように、3種類のセレクタ31,32,33を組み合せ
て構成すればよい。各セレクタ31〜33は垂直走査回
路24からの走査ライン選択信号により駆動制御され
る。各セレクタ31〜33のうちAセレクタ31は「1
6 to 1」セレクタで16本の出力から1本が選択さ
れ、Bセレクタ32は「2 to 1」セレクタ、Cセレク
タ33は「8 to 1」セレクタである。
域20bを部分読出しする場合には、駆動回路5から出
力される垂直走査選択信号VSにより第1垂直走査回路
26a,26bの走査を停止し、第2垂直走査回路27
のみ動作させる。
出力される垂直走査リセット信号VRによりリセットさ
れ、垂直クロックパルスVCにより小ブロックB5A,B
5B〜B12A ,B12B の各第1番目のラインY65,Y73,
Y81,Y89,Y97,Y105 ,Y113 ,Y121 ,Y129 ,
Y137 ,Y145 ,Y153 ,Y161 ,Y169 ,Y177 ,Y
185 が選択される。
ット信号HRによりリセットされ、水平開始位置選択信
号H1 ,H2 ,H3 ,H4 ,H5 により選択された走査
開始位置により、水平クロックパルスHC1 ,HC2 に
よって走査される。駆動回路5の水平カウンタにより予
め設定された数の水平クロックパルスがカウントされる
と、水平走査リセット信号HRが出力されて水平方向が
リセットされる一方、垂直クロックパルスVCが第2垂
直走査回路27に出力され、第2垂直走査回路27は、
選択ラインを切り換えて小ブロックB5A,B5B〜
B12A ,B12B の各第2番目のラインY66,Y74,
Y82,Y90,Y98,Y106 ,Y114 ,Y122 ,Y130 ,
Y138 ,Y146 ,Y154 ,Y162 ,Y170 ,Y178 ,Y
186 が選択される。そして、水平走査回路25が同様に
動作して小ブロックの各第2番目のライン走査が行なわ
れる。
のライン走査が終了すると、以後同様の動作が順次繰り
返される。最終の第8番目の選択ラインのライン走査が
終了すると、駆動回路5の垂直カウンタにより垂直走査
リセット信号VRが出力され、次のフレーム画像のため
の読出し準備に入る。
スVCを連続して与えることで、垂直走査をスキップし
て読み出すことができる。例えば、垂直クロックパルス
VCを2パルス連続して与えれば、読出し速度が2倍で
荒く読み出すことができる。
各共通番目のラインをライン走査させた出力信号は出力
選択回路22を経て多チャンネル16本のアナログビデ
オ信号として出力端子S1 〜S16から出力される。
択された各ブロック(あるいは各小ブロック)の共通選
択ラインからの出力を出力端子S1 〜S16から出力させ
る回路である。出力選択回路22でのライン選択は、垂
直走査回路24から出力される走査ライン選択信号によ
り作動制御されるセレクタ31,32,33の切換によ
り行なわれる。
に、1つの出力端子より1つの所定のブロックあるいは
小ブロックのラインを出力する構成、例えば、出力端子
S1から全画面読出し時にブロックB1 の16ライン
を、部分画面読出し時には小ブロックB5Aの8ラインの
アナログビデオ信号を出力するようになっている。
や部分読出し時に、垂直走査回路24に出力される垂直
クロックパルスVCにより、各ブロックのラインは図7
(A)に示すように1本が選択され、選択されたライン
が水平走査回路25で1画素(ピクセル)30ずつ順次
選択されてライン走査されるが、駆動回路5から垂直走
査回路24に出力されるライン選択信号(垂直クロック
パルスに相当する信号)により、複数のライン、例えば
図7(B)に示すように2本のラインを同時に選択し、
選択された2本のラインの画素30を水平走査回路24
で交互に選択し、水平走査を順次行なうことにより、複
数のラインを1つの出力端子から出力されるようにして
もよい。
て、水平走査回路25により水平開始位置選択信号
H1 ,H2 ,H3 ,H4 ,H5 を適宜選択することによ
り、ラインの読出し開始位置が適宜選定され、図8に示
すように種々の部分読出しが可能になる。例えば、水平
開始位置選択信号H4 を選択することにより、各ブロッ
クB1 〜B16のラインの途中1/2の位置から読み出す
ことができ、また、H5 の選択により他の位置から読み
出しを開始することができる。ラインの読出し画素数は
水平カウンタでカウントされるので、このカウントによ
りラインの読出し終端位置を定めることができる。
と、図5に示す部分読出しとを組み合せることにより、
固体撮像素子16の局所読出しをより高速で行なうこと
も可能となる。
合、以下の性能を確認できた。
ダイオードで左右に2分し左右方向に32ライン読み出
すことも可能である。
られる出力選択回路22Aの他の例を示すものである。
レクタ31,32,33の存在により、出力選択回路2
2内の信号パスが種々異なり、各ブロックの256本の
ラインからの出力負荷が一様でない。各ラインカからの
出力負荷が一様でないことによりアナログビデオ信号の
出力に不都合が生じるおそれがある。
各ラインからの出力負荷を等しくした出力選択回路22
Aを提供するものである。
像素子16を16ライン、4ブロックB1 〜B4 に分割
し、4出力の構成例を原理的に示している。
クタ35は「4 to 1」のセレクタだけである。また、
図10において、数字1,2,3,4は全画面読出し時
の走査回数を示し、出力端子S1 〜S4 のいずれかによ
り出力されることを示している。丸印の数字,は部
分画面読出し時の走査回数をそれぞれ示している。
第1回目のライン走査で各ブロックB1 〜B4 の第1番
目のライン(ライン番号1,5,9,13)が出力端子
S1〜S4 より出力される。以下、ライン番号はNo.
を付して表わす。
からブロックB4 のNo.14ラインが、出力端子S2
からブロックB1 のNo.2ラインが、出力端子S3 か
らはブロックB2 のNo.6ラインが、出力端子S4 か
らブロックB3 のNo.10ラインがそれぞれ出力され
る。
りブロックB3 のNo.11ラインが、S2 よりブロッ
クB4 のNo.15ラインが、S3 よりブロックB1 の
No.3ラインが、S4 よりブロックB2 のNo.7ラ
インがそれぞれ出力される。
りブロックB2 のNo.8ラインが、S2 よりブロック
B3 のNo.12ラインが、S3 よりブロックB4 のN
o.6ラインが、S4 よりブロックB1 のNo.4ライ
ンがそれぞれ出力され、1フレーム分のライン走査が終
了し、次のフレームのライン走査に備えられる。
B3 を選択した選択対象領域の読出しでは、各ブロック
B2 ,B3 はそれぞれ2つの小ブロックに分けられる。
よりNo.11ラインが、S2 よりNo.5ラインが、
S3 よりNo.9ラインが、S4 よりNo.7ラインが
それぞれ出力される。
o.8ラインが、S2 よりNo.12ラインが、S3 よ
りNo.6ラインが、S4 よりNo.10ラインがそれ
ぞれ出力され、2回のライン走査でNo.5〜No.1
2の8ラインが出力される。
採用すると、各ラインからの出力負荷は等しくなり、各
出力端子S1 〜S4 より出力されるラインは連続しな
い、ディジタル化して画像記録メモリ7に記録されるた
め、再構成には問題がない。
子が縦256個×横266個の光電変換素子を二次元配
列した例を代表的に示したが、二次元配列の素子数はこ
れに限定されない。また、固体撮像素子の撮像面を16
の横方向ブロックに区画した例を示したが、ブロックの
方向や数もこれに限定されない。
ブロックに組み込まれる光電変換素子群を水平列方向に
読出し走査させる例を示したが、垂直列方向に読出し走
査させるようにしてもよい。
影装置においては、面撮像センサの1/N(Nは2以上
の整数)の選択対象領域をライン走査する際、上記選択
対象領域のブロックをそれぞれN個ずつの小ブロックに
区分けする一方、各小ブロック共通番目の光電変換素子
列のラインを選択して並列にライン走査させる走査手段
を設け、この走査手段をドライブさせる駆動回路を設け
たので、部分画面読出し時にブロックの構成を変更させ
る一方、このブロックの構成の変更に伴って読み出すラ
イン数を変更させ、かつ部分読出し時にも全画面読出し
時と同じ並列ライン数で出力させることができるから、
1種類の高速撮影装置で異なるフレーム速度の画像がえ
られ、かつ部分(画面)読出し時には全ての出力が有効
映像(ビデオ)信号となり、動画像を効率よく高速撮影
することができ、高速撮影しても高画質の画像が得られ
る。
同じ並列ライン数で出力され、かつ全ての出力が有効映
像信号であるから、後段側の信号処理装置は全画面読出
しと部分画面読出しで区別する必要がなく同じ形式のも
のを共用化できる。
しも部分画面読出しも、各ブロックの共通番目の光電変
換素子列ラインを選択して並列にライン走査されるの
で、全体のアウトライン画像は1本あるいは少ない並列
ライン走査で得られ、一層高速化が図れる。
ムとして適用した例を示す機能ブロック図。
図。
ンサにおける光電変換素子の配置例を示す図。
向16ラインの光電変換素子列の読出し例を示す図。
択対象領域の読出し例を示す図。
る図。
査手段による通常の読出し例を示す図、(B)は走査手
段により2ラインを交互に選択して読み出す例を示す
図。
しを行なう他の例を示す図。
示す図。
図。
Claims (5)
- 【請求項1】 多数の光電変換素子を二次元配列して面
撮像センサを構成し、この面撮像センサの光電変換素子
群を複数列毎にブロック化して複数のブロックに区画
し、各ブロックの光電変換素子列をライン走査してビデ
オ信号を出力する高速撮影装置において、前記面撮像セ
ンサの1/N(Nは2以上の整数)の選択対象領域をラ
イン走査する際、上記選択対象領域のブロックをそれぞ
れN個ずつの小ブロックに区分けする一方、各小ブロッ
ク共通番目の光電変換素子列のラインを選択して並列に
ライン走査させる走査手段を設け、この走査手段をドラ
イブさせる駆動回路を設けたことを特徴とする高速撮影
装置。 - 【請求項2】 走査手段は、垂直走査回路と水平走査回
路とからなり、上記垂直走査回路および水平走査回路は
各ブロックあるいは各小ブロックの共通番目の光電変換
素子列を選択して並列にライン走査させ、かつ選択する
走査ラインを逐次切り換えるように設定した請求項1記
載の高速撮影装置。 - 【請求項3】 走査手段は、各ブロックの光電変換素子
群の共通位置のラインを選択し、ラインの途中の予め決
められた位置からライン走査開始を可能に設定した請求
項1または2記載の高速撮影装置。 - 【請求項4】 走査手段は、各ブロックの光電変換素子
群の複数のラインを選択し、選択された複数のラインを
跨ぐように交互に走査させた請求項1または2記載の高
速撮影装置。 - 【請求項5】 走査手段によりライン走査される各ブロ
ックの光電変換素子群を並列に列方向に読み出す出力選
択回路を設け、この出力選択回路から各走査ラインの映
像信号を出力するようにした請求項1または2記載の高
速撮影装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP02974992A JP3251042B2 (ja) | 1992-02-17 | 1992-02-17 | 高速撮影装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP02974992A JP3251042B2 (ja) | 1992-02-17 | 1992-02-17 | 高速撮影装置 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH05236364A JPH05236364A (ja) | 1993-09-10 |
JP3251042B2 true JP3251042B2 (ja) | 2002-01-28 |
Family
ID=12284746
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP02974992A Expired - Lifetime JP3251042B2 (ja) | 1992-02-17 | 1992-02-17 | 高速撮影装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP3251042B2 (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
WO2006082895A1 (ja) | 2005-02-03 | 2006-08-10 | Hamamatsu Photonics K.K. | 固体撮像装置 |
Families Citing this family (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2006295850A (ja) * | 2005-04-14 | 2006-10-26 | Sony Corp | 画像処理システム,撮像装置,撮像方法,画像再生装置および画像再生方法 |
JP2010219597A (ja) * | 2009-03-13 | 2010-09-30 | Omron Corp | 固体撮像装置 |
JP4657379B1 (ja) * | 2010-09-01 | 2011-03-23 | 株式会社ナックイメージテクノロジー | 高速度ビデオカメラ |
-
1992
- 1992-02-17 JP JP02974992A patent/JP3251042B2/ja not_active Expired - Lifetime
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
WO2006082895A1 (ja) | 2005-02-03 | 2006-08-10 | Hamamatsu Photonics K.K. | 固体撮像装置 |
US8125552B2 (en) | 2005-02-03 | 2012-02-28 | Hamamatsu Photonics K.K. | Solid-state image pickup device with adjustable image readout area |
Also Published As
Publication number | Publication date |
---|---|
JPH05236364A (ja) | 1993-09-10 |
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