JP3243687B2 - 活線挿抜システム - Google Patents
活線挿抜システムInfo
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- JP3243687B2 JP3243687B2 JP28203596A JP28203596A JP3243687B2 JP 3243687 B2 JP3243687 B2 JP 3243687B2 JP 28203596 A JP28203596 A JP 28203596A JP 28203596 A JP28203596 A JP 28203596A JP 3243687 B2 JP3243687 B2 JP 3243687B2
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Description
【０００１】
【発明の属する技術分野】本発明は情報処理装置の活線
挿抜システムに関し、特に接続されたボード等の物理構
成を認識しながら処理を行う情報処理装置の活線挿抜方
式に関する。
挿抜システムに関し、特に接続されたボード等の物理構
成を認識しながら処理を行う情報処理装置の活線挿抜方
式に関する。
【０００２】
【従来の技術】従来、この種の情報処理装置において
は、ボード上に搭載された演算処理装置、入出力処理装
置、メモリ、診断装置、周辺装置等によって構成され、
オぺレーティングシステムによってプログラムを監視す
るとともに、各プログラムの入出力機能の制御やスケジ
ュール管理等を行うことで各種処理を行っている。
は、ボード上に搭載された演算処理装置、入出力処理装
置、メモリ、診断装置、周辺装置等によって構成され、
オぺレーティングシステムによってプログラムを監視す
るとともに、各プログラムの入出力機能の制御やスケジ
ュール管理等を行うことで各種処理を行っている。
【０００３】上記のボードの活線挿抜の方法としては、
バス結合状態のパッケージの活線挿抜用のスイッチの位
置情報から中央演算処理装置に割込みを出力する手段
や、またスイッチの位置情報を基にアドレスバスとデー
タバスとをフローティング状態にする手段を含む方法が
ある。
バス結合状態のパッケージの活線挿抜用のスイッチの位
置情報から中央演算処理装置に割込みを出力する手段
や、またスイッチの位置情報を基にアドレスバスとデー
タバスとをフローティング状態にする手段を含む方法が
ある。
【０００４】この方法ではパッケージの活線挿抜時に、
扱者が活線挿抜用スイッチを切替えることで割込み発生
回路から中央演算処理装置に割込みが発生し、ＲＯＭ
（リードオンリメモリ）に書込まれた割込み処理プログ
ラムによって活線挿抜用スイッチ位置検出回路のステー
タスが読込まれる。
扱者が活線挿抜用スイッチを切替えることで割込み発生
回路から中央演算処理装置に割込みが発生し、ＲＯＭ
（リードオンリメモリ）に書込まれた割込み処理プログ
ラムによって活線挿抜用スイッチ位置検出回路のステー
タスが読込まれる。
【０００５】このとき、そのステータスで活線挿抜用の
スイッチの位置を知り、パッケージのＲＡＭ（ランダム
アクセスメモリ）へのアクセス及び入出力アクセスを停
止することによって、容易にパッケージの活線挿抜を行
うことができる。この活線挿抜方式については、特開平
１−２６３８１０号公報に開示されている。
スイッチの位置を知り、パッケージのＲＡＭ（ランダム
アクセスメモリ）へのアクセス及び入出力アクセスを停
止することによって、容易にパッケージの活線挿抜を行
うことができる。この活線挿抜方式については、特開平
１−２６３８１０号公報に開示されている。
【０００６】
【発明が解決しようとする課題】上述した従来の活線挿
抜機能を有した情報処理装置では、ボードを活線状態で
交換することが可能であるが、ボードの初期不良や挿抜
による故障を検出することができない。よって、挿抜時
のノイズがシステム全体に対する障害を起こすことはな
いが、障害のあるボードを活線挿抜した場合、ボードの
チェック機能がないためにシステム全体に障害をもたら
す可能性がある。
抜機能を有した情報処理装置では、ボードを活線状態で
交換することが可能であるが、ボードの初期不良や挿抜
による故障を検出することができない。よって、挿抜時
のノイズがシステム全体に対する障害を起こすことはな
いが、障害のあるボードを活線挿抜した場合、ボードの
チェック機能がないためにシステム全体に障害をもたら
す可能性がある。
【０００７】そこで、本発明の目的は上記の問題点を解
消し、ボードの初期不良や挿抜による故障で生ずる障害
のシステム全体への伝搬を防止することができる活線挿
抜システムを提供することにある。
消し、ボードの初期不良や挿抜による故障で生ずる障害
のシステム全体への伝搬を防止することができる活線挿
抜システムを提供することにある。
【０００８】
【課題を解決するための手段】本発明による活線挿抜シ
ステムは、電子回路が搭載されたボードの活線挿抜の際
に前記ボードと他の回路とが共通に接続される共通バス
を使用不能状態として前記共通バスを保護する初期化バ
ス保護回路を含む情報処理装置の活線挿抜システムであ
って、前記初期化バス保護回路による前記共通バスの保
護を解除するときに前記ボードが前記共通バスに活線状
態で接続された旨を通知する通知手段と、前記通知手段
による通知に応答して前記ボードの診断を行う診断手段
と、前記診断手段による前記ボードの診断時に前記ボー
ドのエラーデータを他の回路に伝搬するのを防止する抑
止手段とを備えている。
ステムは、電子回路が搭載されたボードの活線挿抜の際
に前記ボードと他の回路とが共通に接続される共通バス
を使用不能状態として前記共通バスを保護する初期化バ
ス保護回路を含む情報処理装置の活線挿抜システムであ
って、前記初期化バス保護回路による前記共通バスの保
護を解除するときに前記ボードが前記共通バスに活線状
態で接続された旨を通知する通知手段と、前記通知手段
による通知に応答して前記ボードの診断を行う診断手段
と、前記診断手段による前記ボードの診断時に前記ボー
ドのエラーデータを他の回路に伝搬するのを防止する抑
止手段とを備えている。
【０００９】本発明による他の活線挿抜システムは、電
子回路が搭載されたボードの活線挿抜の際に前記ボード
と他の回路とが共通に接続される共通バスを使用不能状
態として前記共通バスを保護する初期化バス保護回路を
含む情報処理装置の活線挿抜システムであって、前記ボ
ードは、制御回路を介して共通バスに接続されると共
に、前記初期化バス保護回路による前記共通バスの保護
を解除するときに前記ボードが前記共通バスに活線状態
で接続された旨を通知する通知手段を有し、前記制御回
路は、前記通知手段による通知に応答して前記ボードの
診断を行う診断手段と、前記診断手段による前記ボード
の診断時に前記ボードのエラーデータを他の回路に伝搬
するのを防止する抑止手段とを備えている。
子回路が搭載されたボードの活線挿抜の際に前記ボード
と他の回路とが共通に接続される共通バスを使用不能状
態として前記共通バスを保護する初期化バス保護回路を
含む情報処理装置の活線挿抜システムであって、前記ボ
ードは、制御回路を介して共通バスに接続されると共
に、前記初期化バス保護回路による前記共通バスの保護
を解除するときに前記ボードが前記共通バスに活線状態
で接続された旨を通知する通知手段を有し、前記制御回
路は、前記通知手段による通知に応答して前記ボードの
診断を行う診断手段と、前記診断手段による前記ボード
の診断時に前記ボードのエラーデータを他の回路に伝搬
するのを防止する抑止手段とを備えている。
【００１０】本発明による別の活線挿抜システムは、電
子回路が搭載されたボードの活線挿抜の際に前記ボード
と他の回路とが共通に接続される共通共通バスを使用不
能状態として前記共通バスを保護する初期化バス保護回
路を含む情報処理装置の活線挿抜システムであって、前
記ボードは、前記初期化バス保護回路と、前記初期化バ
ス保護回路による前記共通バスの保護を解除するときに
前記ボードが前記共通バスに活線状態で接続された旨を
通知する通知手段と、前記通知手段による通知に応答し
て前記ボードの診断を行う診断手段と、前記診断手段に
よる前記ボードの診断時に前記ボードのエラーデータを
他の回路に伝搬するのを防止する抑止手段とを備えてい
る。
子回路が搭載されたボードの活線挿抜の際に前記ボード
と他の回路とが共通に接続される共通共通バスを使用不
能状態として前記共通バスを保護する初期化バス保護回
路を含む情報処理装置の活線挿抜システムであって、前
記ボードは、前記初期化バス保護回路と、前記初期化バ
ス保護回路による前記共通バスの保護を解除するときに
前記ボードが前記共通バスに活線状態で接続された旨を
通知する通知手段と、前記通知手段による通知に応答し
て前記ボードの診断を行う診断手段と、前記診断手段に
よる前記ボードの診断時に前記ボードのエラーデータを
他の回路に伝搬するのを防止する抑止手段とを備えてい
る。
【００１１】すなわち、本発明では、マイクロプロセッ
サに読み書きが可能なパリティエラー等のエラーを抑止
するエラー抑止レジスタを設け、活線でのボード挿入時
にマイクロプロセッサが上記のエラー抑止レジスタをセ
ットし、この状態でボードの初期不良または挿抜時のボ
ード破壊を検出する診断プログラムを実行する。これに
よって、活線挿抜したボードによる障害をシステム全体
に伝搬するのを防止することが可能となる。
サに読み書きが可能なパリティエラー等のエラーを抑止
するエラー抑止レジスタを設け、活線でのボード挿入時
にマイクロプロセッサが上記のエラー抑止レジスタをセ
ットし、この状態でボードの初期不良または挿抜時のボ
ード破壊を検出する診断プログラムを実行する。これに
よって、活線挿抜したボードによる障害をシステム全体
に伝搬するのを防止することが可能となる。
【００１２】また、従来技術の活線挿抜回路内の初期化
バス保護回路にマイクロプロセッサへの割込み信号を付
加し、マイクロプロセッサがその割込み信号でボードの
バスへの接続が終了したことを認知して実行する診断プ
ログラムでボードが正常と判断された時に、マイクロプ
ロセッサがメモリ上の物理構成情報を更新することによ
って、オペレーティングシステムも最新の物理構成情報
を参照することができ、活線状態でのボードの増設を容
易に行うことが可能となる。
バス保護回路にマイクロプロセッサへの割込み信号を付
加し、マイクロプロセッサがその割込み信号でボードの
バスへの接続が終了したことを認知して実行する診断プ
ログラムでボードが正常と判断された時に、マイクロプ
ロセッサがメモリ上の物理構成情報を更新することによ
って、オペレーティングシステムも最新の物理構成情報
を参照することができ、活線状態でのボードの増設を容
易に行うことが可能となる。
【００１３】
【発明の実施の形態】次に、本発明の実施例について図
面を参照して説明する。図１は本発明の一実施例の構成
を示すブロック図である。図において、ボード１は初期
化バス保護回路１０と、接触ノイズ防止回路１１，１２
と、バッファ１３，１４と、活線挿抜用コネクタ１ａ，
１ｄと、挿抜動作検出回路１ｂと、補助電源コネクタ１
ｃと、バス保護終了信号用のコネクタ１ｅとを含んで構
成されている。ボード１が挿抜されるバックパネル２に
は主電源３と、補助電源４及び突入電流防止回路４ａと
が接続されている。
面を参照して説明する。図１は本発明の一実施例の構成
を示すブロック図である。図において、ボード１は初期
化バス保護回路１０と、接触ノイズ防止回路１１，１２
と、バッファ１３，１４と、活線挿抜用コネクタ１ａ，
１ｄと、挿抜動作検出回路１ｂと、補助電源コネクタ１
ｃと、バス保護終了信号用のコネクタ１ｅとを含んで構
成されている。ボード１が挿抜されるバックパネル２に
は主電源３と、補助電源４及び突入電流防止回路４ａと
が接続されている。
【００１４】ボード１は活線挿抜用コネクタ１ａ，１ｄ
と補助電源コネクタ１ｃとコネクタ１ｅとをバックパネ
ル２の対応するコネクタ２ａ〜２ｄに差込むことで、図
示せぬ情報処理装置に接続される。尚、ボード１にはチ
ャネル装置等のように情報処理装置のマイクロプロセッ
サ（図示せず）を介して共通バスに接続される回路が搭
載されているものとする。
と補助電源コネクタ１ｃとコネクタ１ｅとをバックパネ
ル２の対応するコネクタ２ａ〜２ｄに差込むことで、図
示せぬ情報処理装置に接続される。尚、ボード１にはチ
ャネル装置等のように情報処理装置のマイクロプロセッ
サ（図示せず）を介して共通バスに接続される回路が搭
載されているものとする。
【００１５】この図１において、ボード１は活線挿抜用
コネクタ１ａ，１ｄによって情報処理装置のバックパネ
ル２に接続される。ボード１をバックパネル２に挿入す
る際にはボード１の挿抜動作検出回路１ｂでバックパネ
ル２への挿入が検出され、初期化バス保護回路１０が動
作を開始し、ボード１をマイクロプロセッサに接続する
ためのバス（図示せず）をディスエーブル状態にする。
コネクタ１ａ，１ｄによって情報処理装置のバックパネ
ル２に接続される。ボード１をバックパネル２に挿入す
る際にはボード１の挿抜動作検出回路１ｂでバックパネ
ル２への挿入が検出され、初期化バス保護回路１０が動
作を開始し、ボード１をマイクロプロセッサに接続する
ためのバス（図示せず）をディスエーブル状態にする。
【００１６】また、ボード１に対しては補助電源コネク
タ２ｂに接続された補助電源４内にある突入電流防止回
路４ａによって、主電源３からの突入電流が防止され
る。さらに、ボード１においては活線挿抜用コネクタ１
ａ，１ｄにノイズが乗らないように、活線挿抜用コネク
タ１ａ，１ｄに接触ノイズ防止回路１１，１２が接続さ
れている。
タ２ｂに接続された補助電源４内にある突入電流防止回
路４ａによって、主電源３からの突入電流が防止され
る。さらに、ボード１においては活線挿抜用コネクタ１
ａ，１ｄにノイズが乗らないように、活線挿抜用コネク
タ１ａ，１ｄに接触ノイズ防止回路１１，１２が接続さ
れている。
【００１７】さらにまた、ボード１の初期化バス保護回
路１０においては挿抜動作検出回路１ｂのショートを検
出すると、バスをディスエーブル状態からイネーブル状
態へと変化させてバスの保護を解除し、バス保護終了信
号をコネクタ１ｅと、バックパネル２と、バスとは別に
設けられた専用線（図示せず）とを介してマイクロプロ
セッサに出力する。本発明の一実施例では上述した回路
構成によって、従来の情報処理装置と同様に、ボード１
の活線挿抜を可能としている。
路１０においては挿抜動作検出回路１ｂのショートを検
出すると、バスをディスエーブル状態からイネーブル状
態へと変化させてバスの保護を解除し、バス保護終了信
号をコネクタ１ｅと、バックパネル２と、バスとは別に
設けられた専用線（図示せず）とを介してマイクロプロ
セッサに出力する。本発明の一実施例では上述した回路
構成によって、従来の情報処理装置と同様に、ボード１
の活線挿抜を可能としている。
【００１８】図２は本発明の一実施例による共通バスへ
の接続例を示すブロック図である。図において、マイク
ロプロセッサ５ａ〜５ｃ及びメモリ６は共通バス１００
を介して相互に接続されている。
の接続例を示すブロック図である。図において、マイク
ロプロセッサ５ａ〜５ｃ及びメモリ６は共通バス１００
を介して相互に接続されている。
【００１９】また、マイクロプロセッサ５ａ〜５ｃ各々
はエラー抑止レジスタ５１ａ〜５１ｃ、例えば共通バス
１００への信号線等に接続されたナンド（ＮＡＮＤ）回
路等を備えており、バス保護終了線１０１〜１０３及び
データ／制御線１１１〜１１３を介してボード１に接続
される。メモリ６には情報処理装置の物理構成情報を格
納する物理構成情報格納部６１が設けられている。尚、
マイクロプロセッサ５ａ〜５ｃ各々はマイクロプログラ
ムによって動作する。
はエラー抑止レジスタ５１ａ〜５１ｃ、例えば共通バス
１００への信号線等に接続されたナンド（ＮＡＮＤ）回
路等を備えており、バス保護終了線１０１〜１０３及び
データ／制御線１１１〜１１３を介してボード１に接続
される。メモリ６には情報処理装置の物理構成情報を格
納する物理構成情報格納部６１が設けられている。尚、
マイクロプロセッサ５ａ〜５ｃ各々はマイクロプログラ
ムによって動作する。
【００２０】図３は図２のマイクロプロセッサ５ａ〜５
ｃの処理動作を示すフローチャートである。これら図１
〜図３を参照して、本発明の一実施例による活線状態で
のボード１のバックパネル２への接続について説明す
る。
ｃの処理動作を示すフローチャートである。これら図１
〜図３を参照して、本発明の一実施例による活線状態で
のボード１のバックパネル２への接続について説明す
る。
【００２１】ボード１をバックパネル２に挿入すると、
初期化バス保護回路１０は挿抜動作検出回路１ｂがバッ
クパネル２への挿入を検出するので動作を開始し、ボー
ド１に接続されるバス（データ／制御線１１１〜１１
３）をディスエーブル状態にする。
初期化バス保護回路１０は挿抜動作検出回路１ｂがバッ
クパネル２への挿入を検出するので動作を開始し、ボー
ド１に接続されるバス（データ／制御線１１１〜１１
３）をディスエーブル状態にする。
【００２２】ボード１のバックパネル２への挿着が完了
すると、初期化バス保護回路１０はバスをディスエーブ
ル状態からイネーブル状態に変化させ、バスの保護を解
除する。同時に、初期化バス保護回路１０はバス保護終
了信号を出力し、マイクロプロセッサ５ａ〜５ｃに割込
みを上げる。
すると、初期化バス保護回路１０はバスをディスエーブ
ル状態からイネーブル状態に変化させ、バスの保護を解
除する。同時に、初期化バス保護回路１０はバス保護終
了信号を出力し、マイクロプロセッサ５ａ〜５ｃに割込
みを上げる。
【００２３】マイクロプロセッサ５ａ〜５ｃはバス保護
終了線１０１〜１０３を介してバス保護終了信号を受取
ると、まずエラー抑止レジスタ５１ａ〜５１ｃに抑止情
報を書込み（図３ステップＳ１）、ボード１からのデー
タのパリティエラー等が共通バス１００を介して情報処
理装置内に伝搬するのを抑止する。
終了線１０１〜１０３を介してバス保護終了信号を受取
ると、まずエラー抑止レジスタ５１ａ〜５１ｃに抑止情
報を書込み（図３ステップＳ１）、ボード１からのデー
タのパリティエラー等が共通バス１００を介して情報処
理装置内に伝搬するのを抑止する。
【００２４】その後、マイクロプロセッサ５ａ〜５ｃは
ボード１の診断プログラムを実行し（図３ステップＳ
２）、バックパネル２に挿着したボード１が正常か否か
を判断する（図３ステップＳ３）。ここで、マイクロプ
ロセッサ５ａ〜５ｃに接続されるボード１の種類等は予
め分かっているので、マイクロプロセッサ５ａ〜５ｃに
はその種類等に対応する診断プログラムが予め記憶され
ている。
ボード１の診断プログラムを実行し（図３ステップＳ
２）、バックパネル２に挿着したボード１が正常か否か
を判断する（図３ステップＳ３）。ここで、マイクロプ
ロセッサ５ａ〜５ｃに接続されるボード１の種類等は予
め分かっているので、マイクロプロセッサ５ａ〜５ｃに
はその種類等に対応する診断プログラムが予め記憶され
ている。
【００２５】マイクロプロセッサ５ａ〜５ｃは診断プロ
グラムが正常終了すると、共通バス１００を介してメモ
リ６の物理構成情報格納部６１から物理構成情報を読込
み、バックパネル２へのボード１の挿着によって変更さ
れた物理構成情報で更新し（図３ステップＳ４）、情報
処理装置の最新の物理構成をメモリ６上の物理構成情報
格納部６１の内容に反映させる。同時に、マイクロプロ
セッサ５ａ〜５ｃはエラー抑止レジスタ５１ａ〜５１ｃ
による共通バス１００へのデータ出力の抑止を解除する
（図３ステップＳ５）。これによって、ボード１の正常
な活線挿抜後に発生する故障を検出することが可能とな
る。
グラムが正常終了すると、共通バス１００を介してメモ
リ６の物理構成情報格納部６１から物理構成情報を読込
み、バックパネル２へのボード１の挿着によって変更さ
れた物理構成情報で更新し（図３ステップＳ４）、情報
処理装置の最新の物理構成をメモリ６上の物理構成情報
格納部６１の内容に反映させる。同時に、マイクロプロ
セッサ５ａ〜５ｃはエラー抑止レジスタ５１ａ〜５１ｃ
による共通バス１００へのデータ出力の抑止を解除する
（図３ステップＳ５）。これによって、ボード１の正常
な活線挿抜後に発生する故障を検出することが可能とな
る。
【００２６】一方、マイクロプロセッサ５ａ〜５ｃは診
断プログラムが異常終了すると、つまりボード１を不良
または故障であると判断すると、メモリ６上の物理構成
情報格納部６１の内容を更新せずに、その旨をオペレー
ティングシステムヘ通知する（図３ステップＳ６）。こ
の後、別のボードがバックパネル２に挿着されると（図
３ステップＳ７）、上記の処理が繰返し行われる。
断プログラムが異常終了すると、つまりボード１を不良
または故障であると判断すると、メモリ６上の物理構成
情報格納部６１の内容を更新せずに、その旨をオペレー
ティングシステムヘ通知する（図３ステップＳ６）。こ
の後、別のボードがバックパネル２に挿着されると（図
３ステップＳ７）、上記の処理が繰返し行われる。
【００２７】上述した動作によって、オペレーティング
システムは更新されたメモリ６上の物理構成情報格納部
６１の内容を参照することで、活線状態で増設された装
置を認識することができる。よって、ボード１の活線挿
抜を可能とし、またボード１の初期不良や挿抜時のボー
ド１の故障によるシステム全体への障害の伝搬を抑止す
ることが可能となる。
システムは更新されたメモリ６上の物理構成情報格納部
６１の内容を参照することで、活線状態で増設された装
置を認識することができる。よって、ボード１の活線挿
抜を可能とし、またボード１の初期不良や挿抜時のボー
ド１の故障によるシステム全体への障害の伝搬を抑止す
ることが可能となる。
【００２８】図４は本発明の他の実施例の構成を示すブ
ロック図である。図において、ボード７はマイクロプロ
セッサ７０と、初期化バス保護回路７１と、接触ノイズ
防止回路７２，７３と、バッファ７４，７５と、エラー
抑止レジスタ７６，７７と、活線挿抜用コネクタ７ａ，
７ｄと、挿抜動作検出回路７ｂと、補助電源コネクタ７
ｃとを含んで構成されている。ボード７が挿抜されるバ
ックパネル８には主電源３と、補助電源４及び突入電流
防止回路４ａとが接続されている。
ロック図である。図において、ボード７はマイクロプロ
セッサ７０と、初期化バス保護回路７１と、接触ノイズ
防止回路７２，７３と、バッファ７４，７５と、エラー
抑止レジスタ７６，７７と、活線挿抜用コネクタ７ａ，
７ｄと、挿抜動作検出回路７ｂと、補助電源コネクタ７
ｃとを含んで構成されている。ボード７が挿抜されるバ
ックパネル８には主電源３と、補助電源４及び突入電流
防止回路４ａとが接続されている。
【００２９】ボード７は活線挿抜用コネクタ７ａ，７ｄ
と補助電源コネクタ７ｃとをバックパネル８の対応する
コネクタ８ａ〜８ｃに差込むことで、図示せぬ情報処理
装置に接続される。
と補助電源コネクタ７ｃとをバックパネル８の対応する
コネクタ８ａ〜８ｃに差込むことで、図示せぬ情報処理
装置に接続される。
【００３０】本発明の他の実施例ではボード７上にマイ
クロプロセッサ７０が搭載され、初期化バス保護回路７
１がバスの保護を解除するのと同時にバス保護終了信号
を出力すると、上記の本発明の一実施例と同様に、マイ
クロプロセッサ７０がエラー抑止レジスタ７６，７７を
セットする。
クロプロセッサ７０が搭載され、初期化バス保護回路７
１がバスの保護を解除するのと同時にバス保護終了信号
を出力すると、上記の本発明の一実施例と同様に、マイ
クロプロセッサ７０がエラー抑止レジスタ７６，７７を
セットする。
【００３１】この後、マイクロプロセッサ７０は図３に
示す本発明の一実施例の処理動作と同様の動作を行い、
ボード７の診断プログラムを実行する。マイクロプロセ
ッサ７０は診断プログラムが正常終了すると、バックパ
ネル８内に接続される共通バス（図示せず）を介してメ
モリ上の物理構成情報を更新し、エラー抑止レジスタ７
６，７７をリセットして処理を終了する。
示す本発明の一実施例の処理動作と同様の動作を行い、
ボード７の診断プログラムを実行する。マイクロプロセ
ッサ７０は診断プログラムが正常終了すると、バックパ
ネル８内に接続される共通バス（図示せず）を介してメ
モリ上の物理構成情報を更新し、エラー抑止レジスタ７
６，７７をリセットして処理を終了する。
【００３２】上記の本発明の他の実施例でも、上述した
本発明の一実施例と同様に、オペレーティングシステム
は更新されたメモリ上の物理構成情報を参照すること
で、活線状態で増設された装置を認識することができ
る。よって、ボード７の活線挿抜を可能とし、またボー
ド７の初期不良や挿抜時のボード７の故障によるシステ
ム全体への障害の伝搬を抑止することが可能となる。
本発明の一実施例と同様に、オペレーティングシステム
は更新されたメモリ上の物理構成情報を参照すること
で、活線状態で増設された装置を認識することができ
る。よって、ボード７の活線挿抜を可能とし、またボー
ド７の初期不良や挿抜時のボード７の故障によるシステ
ム全体への障害の伝搬を抑止することが可能となる。
【００３３】このように、ボード１，７の活線挿抜の際
にボード１，７とマイクロプロセッサ５ａ〜５ｃ，７０
とが共通に接続されるバス（データ／制御線１１１〜１
１３あるいはバックパネル８内の共通バス）をディスエ
ーブル状態としてバスを保護する初期化バス保護回路１
０，７１によるバスの保護解除時にボード１，７のバス
への活線状態での接続をバス保護終了信号でマイクロプ
ロセッサ５ａ〜５ｃ，７０に通知し、この通知に応答し
てマイクロプロセッサ５ａ〜５ｃ，７０がボード１，７
の診断を行うとともに、このボード１，７の診断時にエ
ラー抑止レジスタ５１ａ〜５１ｃ，７６，７７をセット
してボード１，７のエラーデータが他の回路へ伝搬する
のを抑止することによって、ボード１，７の初期不良や
挿抜による故障で生ずる障害のシステム全体への伝搬を
防止することができる。
にボード１，７とマイクロプロセッサ５ａ〜５ｃ，７０
とが共通に接続されるバス（データ／制御線１１１〜１
１３あるいはバックパネル８内の共通バス）をディスエ
ーブル状態としてバスを保護する初期化バス保護回路１
０，７１によるバスの保護解除時にボード１，７のバス
への活線状態での接続をバス保護終了信号でマイクロプ
ロセッサ５ａ〜５ｃ，７０に通知し、この通知に応答し
てマイクロプロセッサ５ａ〜５ｃ，７０がボード１，７
の診断を行うとともに、このボード１，７の診断時にエ
ラー抑止レジスタ５１ａ〜５１ｃ，７６，７７をセット
してボード１，７のエラーデータが他の回路へ伝搬する
のを抑止することによって、ボード１，７の初期不良や
挿抜による故障で生ずる障害のシステム全体への伝搬を
防止することができる。
【００３４】
【発明の効果】以上説明したように本発明によれば、電
子回路が搭載されたボードの活線挿抜の際にボードと他
の回路とが共通に接続されるバスを使用不能状態として
バスを保護する初期化バス保護回路を含む情報処理装置
の活線挿抜システムにおいて、初期化バス保護回路によ
るバスの保護を解除する時にボードのバスへの活線状態
での接続を通知し、この通知に応答してボードの診断を
行うとともに、ボードの診断時にボードのエラーデータ
の他の回路への伝搬を抑止することによって、ボードの
初期不良や挿抜による故障で生ずる障害のシステム全体
への伝搬を防止することができるという効果がある。
子回路が搭載されたボードの活線挿抜の際にボードと他
の回路とが共通に接続されるバスを使用不能状態として
バスを保護する初期化バス保護回路を含む情報処理装置
の活線挿抜システムにおいて、初期化バス保護回路によ
るバスの保護を解除する時にボードのバスへの活線状態
での接続を通知し、この通知に応答してボードの診断を
行うとともに、ボードの診断時にボードのエラーデータ
の他の回路への伝搬を抑止することによって、ボードの
初期不良や挿抜による故障で生ずる障害のシステム全体
への伝搬を防止することができるという効果がある。
【図１】本発明の一実施例の構成を示すブロック図であ
る。
る。
【図２】本発明の一実施例による共通バスへの接続例を
示すブロック図である。
示すブロック図である。
【図３】図２のマイクロプロセッサの処理動作を示すフ
ローチャートである。
ローチャートである。
【図４】本発明の他の実施例の構成を示すブロック図で
ある。
ある。
１，７ ボード １ａ，１ｄ，７ａ，７ｄ 活線挿抜用コネクタ １ｂ，７ｂ 挿抜動作検出回路 １ｃ，７ｃ 補助電源コネクタ １ｅ バス保護終了信号用のコネクタ ２，８ バックパネル ２ａ〜２ｄ，８ａ〜８ｃ コネクタ ３ 主電源 ４ 補助電源 ４ａ 突入電流防止回路 ５ａ〜５ｃ，７０ マイクロプロセッサ ６ メモリ １０，７１ 初期化バス保護回路 １１，１２，７２，７３ 接触ノイズ防止回路 ５１ａ〜５１ｃ，７６，７７ エラー抑止レジスタ ６１ 物理構成情報格納部
Claims (6)
- 【請求項１】 電子回路が搭載されたボードの活線挿抜
の際に前記ボードと他の回路とが共通に接続される共通
バスを使用不能状態として前記共通バスを保護する初期
化バス保護回路を含む情報処理装置の活線挿抜システム
であって、前記初期化バス保護回路による前記共通バス
の保護を解除するときに前記ボードが前記共通バスに活
線状態で接続された旨を通知する通知手段と、前記通知
手段による通知に応答して前記ボードの診断を行う診断
手段と、前記診断手段による前記ボードの診断時に前記
ボードのエラーデータを他の回路に伝搬するのを防止す
る抑止手段とを有することを特徴とする活線挿抜システ
ム。 - 【請求項２】 前記情報処理装置は、当該情報処理装置
の物理構成を示す物理構成情報と、前記診断手段による
診断で前記ボードが正常と判断された後に前記物理構成
情報を更新する手段とを有することを特徴とする請求項
１記載の活線挿抜システム。 - 【請求項３】 電子回路が搭載されたボードの活線挿抜
の際に前記ボードと他の回路とが共通に接続される共通
バスを使用不能状態として前記共通バスを保護する初期
化バス保護回路を含む情報処理装置の活線挿抜システム
であって、前記ボードは、制御回路を介して共通バスに
接続されると共に、前記初期化バス保護回路による前記
共通バスの保護を解除するときに前記ボードが前記共通
バスに活線状態で接続された旨を通知する通知手段を有
し、前記制御回路は、前記通知手段による通知に応答し
て前記ボードの診断を行う診断手段と、前記診断手段に
よる前記ボードの診断時に前記ボードのエラーデータを
他の回路に伝搬するのを防止する抑止手段とを有するこ
とを特徴とする活線挿抜システム。 - 【請求項４】 前記制御回路は、前記情報処理装置の物
理構成を示す物理構成情報と、前記診断手段による診断
で前記ボードが正常と判断された後に前記物理構成情報
を更新する手段とを有することを特徴とする請求項１記
載の活線挿抜システム。 - 【請求項５】 電子回路が搭載されたボードの活線挿抜
の際に前記ボードと他の回路とが共通に接続される共通
共通バスを使用不能状態として前記共通バスを保護する
初期化バス保護回路を含む情報処理装置の活線挿抜シス
テムであって、前記ボードは、前記初期化バス保護回路
と、前記初期化バス保護回路による前記共通バスの保護
を解除するときに前記ボードが前記共通バスに活線状態
で接続された旨を通知する通知手段と、前記通知手段に
よる通知に応答して前記ボードの診断を行う診断手段
と、前記診断手段による前記ボードの診断時に前記ボー
ドのエラーデータを他の回路に伝搬するのを防止する抑
止手段とを有することを特徴とする活線挿抜システム。 - 【請求項６】 前記ボードは、前記情報処理装置の物理
構成を示す物理構成情報と、前記診断手段による診断で
前記ボードが正常と判断された後に前記物理構成情報を
更新する手段とを有することを特徴とする請求項１記載
の活線挿抜システム。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP28203596A JP3243687B2 (ja) | 1996-10-24 | 1996-10-24 | 活線挿抜システム |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP28203596A JP3243687B2 (ja) | 1996-10-24 | 1996-10-24 | 活線挿抜システム |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH10124187A JPH10124187A (ja) | 1998-05-15 |
| JP3243687B2 true JP3243687B2 (ja) | 2002-01-07 |
Family
ID=17647331
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP28203596A Expired - Fee Related JP3243687B2 (ja) | 1996-10-24 | 1996-10-24 | 活線挿抜システム |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3243687B2 (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2010055348A (ja) * | 2008-08-28 | 2010-03-11 | Hitachi Computer Peripherals Co Ltd | ディスクサブシステム及びディスクサブシステムの装置構成情報登録方法 |
-
1996
- 1996-10-24 JP JP28203596A patent/JP3243687B2/ja not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JPH10124187A (ja) | 1998-05-15 |
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