JP3167399U - 多層セラミック素子の構造 - Google Patents
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Abstract
【課題】めっき工程がなく、従って環境を汚染することなく製造される多層セラミック素子を提供する。【解決手段】本多層セラミック素子50は、千鳥状になった複数の内部電極65を内部に含み両端に該千鳥状の内部電極に電気的に接続された導電電極70が設けられたセラミック本体60を備える。該各導電電極はハンダペースト層72で覆われている。従って、この多層セラミック素子は、めっき工程なしで製造されるので、めっき液による環境汚染を防ぎ、ニッケル廃液またはスズ廃液を処理するための時間と費用を省くことが出来、製造コストが低減され処理時間が短縮される。【選択図】図4
Description
本考案は、多層セラミック素子、特に、多層セラミック素子の外部電極の改善された構造であって、ニッケルめっきとスズめっきの両方を使用することなく作製される構造に関する。
現在の一般的な多層チップ受動素子としては、セラミック電子素子、例えば多層セラミックコンデンサー(MLCC)、多層セラミックインダクター(MLCI)、多層バリスター(MLV)、及び多層セラミックサーミスターがある。以下、これら全てのセラミック電子素子を「多層セラミック素子」と称する。
図1を参照すると、既存の多層セラミック素子10は、両端に導電電極30が設けられたセラミック本体20と、セラミック本体20内に配置され導電電極30に電気的に接続された千鳥状の内部電極40とを備える。
従来、多層セラミック素子10の外部電極30は、回路基板上に設けられたコンタクトに取り付けられる。従って、多層セラミック素子10の外部電極30はハンダ付け熱、腐食、及び酸化に良好な耐性を有する必要がある。
このために、製造プロセスにおいて、ニッケルめっきとスズめっきとが行われて、外部電極30は最内導電電極31、中間ニッケルめっき層32、及び最外スズめっき層33からなる層状構造を有するよう作製される。ニッケルめっき層32は銀でできた導電電極31を保護する中間シールドとして働く。ニッケルのハンダ付け熱への耐性が低いので、ニッケルめっき層32をスズめっき層33で被覆してハンダ付け熱への適切な耐性を持つようにする必要がある。
しかし、多層セラミック素子10を製造するためのめっき工程は、環境を著しく汚染する有害な廃棄物を発生させる場合がある。
図2に示すように、表面実装技術(SMT)が開発され、多層セラミック素子10は現在、表面実装素子(SMD)として入手可能である。成熟したSMT技術を使用して、多層セラミック素子10を接着剤又はスズペースト95を予め付けた回路基板90上に直接配置して、ペースト95を熱風又は赤外線でその溶融点まで加熱し次に冷却することで、回路基板90のコンタクトに固定することが出来、従来のプロセスが必要としたハンダ付け工程を必要としない。
即ち、多層セラミック素子10の外部電極30は、回路基板90に従来のハンダ付け工程を使用することなくSMTにより取り付けられる。従って、ニッケルめっき層32及びスズめっき層33を被覆することで多層セラミック素子10の外部電極30にハンダ付け熱及び腐食への追加の耐性を付与する必要はもはやない。
この事実に鑑みて、本考案の主目的は、めっき工程がなく、従って環境を汚染することなく製造される多層セラミック素子を提供することである。
上記目的を達成するために、本考案の多層セラミック素子は、千鳥状になった複数の内部電極を内部に含み両端に該千鳥状の内部電極に電気的に接続された導電電極が設けられたセラミック本体を備える。該各導電電極はハンダペースト層で覆われている。
本考案によれば、多層セラミック素子の前記導電電極は、銀、銅、銀合金、又は銅合金でできた電極層である。該導電電極は、前記ハンダペースト層が該導電電極を被覆するのを助けるAg/Pd合金又はAg/Pt合金でできているのが好ましい。
本考案によれば、多層セラミック素子の前記ハンダペースト層はハンダ付け用フラックスと、スズ粉末、銅粉末、スズ系合金粉末、及び銅系合金粉末(粒子径は全て1〜5μm)のうち1つ以上とを含む。該ハンダ付け用フラックスは20〜30体積%を占める。
本考案によれば、この多層セラミック素子は、めっき工程なしで製造されるので、ニッケル廃液及びスズ廃液の処理の必要がなく、環境汚染を引き起こさず、製造コストが低減され処理時間が短縮されるメリットを有する。
本考案の好適な態様、他の目的及び利点は、下記の実施形態の詳細な説明と添付の図面を参照することで最も良く理解されるであろう。
本考案の好適な態様、他の目的及び利点は、下記の実施形態の詳細な説明と添付の図面を参照することで最も良く理解されるであろう。
図3を参照すると、本考案に係る多層セラミック素子50は、千鳥状の内部電極65を内部に含み両端に内部電極65に電気的に接続された導電電極70が設けられたセラミック本体60から構成される。各導電電極70はハンダペースト層72で覆われている。
導電電極70は銀、銅、銀合金、又は銅合金でできた電極層である。特に、導電電極70はAg/Pd合金又はAg/Pt合金でできているのが好ましい。Ag/Pd合金又はAg/Pt合金でできた導電電極70の銀とパラジウム(又は銀とプラチナ)の比は、様々な比から選択することが出来るが、銀とパラジウム(又は銀とプラチナ)の重量比は、95:5〜99:1の範囲であることが好ましい。選択された材料はハンダペースト層72が導電電極70を被覆するのを助ける。
ハンダペースト層72はハンダ付け用フラックスと、スズ粉末、銅粉末、スズ系合金粉末、及び銅系合金粉末(粒子径は全て1〜5μm)のうち1つ以上とから調製されたペーストである。一方、ハンダペースト層72に適切な粘度を付与するために、該ハンダ付け用フラックスはハンダペースト層72の全体積の20〜30%を占める。
ハンダペースト層72を、浸漬、印刷、又は噴霧によるか又はスズ浸漬炉を使用して導電電極70の外面に塗布してもよい。
例えば、粒子サイズ1〜5μmのSn、Ag、及びCuの微粉末を、94.5:5.0:0.5(=Sn:Ag:Cu)の重量比で混合し、次にハンダ付け用フラックスと混合して粘着性のハンダ・スズペーストを形成してもよい。ここで、ハンダ付け用フラックスはハンダ・スズペーストの20〜30体積%の濃度である。この調製されたハンダ・スズペーストを多層セラミック素子50の各導電電極70の外面に塗布しハンダペースト層72を形成する。これにより多層セラミック素子50の改善された構造が完成する。
図4に示すように、本考案の多層セラミック素子50は粘着性のハンダペースト層72を有しているので、回路基板90に接着剤又はスズペーストを付ける必要がない。本考案の多層セラミック素子50を回路基板90のコンタクト上に直接配置し、ハンダペースト層72を熱風又は赤外線でその溶融点まで加熱し次に冷却することで回路基板90のコンタクトに固定できる。
これにより、硬化したハンダペースト層72と導電電極70とは接合され多層セラミック素子50の外部電極75を形成する。
従って、開示した多層セラミック素子50は、めっき工程なしで製造されるので、めっき液による環境汚染を防ぎ、ニッケル廃液またはスズ廃液を処理するための時間と費用を省くことが出来、製造コストが低減され処理時間が短縮される。
50 多層セラミック素子
60 セラミック本体
65 内部電極
70 導電電極
72 ハンダペースト層
75 外部電極
90 回路基板
60 セラミック本体
65 内部電極
70 導電電極
72 ハンダペースト層
75 外部電極
90 回路基板
Claims (4)
- 千鳥状になった複数の内部電極を内部に含み両端に該千鳥状の内部電極に電気的に接続された導電電極が設けられたセラミック本体を備え、
該各導電電極はハンダペースト層で覆われていることを特徴とする多層セラミック素子の構造。 - 前記導電電極は銀電極、銅電極、銀合金電極、銅合金電極、Ag/Pd合金電極、及びAg/Pt合金電極からなるグループから選択された1つである請求項1に記載の多層セラミック素子の構造。
- 前記ハンダペースト層は、ハンダ付け用フラックスと、スズ粉末、銅粉末、スズ系合金粉末、及び銅系合金粉末のうち1つ以上とを含み、これら全ての粉末の粒子径は1〜5μmである請求項1又は2に記載の多層セラミック素子の構造。
- 前記ハンダ付け用フラックスは前記ハンダペースト層の20〜30体積%を占める請求項3に記載の多層セラミック素子の構造。
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JP2011000609U JP3167399U (ja) | 2011-02-07 | 2011-02-07 | 多層セラミック素子の構造 |
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CN110858516A (zh) * | 2018-08-23 | 2020-03-03 | 三星电机株式会社 | 多层陶瓷电子组件及制造该多层陶瓷电子组件的方法 |
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CN110858516A (zh) * | 2018-08-23 | 2020-03-03 | 三星电机株式会社 | 多层陶瓷电子组件及制造该多层陶瓷电子组件的方法 |
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