JP3134067B2 - 低抵抗チップ抵抗器及びその製造方法 - Google Patents
低抵抗チップ抵抗器及びその製造方法Info
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Description
流検出センサーとして組み込まれるように、低抵抗値と
安定した良好なTCR(抵抗温度特性、以下同じ)を備
えてなる低抵抗チップ抵抗器とその製造方法に関する。
プ抵抗器としては、絶縁基板と、該絶縁基板上に形成さ
れる表電極と、該表電極を跨ぐように形成される抵抗膜
と、該抵抗膜を被覆する保護膜とを備えてなるものが一
般に知られている(特開平9−180903号公報参
照)。
従来の低抵抗チップ抵抗器においては、抵抗膜本来のE
SD(耐静電気破壊)特性等の電気的特性や、ある程度の
低抵抗値範囲が確保されているものの、安定した良好な
TCRが確保できているとは必ずしも言えない。この従
来の低抵抗チップ抵抗器において具体的に得られている
抵抗値は100mΩ〜数Ωであり、TCRにあっては2
00ppm/℃以上にとどまっているのが実状である。
を解決せんとしたものであり、その目的は、従来得られ
ていた各種特性を維持しつつ、低抵抗化とより良好なT
CRの確保とを可能にする低抵抗チップ抵抗器及びその
製造方法を提供することにある。
みてなされたものであり、その要旨とするところは、絶
縁基板と、該絶縁基板上に形成される一対の表電極と、
該表電極を跨ぐように形成される抵抗膜と、該抵抗膜を
被覆する保護膜とを備えてなる低抵抗チップ抵抗器であ
って、上記表電極が、Ag・Pd系メタルグレーズ下層
膜及び/又はAg系メタルグレーズ上層膜からなる第1
表電極層と、該第1表電極層上に並設される膜厚30μ
m以上のCuめっき膜からなる第2表電極層とを含むこ
とを特徴とする低抵抗チップ抵抗器にある。
表電極において、Ag・Pd系メタルグレーズ下層膜及
び/又はAg系メタルグレーズ上層膜からなる第1表電
極層と、該第1表電極層上に並設される膜厚30μm以
上のCuめっき膜からなる第2表電極層とを採用したの
で、上述した第1表電極層と第2表電極層とが相俟っ
て、従来得られていた各種特性を維持しつつ、低抵抗化
とより良好なTCR(小さなTCR)の確保を可能にす
る。
抗器を製造する方法であって、上記第2表電極層を電気
めっき法により形成することとし、第2表電極層の形成
に先立って、集合絶縁基板の縦横分割溝の部分、並びに
第2表電極層を形成する範囲を除く部分を被覆するよう
にめっきレジストを形成する工程と、第2表電極層の形
成後に、めっきレジストを除去する工程と、を含むこと
を特徴とする低抵抗チップ抵抗器の製造方法にある。
製造する方法において、第2表電極層を電気めっき法に
より形成することとし、第2表電極層の形成に先立っ
て、集合絶縁基板の縦横分割溝の部分、並びに第2表電
極層を形成する範囲を除く部分を被覆するようにめっき
レジストを形成する工程と、第2表電極層の形成後に、
めっきレジストを除去する工程とを採用したので、比較
的厚いCuめっき膜からなる第2表電極層が集合絶縁基板
の縦横分割溝上に形成されることがなく、集合絶縁基板
の分割時におけるバリ(欠け)の発生を極力防止するこ
とができる。
ップ抵抗器の持つ個々の平面サイズは、長さ方向(以
下、Lと称す):1.6mm×幅方向(以下、Wと称
す):0.8mm、L:2.0mm×W:1.25m
m、L:3.2mm×W:1.6mm、L:3.5mm
×W:2.5mm、L:5.0mm×W:2.5mm、
L:6.3×W3.2mm等の態様がある。
極層は、第1表電極層上に30μm以上の膜厚で形成さ
れるが、低抵抗チップ抵抗器の個々の平面サイズを考慮
すれば、現実的には30μm〜40μm程度の膜厚とす
ることが望ましい。
説明する。
板1と、該絶縁基板1に設けられた一対の表電極(2,
5,7)及び裏電極2'と、該表電極を跨ぐように形成
された抵抗膜3と、該抵抗膜3を被覆するように設けら
れた保護膜(4,9)と、上記基板端面に形成される端
面電極10及び端面めっき膜11と、を備えてなる。
板を縦横分割溝1a,1bに沿って個片状に分割される
ことによって独立した単体チップである。
に形成された膜厚10μm以下の一対のAg・Pd系メ
タルグレーズ下層膜2及びAg系メタルグレーズ上層膜
5からなる第1表電極層2と、該第1表電極層上に形成
された膜厚30μm以上のCuめっき膜7からなる第2
表電極層によって構成されている。ここでは、Ag・P
dメタルグレーズ2及びAg系メタルグレーズ5の両者
を採用しているが、何れか一方のみを採用する態様とし
てもよい。尚、基板1の下面には、10μm以下の一対
のAg系メタルグレーズ2'からなる裏電極が形成され
ている。
1表電極層のAg・Pdメタルグレーズ下層膜2及びA
g系メタルグレーズ上層膜5によって各端部が挟み込ま
れるように配置されている。ここで、上記表電極におい
ては、第1表電極層の下層膜、上層膜、及び第2電極層
の順に面積抵抗が低くなるように配置してあり、結果と
して表電極の抵抗値が抵抗膜の抵抗値に影響することが
ないように低抵抗化を配慮している。
出部分を被覆するように形成される第1保護コート4
と、該第1保護コート4上からトリミングされた抵抗膜
3を被覆するように形成される第2保護コート9とから
なる。
は、Ag等を含む導電性樹脂塗料からなり、絶縁基板と
の密着性を確保し、上述の表電極と裏電極との電気的接
続を確保している。
極の全体を被覆するように、端面めっき膜11として、
下層Cuめっき11aと、中層Niめっき11bと、上
層はんだめっき11cとを施している。尚、上記下層C
uめっきの形成は、めっき膜11の抵抗値を低く保つよ
うに作用する。
製造方法について図2〜図5を参照して説明する。
bを備えた集合基板の区画域毎に、Ag・Pd系メタル
グレーズ(重量比 Ag;70wt%,Pd;30wt
%)をその上面に印刷・乾燥(850℃)することによ
り膜厚10μm以下の一対の第1表電極層下層膜2を形
成すると共に、Ag系メタルグレーズをその下面に印刷
・乾燥(850℃)することにより膜厚10μm以下の
一対の裏電極2'を形成する。
1電極層のAg・Pd系メタルグレーズ下層膜2を跨ぐ
ようにAg・Pd系メタルグレーズ(重量比 Ag;4
5wt%,Pd;55wt%)を印刷・焼成(850
℃)することにより膜厚8μm〜25μmの抵抗膜3を
形成する。ここで抵抗膜3は、単層の態様に限られず、
印刷・焼成を繰り返して多層化の態様とすることができ
るほか、第1表電極層の上層膜又は下層膜による電極間
隔を調整することにより抵抗膜の抵抗値を所要の値に設
定するといった態様とすることができる。
び抵抗膜3におけるAg・Pd系メタルグレーズの重量比
を選択することにより、低抵抗化並びに小さなTCRの
より簡易な確保に寄与することができる。
系メタルグレーズを印刷・焼成(600℃)することに
より膜厚10μm以下の第1表電極層上層膜5を形成す
る。
護コート4として硼珪酸鉛ガラスペーストを印刷・焼成
(600℃)する。
4に示すように、めっきレジスト6としてピッチ系合成
樹脂を集合基板の縦横分割溝1a,1bの部分及び第2
表電極層7を形成する範囲を除く部分に印刷・硬化(2
00℃)する。
第2表電極層7を形成する範囲の表面を希塩酸液で粗化
・洗浄する。この粗化・洗浄によれば、良好な電気的接
触と密着性とが確保され、抵抗膜と電極との良好な電流
路が確保される。
板の状態で第1表電極層上層膜5上に電気めっき法によ
り膜厚30μm以上のCuめっき膜からなる第2表電極
層7を形成する。
材を用いてめっきレジストを除去する。
第1保護コート4上より抵抗膜3をレーザートリミング
することによって所要の抵抗値に調整する。
上記工程のトリミング跡8を被覆するようにエポキシ系
又はフェノール変成エポキシ系等の合成樹脂塗料を印刷
・硬化(200℃)することにより上記第2保護コート
9を形成する。
1を縦分割溝1aに沿って短冊状に分割する。
g等を含有する導電性樹脂材料を印刷・硬化(200
℃)することにより端面電極10を形成する。
された集合絶縁基板1を横分割溝1bに沿って個片状に
更に分割することにより単体チップを得る。
めっき法により下層のCuめっき11a、中層のニッケ
ルめっき11b、及びはんだめっき11cとからなるめ
っき膜11を形成し、本発明にかかる低抵抗チップ抵抗
器の製造が完了する。尚、上述した工程Aと工程Bと
は、工程順序を逆にして実施することもできる。
ップ抵抗器は、抵抗値範囲を20mΩ程度にまで下げる
ことができ、図6に示すようにTCRを75ppm/℃
〜100ppm/℃に抑制することができた。
2.0mm×W:1.25mmの平面サイズを有する単
体チップのものであって、公称抵抗値が25mΩ、抵抗
値許容差±1%のものを試料とした低抵抗チップ抵抗器
において、20℃を基準温度として、基準温度より40
℃高い試験温度と、基準温度より30℃低い試験温度と
で測定したときのCuめっき膜からなる第2表電極層の
膜厚及びTCRの関係を示したグラフである。
チップ抵抗器の表電極において、Ag・Pd系メタルグ
レーズ下層膜及び/又はAg系メタルグレーズ上層膜か
らなる第1表電極層と、該第1表電極層上に並設される
膜厚30μm以上のCuめっき膜からなる第2表電極層
とを採用する態様としたので、上述した第1表電極層と
第2表電極層とが相俟って、従来得られていた各種特性
を維持しつつ、低抵抗化とより良好なTCR(小さなTC
R)の確保を可能にするといった効果を奏する。
法は、低抵抗チップ抵抗器を製造する方法において、第
2表電極層を電気めっき法により形成することとし、第
2表電極層の形成に先立って、集合絶縁基板の縦横分割
溝の部分、並びに第2表電極層を形成する範囲を除く部
分を被覆するようにめっきレジストを形成する工程と、
第2表電極層の形成後に、めっきレジストを除去する工
程とを採用する態様としたので、比較的厚膜のCuめっき
膜からなる第2表電極層が集合絶縁基板の縦横分割溝上
に形成されることがなく、集合絶縁基板の分割時におけ
るバリ(欠け)の発生を極力防止することができるとい
った効果を奏する。
概略縦断面図である。
れ図である。
ある。
ある。
ある。
極層の膜厚と低抵抗チップ抵抗器のTCRの関係を示す
グラフである。
Claims (2)
- 【請求項1】 絶縁基板と、該絶縁基板上に形成される
一対の表電極と、該表電極を跨ぐように形成される抵抗
膜と、該抵抗膜を被覆する保護膜とを備えてなる低抵抗
チップ抵抗器であって、 上記表電極が、Ag・Pd系メタルグレーズ下層膜及び
/又はAg系メタルグレーズ上層膜からなる第1表電極
層と、該第1表電極層上に並設される膜厚30μm以上
のCuめっき膜からなる第2表電極層とを含むことを特
徴とする低抵抗チップ抵抗器。 - 【請求項2】 請求項1に記載の低抵抗チップ抵抗器を
製造する方法であって、 上記第2表電極層を電気めっき法により形成することと
し、 第2表電極層の形成に先立って、集合絶縁基板の縦横分
割溝の部分、並びに第2表電極層を形成する範囲を除く
部分を被覆するようにめっきレジストを形成する工程
と、 第2表電極層の形成後に、めっきレジストを除去する工
程と、を含むことを特徴とする低抵抗チップ抵抗器の製
造方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP10275158A JP3134067B2 (ja) | 1998-09-29 | 1998-09-29 | 低抵抗チップ抵抗器及びその製造方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
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JP10275158A JP3134067B2 (ja) | 1998-09-29 | 1998-09-29 | 低抵抗チップ抵抗器及びその製造方法 |
Publications (2)
Publication Number | Publication Date |
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JP2000106302A JP2000106302A (ja) | 2000-04-11 |
JP3134067B2 true JP3134067B2 (ja) | 2001-02-13 |
Family
ID=17551492
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
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JP10275158A Expired - Lifetime JP3134067B2 (ja) | 1998-09-29 | 1998-09-29 | 低抵抗チップ抵抗器及びその製造方法 |
Country Status (1)
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---|---|---|---|---|
JP3665545B2 (ja) * | 2000-08-17 | 2005-06-29 | 太陽社電気株式会社 | チップ抵抗器及びその製造方法 |
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JP4729398B2 (ja) * | 2005-12-22 | 2011-07-20 | 太陽社電気株式会社 | チップ抵抗器 |
JP5249566B2 (ja) * | 2007-11-30 | 2013-07-31 | 太陽社電気株式会社 | チップ抵抗器及びチップ抵抗器の製造方法 |
-
1998
- 1998-09-29 JP JP10275158A patent/JP3134067B2/ja not_active Expired - Lifetime
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